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DataMuseum.dkPresents historical artifacts from the history of: CP/M |
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┆06┆i↲
↲
┆a1┆┆b0┆TABLE OF CONTENTS┆05┆PAGE↲
↲
1. INTRODUCTION ............................................. 1 ↲
↲
2. GENERAL DESCRIPTION OF CPU610X ........................... 2↲
↲
3. BLOCK DIAGRAM ............................................ 3↲
↲
4. FUNCTIONAL DESCRIPTION ................................... 4↲
4.1 On board CPU ......................................... 4↲
4.1.1 80286 CPU ...................................... 4↲
4.1.2 Optional 80287 Numeric processor ............... 5↲
4.2 I/O Interface ........................................ 5↲
4.2.1 I/O adressing on board ......................... 5↲
4.2.2 Seriees interface .............................. 7↲
4.2.3 Parallel interface ............................. 8↲
4.3 Clock Generator ...................................... 11↲
4.4 Interrupt operation .................................. 11↲
4.4.1 Interrupt Source ............................... 11↲
4.4.2 Interrupt Generator ............................ 14↲
4.5 Software Reset and Power commands .................... 15↲
4.5.1 Software Reset ................................. 15↲
4.5.2 Power Down Operation ........................... 15↲
4.6 On board clock ....................................... 16↲
4.7 Memory addressing .................................... 17↲
4.7.1 On board EPROM ................................. 17↲
4.8 Bus Interface ........................................ 18↲
4.8.1 MULTIBUS ....................................... 18↲
4.8.2 iLBX bus ....................................... 19↲
4.8.3 iSBX bus ....................................... 19↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆06┆ii↲
↲
┆a1┆┆b0┆TABLE OF CONTENTS (continued)┆05┆PAGE↲
↲
5. TECHNICAL DESCRIPTION .................................... 20↲
5.1 Logic Diagrams with Signal Description ............... 20↲
5.2 PAL and PROM Descriptions ............................ 66↲
5.3 Timing Diagrams ...................................... 84↲
5.3.1 First ROM access on CPU610B .................... 85↲
5.3.2 8274 cycle on CPU610A .......................... 86↲
╞ 5.3.3 RTC cycle CPU610A .............................. 87↲
╞ 5.3.4 Multibus cycle on CPU610B to MEM691 ............ 88↲
╞ 5.3.5 iLBXbus cycle CPU610B to MEM691 ................ 89↲
5.4 Plugs ................................................ 90↲
╞ 5.4.1 P1 Multibus Connector .......................... 90↲
╞ 5.4.2 P2 extended Multibus Connector ↲
(iLBXbus connector) ............................ 91↲
╞ 5.4.3 J1 Console Interface Connector ................. 92↲
╞ 5.4.4 J2 RS422A Multidrop Interface Connector ........ 93↲
╞ 5.4.5 J3 Parallel Printer Interface Connector ........ 94↲
╞ 5.4.6 J4 LED603, BBC601 and Key Interrupt Connector .. 95↲
╞ 5.4.7 J5 iSBXbus Interface Connector ................. 96↲
5.5 Jumpers .............................................. 97↲
5.6 Environmental Specification .......................... 98↲
5.7 Physical Specifications .............................. 99↲
5.8 Power Specifications ................................. 99↲
↲
↲
┆a1┆┆b0┆APPENDIX↲
↲
A. REFERENCES ............................................... 101↲
════════════════════════════════════════════════════════════════════════
↓
┆14┆┆b3┆ ┆0b┆↲
┆a1┆┆b0┆┆b0┆┆a1┆┆b0┆┆a1┆1. INTRODUCTION.↲
↲
┆84┆This technical manual describes the CPU610X (CPU610A ↓
┆19┆┆89┆┄┄6MHz and CPU610B 8MHz).↲
┆84┆↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆2. GENERAL DESCRIPTION OF CPU610X.↲
↲
┆84┆┆84┆The CPU610X contains:↲
↲
1. INTEL's i APX 80286 Microprocessor.↲
↲
2. MULTIBUS interface.↲
↲
3. ┆84┆iLBX bus interface, the CPU610X acts as a primary ↓
┆19┆┆8c┆┄┄master.↲
↲
4. One iSBX bus without DMA channel support.↲
↲
5. Consol interface. (V24/RS232C).↲
↲
6. Multidrop interface. (RS422A).↲
↲
7. ┆84┆Parallel printer interface. (Centronics and RC750 ↓
┆19┆┆8c┆┄┄Partner compatibel).↲
↲
8. ┆84┆Interface to the light emmiting print LED603 and the ↓
┆19┆┆8c┆┄┄Battery Backup control unit BBC601.↲
↲
9. ┆84┆Up to 64K bytes (2*32K bytes) EPROM in two standard ↓
┆19┆┆8c┆┄┄JEDEC sockets. 128 bytes (256*4 bit) bipolar PROM.↲
↲
10. ┆84┆A real time clock shows the time of day, day of month ↓
┆19┆┆8c┆┄┄and the day of the year.↲
↲
11. ┆84┆As an option the CPU610X can include a numeric ↓
┆19┆┆8c┆┄┄processor 80287 from INTEL.↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆b0┆┆a1┆┆b0┆┆b0┆┆a1┆3. BLOCK DIAGRAM.↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆b0┆┆a1┆┆b0┆┆a1┆4. FUNCTIONAL DESCRIPTION.↲
↲
┆a1┆┆b0┆┆f0┆┆e1┆ ┆84┆This chapter describes the use of the elements on the ↓
┆19┆┆89┆┆81┆┄CPU board.↲
↲
↲
┆b0┆┆a1┆4.1 On board CPU.↲
↲
┆b0┆┆a1┆┆f0┆┆e1┆ ┆84┆This part describes the processors on the CPU board. The ↓
┆19┆┆89┆┆81┆┄CPU board use INTEL's 80286 as the central processor. As ↓
┆19┆┆89┆┆81┆┄an option the CPU board includes interface to the 80287 ↓
┆19┆┆89┆┆81┆┄numeric processor. (See litt 1 for further details of ↓
┆19┆┆89┆┆81┆┄the processors).↲
┆b0┆┆a1┆┆f0┆┆e1┆↲
↲
┆a1┆┆b0┆4.1.1 80286 CPU.↲
↲
┆84┆The INTEL's 80286-6 (6 MHz for CPU610A) or 80286 (8 Hz ↓
┆19┆┆89┆┄┄for CPU610B) is the central processor on the CPU board. ↓
┆19┆┆89┆┄┄The microprocessor work in to different modes:↲
↲
1. The real address mode.↲
↲
2. The protected virtual address mode. (PVAM)↲
↲
┆84┆In mode nr 1 the processor addresses up to 1 Mbytes. In ↓
┆19┆┆89┆┄┄mode nr 2 it addr┆84┆ess up 16 Mbytes.↲
↲
┆84┆The processor makes use of an on-chip memory mangement ↓
┆19┆┆89┆┄┄in the protected virtual address mode↲
↲
┆84┆The CPU board begins in the real address mode. When the ↓
┆19┆┆89┆┄┄80286 makes a word Out instrution on I/O address 00CA to ↓
┆19┆┆89┆┄┄the first parallel port, it switches to protected mode. ↓
┆19┆┆89┆┄┄Then it is impossible to switch back to real address ↓
┆19┆┆89┆┄┄mode.↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆4.1.2 Optional 80287 Numeric processor.↲
↲
┆84┆The CPU board can be expanded with a numeric processor ↓
┆19┆┆89┆┄┄INTEL's 80287 (8 MHz) or 80287-3 (5 MHz). The processor ↓
┆19┆┆89┆┄┄is used to floating point operation and other difficult ↓
┆19┆┆89┆┄┄numeric operations.↲
↲
┆84┆All interface to the numeric processor is on the CPU ↓
┆19┆┆89┆┄┄board.↲
↲
↲
┆f0┆┆a1┆┆b0┆┆a1┆┆b0┆┆a1┆4.2 I/O Interface.↲
┆b0┆┆a1┆↲
┆b0┆┆a1┆┆f0┆┆e1┆ ┆84┆The next part of chapter four describes the use of the ↓
┆19┆┆89┆┆81┆┄iAPX286 I/O address space.↲
↲
↲
┆b0┆┆a1┆4.2.1 I/O addressing on board.↲
┆b0┆┆a1┆↲
┆b0┆┆a1┆Device Data size I/O address ↲
↲
PAL012. (Interrupt out). Byte : Reset 0082↲
PAL012. (Interrupt out). Byte : Set 0086↲
TBP24S10. (Bipolar PROM). 4 bit 0086↲
RTC. (MM158167A/RTC58321) Byte/4 bit 008A↲
8259A-2 PIC. (Slave2). Byte: Status. 0094┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
8259A-2 PIC. (Slave2). Byte: MASK. 0096┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
8255A-5 PPI. (Parallel 2) Byte: Port A Out. 0098┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
8255A-5 PPI. (Parallel 2) Byte: Port B In. 009A↲
8255A-5 PPI. (Parallel 2) Byte: Port C Out. 009C┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
8255A-5 PPI. (Parallel 2) Byte: Control. 009E┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
iSBX bus. Byte/word 00A0-00BF┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
8259A-2 PIC. (Master). Byte: Status. 00C0┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
8259A-2 PIC. (Master). Byte: MASK. 00C2┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
8259A-2 PIC. (Slave1). Byte: Status. 00C4┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
8259A-2 PIC. (Slave1). Byte: MASK. 00C6┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
════════════════════════════════════════════════════════════════════════
↓
┆b0┆┆a1┆Device Data size I/O address ↲
↲
8255A-5 PPI. (Parallel 1) Byte: Port A Out. 00C8┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
8255A-5 PPI. (Parallel 1) Byte: Port B In. 00CA↲
word: WR PVAM 00CA↲
8255A-5 PPI. (Parallel 1) Byte: Port C Out. 00CC┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
8255A-5 PPI. (Parallel 1) Byte: Control. 00CE┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
8254 PIT. (Timer). Byte: Counter 0 00D0┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
8254 PIT. (Timer). Byte: Counter 1 00D2┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
8254 PIT. (Timer). Byte: Counter 2 00D4┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
8254 PIT. (Timer). Byte: Control. 00D6┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
8274 MPSC. CH A. Byte: Data. 00D8┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
8274 MPSC. CH B. Byte: Data. 00DA┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
8274 MPSC. CH A. Byte: Control. 00DC┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
8274 MPSC. CH B. Byte: Control. 00DE┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
80287 Numric Processor. Word: RD status.↲
WR Opcode. 00F8↲
80287 Numric Processor. Word: Data. 00FA┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
80287 Numric Processor. Word: Address. 00FC┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
↲
┆b0┆ -------------------------------------------------------↲
↲
Fig 4.2.1 ┆84┆I/O addresses on the CPU board.↲
↲
┆b0┆┆a1┆Target Data size I/O address ↲
↲
MULIBUS byte/word 0000-007F↲
-"- -"- 0100-FFFF↲
↲
┆b0┆ -------------------------------------------------------↲
↲
Fig 4.2.2 ┆84┆I/O addresses from i APX 80286 to the ↓
┆19┆┆93┆┄┄MULTIBUS.↲
════════════════════════════════════════════════════════════════════════
↓
┆b0┆┆a1┆Target Chip select Data size I/O address ↲
↲
iSBX bus /MCS0 byte 00A0-00AF↲
-"- /MCS1 byte 00B0-00BF↲
iSBX bus /MCS0 word 00A0-00A8↲
-"- /MCS1 word 00A0-00AF↲
↲
┆b0┆ -------------------------------------------------------↲
↲
Fig 4.2.3 ┆84┆I/O addresses from i APX 80286 to the iSBX ↓
┆19┆┆93┆┄┄bus.↲
↲
↲
┆b0┆┆a1┆4.2.2 Seriees ┆a1┆┆b0┆interface.↲
┆b0┆┆a1┆┆f0┆┆e1┆↲
┆84┆The CPU board has two seriees channels A and B. Channel A ↓
┆19┆┆89┆┄┄makes the connection to the multidrop RS422A line. ↓
┆19┆┆89┆┄┄Channel B takes care of the consol with RS232C ↓
┆19┆┆89┆┄┄interface.↲
┆84┆The INTEL's 8274 Multi-protocol Serial Controller (MPSC) ↓
┆19┆┆89┆┄┄takes care of most of the seriees communication. Two ↓
┆19┆┆89┆┄┄extra signals in channel B /DSRB (Data Set Ready) and ↓
┆19┆┆89┆┄┄/CIB (Calling Indicator) interface to the parallel port ↓
┆19┆┆89┆┄┄1.↲
↲
┆84┆The used signals in channel A are :↲
↲
┆b0┆ ┆84┆ ┆b0┆┆a1┆Signal Meaning ↲
↲
TXDA Transmitted Data↲
RXDA Received Data↲
/RTSA Request To Send↲
/CTSA Ready For Sending↲
/CDA Carrier On↲
-------------------------------↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆84┆The used signals in channal B are :↲
↲
┆b0┆ ┆84┆ ┆b0┆┆a1┆Signal Meaning ↲
↲
TXDB Transmitted Data↲
RXDB Received Data↲
/RTSB Request To Send↲
/CTSB Ready For Sending↲
/DSRB Data Set Ready↲
/CDB Carrier On↲
/CIB Calling Indicator↲
-------------------------------↲
↲
↲
┆b0┆┆a1┆4.2.3 Parallel interface.↲
↲
┆84┆There are two parallel ports on the board. The INTEL's ↓
┆19┆┆89┆┄┄parallel port 8255A-5 is used in both cases. The port A ↓
┆19┆┆89┆┄┄and C are output ports and B is an input port.↲
┆84┆The first parallel port connect a printer to the CPU ↓
┆19┆┆89┆┄┄board. The printer interface must be a RC750 ("PARTNER") ↓
┆19┆┆89┆┄┄or Centronics compatible interface.↲
↲
┆84┆The next parallel port includes the addresses to the ↓
┆19┆┆89┆┄┄Real Time Clock, the bipolar PROM and some special ↓
┆19┆┆89┆┄┄signals. (See the list below).↲
┆b0┆┆a1┆┆f0┆┆e1┆↲
Signals from parallel port nr. 1↲
↲
┆a1┆┆b0┆Pin Signal ↲
↲
PA0 DATA 0 (Printer)↲
PA1 DATA 1 (Printer)↲
PA2 DATA 2 (Printer)↲
PA3 DATA 3 (Printer)↲
PA4 DATA 4 (Printer)↲
PA5 DATA 5 (Printer)↲
PA6 DATA 6 (Printer)↲
PA7 DATA 7 (Printer)↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆Pin Signal ↲
↲
PB0 Not in use.↲
PB1 /CIB (Calling Indicator to consol)↲
PB2 /DSRB (Data Set Ready to consol)↲
PB3 BUSY (Printer)↲
PB4 /ACK (Printer)↲
PB5 /FAULT (Printer)↲
PB6 SELECTED (Printer)↲
PB7 PAPER END (Printer)↲
PC0 STROBE (Printer)↲
PC1 /SELECT (Printer)↲
PC2 /LPINIT┆84┆ (Printer)↲
PC3 /TIMEOUT INT (┆84┆Used to generate a timeout ↓
┆19┆┆a2┆┄┄interrupt).↲
PC4 /AUTOLF (Printer)↲
PC5 ┆84┆/LED2 (The light signal control a light ↓
┆19┆┆94┆┄┄emiting diode. It indicates when the CPU ↓
┆19┆┆94┆┄┄makes access to a disk).↲
PC6 ┆84┆SER LB (Used to loopback with the 8274 multi- ↓
┆19┆┆94┆┄┄protocol controller).↲
PC7 LPINT (┆84┆Used if /ACK is low to generate an ↓
┆19┆┆9b┆┄┄interrupt from the lineprinter).↲
↲
┆b0┆-------------------------------------------------------↲
↲
Signals from parallel port nr. 2↲
↲
┆a1┆┆b0┆Pin Signal ↲
↲
PA0 SLIOADR 0 (RTC and BPROM address)↲
PA1 SLIOADR 1 (RTC and BPROM address)↲
PA2 SLIOADR 2 (RTC and BPROM address)↲
PA3 SLIOADR 3 (RTC and BPROM address)↲
PA4 SLIOADR 4 (RTC and BPROM address)↲
PA5 SLIOADR 5 (RTC and BPROM address)↲
PA6 SLIOADR 6 (RTC and BPROM address)↲
PA7 SLIOADR 7 (RTC and BPROM address)↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆Pin Signal ↲
↲
PB0 ┆84┆/Testslave. (If two CPU is used, it indicates ↓
┆19┆┆94┆┄┄which is the test master). A testmaster is ↓
┆19┆┆94┆┄┄the multibus board which teststhe ↓
┆19┆┆94┆┄┄multibus.(See litt 7)).↲
PB1 If low there is only access to the Multibus.↲
PB2 Teststrap.↲
PB3 /PINTR2 unlock┆84┆ power interrupt from the batteri ↓
┆19┆┆94┆┄┄backup unit BBC601.↲
PB4 ┆84┆BBCINT a latched signal from the BBC601.↲
PB5 ┆84┆XOPT0 (An undefinite signal from the iSBX ↓
┆19┆┆94┆┄┄bus).↲
PB6 ┆84┆XOPT1 (An undefinite signal from the iSBX ↓
┆19┆┆94┆┄┄bus).↲
PB7 ┆84┆/XPST (If low an iSBX modul is on the CPU ↓
┆19┆┆94┆┄┄board).↲
PC0 ┆84┆/LED1 (The /LED1 signal control a light ↓
┆19┆┆94┆┄┄emiting diode which indicates when the CPU is ↓
┆19┆┆94┆┄┄in test mode).↲
PC1 ┆84┆PINT2EN (Enable a BBC601 interrupt from the ↓
┆19┆┆94┆┄┄BBC601).↲
PC2 ┆84┆/iLBX (When low it enables the iLBX bus; ↓
┆19┆┆94┆┄┄otherwise the CPU uses the MULTIBUS.↲
PC3 Not in use.↲
PC4 OPTO0 (An undefinite signal to the iSBX bus).↲
PC5 ┆84┆/OPT0EN (When low the it enables the signal ↓
┆19┆┆94┆┄┄OPT0 as an output signal to the iSBX bus).↲
PC6 OPTO0 (An undefinite signal to the iSBX bus).↲
PC7 ┆84┆/OPT1EN (When low the it enables the signal ↓
┆19┆┆94┆┄┄OPT1 as an output signal to the iSBX bus).↲
↲
┆b0┆-------------------------------------------------------↲
════════════════════════════════════════════════════════════════════════
↓
┆b0┆┆a1┆┆a1┆┆b0┆┆b0┆┆a1┆4.3 Clock Generator.↲
↲
┆84┆The CPU board uses an external clock generator 82284. ↓
┆19┆┆89┆┄┄(82284-6 on CPU610A and 82284-8 on CPU610B). The clock ↓
┆19┆┆89┆┄┄generator generates CPUCLK and a clock for the 8254 ↓
┆19┆┆89┆┄┄Programmable Interval Timer (PIT). ┆07┆The interval timer ↓
┆19┆┆89┆┄┄includes three programmable counters.↲
↲
┆84┆There is a 9,8405 MHz clock generator to the multibus. ↓
┆19┆┆89┆┄┄This clock is divided by two to generate a 4,9 Mhz clock ↓
┆19┆┆89┆┄┄signal. The 80287-3 numeric processor extension unit can ↓
┆19┆┆89┆┄┄run with this clock signal.↲
┆a1┆┆b0┆↲
↲
┆b0┆┆a1┆4.4 Interrupt operation.↲
↲
┆84┆The CPU610X includes three programable interrupt ↓
┆19┆┆89┆┄┄controllers (PIC's). The interrupt controllers take care ↓
┆19┆┆89┆┄┄of the interrupt input to the 80286. They are working in ↓
┆19┆┆89┆┄┄master slave relationship. The interrupt controllers ↓
┆19┆┆89┆┄┄make it possible to connect up to 22 interrupts to the ↓
┆19┆┆89┆┄┄80286. (Futher details are included in litt 6).↲
┆84┆The 80286 is able to generate up to three independent ↓
┆19┆┆89┆┄┄multibus interrupts. A PAL takes care of the interrupt ↓
┆19┆┆89┆┄┄output control.↲
↲
↲
┆a1┆┆b0┆4.4.1 Interrupt Source.↲
↲
┆84┆The priority of the input interrupts are showed in fig ↓
┆19┆┆89┆┄┄4.4.1.1. It is possible to change priority, but then the ↓
┆19┆┆89┆┄┄wiring must be modificated.↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆b0┆┆a1┆Interrupt nr. Signal Source Destination. ↲
↲
NMI PINTR1/2 Key/BBC601 CPU80286↲
0 COUNT 0 Interval timer Master PIC IR 0↲
1 MBINT 1 Multibus Master PIC IR 1↲
2 MBINT 2 Multibus Master PIC IR 2↲
3 MBINT 3 Multibus Master PIC IR 3↲
4 MBINT 4 Multibus Master PIC IR 4↲
5 MBINT 5 Multibus Master PIC IR 5↲
6 SERINT Serial I/O Master PIC IR 6↲
7 SLINT1 Slave1 PIC Master PIC IR 7↲
8 MBINT 6 Multibus Slave1 PIC IR 0↲
9 MBINT 7 Multibus Slave1 PIC IR 1↲
10 TMOUTINT Time out Slave1 PIC IR 2↲
11 XINT 0 iSBX bus Slave1 PIC IR 3↲
12 XINT 1 iSBX bus Slave1 PIC IR 4↲
13 MBINT 0 Multibus Slave1 PIC IR 5↲
14 LPINT Line printer Slave1 PIC IR 6↲
15 SLINT2 Slave2 PIC Slave1 PIC IR 7↲
16 MBINT 8 Multibus Slave2 PIC IR 0↲
17 MBINT 9 Multibus Slave2 PIC IR 1↲
18 MBINT 10 Multibus Slave2 PIC IR 2↲
19 MBINT 11 Multibus Slave2 PIC IR 3↲
20 MBINT 12 Multibus Slave2 PIC IR 4↲
21 MBINT 13 Multibus Slave2 PIC IR 5↲
22 MBINT 14 Multibus Slave2 PIC IR 6↲
23 MBINT 15 Multibus Slave2 PIC IR 7↲
↲
┆b0┆ --------------------------------------------------------↲
↲
┆84┆Fig 4.4.1.1 Standard interrupts on the board. The ↓
┆19┆┆89┆┄┄priority is from top to down. The NMI is a non mask able ↓
┆19┆┆89┆┄┄interrupt which occurs when mains is low or from the ↓
┆19┆┆89┆┄┄front key.↲
════════════════════════════════════════════════════════════════════════
↓
┆84┆It is possible to send eight extra multibus interrupts ↓
┆19┆┆89┆┄┄to the CPU from the multibus. (MBINT 8 - MBINT 15). An ↓
┆19┆┆89┆┄┄I/O write with the following format interrupts the CPU.↲
┆f0┆┆e1┆┆a1┆┆b0┆↲
┆84┆Format of an I/O write extended multibus interrupt ↓
┆19┆┆89┆┄┄instruction to the CPU :↲
↲
┆b0┆┆a1┆┆84┆┆f0┆┆e1┆ ┆b0┆┆a1┆MULTIBUS I/O address Destination. ↲
┆b0┆┆a1┆┆f0┆↲
0900 Testmaster CPU610X↲
0908 Testslave CPU610X↲
↲
┆b0┆┆b0┆-----------------------------------------↲
↲
┆b0┆┆a1┆┆84┆MULTIBUS Data field Destination. ↲
┆b0┆┆a1┆┆f0┆┆e1┆↲
00FF MBINT 8 (Reset)↲
00EF MBINT 8 (Set)↲
↲
00DF MBINT 9 (Reset)↲
00CF MBINT 9 (Set)↲
↲
00BF MBINT 10 (Reset)↲
00AF MBINT 10 (Set)↲
↲
009F MBINT 11 (Reset)↲
008F MBINT 11 (Set)↲
↲
007F MBINT 12 (Reset)↲
006F MBINT 12 (Set)↲
↲
005F MBINT 13 (Reset)↲
004F MBINT 13 (Set)↲
↲
003F MBINT 14 (Reset)↲
002F MBINT 14 (Set)↲
↲
001F MBINT 15 (Reset)↲
000F MBINT 15 (Set)↲
↲
┆b0┆┆b0┆------------------------------------------↲
════════════════════════════════════════════════════════════════════════
↓
┆b0┆┆a1┆4.4.2 Interrupt Generator.↲
↲
┆84┆The CPU is able to set up to three independt multibus ↓
┆19┆┆89┆┄┄interrupts. (Jumpers make the connection). The CPU or ↓
┆19┆┆89┆┄┄another multibus master is able to reset these ↓
┆19┆┆89┆┄┄interrupts.↲
↲
┆84┆Format of an I/O write extended multibus interrupt reset ↓
┆19┆┆89┆┄┄instruction to the CPU :↲
↲
┆b0┆┆a1┆┆84┆MULTIBUS I/O address Destination. ↲
┆b0┆┆a1┆┆f0┆↲
0900 Testmaster CPU610X↲
0908 Testslave CPU610X↲
↲
┆b0┆┆b0┆-------------------------------------------↲
↲
┆b0┆┆a1┆┆84┆MULTIBUS Data field Destination.↲
┆b0┆┆a1┆┆f0┆┆e1┆↲
0009 /MBOUT1↲
000A /MBOUT2↲
000B /MBOUT3↲
↲
┆b0┆┆b0┆-------------------------------------↲
↲
┆84┆Format of an output interrupt reset or set instruction ↓
┆19┆┆89┆┄┄from the CPU :↲
↲
┆b0┆┆a1┆┆84┆CPU I/O address Destination. ↲
┆b0┆┆a1┆┆f0┆↲
0086 Reset MBOUTX *↲
0082 Set MBOUTX↲
↲
┆b0┆┆b0┆----------------------------------------↲
↲
┆84┆* The data field selects the MBOUTX signal. (X=1,2,3).↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆b0┆┆a1┆┆84┆CPU Data field Destination. ↲
┆b0┆┆a1┆┆f0┆┆e1┆↲
0009 /MBOUT1 ↲
000A /MBOUT2↲
000B /MBOUT3↲
↲
┆b0┆┆b0┆-------------------------------------↲
↲
↲
┆b0┆┆a1┆4.5 Software Reset and Power commands.↲
↲
┆84┆This part describes the software Reset and power down ↓
┆19┆┆89┆┄┄functions.↲
↲
↲
┆b0┆┆a1┆4.5.1 Software Reset.↲
↲
┆84┆An out instruction to I/O address 0082H with data equal ↓
┆19┆┆89┆┄┄zero reset the CPU and the multibus in 5ms.↲
↲
↲
┆b0┆┆a1┆4.5.2 Power Down Operation.↲
↲
┆84┆This part desribes the power sense and power swich ↓
┆19┆┆89┆┄┄function on the CPU board.↲
↲
┆84┆The non-maskable interrupt (NMI) in 80286 is used to ↓
┆19┆┆89┆┄┄indicate power down interrupts. There is two source to ↓
┆19┆┆89┆┄┄generate a power down interrupt. One is the front panel ↓
┆19┆┆89┆┄┄key and the secound is the optionel batteri backup unit ↓
┆19┆┆89┆┄┄BBC601.↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆84┆The key at the front panel generate a NMI interrupt ↓
┆19┆┆89┆┄┄(PINT1).↲
↲
┆84┆If the RC39 includes a batteri backup unit BBC(601) (An ↓
┆19┆┆89┆┄┄option), then the NMI interrupt input is connected to ↓
┆19┆┆89┆┄┄the BBC601 and is activated under main power fail. In ↓
┆19┆┆89┆┄┄this case it is posible to distinct it from the key ↓
┆19┆┆89┆┄┄interrupt with an input instruction to PPI2 on address ↓
┆19┆┆89┆┄┄009AH. If data bit four is high then it is from BBC601 ↓
┆19┆┆89┆┄┄and the batteries is on else from the front key. If it ↓
┆19┆┆89┆┄┄is from the BBC601, then databit three indicates main ↓
┆19┆┆89┆┄┄power on or off (on when high).↲
↲
┆84┆The CPU610X power down when it make an output ↓
┆19┆┆89┆┄┄instruction to I/O address:↲
↲
009CH with data equal XXX8H↲
↲
↲
┆b0┆┆a1┆4.6 On board clock.↲
↲
┆84┆The CPU board includes a Real Time Clock (RTC) . The RTC ↓
┆19┆┆89┆┄┄IC is the MM158167 (National) (Fist source) or RTC58321 ↓
┆19┆┆89┆┄┄from Suwa Seikosha (second source). The two sources are ↓
┆19┆┆89┆┄┄not compatible. Special programming is necessary in each ↓
┆19┆┆89┆┄┄case. (See the manuals from the factory). The addresses ↓
┆19┆┆89┆┄┄to the RTC come from the second parallel port. The RTC ↓
┆19┆┆89┆┄┄is non sensitive to power fails. The CPU board gives ↓
┆19┆┆89┆┄┄battery backup for at least nine years. In a month the ↓
┆19┆┆89┆┄┄first source will differ at the most 0.2 sec and the ↓
┆19┆┆89┆┄┄second source 40 sec.↲
┆b0┆┆a1┆↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆4.7 Memory addressing.↲
┆b0┆┆a1┆↲
┆84┆The EPROMs are ┆81┆┆82┆the only onboard memories. (The bipolar ↓
┆19┆┆89┆┄┄PROM is in I/O addressing space). Fig 4.7.1-2 shows the ↓
┆19┆┆89┆┄┄total memory address map of the CPU board in real and ↓
┆19┆┆89┆┄┄protected virtual address mode. ┆b0┆┆a1┆↲
↲
┆b0┆┆a1┆Target memory size Real address space↲
↲
EPROM (UV) 64 K bytes 0F0000-0FFFFF↲
MULTIBUS 66 K bytes 0E0000-0EFFFF↲
iLBX bus 896 K bytes 000000-0DFFFF↲
┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
┆b0┆ -------------------------------------------------------↲
↲
Fig 4.7.1 ┆84┆The Memory Map of the CPU in Real Address ↓
┆19┆┆93┆┄┄Mode.↲
┆b0┆┆a1┆┆f0┆┆e1┆ ┆b0┆┆a1┆Target memory size Real address space↲
↲
EPROM (UV) 64 K bytes FF0000-FFFFFF↲
MULTIBUS 8128 K bytes 800000-FEFFFF↲
iLBX bus 8192 K bytes 000000-7FFFFF↲
┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆┆e1┆┆f0┆↲
┆b0┆ -------------------------------------------------------↲
↲
Fig 4.7.2 ┆84┆The Memory Map of the CPU in Protected Virtual ↓
┆19┆┆93┆┄┄Address Mode (PVAM).↲
↲
↲
┆b0┆┆a1┆┆81┆┆b0┆┆a1┆4.7.1 On board EPROM.↲
↲
┆84┆The CPU board contains two 28 pins JEDEC sockes to the ↓
┆19┆┆89┆┄┄EROM (UV erasable). In each socket it is possible to ↓
┆19┆┆89┆┄┄mount IC's of the types : 2732 (4k), 2764 (8k), 27128 ↓
┆19┆┆89┆┄┄(16k) and 27256 (32k). A jumper must be insert when the ↓
┆19┆┆89┆┄┄27256 is in use. (All the EPROM's must be 27XXX, ↓
════════════════════════════════════════════════════════════════════════
↓
┆19┆┆89┆┄┄27XXX-2, 27XXX-2.5 0V 27XXX-3. The EPROM's have to be ↓
┆19┆┆89┆┄┄addressed in the top of the memory adressing space. (See ↓
┆19┆┆89┆┄┄the addressing map below).↲
┆b0┆┆a1┆↲
EPROM's address map :↲
↲
┆b0┆┆a1┆Type memory size Real address space PVAM space┆b0┆┆a1┆ ↲
↲
2764 16 K bytes 0FC000-0FFFFF FFC000-FFFFFF↲
┆e1┆┆f0┆ 27128 32 K bytes 0F8000-0FFFFF FF8000-FFFFFF↲
┆b0┆┆a1┆┆f0┆┆e1┆ 27256 64 K bytes 0F0000-0FFFFF FF0000-FFFFFF↲
↲
┆b0┆ -------------------------------------------------------↲
↲
↲
┆b0┆┆a1┆┆b0┆┆a1┆4.8 Bus Interface.↲
↲
┆84┆The next part shows the uses of busses. All the busses ↓
┆19┆┆89┆┄┄are INTEL compatible. (See lit 2,3 and 4 for further ↓
┆19┆┆89┆┄┄information.).↲
↲
The CPU board use three busses:↲
↲
1. MULTIBUS.↲
↲
2. iLBX bus.↲
↲
3. iSBX bus.↲
↲
↲
┆a1┆┆b0┆4.8.1 MULTIBUS.↲
↲
┆84┆The interface to the MULTIBUS makes use of:↲
↲
1. ┆84┆One 8289 Bus Arbiter and a PAL.↲
↲
2. One bus controller 82288.↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆b0┆┆a1┆4.8.2 iLBX bus.↲
↲
┆84┆The iLBX bus is a very fast memory bus. The iLBX bus ↓
┆19┆┆89┆┄┄interfaces to the CPU board with use of standard TTL ↓
┆19┆┆89┆┄┄IC's and PAL'S. The CPU board always acts as a primary ↓
┆19┆┆89┆┄┄master on the iLBX bus. It is possible to disconnect the ↓
┆19┆┆89┆┄┄iLBX bus when the PC2 bit in the second parallel port is ↓
┆19┆┆89┆┄┄high.↲
↲
↲
┆b0┆┆a1┆┆a1┆┆b0┆4.8.3 iSBX bus.↲
↲
┆84┆There is only one iSBX bus on the CPU board. There is no ↓
┆19┆┆89┆┄┄DMA support to the iSBX bus on the board. The iSBX bus ↓
┆19┆┆89┆┄┄interfaces to the CPU board with a 8255A-5 parallel port ↓
┆19┆┆89┆┄┄and with no extra latch or trancievers.↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆5 TECHNICAL DESCRIPTION.↲
↲
┆84┆This chapter includes logic diagrams, PAL, PROM ↓
┆19┆┆89┆┄┄description and timming diagrams.↲
↲
↲
┆b0┆┆a1┆5.1 Logic Diagrams with Signal Descriptions.↲
↲
┆84┆This part includes the logic diagrams and signal ↓
┆19┆┆89┆┄┄descriptions. The notation of the signals is:↲
↲
A0, active ┆b0┆high┆f0┆ (2.4V - 5.25V)↲
/A0, active ┆b0┆low┆f0┆ (0V - 0.8V)↲
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
╱04002d4e0a0006000000000301413100000000000000000000000000000000000000000000000000050f19232d37414b555f69737d8791ff04╱
↓
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↲
A0 - A2 3,5,15 A0-A17 is a 24 bit↲
A3 - A7 3,5,15,19 address bus. Bits (0-F)↲
A8 - AA 3,5,6,15,19 are used for both memory↲
AB - AF 3,5,15,19 and I/O addressing. Bits↲
A10 - A17 5,15,19 (10-17) are the 8 most↲
significiant memory↲
address bits.↲
↲
D0 - D7 3,5,11,15 16 bit bidirectionnal↲
D8 - DF 3,5,11,15,16 data bus.↲
↲
/BHE 4,18 ┆84┆Controls byte transfer ↓
┆19┆┆a9┆┄┄on data bus lines D8-DF.↲
↲
╞ /S0 2,4,14,21 CPU status line.↲
╞ /S1 2,4,14,18,21 CPU status line.↲
M(/IO) 1,4,14,19 CPU status line.↲
COD(/INTA) 1,2 CPU status line.↲
↲
/LOCK 14 ┆84┆Used to give the CPU ↓
┆19┆┆a9┆┄┄exclusive access to the ↓
┆19┆┆a9┆┄┄Multibus and the ↓
┆19┆┆a9┆┄┄iLBXbus.↲
↲
╞ /PEACK 2 ┆84┆Use to signals the ↓
┆19┆┆a9┆┄┄processor extension when ↓
┆19┆┆a9┆┄┄the requested operand is ↓
┆19┆┆a9┆┄┄being transferred.↲
↲
╞ HLDA 2,18 ┆84┆Used to pass control of ↓
┆19┆┆a9┆┄┄the iLBXbus to a ↓
┆19┆┆a9┆┄┄secondary master board.↲
↲
╞ INTR CYC╞ 4,19╞ ┆84┆Indicates an interrupt ↓
┆19┆┆a9┆┄┄cycle.↲
↲
╞ INTA/(/C)╞ 19╞ ┆84┆A status signal from the ↓
┆19┆┆a9┆┄┄80286.↲
↲
╞ BM/(/IO)╞ 1╞ ┆84┆A status signal from the ↓
┆19┆┆a9┆┄┄80286.↲
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↲
╞ /INIT 2 ┆84┆Reset the multibus and ↓
┆19┆┆a9┆┄┄the CPU board.↲
↲
80287RESET 2 Reset the 80287.↲
↲
RESET 1,2,4,8,12,16 Reset the CPU board.↲
╞ /RESET 7,9,12,13,14↲
17,18,20,21↲
↲
╞ CPUCLK 1,2,4,12,14 ┆84┆12MHz (CPU610A) or 16MHz ↓
┆19┆┆a9┆┄┄(CPU610B) clock with 50% ↓
┆19┆┆a9┆┄┄duty cycle.↲
╞ /CPUCLK 14,20,21↲
↲
PCLK 2,4,12,14 ┆84┆6MHz (CPU610A) or 8MHz ↓
┆19┆┆a9┆┄┄(CPU610B) clock with 50% ↓
┆19┆┆a9┆┄┄duty cycle.↲
↲
╞ MCLK 2,3,4,16 ┆84┆10MHz clock with 50% ↓
┆19┆┆a9┆┄┄duty cycle.↲
╞ /MCLK 3↲
↲
/READY 1,2,4,12,14 ┆84┆It indicates when the ↓
┆19┆┆a9┆┄┄current bus cycle is to ↓
┆19┆┆a9┆┄┄be completed.↲
↲
╞ 80287CLK 2 ┆84┆A clock signal to the ↓
┆19┆┆a9┆┄┄80287.↲
↲
PEREQ 1 ┆84┆It indicates when the ↓
┆19┆┆a9┆┄┄80287 is ready to ↓
┆19┆┆a9┆┄┄transfer data.↲
↲
/BUSY 1 ┆84┆80287 is currently ↓
┆19┆┆a9┆┄┄executing a command.↲
↲
/ERROR 1 ┆84┆An unmasked error ↓
┆19┆┆a9┆┄┄condition exists in ↓
┆19┆┆a9┆┄┄80287.↲
↲
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↲
╞ PUADR0 20,21 PUADR0-PUADRF is a 16↲
╞ PUADR1 2,6,7,8,9 bit address bus to both↲
10,11,12,13, memory and I/O.↲
14,20 Combinations of PUADR0↲
╞ PUADR2 2,6,7,8,9, and /BHE indicate byte↲
10,11,12,13, or word transfer.↲
14,20↲
╞ PUADR3 11,16,20↲
PUADR4 11,20↲
PUADR5-PUADRF 11↲
↲
╞ /BCLK 3,14 ┆84┆10MHz clock signal for ↓
┆19┆┆a9┆┄┄the 8289 bus arbiter and ↓
┆19┆┆a9┆┄┄the multibus.↲
↲
╞ /CCLK╞ 3 ┆84┆10MHz clock signal. ↓
┆19┆┆a9┆┄┄/CCLK is inverse to ↓
┆19┆┆a9┆┄┄/BCLK.↲
↲
╞ /MBIOWC 7 Multibus I/O write.↲
↲
╞ /MBACK╞ 20╞ Multibus acknowledge↲
↲
IODAT0-IODAT1╞ 2,6,7,8,9,10, 16 bit bidirectional↲
11,12,13,16,17 data bus for on board↲
╞ IODAT2-IODAT3╞ 2,6,8,9,10,11, devices. (Note that↲
╞ 12,13,16,17 the iSBXbus acts as an↲
╞ IODAT4-IODAT7 2,6,8,9,10,12 onboard device).↲
╞ ╞ 13,16,17↲
╞ IODAT7-IODATF 2,16↲
↲
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↲
╞ /LMRDC╞ 11,18╞ ┆84┆Local Memory Read ↓
┆19┆┆a9┆┄┄Command.(Note that the ↓
┆19┆┆a9┆┄┄iLBXbus acts as on board ↓
┆19┆┆a9┆┄┄memory).↲
╞ /LMWTC╞ 18╞ ┆84┆Local Memory Write ↓
┆19┆┆a9┆┄┄Command.↲
╞ /LIORD 2,6,8,9,10,11, Local I/O Read.↲
╞ ╞ 12,13,16,17,18↲
╞ LIORD ╞ 17↲
╞ /LIOWR 2,6,7,8,9,10, Local I/O Write.↲
╞ ╞ 11,12,13,16,↲
╞ ╞ 17,18↲
╞ /LINTA╞ 6,13,19,20 ┆84┆Local Interrupt ↓
┆19┆┆a9┆┄┄Acknowledge.↲
╞ OBDT/R╞ 3,5,21╞ ┆84┆Controls the direction ↓
┆19┆┆a9┆┄┄the data flow. If high ↓
┆19┆┆a9┆┄┄then a write cycle is ↓
┆19┆┆a9┆┄┄performed.↲
╞ LBXDEN╞ 19╞ ┆84┆Enables the data to the ↓
┆19┆┆a9┆┄┄iLBXbus.↲
╞ LMCE╞ 6 ┆84┆Enables cascade ↓
┆19┆┆a9┆┄┄addresses from the ↓
┆19┆┆a9┆┄┄master 8259A interrupt ↓
┆19┆┆a9┆┄┄controller to the CPU ↓
┆19┆┆a9┆┄┄address bus.↲
╞ /LALE╞ 3,4,12,14,19, Controls the address↲
21 latchs.↲
╞ LALE╞ 20↲
╞ /OBDEN╞ 3╞ ┆84┆Enables the onbard data ↓
┆19┆┆a9┆┄┄transeivers.↲
╞ MBINT0-MBINT7╞ 13╞ ┆84┆Interrupts from the ↓
┆19┆┆a9┆┄┄multibus.↲
╞ 5 MHz CLK╞ 2 ┆84┆50% duty cycle clock to ↓
┆19┆┆a9┆┄┄the 80287 in 5.0 MHz ↓
┆19┆┆a9┆┄┄version.↲
╞ SERCLK╞ 9 ┆84┆Is the CPUCLK divided by ↓
┆19┆┆a9┆┄┄four to the 8274 MPSC.↲
╞ TCLK╞ 10╞ ┆84┆1.25MHz 50% duty cycle ↓
┆19┆┆a9┆┄┄clock to baud rate ↓
┆19┆┆a9┆┄┄generation.↲
╞ /LBHE╞ 18,20,21 ┆84┆It controls the data ↓
┆19┆┆a9┆┄┄flow to the multibus on ↓
┆19┆┆a9┆┄┄the data lines D8-DF.↲
╞ LINTR CYC╞ 2,4 ┆84┆It indicates the current ↓
┆19┆┆a9┆┄┄bus cycle services a ↓
┆19┆┆a9┆┄┄local interrupt.↲
╞ /LBUS EN╞ 4╞ ┆84┆The current bus cycle is ↓
┆19┆┆a9┆┄┄a local I/O cycle↲
╞ MBREQ╞ 14,20 ┆84┆The current bus cycle is ↓
┆19┆┆a9┆┄┄a multibus cycle.↲
╞ SLCS╞ 20 ┆84┆Chip select signal to ↓
┆19┆┆a9┆┄┄the interrupt ↓
┆19┆┆a9┆┄┄controllers, the ↓
┆19┆┆a9┆┄┄interrupt outputs, the ↓
┆19┆┆a9┆┄┄RTC and the bipolar ↓
┆19┆┆a9┆┄┄PROM's.↲
════════════════════════════════════════════════════════════════════════
↓
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
↓
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↲
╞ AB0-AB23╞ 5╞ ┆84┆iLBXbus address ↓
┆19┆┆a9┆┄┄transeivers.↲
↲
╞ DB0-DB15 ╞ 5 ┆84┆iLBXbus data ↓
┆19┆┆a9┆┄┄transeivers.↲
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↲
╞ INTR╞ 1╞ ┆84┆Interrupt to 80286.↲
↲
╞ /MEN╞ 14 ┆84┆Master enables signal to ↓
┆19┆┆a9┆┄┄the data latch.↲
↲
╞ CAS 0-CAS 2 6,13,20 ┆84┆Used in the second ↓
┆19┆┆a9┆┄┄interrupt acknowledge ↓
┆19┆┆a9┆┄┄cycle to select a slave ↓
┆19┆┆a9┆┄┄interrrupt controller or ↓
┆19┆┆a9┆┄┄the 8274 MPSC.↲
↲
╞ A8,A9,AA╞ 1,3,15,19 ┆84┆Addresses on the local ↓
┆19┆┆a9┆┄┄address bus used to the ↓
┆19┆┆a9┆┄┄cascaded address.↲
↲
╞ SLINT1╞ 6╞ ┆84┆Interrupts to the master ↓
┆19┆┆a9┆┄┄interrupt controller.↲
↲
╞ /SLEN 1╞ 14╞ ┆84┆Used to enable the data ↓
┆19┆┆a9┆┄┄transeivers.↲
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↲
╞ /MBINTCS╞ 7 ┆84┆Opens the multibus ↓
┆19┆┆a9┆┄┄interrupt logic.↲
↲
╞ /SWRESET╞ 2╞ ┆84┆Resets the multibus and ↓
┆19┆┆a9┆┄┄the CPU board.↲
↲
╞ /MBOUT1-╞ 7╞ ┆84┆Generates a interrupt to↲
/MBOUT3 the multibus.↲
↲
╞ /PWDEN╞ 12╞ ┆84┆Enables the power down ↓
┆19┆┆a9┆┄┄signal from the PPI2↲
↲
╞ /XACK╞ 3,7 ╞ ┆84┆Acknowledges from a ↓
┆19┆┆a9┆┄┄device on the multibus.↲
↲
╞ MBINT8-MBINT15╞ 13 ┆84┆Extended multibus ↓
┆19┆┆a9┆┄┄interrupts. It is set or ↓
┆19┆┆a9┆┄┄reset from another ↓
┆19┆┆a9┆┄┄multibus master.↲
↲
╞ /INT0-/INT7╞ 4,7╞ ┆84┆Multibus interrupt lines↲
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↲
╞ DATA0-DATA7╞ 8╞ ┆84┆Data lines to the ↓
┆19┆┆a9┆┄┄centronics parallel ↓
┆19┆┆a9┆┄┄printer.↲
↲
╞ /STROBE╞ 8╞ Data strobe signal.↲
↲
╞ /LPINIT╞ 8╞ Lineprinter reset.↲
↲
╞ /AUTOLF╞ 8╞ Auto line feed.↲
↲
╞ /LED2╞ 8╞ ┆84┆Signal to the disk ↓
┆19┆┆a9┆┄┄access indication led.↲
↲
╞ SERLB╞ 11╞ ┆84┆Used in test mode to ↓
┆19┆┆a9┆┄┄loopback in the RS422A ↓
┆19┆┆a9┆┄┄interface.↲
↲
╞ LPINT╞ 13╞ ┆84┆Lineprinter interrupt.↲
↲
╞ KEYINT╞ 8╞ ┆84┆Interrupt from the front ↓
┆19┆┆a9┆┄┄key.↲
↲
╞ TIME OUT INT╞ 13╞ ┆84┆Timeout interrupt.↲
↲
╞ NMI╞ 1╞ Non Maskable Interrupt.↲
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↲
╞ SERINT╞ 13╞ ┆84┆Interrupts from the 8274 ↓
┆19┆┆a9┆┄┄MPSC.↲
↲
╞ TxDALOOP╞ 11╞ ┆84┆Transmits data. (Channel ↓
┆19┆┆a9┆┄┄A).↲
↲
╞ /RTSA╞ 10╞ ┆84┆Request To Send (Channel ↓
┆19┆┆a9┆┄┄A).↲
↲
╞ /DTRA╞ 10╞ ┆84┆Data Terminal Ready ↓
┆19┆┆a9┆┄┄(Channel a).↲
↲
╞ TxDB╞ 9╞ ┆84┆Transmit Data (Channel ↓
┆19┆┆a9┆┄┄B).↲
↲
╞ /RTSB╞ 9╞ ┆84┆Requests To Send ↓
┆19┆┆a9┆┄┄(Channel B).↲
↲
╞ /DTRB╞ 9╞ ┆84┆Data Terminal Ready ↓
┆19┆┆a9┆┄┄(Channel B).↲
↲
╞ RxDB╞ 9╞ ┆84┆Received Data ↓
┆19┆┆a9┆┄┄(ChannelB).↲
↲
╞ /CTSB╞ 9╞ ┆84┆Clear To Send ↓
┆19┆┆a9┆┄┄(ChannelB).↲
↲
╞ /DSRB╞ 8╞ ┆84┆Data Set Ready ↓
┆19┆┆a9┆┄┄(ChannelB).↲
↲
╞ /CDB╞ 9╞ ┆84┆Carrier Detect ↓
┆19┆┆a9┆┄┄(ChannelB).↲
↲
╞ /CIB╞ 8╞ ┆84┆Calling Indicator ↓
┆19┆┆a9┆┄┄(Channel B).↲
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↲
╞ COUNT0╞ 13╞ ┆84┆Interrupt from timer.↲
↲
╞ BAUDA,BAUDB╞ 9╞ ┆84┆Baud rate clock signals ↓
┆19┆┆a9┆┄┄to channel A and B in ↓
┆19┆┆a9┆┄┄8274 MPSC.↲
↲
╞ RxDALOOP╞ 11╞ ┆84┆Receives data. (Channel ↓
┆19┆┆a9┆┄┄A).↲
↲
╞ TT╞ 11╞ Terminal Timing.↲
↲
╞ /CTSALOOP╞ 11╞ ┆84┆Clear To Send. (Channel ↓
┆19┆┆a9┆┄┄A).↲
↲
╞ /CDA╞ 9╞ ┆84┆Carrier Detect. (Channel ↓
┆19┆┆a9┆┄┄A).↲
↲
╞ /RTSALOOP╞ 10,11╞ ┆84┆Ready To Send. (Channel ↓
┆19┆┆a9┆┄┄A).↲
↲
╞ RD(A)╞ 10╞ ┆84┆Transmit data. (Channel ↓
┆19┆┆a9┆┄┄A).↲
╞ RD(B)╞ 10╞ Inverted signal.↲
↲
╞ RT(A)╞ 10╞ ┆84┆Transmit Timing. ↓
┆19┆┆a9┆┄┄(Channel A).↲
╞ RT(B)╞ 10╞ Inverted signal.↲
↲
╞ CS(A)╞ 10╞ ┆84┆Ready To Send. (Channel ↓
┆19┆┆a9┆┄┄A).↲
╞ CS(B)╞ 10╞ Inverted signal.↲
↲
╞ DM(A)╞ 10╞ ┆84┆Data Mode. (Channel A).↲
╞ DM(B)╞ 10 ╞ Inverted signal.↲
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↲
D0 - D7 3,5,11,15 16 bit bidirectionnal↲
D8 - DF 3,5,11,15,16 data bus.↲
↲
IODAT0-IODAT1╞ 2,6,7,8,9,10, 16 bit bidirectional↲
11,12,13,16,17 data bus for on board↲
╞ IODAT2-IODAT3╞ 2,6,8,9,10,11, devices.↲
╞ 12,13,16,17↲
↲
╞ TxDA╞ 10╞ ┆84┆Transmits Data. (Channel ↓
┆19┆┆a9┆┄┄A).↲
↲
╞ RxDA╞ 9╞ ┆84┆Receives Data. (Channel ↓
┆19┆┆a9┆┄┄A).↲
↲
╞ /RxCA╞ 9╞ ┆84┆Receiver Clock. (Channel ↓
┆19┆┆a9┆┄┄A).↲
↲
╞ /CTSA╞ 9╞ ┆84┆Clear To Send. (Channel ↓
┆19┆┆a9┆┄┄A).↲
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆Description↲
↲
╞ SLIOADR0-╞ 11,17╞ Address bus↲
SLIOADR4 to address infreqently↲
used onboard components.↲
╞ SLIOADR5-╞ 11↲
╞ SLIOADR8↲
↲
╞ /LED1╞ 12╞ Signal to the test led.↲
↲
╞ PINT2EN╞ 8╞ ┆84┆Enables the key ↓
┆19┆┆a9┆┄┄interrupt.↲
↲
╞ /iLBX╞ 18,19╞ ┆84┆If low the iLBXbus is ↓
┆19┆┆a9┆┄┄selected to memory ↓
┆19┆┆a9┆┄┄transfers.↲
↲
╞ OPTO0╞ 16╞ ┆84┆Optional signal zero to ↓
┆19┆┆a9┆┄┄the iSBXbus.↲
↲
╞ /OPT0EN╞ 16╞ ┆84┆Enables signal OPT00 to ↓
┆19┆┆a9┆┄┄the iSBXbus.↲
↲
╞ OPT10╞ 16╞ ┆84┆Optional signal one to ↓
┆19┆┆a9┆┄┄the iSBXbus.↲
↲
╞ /OPT1EN╞ 16╞ ┆84┆Enables signal OPT10 to ↓
┆19┆┆a9┆┄┄the iSBXbus.↲
↲
╞ PDMD╞ 12╞ Power Down Demand.↲
↲
╞ TESTSLAVE╞ 3╞ ┆84┆If low the CPU board is ↓
┆19┆┆a9┆┄┄testslave.↲
↲
╞ /TESTSLAVE╞ 7↲
↲
╞ /PINTR2╞ 8╞ ┆84┆Un latched key ↓
┆19┆┆a9┆┄┄interrupt.↲
↲
╞ /CLTMOUT╞ 12╞ ┆84┆Clears the timeout ↓
┆19┆┆a9┆┄┄circuit.↲
↲
╞ /TMOUT╞ 8,20╞ Timeout signal.↲
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
↓
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↲
╞ IRM0-IRM6╞ 6╞ ┆84┆Interrupts to the master ↓
┆19┆┆a9┆┄┄interrupt controller.↲
↲
╞ IRSL1 0-IRSL1 7╞ 6╞ ┆84┆Interrupts to the slave ↓
┆19┆┆a9┆┄┄one interrupt ↓
┆19┆┆a9┆┄┄controller.↲
↲
╞ IRSL2 0-IRSL2 7╞ 6╞ ┆84┆Interrupts to the slave ↓
┆19┆┆a9┆┄┄two interrupt ↓
┆19┆┆a9┆┄┄controller.↲
↲
╞ SLINT2╞ 6╞ ┆84┆Interrupt to the master ↓
┆19┆┆a9┆┄┄interrupt controller.↲
↲
╞ /SLEN2╞ 14╞ ┆84┆Enables the data ↓
┆19┆┆a9┆┄┄transeivers.↲
↲
╞ 2NDINTRCYC╞ 20╞ Indicates the second↲
/2NDINTRCYC 13 interrupt acknowledge↲
cycle.↲
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↲
╞ /DELBUSAEN╞ 20╞ ┆84┆Used to delay the BUSAEN ↓
┆19┆┆a9┆┄┄signal.↲
↲
╞ BUSAEN╞ 14╞ Multibus address enable↲
/BUSAEN 14,15,20 signal.↲
↲
╞ /LOCK╞ 14╞ ┆84┆Is used to extend mutual ↓
┆19┆┆a9┆┄┄exclusion to dualport ↓
┆19┆┆a9┆┄┄RAM's on the multibus.↲
↲
╞ OBLOCK╞ 18╞ It indicates that the↲
/OBLOCK╞ 14 CPU lock dualport RAM's↲
on the iLBXbus↲
↲
╞ AEN╞ 14╞ ┆84┆Enables the addrress ↓
┆19┆┆a9┆┄┄lines on the multibus.↲
↲
╞ /BPRO╞ 14╞ ┆84┆Used in applications ↓
┆19┆┆a9┆┄┄with seriel priority in ↓
┆19┆┆a9┆┄┄the arbitration phase on ↓
┆19┆┆a9┆┄┄the multibus.↲
↲
╞ /BREQ╞ 14 ╞ Multibus request.↲
↲
╞ /BUSY╞ 14╞ ┆84┆Used when a master use ↓
┆19┆┆a9┆┄┄the multibus to a data ↓
┆19┆┆a9┆┄┄transfer.↲
↲
╞ /CBRQ╞ 14╞ ┆84┆It instructs the arbiter ↓
┆19┆┆a9┆┄┄if there are any other ↓
┆19┆┆a9┆┄┄arbiters of lower ↓
┆19┆┆a9┆┄┄prority requesting the ↓
┆19┆┆a9┆┄┄use of the multibus.↲
↲
╞ /MBRDC╞ 14╞ ┆84┆Multibus memory reads ↓
┆19┆┆a9┆┄┄signal.↲
════════════════════════════════════════════════════════════════════════
↓
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
↓
↲
┆8c┆┄┆88┆↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↲
╞ /MBWTC╞ 14╞ ┆84┆Multibus memory writes ↓
┆19┆┆a9┆┄┄signal.↲
↲
╞ /MBIORC╞ 14╞ ┆84┆Multibus I/O reads ↓
┆19┆┆a9┆┄┄signal.↲
↲
╞ /MBIOWC╞ 14╞ ┆84┆Multibus I/O writes ↓
┆19┆┆a9┆┄┄signal.↲
↲
╞ /MBINTA╞ 14╞ ┆84┆Multibus Interrupt ↓
┆19┆┆a9┆┄┄Acknowledge.↲
↲
╞ MBDT(/R)╞ 15,16╞ ┆84┆┆84┆Indicates the direction ↓
┆19┆┆a9┆┄┄of the data flow on the ↓
┆19┆┆a9┆┄┄multibus.↲
↲
╞ MBALE╞ 15╞ ┆84┆Latch the addresses to ↓
┆19┆┆a9┆┄┄the multibus.↲
↲
╞ /INTEN╞ 4,20╞ ┆84┆Enables the interrupt ↓
┆19┆┆a9┆┄┄vetors to the I/O data ↓
┆19┆┆a9┆┄┄bus.↲
↲
╞ MBDEN╞ 21╞ ┆84┆Enables the data ↓
┆19┆┆a9┆┄┄transeivers to the ↓
┆19┆┆a9┆┄┄multibus.↲
↲
╞ /DAT0-/DAT1╞ 7,15,16╞ Data signals on the↲
/DAT2-/DAT3 15,16 multibus.↲
╞ /DAT4-/DAT7 7,15,16↲
╞ /DAT8-/DATF╞ 15↲
↲
╞ /ADR0-/ADR2╞ 15╞ Address signals on the↲
╞ /ADR3╞ 7,15 multibus.↲
╞ /ADR4-/ADR5╞ 15↲
╞ /ADR6-/ADRF╞ 7,15↲
╞ /ADR10-ADR23╞ 15↲
════════════════════════════════════════════════════════════════════════
↓
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
↓
↲
════════════════════════════════════════════════════════════════════════
↓
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↓
↲
╞ MD0-MDF╞ 16╞ ┆84┆iSBXbus bidirectional ↓
┆19┆┆a9┆┄┄data lines.↲
↲
╞ MA0-MA2╞ 16╞ ┆84┆iSBXbus address lines.↲
↲
╞ RESET╞ 16╞ Reset to the iSBXbus.↲
↲
╞ MCLK╞ 16╞ ┆84┆10 MHz 50% duty cycle ↓
┆19┆┆a9┆┄┄clock to the iSBXbus.↲
↲
╞ /IORD╞ 16╞ ┆84┆I/O read to the iSBXbus.↲
↲
╞ /IOWRT╞ 16╞ ┆84┆I/O write to the ↓
┆19┆┆a9┆┄┄iSBXbus.↲
↲
╞ /MCS0-/MCS1 16╞ ┆84┆Chip select lines to the ↓
┆19┆┆a9┆┄┄iSBXbus.↲
↲
╞ OPT0-OPT1╞ 12╞ ┆84┆Optional lines to or ↓
┆19┆┆a9┆┄┄from the iSBXbus.↲
↲
╞ /XPST╞ 12,19╞ ┆84┆Indicates that an iSBX ↓
┆19┆┆a9┆┄┄board is present.↲
↲
╞ XINT0-XINT1╞ 13╞ ┆84┆Interrupts from the iSBX ↓
┆19┆┆a9┆┄┄board.↲
↲
╞ /XWAIT╞ 20╞ ┆84┆Used to indicates that ↓
┆19┆┆a9┆┄┄the iSBX board is busy.↲
↲
╞ /DAT0-/DAT1╞ 7,15,16╞ Data signals on the↲
/DAT2-/DAT3 15,16 multibus.↲
╞ /DAT4-/DAT7 7,15,16↲
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↲
IODAT0-IODAT1╞ 2,6,7,8,9,10, 16 bit bidirectional↲
11,12,13,16,17 data bus for on board↲
╞ IODAT2-IODAT3╞ 2,6,8,9,10,11, devices.↲
╞ 12,13,16,17↲
╞ IODAT4-IODAT7 2,6,8,9,10,12↲
╞ ╞ 13,16,17↲
↲
╞ /RTCBUSY1╞ 20╞ Used when the RTC is↲
/RTCBUSY2 20 busy.↲
↲
╞ VBBU╞ 17╞ ┆84┆Power to the RTCs from ↓
┆19┆┆a9┆┄┄the battery.↲
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↲
╞ RTCAWR╞ 17,18╞ ┆84┆This signal is used to ↓
┆19┆┆a9┆┄┄transfer an address to ↓
┆19┆┆a9┆┄┄the secound source RTC.↲
↲
╞ RTCDWR╞ 17 ╞ ┆84┆This signal is used to ↓
┆19┆┆a9┆┄┄transfer data to the ↓
┆19┆┆a9┆┄┄secound source RTC.↲
↲
╞ UAEN╞ 19╞ ┆84┆This bit is set when the ↓
┆19┆┆a9┆┄┄80286 switch to ↓
┆19┆┆a9┆┄┄protected virtual ↓
┆19┆┆a9┆┄┄address mode.↲
↲
╞ /ASTB╞ 19╞ iLBXbus address strobe.↲
↲
╞ BHEN╞ 19╞ ┆84┆This signal together ↓
┆19┆┆a9┆┄┄with address line AB0 ↓
┆19┆┆a9┆┄┄indicates when the data ↓
┆19┆┆a9┆┄┄transport on the iLBXbus ↓
┆19┆┆a9┆┄┄is a byte transfer (Low ↓
┆19┆┆a9┆┄┄byte or high byte) or a ↓
┆19┆┆a9┆┄┄word transfer.↲
↲
╞ R(/W)╞ 18╞ ┆84┆If high the CPU board ↓
┆19┆┆a9┆┄┄read from the iLBXbus ↓
┆19┆┆a9┆┄┄otherwise it write from ↓
┆19┆┆a9┆┄┄the bus.↲
↲
╞ /LOCK╞ 18╞ ┆84┆Is used to extend mutual ↓
┆19┆┆a9┆┄┄exclusion to dualport ↓
┆19┆┆a9┆┄┄RAM's on the iLBXbus.↲
↲
╞ /DSTB╞ 18 ╞ ┆84┆Data strobe to the ↓
┆19┆┆a9┆┄┄iLBXbus.↲
↲
╞ SMACK╞ 5╞ ┆84┆Secondary Master ↓
┆19┆┆a9┆┄┄Acknowledge. It gives a ↓
┆19┆┆a9┆┄┄secondary master on the ↓
┆19┆┆a9┆┄┄iLBXbus the control of ↓
┆19┆┆a9┆┄┄the iLBXbus.↲
════════════════════════════════════════════════════════════════════════
↓
↲
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
↓
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆Description↲
↲
╞ /EPROMCS╞ 11,20╞ ┆84┆Chip select to the ↓
┆19┆┆a9┆┄┄EPROM's.↲
↲
╞ /BVI╞ 19,20╞ ┆84┆Bus vector interrupt.↲
↲
╞ /EPCS╞ 19╞ ┆84┆Un latch chip select to ↓
┆19┆┆a9┆┄┄the EPROM's.↲
↲
╞ /iLBXCS╞ 19╞ ┆84┆Chip select to the ↓
┆19┆┆a9┆┄┄iLBXbus.↲
↲
╞ iLBXBUSEN╞ 20╞ Enable the iLBXbus.↲
↲
╞ /iLBXDEN╞ 5╞ ┆84┆iLBX data enable signal.↲
↲
╞ /IOACCESS╞ 4,19,20╞ ┆84┆The current cycle is an ↓
┆19┆┆a9┆┄┄I/O cycle.↲
↲
╞ SLREQ╞ 4 ┆84┆An unlatch chip select ↓
┆19┆┆a9┆┄┄signal to the↓
┆19┆┆a9┆┄┄interrupt outputs, the ↓
┆19┆┆a9┆┄┄RTC and the bipolar ↓
┆19┆┆a9┆┄┄PROM's.↲
↲
╞ /PICCS╞ 20╞ ┆84┆Chip select to the ↓
┆19┆┆a9┆┄┄interrupt controllers.↲
↲
╞ /PPICS╞ 20,21╞ ┆84┆Chip select to the ↓
┆19┆┆a9┆┄┄parallel ports.↲
↲
╞ /PITCS╞ 10╞ Timer chip select.↲
↲
╞ /SERCS╞ 9,21╞ ┆84┆8274 MPSC chip select.↲
↲
╞ /PECS╞ 2╞ 80287 chip select.↲
↲
╞ /SBXCS╞ 20╞ iSBX chip select.↲
↲
╞ /OBACCESS ╞ 4,14╞ ┆84┆Onboard access. (Note ↓
┆19┆┆a9┆┄┄that iLBX cycles is ↓
┆19┆┆a9┆┄┄onbord accesses).↲
↲
╞ ASTB╞ 18╞ ┆84┆Address strobe to the ↓
┆19┆┆a9┆┄┄iLBXbus.↲
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↲
╞ /PICS1-/PICS2╞ 6╞ ┆84┆Chip select to the ↓
┆19┆┆a9┆┄┄master and slave number ↓
┆19┆┆a9┆┄┄one interrupt ↓
┆19┆┆a9┆┄┄controllers.↲
↲
╞ /PICS3╞ 1╞ ┆84┆Chip select to slave ↓
┆19┆┆a9┆┄┄interrupt controller ↓
┆19┆┆a9┆┄┄number two.↲
↲
╞ /PPICS1╞ 8,18╞ ┆84┆Chip select to parallel ↓
┆19┆┆a9┆┄┄port one.↲
↲
╞ /PPICS2╞ 12 ╞ ┆84┆Chip select to parallel ↓
┆19┆┆a9┆┄┄port two.↲
↲
╞ /MCS0-/MCS1╞ 16╞ ┆84┆Chip selects to the ↓
┆19┆┆a9┆┄┄iSBXbus.↲
↲
╞ /INTOUTCS╞ 7╞ ┆84┆Chip select to multibus ↓
┆19┆┆a9┆┄┄interrupt generation.↲
↲
╞ RTCS╞ 17,18,20╞ Chip select to the↲
/RTCS 17 Real Time Clock.↲
↲
╞ /BPROMCS╞ 11╞ ┆84┆Bipolar PROM chip ↓
┆19┆┆a9┆┄┄select.↲
↲
╞ /SRDY╞ 2╞ Syncron Ready.↲
↲
╞ /DLYINTA╞ 9,20╞ ┆84┆Delays the interrupt ↓
┆19┆┆a9┆┄┄acknowledge to the 8274 ↓
┆19┆┆a9┆┄┄MPSC.↲
↲
╞ /IOWAIT╞ 20╞ ┆84┆Generates longer onboard ↓
┆19┆┆a9┆┄┄I/O cycles.↲
↲
╞ SEREN╞ 14,20╞ ┆84┆Enables the interrupt ↓
┆19┆┆a9┆┄┄vectors from the 8274 ↓
┆19┆┆a9┆┄┄MPSC to the local data ↓
┆19┆┆a9┆┄┄bus.↲
↲
╞ /TIMEOUT TRIG╞ 12╞ ┆84┆Initiates the timeout ↓
┆19┆┆a9┆┄┄logic.↲
↲
╞ /ASYNC RDY╞ 2╞ Asyncron Ready.↲
════════════════════════════════════════════════════════════════════════
↓
↲
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
↓
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆ Signal┆e1┆┆a1┆ ┆e1┆ ┆a1┆Destination┆e1┆ ┆a1┆┆e1┆ ┆a1┆Description↲
↲
╞ /MBSWAP╞ 16╞ ┆84┆Exchange data bytes ↓
┆19┆┆a9┆┄┄between the high and low ↓
┆19┆┆a9┆┄┄end of the data lines.↲
↲
╞ /BHEN╞ 21╞ ┆84┆This signal together ↓
┆19┆┆a9┆┄┄with address line /ADR0 ↓
┆19┆┆a9┆┄┄indicates when the data ↓
┆19┆┆a9┆┄┄transport on the ↓
┆19┆┆a9┆┄┄multibus is a byte ↓
┆19┆┆a9┆┄┄transfer (Low byte or ↓
┆19┆┆a9┆┄┄high byte) or a word ↓
┆19┆┆a9┆┄┄transfer.↲
↲
╞ /MBHEN╞ 15╞ ┆84┆Enables the high bytes ↓
┆19┆┆a9┆┄┄to the multibus.↲
↲
╞ /MBLEN╞ 15╞ ┆84┆Enables the low bytes to ↓
┆19┆┆a9┆┄┄the multibus.↲
↲
╞ /DLYCMD╞ 4,20╞ ┆84┆Delays the commands from ↓
┆19┆┆a9┆┄┄the local bus ↓
┆19┆┆a9┆┄┄controller.↲
↲
╞ /ARDYEN╞ 2╞ ┆84┆Enables the asyncron ↓
┆19┆┆a9┆┄┄ready.↲
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
↓
┆b0┆┆a1┆5.2 PAL and PROM Descriptions.↲
↲
PAL16L8 PAL DESIGN SPECIFICATIONS↲
PAT012 821228 AAJ↲
3-BIT ADFDRESSABLE LATCH↲
↲
/INIT /WRT /CS A6 A1 IODO IOD1 /CLR /MBDO GND↲
/MBD1 NC Q3 IQ3 Q2 IQ2 Q1 IQ1 /FO VCC↲
↲
IF(VCC) FO= WRT*CS*A6*/A1*/IOD1*/IODO↲
↲
IF(VCC) /Q1= INIT↲
+WRT*CS*A6*A1*/IOD1*IODO↲
+CLR*/MBD1*MBDO↲
+IQ1↲
↲
IF(VCC) /IQ1= WRT*CS*A6*/A1*/IOD1*IODO↲
+Q1↲
↲
IF(VCC) /Q2= INIT↲
+WRT*CS*A6*A1*IOD1*/IODO↲
+CLR*MBD1*/MBDO↲
+IQ2↲
↲
IF(VCC) /IQ2= WRT*CS*A6*/A1*IOD1*/IODO↲
+Q2↲
↲
IF(VCC) /Q3= INIT↲
+WRT*CS*A6*A1*IOD1*IODO↲
+CLR*MBD1*MBDO↲
+IQ3↲
↲
IF(VCC) /IQ3= WRT*CS*A6*/A1*IOD1*IODO↲
+Q3↲
↲
DESCRIPTION:↲
↲
THE CIRCUIT CONTAINS THREE SET-RESET LATCHES (Q1,Q2,Q3) AND↲
NON LATCHED OUTPUT (FO).↲
WRT*CS*A6*/A1 SETS THE LATCH (Q=1,IQ=0) SELECTED BY IOD1,IODO,↲
OR PULSES THE OUTPUT FO IF IODA1=IODO=0.↲
WRT*CS*A6*A1 RESETS THE LATCH (Q=0,IQ=1) SELECTED BY IOD1,IODO↲
CLR RESETS THE LATCH SELECTED BY MBD1,MBDO.↲
INIT RESETS ALL LATCHES.↲
↲
════════════════════════════════════════════════════════════════════════
↓
************** **************↲
* * * *↲
**** ****↲
/INIT * 1* *20* VCC↲
**** ****↲
* *↲
**** ****↲
/WRT * 2* *19* /FO↲
**** ****↲
* *↲
**** ****↲
/CS * 3* *18* IQ1↲
**** ****↲
* *↲
**** ****↲
A6 * 4* *17* Q1↲
**** ****↲
* *↲
**** ****↲
A1 * 5* *16* IQ2↲
**** ****↲
* *↲
**** ****↲
IODO * 6* *15* Q2↲
**** ****↲
* *↲
**** ****↲
IOD1 * 7* *14* IQ3↲
**** ****↲
* *↲
**** ****↲
/CLR * 8* *13* Q3↲
**** ****↲
* *↲
**** ****↲
/MBDO * 9* *12* NC↲
**** ****↲
* *↲
**** ****↲
GND *10* *11* /MBD1↲
**** ****↲
* *↲
*******************************↲
↲
════════════════════════════════════════════════════════════════════════
↓
PAL16R6A PAL DESIGN SPECIFICATIONS↲
PAT069 841022 HEP↲
CPU610 82289 EMULATOR.↲
↲
/CPUCLK LALE /READY /RESET MBREQ /BLOCK NC VCC VCC GND↲
GND NC /Q0 /Q1 AENOUT NC /S0S1S2 CCLK /DLOCK VCC↲
↲
Q0:=READY*/RESET↲
↲
Q1:=Q0*/RESET↲
↲
S0S1S2:= /Q0*MBREQ*/RESET↲
↲
/AENOUT:= /S0S1S2*/MBREQ↲
+Q0↲
↲
/CCLK:=Q1*/RESET↲
↲
IF (VCC) DLOCK= BLOCK↲
↲
DESCRIPTION:↲
↲
PAT069 AND 8289 EMULATES AN 82289 BUS ARBITER. (CHECKSUM= 01E0).↲
════════════════════════════════════════════════════════════════════════
↓
↲
************** **************↲
* * * *↲
**** ****↲
/CPUCLK * 1* *20* VCC↲
**** ****↲
* *↲
**** ****↲
LALE * 2* *19* /DLOCK↲
**** ****↲
* *↲
**** ****↲
/READY * 3* *18* CCLK↲
**** ****↲
* *↲
**** ****↲
/RESET * 4* *17* /S0S1S2↲
**** ****↲
* *↲
**** ****↲
MBREQ * 5* *16* NC↲
**** ****↲
* *↲
**** ****↲
/BLOCK * 6* *15* AENOUT↲
**** ****↲
* *↲
**** ****↲
NC * 7* *14* /Q1↲
**** ****↲
* *↲
**** ****↲
VCC * 8* *13* /Q0↲
**** ****↲
* *↲
**** ****↲
VCC * 9* *12* NC↲
**** ****↲
* *↲
**** ****↲
GND *10* *11* GND↲
**** ****↲
* *↲
*******************************↲
════════════════════════════════════════════════════════════════════════
↓
PAT070 841023 HEP↲
CPU610 MEMORY ADDRESS DECODER.↲
↲
A10 A11 A12 A13 A14 A15 A16 A17 MIO GND↲
UAEN /EPCS /ILBX INTCY INTAC NC /BVI NC /ILBXCS VCC↲
↲
IF(VCC) ILBXCS= ILBX*MIO*/UAEN*/A13 ; REAL ADDRESS MODE.↲
+ILBX*MIO*/UAEN*/A12 ; REAL ADDRESS MODE.↲
+ILBX*MIO*/UAEN*/A11 ; REAL ADDRESS MODE.↲
+ILBX*MIO*UAEN*/A17 ; PVAM.↲
↲
IF(VCC) EPCS= MIO*/UAEN*A10*A11*A12*A13 ; REAL ADDRESS MODE.↲
+MIO*UAEN*A10*A11*A12*A13*A14*A15*A16*A17 ; PVAM.↲
↲
IF(VCC) BVI= INTCY ; BUS VECTOR INTERRUPT↲
↲
DESCRIPTION:↲
↲
PAT070 IS DECODES THE MEMORY ADDRESSES TO THE ILBX BUS AND THE↲
EPROM'S. FURTHER IT DECODES BUS VECTOR INTERRUPTS.↲
(CHECKSUM = 040C)↲
════════════════════════════════════════════════════════════════════════
↓
↲
************** **************↲
* * * *↲
**** ****↲
A10 * 1* *20* VCC↲
**** ****↲
* *↲
**** ****↲
A11 * 2* *19* /ILBXCS↲
**** ****↲
* *↲
**** ****↲
A12 * 3* *18* NC↲
**** ****↲
* *↲
**** ****↲
A13 * 4* *17* /BVI↲
**** ****↲
* *↲
**** ****↲
A14 * 5* *16* NC↲
**** ****↲
* *↲
**** ****↲
A15 * 6* *15* INTAC↲
**** ****↲
* *↲
**** ****↲
A16 * 7* *14* INTCY↲
**** ****↲
* *↲
**** ****↲
A17 * 8* *13* /ILBX↲
**** ****↲
* *↲
**** ****↲
MIO * 9* *12* /EPCS↲
**** ****↲
* *↲
**** ****↲
GND *10* *11* UAEN↲
**** ****↲
* *↲
*******************************↲
════════════════════════════════════════════════════════════════════════
↓
PAT071 841018 HEP↲
CPU610 FIRST I/O ADDRESS DECODER.↲
↲
LALE A A7 A3 A4 A5 A6 /XPST B GND↲
GND /IOA /PICCS /PPICS /PITCS /SERCS /PECS /SBXCS SLREQ VCC↲
↲
PICCS:= A*B*/A3*/A4*/A5*A6*A7 ; PIC 1 AND PIC 2↲
+A*B*/A3*A4*/A5*/A6*A7 ; PIC 3 (SLAVE 2)↲
↲
PPICS:= A*B*A3*/A4*/A5*A6*A7 ; PARALLEL PORT 1↲
+A*B*A3*A4*/A5*/A6*A7 ; PARALLEL PORT 2↲
↲
PITCS:= A*B*/A3*A4*/A5*A6*A7 ; INTERVAL TIMER↲
↲
SERCS:= A*B*A3*A4*/A5*A6*A7 ; SERIAL PORT↲
↲
PECS:= A*B*A3*A4*A5*A6*A7 ; NUMERIC PROCESSOR EXTENSION↲
↲
SBXCS:= XPST*A*B*A5*/A6*A7 ; ISBX BUS↲
↲
IF(VCC) IOA= A*B↲
↲
IF(VCC) SLREQ= /A ; RTC, BPROM AND INTERRUPT OUT↲
+/B ; CHIP SELECTION↲
+A4↲
+A5↲
+A6↲
+/A7↲
↲
DESCRIPTION:↲
↲
PAT071 INCLUDES THE FIRST I/O DECODING TO THE ONBOARD I/O PORTS.↲
↲
(CHECKSUM = 056F)↲
════════════════════════════════════════════════════════════════════════
↓
↲
************** **************↲
* * * *↲
**** ****↲
LALE * 1* *20* VCC↲
**** ****↲
* *↲
**** ****↲
A * 2* *19* SLREQ↲
**** ****↲
* *↲
**** ****↲
A7 * 3* *18* /SBXCS↲
**** ****↲
* *↲
**** ****↲
A3 * 4* *17* /PECS↲
**** ****↲
* *↲
**** ****↲
A4 * 5* *16* /SERCS↲
**** ****↲
* *↲
**** ****↲
A5 * 6* *15* /PITCS↲
**** ****↲
* *↲
**** ****↲
A6 * 7* *14* /PPICS↲
**** ****↲
* *↲
**** ****↲
/XPST * 8* *13* /PICCS↲
**** ****↲
* *↲
**** ****↲
B * 9* *12* /IOA↲
**** ****↲
* *↲
**** ****↲
GND *10* *11* GND↲
**** ****↲
* *↲
*******************************↲
════════════════════════════════════════════════════════════════════════
↓
PAT072 841023 HEP↲
CPU610 SECONDARY I/O ADDRESS DECODER.↲
↲
PUADR0 PUADR2 PUADR3 PUADR4 NC /LBHE /PICCS /PPICS SLCS GND↲
/SBXCS /PICCS1 /PICCS2 /PICCS3 /PPICS1 /PPICS2 /MCS0 /MCS1 ↓
/INTOUT VCC↲
↲
IF(VCC) PICCS1= PICCS*/PUADR4*/PUADR2 ; MASTER PIC↲
↲
IF(VCC) PICCS2= PICCS*/PUADR4*PUADR2 ; SLAVE 1 PIC↲
↲
IF(VCC) PICCS3= PICCS*PUADR4 ; SLAVE 2 PIC↲
↲
IF(VCC) PPICS1= PPICS*/PUADR4 ; PPI 1↲
↲
IF(VCC) PPICS2= PPICS*PUADR4 ; PPI 2↲
↲
IF(VCC) MCS0= SBXCS*LBHE*PUADR0*/PUADR4 ; ISBX BYTE↲
+SBXCS*/LBHE*/PUADR0*/PUADR4 ; -"-↲
+SBXCS*LBHE*/PUADR0*/PUADR3 ; ISBX WORD↲
↲
IF(VCC) MCS1= SBXCS*LBHE*PUADR0*PUADR4 ; ISBX BYTE↲
+SBXCS*/LBHE*/PUADR0*PUADR4 ; -"-↲
+SBXCS*LBHE*/PUADR0*PUADR3 ; ISBX WORD↲
↲
IF(VCC) INTOUT= SLCS*/PUADR3 ; INTERRUPT OUT↲
↲
DESCRIPTION:↲
↲
PAT072 INCLUDES THE FIRST I/O DECODING TO THE ONBOARD I/O PORTS.↲
(CHECKSUM = 087C)↲
════════════════════════════════════════════════════════════════════════
↓
↲
************** **************↲
* * * *↲
**** ****↲
PUADR0 * 1* *20* VCC↲
**** ****↲
* *↲
**** ****↲
PUADR2 * 2* *19* /INTOUT↲
**** ****↲
* *↲
**** ****↲
PUADR3 * 3* *18* /MCS1↲
**** ****↲
* *↲
**** ****↲
PUADR4 * 4* *17* /MCS0↲
**** ****↲
* *↲
**** ****↲
NC * 5* *16* /PPICS2↲
**** ****↲
* *↲
**** ****↲
/LBHE * 6* *15* /PPICS1↲
**** ****↲
* *↲
**** ****↲
/PICCS * 7* *14* /PICCS3↲
**** ****↲
* *↲
**** ****↲
/PPICS * 8* *13* /PICCS2↲
**** ****↲
* *↲
**** ****↲
SLCS * 9* *12* /PICCS1↲
**** ****↲
* *↲
**** ****↲
GND *10* *11* /SBXCS↲
**** ****↲
* *↲
*******************************↲
════════════════════════════════════════════════════════════════════════
↓
PAT073 841023 HEP↲
CPU610 WAIT STATE GENERATOR.↲
↲
/CPUCLK SEREN LINTR 2INTCY /INTEN /IOACC /EPROM /DLYCMD /LALE GND↲
GND /DEBUAE /LINTA /Q0 /Q1 /Q2 /IOMBWA /DLINTA /IOWAIT VCC↲
↲
Q0:= /LALE*/DLYCMD*/Q0 ; 3 BIT COUNTER↲
↲
Q1:= /LALE*/DLYCMD*/Q1*Q0↲
+/LALE*/DLYCMD*/Q0*Q1↲
↲
Q2:= /LALE*/DLYCMD*/Q2*Q1*Q0↲
+/LALE*/DLYCMD*/Q0*/Q1*Q2↲
+/LALE*/DLYCMD*Q0*/Q1*Q2↲
+/LALE*/DLYCMD*/Q0*Q1*Q2↲
↲
IOMBWA:= IOACC*/Q1 ; I/O (ONBOARD) AND↲
+DEBUAE ; MULTIBUS WAITSTATES↲
+/IOACC*/Q2 ; GENERATION↲
↲
IF(VCC) IOWAIT= LALE*EPROM ; FIRST EPROM WAITSTATE↲
+EPROM*/Q2 ; 2 EPROM WAITSTATES↲
+LALE*IOACC ; FIRST I/O WAITSTATE↲
+IOMBWA ; MULTIBUS AND I/O↲
+LALE*LINTR ; FIRST INTERRUPT ↓
WAITSTATE↲
+SEREN*2INTCY*/Q2 ; 8274 INTERRUPT ↓
WAITSTATE↲
↲
IF(VCC) DLINTA= SEREN*/2INTCY*LINTA ; DELAY OF INTERRUPT↲
+SEREN*2INTCY*LINTA ; ACKNOWLEDGE TO 8274↲
↲
DESCRIPTION:↲
↲
PAT073 IS A WAIT STATE GENERATOR. FURTHER IT DELAY THE INTA↲
SIGNAL TO THE 8274↲
(CHECKSUM = 06C6)↲
════════════════════════════════════════════════════════════════════════
↓
↲
************** **************↲
* * * *↲
**** ****↲
/CPUCLK * 1* *20* VCC↲
**** ****↲
* *↲
**** ****↲
SEREN * 2* *19* /IOWAIT↲
**** ****↲
* *↲
**** ****↲
LINTR * 3* *18* /DLINTA↲
**** ****↲
* *↲
**** ****↲
2INTCY * 4* *17* /IOMBWA↲
**** ****↲
* *↲
**** ****↲
/INTEN * 5* *16* /Q2↲
**** ****↲
* *↲
**** ****↲
/IOACC * 6* *15* /Q1↲
**** ****↲
* *↲
**** ****↲
/EPROM * 7* *14* /Q0↲
**** ****↲
* *↲
**** ****↲
/DLYCMD * 8* *13* /LINTA↲
**** ****↲
* *↲
**** ****↲
/LALE * 9* *12* /DEBUAE↲
**** ****↲
* *↲
**** ****↲
GND *10* *11* GND↲
**** ****↲
* *↲
*******************************↲
════════════════════════════════════════════════════════════════════════
↓
PAT074 841023 HEP↲
CPU610 ASYNCRON READY GENERATOR↲
↲
/IOWAIT /DLINTA LINTR BVI /RTCBSY /XWAIT /TMOUT /BUAEN LBXEN GND↲
MBREQ SEREN NC CAS0 CAS1 CAS2 /MBXACK /TMTRIG /ARDY VCC↲
↲
IF(VCC) ARDY= /XWAIT*/RTCBSY*/IOWAIT*/LBXEN*/MBREQ ; LOCAL OR ↓
ILBX↲
+MBXACK*MBREQ*BUAEN ; MULITIBUS↲
+TMOUT ; -"-↲
↲
IF(VCC) TMTRIG= /MBXACK*MBREQ*BUAEN ; MULTIBUS↲
+LBXEN ; ILBX BUS↲
+LINTR ; LOCAL INTR↲
+RTCBSY ; RTC↲
↲
IF(VCC) /SEREN= CAS0 ; SELECTION OF ↓
THE↲
+/CAS1 ; 8274 FROM ↓
THE MASTER↲
+/CAS2 ; PIC↲
↲
DESCRIPTION:↲
↲
PAT074 IS AN ASYNCRON READY GENERATOR. FURTHER IT INCLUDES ↓
CIRCUIT SELECTION AND SELECTION OF THE 8274 IN THE INTERUPT ↓
ACKNOWLEDGE PHASE.↲
(CHECKSUM = 0593)↲
════════════════════════════════════════════════════════════════════════
↓
************** **************↲
* * * *↲
**** ****↲
/IOWAIT * 1* *20* VCC↲
**** ****↲
* *↲
**** ****↲
/DLINTA * 2* *19* /ARDY↲
**** ****↲
* *↲
**** ****↲
LINTR * 3* *18* /TMTRIG↲
**** ****↲
* *↲
**** ****↲
BVI * 4* *17* /MBXACK↲
**** ****↲
* *↲
**** ****↲
/RTCBSY * 5* *16* CAS2↲
**** ****↲
* *↲
**** ****↲
/XWAIT * 6* *15* CAS1↲
**** ****↲
* *↲
**** ****↲
/TMOUT * 7* *14* CAS0↲
**** ****↲
* *↲
**** ****↲
/BUAEN * 8* *13* NC↲
**** ****↲
* *↲
**** ****↲
LBXEN * 9* *12* SEREN↲
**** ****↲
* *↲
**** ****↲
GND *10* *11* MBREQ↲
**** ****↲
* *↲
*******************************↲
↲
════════════════════════════════════════════════════════════════════════
↓
PAL16R6A PAL DESIGN SPECIFICATIONS↲
PAT075 841023 HEP↲
CPU610 COMMAND DELAY GENERATOR↲
↲
/CPUCLK /S0 /S1 OBDTR NC LALE /SERCS /RESET /CPUCLK GND↲
GND /PPICS /DTR /Q0 /DLYCMD /Q1 /Q2 /Q3 /ARDYEN VCC↲
↲
Q0:= /RESET*DLYCMD*/Q0 ; COMMAND DELAY COUNTER↲
↲
Q1:= /RESET*DLYCMD*/Q1*Q0 ; -"-↲
+/RESET*DLYCMD*/Q0*Q1↲
↲
Q2:= /RESET*DLYCMD*Q0*Q1*/Q2 ; -"-↲
+/RESET*DLYCMD*/Q0*/Q1*Q2↲
+/RESET*DLYCMD*Q0*/Q1*Q2↲
+/RESET*DLYCMD*/Q0*Q1*Q2↲
↲
Q3:= /RESET*DLYCMD*Q0*Q1*Q2*/Q3 ; -"-↲
+/RESET*DLYCMD*/Q0*/Q1*/Q2*Q3↲
+/RESET*DLYCMD*Q0*/Q1*/Q2*Q3↲
+/RESET*DLYCMD*/Q0*Q1*/Q2*Q3↲
+/RESET*DLYCMD*Q0*Q1*/Q2*Q3↲
+/RESET*DLYCMD*/Q0*/Q1*Q2*Q3↲
+/RESET*DLYCMD*Q0*/Q1*Q2*Q3↲
↲
/DTR:= /OBDTR*RESET ; WRITE I/O CYCLE↲
↲
DLYCMD:= /RESET*SERCS*/S0*S1*/LALE ; 8274 STATUS CYCLE↲
+/RESET*SERCS*S0*/S1*/LALE ; -"-↲
+/RESET*SERCS*/Q1*/Q2*/Q3*DLYCMD ; 8274 COMMAND DELAY↲
+/RESET*PPICS*/S0*S1*/LALE ; 8255 STATUS CYCLE↲
+/RESET*PPICS*S0*/S1*/LALE ; 8255 COMMAND DELAY↲
+/RESET*PPICS*/Q3*DLYCMD ; -"-↲
+/RESET*PPICS*/Q1*/Q2*Q3*DLYCMD ; -"-↲
↲
IF(VCC) ARDYEN= S0*S1 ; ENABLE THE ASYNCRON↲
+/S0*/S1 ; READY INPUT ON 82284↲
↲
DESCRIPTION:↲
↲
PAT075 IS A COMMAND DELAY GENERATOR. FURTHER IT INCLUDES A ENABLE ↓
SIGNAL ARDYEN FOR THE 82284 READY GENERATIONS CIRCUIT↲
(CHECKSUM = 06A6)↲
════════════════════════════════════════════════════════════════════════
↓
↲
************** **************↲
* * * *↲
**** ****↲
/CPUCLK * 1* *20* VCC↲
**** ****↲
* *↲
**** ****↲
/S0 * 2* *19* /ARDYEN↲
**** ****↲
* *↲
**** ****↲
/S1 * 3* *18* /Q3↲
**** ****↲
* *↲
**** ****↲
OBDTR * 4* *17* /Q2↲
**** ****↲
* *↲
**** ****↲
NC * 5* *16* /Q1↲
**** ****↲
* *↲
**** ****↲
LALE * 6* *15* /DLYCMD↲
**** ****↲
* *↲
**** ****↲
/SERCS * 7* *14* /Q0↲
**** ****↲
* *↲
**** ****↲
/RESET * 8* *13* /DTR↲
**** ****↲
* *↲
**** ****↲
/CPUCLK * 9* *12* /PPICS↲
**** ****↲
* *↲
**** ****↲
GND *10* *11* GND↲
**** ****↲
* *↲
*******************************↲
════════════════════════════════════════════════════════════════════════
↓
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
↓
┆b0┆┆a1┆LAR001↲
↲
┆84┆This bipolar PROM includes identity data. The format of ↓
┆19┆┆89┆┄┄the data :↲
↲
┆a1┆┆b0┆Address range information. ↲
↲
00H-0BH Indentiti nr↲
C9H-D4H Name in Ascii (LAR001)↲
D5H-E0H production date (Year/Month/Day in Ascii)↲
E5H-F0H PLS nr of the bipolar PROM 74S287 in Ascii↲
FCH-FFH checksum↲
↲
┆b0┆---------------------------------------------------↲
↲
════════════════════════════════════════════════════════════════════════
↓
;ROC416 CPU610 Multibus I/O address identification. 841121 HEP.↲
;↲
0000' ╞ ASEG╞ ╞ ; ↓
Prom start address↲
╞ ORG╞ 3DBH╞ ;↲
╞ ╞ ╞ ;↲
03DB F0 ╞ DB 0F0H ; select ↓
extended multibus interrupts.↲
03DC FFFF ╞ DW╞ 0FFFFH╞ ;↲
03DE FFFF ╞ DW╞ 0FFFFH╞ ;↲
03E0 FFFF ╞ DW╞ 0FFFFH╞ ;↲
03E2 FFFF ╞ DW╞ 0FFFFH╞ ;↲
03E4 FFFF ╞ DW╞ 0FFFFH╞ ;↲
03E6 FFFF ╞ DW╞ 0FFFFH╞ ;↲
03E8 FFFF ╞ DW╞ 0FFFFH╞ ;↲
03EA FFFF ╞ DW╞ 0FFFFH╞ ;↲
03EC FFFF ╞ DW╞ 0FFFFH╞ ;↲
03EE FFFF ╞ DW╞ 0FFFFH╞ ;↲
03F0 FFFF ╞ DW╞ 0FFFFH╞ ;↲
03F2 FFFF ╞ DW╞ 0FFFFH╞ ;↲
03F4 FFFF ╞ DW╞ 0FFFFH╞ ;↲
03F6 FFFF ╞ DW╞ 0FFFFH╞ ;↲
03F8 FFFF ╞ DW╞ 0FFFFH╞ ;↲
03FA FFFF ╞ DW╞ 0FFFFH╞ ;↲
03FC FFFF ╞ DW╞ 0FFFFH╞ ;↲
03FE FFFF ╞ DW╞ 0FFFFH╞ ;↲
;↲
╞ END↲
════════════════════════════════════════════════════════════════════════
↓
┆b0┆┆a1┆┆b0┆┆a1┆5.3 Timing Diagrams.↲
↲
╞ ┆84┆This part describes the behaviour of the signals in ↓
┆19┆┆89┆┄┄time. The dokumentation is from a logic analyzer model ↓
┆19┆┆89┆┄┄1630D from Hewelt Packard.↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆b0┆┆a1┆5.3.1 First ROM access on CPU610B.↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆b0┆┆a1┆5.3.2 8274 cycle on CPU610A.↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆88┆┆b0┆┆a1┆5.3.3 RTC cycle CPU610A.↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆b0┆┆a1┆5.3.4 Multibus cycle on CPU610B to MEM691.↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆b0┆┆a1┆5.3.5 iLBXbus cycle CPU610B to MEM691.↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆5.4 Plugs.↲
↲
┆84┆This part descibes the plugs on CPU610X. The Multibus ↓
┆19┆┆8a┆┄┄(P1) and iLBX (P2) connectors is edge connectors. The ↓
┆19┆┆8a┆┄┄rest connectors is ITT CANNON G08 connectors.↲
↲
┆b0┆┆a1┆5.4.1 P1 Multibus Connector.↲
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a1a2a37414b555f69737d8791ffffff04╱
↓
↲
╞ ┆b0┆┆a1┆Pin╞ Signal╞ Pin╞ Signal. ↲
↲
╞ 1╞ GND╞ 2╞ GND↲
╞ 3╞ +5V╞ 4╞ +5V↲
╞ 5╞ +5V╞ 6╞ +5V↲
╞ 7╞ +12V╞ 8╞ +12V↲
╞ 9╞ Reserved╞ 10╞ Reserved↲
╞ 11╞ GND╞ 12╞ GND↲
╞ 13╞ /BCLK╞ 14╞ /INIT↲
╞ 15╞ /BPRN╞ 16╞ /BPRO↲
╞ 17╞ /BUSY╞ 18╞ /BREQ↲
╞ 19╞ /MRDC╞ 20╞ /MWTC↲
╞ 21╞ /IORC╞ 22╞ /IOWC↲
╞ 23╞ /XACK╞ 24╞ /INH1↲
╞ 25╞ /LOCK╞ 26╞ /INH2↲
╞ 27╞ /BHEN╞ 28╞ /AD10↲
╞ 29╞ /CBRQ╞ 30╞ /AD11↲
╞ 31╞ /CCLK╞ 32╞ /AD12↲
╞ 33╞ /INTA╞ 34╞ /AD13↲
╞ 35╞ /INT6╞ 36╞ /INT7↲
╞ 37╞ /INT4╞ 38╞ /INT5↲
╞ 39╞ /INT2╞ 40╞ /INT3↲
╞ 41╞ /INT0╞ 42╞ /INT1↲
╞ 43╞ /ADRE╞ 44╞ /ADRF↲
╞ 45╞ /ADRC╞ 46╞ /ADRD↲
╞ 47╞ /ADRA╞ 48╞ /ADRB↲
╞ 49╞ /ADR8╞ 50╞ /ADR9↲
╞ 51╞ /ADR6╞ 52╞ /ADR7↲
╞ 53╞ /ADR4╞ 54╞ /ADR5↲
╞ 55╞ /ADR2╞ 56╞ /ADR3↲
╞ 57╞ /ADR0╞ 58╞ /ADR1↲
╞ 59╞ /DATE╞ 60╞ /DATF↲
╞ 61╞ /DATC╞ 62╞ /DATD↲
╞ 63╞ /DATA╞ 64╞ /DATB↲
╞ 65╞ /DAT8╞ 66╞ /DAT9↲
╞ 67╞ /DAT6╞ 68╞ /DAT7↲
╞ 69╞ /DAT4╞ 70╞ /DAT5↲
╞ 71╞ /DAT2╞ 72╞ /DAT3↲
╞ 73╞ /DAT0╞ 74╞ /DAT1↲
╞ 75╞ GND╞ 76╞ GND↲
╞ 77╞ Reserved╞ 78╞ Reserved↲
╞ 79╞ -12V╞ 80╞ -12V↲
╞ 81╞ +5V╞ 82╞ +5V↲
╞ 83╞ +5V╞ 84╞ +5V↲
╞ 85╞ GND╞ 86╞ GND↲
╞ ┆b0┆---------------------------------------↲
════════════════════════════════════════════════════════════════════════
↓
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
↓
↲
↲
↲
↲
↲
↲
↲
↲
↲
↲
Fig 5.4.1 P1 and P2 Pin assignment.↲
↲
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
↓
↲
┆a1┆┆b0┆5.4.2 P2 extended Multibus Connector (iLBXbus connector).↲
↲
╞ ┆b0┆┆a1┆Pin╞ Signal╞ Pin╞ Signal. ↲
↲
╞ 1╞ DB0╞ 2╞ DB1↲
╞ 3╞ DB2╞ 4╞ DB3↲
╞ 5╞ DB4╞ 6╞ DB5↲
╞ 7╞ DB6 ╞ 8╞ DB7↲
╞ 9╞ GND ╞ 10╞ DB8↲
╞ 11╞ DB9 ╞ 12╞ DB10↲
╞ 13╞ DB11 ╞ 14╞ DB12↲
╞ 15╞ DB13 ╞ 16╞ DB14↲
╞ 17╞ DB15 ╞ 18╞ GND↲
╞ 19╞ AB0 ╞ 20╞ AB1↲
╞ 21╞ AB2 ╞ 22╞ AB3↲
╞ 23╞ AB4 ╞ 24╞ AB5↲
╞ 25╞ AB6 ╞ 26╞ AB7↲
╞ 27╞ GND ╞ 28╞ AB8↲
╞ 29╞ AB9 ╞ 30╞ AB10↲
╞ 31╞ AB11 ╞ 32╞ AB12↲
╞ 33╞ AB13 ╞ 34╞ AB14↲
╞ 35╞ AB15 ╞ 36╞ GND↲
╞ 37╞ AB16╞ 38╞ AB17↲
╞ 39╞ AB18 ╞ 40╞ AB19↲
╞ 41╞ AB20 ╞ 42╞ AB21↲
╞ 43╞ AB22 ╞ 44╞ AB23↲
╞ 45╞ GND ╞ 46╞ /ACK↲
╞ 47╞ BHEN ╞ 48╞ R/(/W)↲
╞ 49╞ /ASTB╞ 50╞ /DSTB↲
╞ 51╞ /SMRQ╞ 52╞ /SMACK↲
╞ 53╞ /LOCK╞ 54╞ GND↲
╞ 55╞ /ADR22╞ 56╞ /ADR23↲
╞ 57╞ /ADR20╞ 58╞ /ADR21↲
╞ 59╞ Reserved╞ 60╞ /TPAR↲
╞ ┆b0┆---------------------------------------↲
════════════════════════════════════════════════════════════════════════
↓
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
↓
┆b0┆┆a1┆5.4.3 J1 Console interface connector.↲
↲
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
↓
┆a1┆┆b0┆┆f0┆┆a1┆┆e1┆┆a1┆┆b0┆J1 Console (RS232C) Signals↲
↲
1┆a1┆┆e1┆ ┆e1┆┆a1┆┆e1┆ RETUR┆a1┆┆e1┆N↲
2 ┆a1┆┆e1┆ ┆a1┆┆e1┆ Non Connected↲
3 ┆a1┆┆e1┆ Non Connected↲
┆e1┆ 4 ┆a1┆┆a1┆┆e1┆ Non Connected↲
5 ┆a1┆┆e1┆ RETURN↲
6 ┆a1┆┆a1┆┆e1┆ Non Connected↲
7 ┆a1┆┆e1┆ CALLING INDICATOR B↲
8 ┆a1┆┆a1┆┆e1┆ CARRIER DET B↲
┆b0┆┆a1┆┆f0┆┆e1┆┆b0┆┆a1┆┆e1┆┆f0┆ 9 ┆a1┆┆e1┆ RETURN↲
10 ┆a1┆┆e1┆ DATA TERM. RDY B↲
11┆a1┆┆e1┆ RETURN↲
12 DATA SET READY B↲
13 ┆a1┆┆e1┆ RETURN↲
14 ┆a1┆┆e1┆ C┆a1┆┆e1┆LEAR TO SEN┆e1┆┆a1┆┆e1┆D B↲
15 ┆a1┆┆e1┆ RETURN↲
16 ┆a1┆┆e1┆ ┆a1┆┆e1┆REQUEST TO SEND B↲
17 ┆a1┆┆e1┆ RETURN↲
18 ┆a1┆┆e1┆ ┆a1┆┆e1┆/RECIEVE DATA B↲
19 ┆a1┆┆e1┆ RETURN↲
20 /TRANSMIT DATA B↲
┆b0┆ ---------------------------------↲
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
↓
↲
↲
↲
↲
↲
↲
↲
↲
↲
↲
↲
↲
Fig 5.4.2 J1 pin assignment.↲
↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆b0┆┆a1┆5.4.4 J2 RS422A Multidrop Interface Connector.↲
↲
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
↓
┆b0┆┆a1┆┆e1┆ ┆a1┆┆b0┆┆f0┆┆a1┆┆e1┆┆a1┆┆b0┆J2 Printer Signals ↲
↲
1┆a1┆┆e1┆ ┆e1┆┆a1┆┆e1┆ RETURN┆a1┆┆a1┆┆a1┆┆e1┆┆a1┆┆a1┆┆e1┆┆a1┆┆b0┆┆e1┆┆f0┆↲
2 ┆a1┆┆e1┆ ┆a1┆┆e1┆ RECIEVE ┆e1┆┆a1┆┆e1┆COMMON↲
3 ┆a1┆┆e1┆ Non Connected↲
┆e1┆ 4 ┆a1┆┆a1┆┆e1┆ TERMINAL TIMMING↲
5 ┆a1┆┆e1┆ /TERMINAL TIMMING↲
6 ┆a1┆┆a1┆┆e1┆ SEND DATA↲
7 ┆a1┆┆e1┆ /SEND DATA↲
8 ┆a1┆┆a1┆┆e1┆ Non Connected↲
┆b0┆┆a1┆┆f0┆┆e1┆┆b0┆┆a1┆┆e1┆┆f0┆ 9 ┆a1┆┆e1┆ Non Connected↲
10 ┆a1┆┆e1┆ ┆a1┆┆e1┆ RECEIVE D┆e1┆┆a1┆┆e1┆ATA↲
11 ┆a1┆┆e1┆ /RECEIVE DATA↲
12 ┆a1┆┆e1┆ ┆a1┆┆e1┆REQUEST TO SEND↲
13 ┆a1┆┆e1┆ ┆a1┆┆e1┆ /REQUEST TO SEND↲
14 ┆a1┆┆e1┆ R┆e1┆ECEIVE TIMING (B)↲
15 ┆e1┆ RECEIVE TIMING (A)↲
16 ┆a1┆┆e1┆ ┆a1┆┆e1┆ CLEAR TO SEND↲
17 ┆a1┆┆e1┆ /CLEAR TO SEND↲
18 ┆a1┆┆e1┆ ┆a1┆┆e1┆ Non Connected↲
19 ┆a1┆┆e1┆ Non Connected↲
20 DATA MODE↲
21 ┆a1┆┆e1┆ /DATA MODE↲
22 ┆a1┆┆e1┆ ┆a1┆┆e1┆ TERMINAL READY↲
23 ┆a1┆┆e1┆ /TERMINAL READY↲
24 ┆a1┆┆e1┆ ┆a1┆┆e1┆ Non Connected↲
25 ┆a1┆┆a1┆┆e1┆ Non Connected↲
26 Non Connected↲
┆b0┆------------------------------↲
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
↓
↲
↲
↲
↲
↲
↲
↲
↲
↲
↲
Fig 5.4.3 J2 pin assignment.↲
↲
↲
┆8c┆┆83┆┆9c┆↓
┆b0┆┆a1┆5.4.5 J3 Parallel Printer Interface Connector.↲
↲
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
↓
┆b0┆┆a1┆┆b0┆┆a1┆┆e1┆ ┆a1┆┆b0┆┆f0┆┆a1┆┆e1┆┆a1┆┆b0┆J3 Printer Signals↲
↲
1┆a1┆┆e1┆ ┆e1┆┆a1┆┆e1┆ /STROBE┆a1┆┆a1┆┆a1┆┆e1┆┆a1┆┆a1┆┆e1┆┆a1┆┆b0┆┆e1┆┆f0┆↲
2 ┆a1┆┆e1┆ ┆a1┆┆e1┆ /AUTO LF┆e1┆┆a1┆↲
3 ┆a1┆┆e1┆ DATA 0┆e1┆┆e1┆↲
┆e1┆ 4 ┆a1┆┆a1┆┆e1┆ /FAULT↲
5 ┆a1┆┆e1┆ DATA 1↲
6 ┆a1┆┆a1┆┆e1┆ /LP INIT↲
7 ┆a1┆┆e1┆ DATA 2↲
8 ┆a1┆┆a1┆┆e1┆ /SELECT↲
┆b0┆┆a1┆┆f0┆┆e1┆┆b0┆┆a1┆┆e1┆┆f0┆ 9 ┆a1┆┆e1┆ DATA 3↲
10 ┆a1┆┆e1┆ ┆a1┆┆e1┆ RETURN┆e1┆┆a1┆┆e1┆↲
11 ┆a1┆┆e1┆ DATA 4↲
12 ┆a1┆┆e1┆ ┆a1┆┆e1┆ RETURN┆e1┆┆a1┆┆e1┆┆a1┆┆e1┆↲
13 ┆a1┆┆e1┆ DATA 5↲
14 ┆a1┆┆e1┆ ┆a1┆┆e1┆ RETURN┆e1┆┆a1┆┆e1┆↲
15 ┆a1┆┆e1┆ DATA 6↲
16 ┆a1┆┆e1┆ ┆a1┆┆e1┆ RETURN┆e1┆┆a1┆┆e1┆↲
17 ┆a1┆┆e1┆ DATA 7↲
18 ┆a1┆┆e1┆ ┆a1┆┆e1┆ RETURN┆e1┆┆a1┆┆e1┆↲
19 ┆a1┆┆e1┆ /ACK↲
20 RETURN┆e1┆┆a1┆┆e1┆┆e1┆↲
21 ┆a1┆┆e1┆ BUSY↲
22 ┆a1┆┆e1┆ ┆a1┆┆e1┆ RETURN┆e1┆┆a1┆↲
23 ┆a1┆┆e1┆ PAPER END↲
24 ┆a1┆┆e1┆ ┆a1┆┆e1┆ RETURN┆e1┆┆a1┆↲
25 ┆a1┆┆a1┆┆e1┆ SELECTED↲
26 non connected↲
┆b0┆ ----------------------------↲
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
↓
↲
↲
↲
↲
↲
↲
↲
↲
↲
↲
↲
Fig 5.4.4 J3 pin assignment.↲
↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆5.4.6 ┆84┆J4 LED603, BBC601 and Key Interrupt Connector.↲
↲
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
↓
┆b0┆┆a1┆┆b0┆┆a1┆┆e1┆ ┆a1┆┆b0┆┆f0┆┆a1┆┆e1┆┆a1┆┆b0┆J4 Signals ↲
↲
1┆a1┆┆e1┆ ┆e1┆┆a1┆┆e1┆ LED 1 CATHODE↲
2 ┆a1┆┆e1┆ ┆a1┆┆e1┆ LED 1 ANOD┆a1┆┆e1┆E↲
3 ┆a1┆┆e1┆ LED 2 CATHODE┆e1┆┆e1┆↲
┆e1┆ 4 ┆a1┆┆a1┆┆e1┆ LED 2 ANODE↲
5 ┆a1┆┆e1┆ /PINTR1↲
6 ┆a1┆┆a1┆┆e1┆ RETURN↲
7 ┆a1┆┆e1┆ /PINTR2↲
8 ┆a1┆┆a1┆┆e1┆ RETURN↲
┆b0┆┆a1┆┆f0┆┆e1┆┆b0┆┆a1┆┆e1┆┆f0┆ 9 ┆a1┆┆e1┆ PDMD↲
10 ┆a1┆┆e1┆ ┆a1┆┆e1┆ RETURN┆e1┆┆a1┆┆e1┆↲
11 ┆a1┆┆e1┆ +12V SENSE↲
12 ┆a1┆┆e1┆ ┆a1┆┆e1┆ +5V SENSE┆e1┆┆a1┆┆e1┆┆a1┆┆e1┆↲
13┆a1┆┆e1┆ /PINTR2↲
14 ┆a1┆┆e1┆ ┆a1┆┆e1┆ RETURN┆e1┆┆a1┆┆e1┆↲
15 ┆a1┆┆e1┆ Non Connected↲
16 ┆a1┆┆e1┆ ┆a1┆┆e1┆Non Connected↲
┆b0┆ ----------------------------↲
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
↓
↲
↲
↲
↲
↲
↲
↲
↲
↲
↲
↲
Fig 5.4.5 J4 pin assignment.↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆b0┆┆a1┆5.4.7 J5 iSBXbus Interface Connector.↲
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
↓
↲
╞ ┆b0┆┆a1┆Pin╞ Signal╞ Pin╞ Signal. ↲
↲
╞ 1╞ +12V╞ 2╞ -12V↲
╞ 3╞ GND╞ 4╞ +5V↲
╞ 5╞ RESET╞ 6╞ MCLK↲
╞ 7╞ MA2 ╞ 8╞ /MPST↲
╞ 9╞ MA1 ╞ 10╞ Reserved↲
╞ 11╞ MA0 ╞ 12╞ MINTR1↲
╞ 13╞ /IOWRT╞ 14╞ MINTR0↲
╞ 15╞ /IORD╞ 16╞ /MWAIT↲
╞ 17 GND ╞ 18╞ +5↲
╞ 19╞ MD7 ╞ 20╞ /MCS1↲
╞ 21╞ MD6 ╞ 22╞ /MCS0↲
╞ 23╞ MD5 ╞ 24╞ Reserved↲
╞ 25╞ MD4 ╞ 26╞ (TDMA)*↲
╞ 27╞ MD3 ╞ 28╞ OPT1↲
╞ 29╞ MD2 ╞ 30╞ OPT0↲
╞ 31╞ MD1 ╞ 32╞ (/MDACK)*↲
╞ 33╞ MD0 ╞ 34╞ (MDRQT)*↲
╞ 35╞ GND ╞ 36╞ +5V↲
╞ 37╞ MDE ╞ 38╞ MDF↲
╞ 39╞ MDC ╞ 40╞ MDD↲
╞ 41╞ MDA ╞ 42╞ MDB↲
╞ 43╞ MD8 ╞ 44╞ MD9↲
╞ ┆b0┆---------------------------------------↲
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
↓
╞ * ┆84┆Note this DMA signals are not included on the CPU610X ↓
┆19┆┆8b┆┄┄board.↲
↲
↲
↲
↲
↲
↲
↲
↲
↲
↲
↲
↲
Fig 5.4.6 J5 pin assignment.↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆5.5 ╞ Jumpers.↲
↲
╞ ┆84┆The CPU board includes only one standard detachable ↓
┆19┆┆89┆┄┄jumper W11. The rest of the jumpers is connected direct ↓
┆19┆┆89┆┄┄on the printed board. It can be disconnected with a ↓
┆19┆┆89┆┄┄knife.↲
↲
╞ The standard jumpers on the CPU610X are listed below :↲
↲
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
↓
┆b0┆┆a1┆Jumper connections Function. ↲
↲
W1 NC Test Jumper (Not in Use).↲
W2 NC -"- ┆84┆(Disconnects the ↓
┆19┆┆b0┆┄┄iLBXbus).↲
W3 NC -"- ┆84┆(Test master else ↓
┆19┆┆b0┆┄┄test slave).↲
╞ W4 NC╞ ┆84┆Bus Priority Out. (Only used ↓
┆19┆┆a4┆┄┄in systems with seriel ↓
┆19┆┆a4┆┄┄arbitrations logic).↲
W5 1 - 44 ┆84┆Timer interrupt to Master PIC ↓
┆19┆┆a4┆┄┄level 0.↲
╞ W5 2 - 43 ┆84┆Multibus interrupt 2 to ↓
┆19┆┆a4┆┄┄Master PIC level 2.↲
╞ W5 3 - 42 ┆84┆Multibus interrupt 3 to ↓
┆19┆┆a4┆┄┄Master PIC level 3.↲
╞ W5 4 - 41 ┆84┆Multibus interrupt 4 to ↓
┆19┆┆a4┆┄┄Master PIC level 4.↲
╞ W5 5 - 40 ┆84┆Multibus interrupt 5 to ↓
┆19┆┆a4┆┄┄Master PIC level 5.↲
W5 6 - 39 ┆84┆8274 interrupt to Master PIC ↓
┆19┆┆a4┆┄┄level 6.↲
W5 7 - 38 ┆84┆Multibus interrupt 6 to Slave ↓
┆19┆┆a4┆┄┄PIC1 level 0.↲
╞ W5 8 - 37 ┆84┆Multibus interrupt 7 to Slave ↓
┆19┆┆a4┆┄┄PIC level 1.↲
W5 9 - 36 ┆84┆Time out interrupt to Slave ↓
┆19┆┆a4┆┄┄PIC1 level 2.↲
W5 10 - 35 ┆84┆iSBXbus interrupt 0 to Slave ↓
┆19┆┆a4┆┄┄PIC1 level 3.↲
W5 11 - 34 ┆84┆iSBXbus interrupt 1 to Slave ↓
┆19┆┆a4┆┄┄PIC1 level 4.↲
╞ W5 12 - 33 ┆84┆Multibus interrupt 0 to Slave ↓
┆19┆┆a4┆┄┄PIC1 level 5.↲
╞ W5 13 - 32 ┆84┆Multibus interrupt 1 to Slave ↓
┆19┆┆a4┆┄┄PIC1 level 6.↲
W5 14 - 31 ┆84┆Line Printer interrupt to ↓
┆19┆┆a4┆┄┄Slave PIC1 level 7.↲
W5 15 - 30 ┆84┆Extended multibus interrupt 8 ↓
┆19┆┆a4┆┄┄to Slave PIC2 level 0.↲
W5 16 - 29 ┆84┆Extended multibus interrupt 9 ↓
┆19┆┆a4┆┄┄to Slave PIC2 level 1.↲
W5 17 - 28 ┆84┆Extended multibus interrupt ↓
┆19┆┆a4┆┄┄10 to Slave PIC2 level 2.↲
════════════════════════════════════════════════════════════════════════
↓
┆b0┆┆a1┆Jumper connections Function. ↲
↲
W5 18 - 27 ┆84┆Extended multibus interrupt ↓
┆19┆┆a4┆┄┄11 to Slave PIC2 level 3.↲
W5 19 - 26 ┆84┆Extended multibus interrupt ↓
┆19┆┆a4┆┄┄12 to Slave PIC2 level 4.↲
W5 20 - 25 ┆84┆Extended multibus interrupt ↓
┆19┆┆a4┆┄┄13 to Slave PIC2 level 5.↲
W5 21 - 24 ┆84┆Extended multibus interrupt ↓
┆19┆┆a4┆┄┄14 to Slave PIC2 level 6.↲
W5 22 - 23 ┆84┆Extended multibus interrupt ↓
┆19┆┆a4┆┄┄15 to Slave PIC2 level 7.↲
W6 NC ┆84┆Used to generate interrupts ↓
┆19┆┆a4┆┄┄out to the multibus.↲
W7 2 - 3 ┆84┆Select the baud rate signal A ↓
┆19┆┆a4┆┄┄as a receiver clock in the ↓
┆19┆┆a4┆┄┄RS422A interface, else the TT ↓
┆19┆┆a4┆┄┄signal (Terminal Timing) is ↓
┆19┆┆a4┆┄┄in use.↲
W8 NC Test Jumper. (Not in use).↲
W9 NC ┆84┆Used to the (80287). NC it ↓
┆19┆┆a4┆┄┄indicates that the 80287 use ↓
┆19┆┆a4┆┄┄the CPU clock else it is ↓
┆19┆┆a4┆┄┄divided by three.↲
W10 1 - 3 ┆84┆Select the 80287 clock. It ↓
┆19┆┆a4┆┄┄use the cpu clock divided by ↓
┆19┆┆a4┆┄┄two in the standard ↓
┆19┆┆a4┆┄┄configuration else cut W10 ↓
┆19┆┆a4┆┄┄1-3 5MHz clock or W10 3-4 (W9 ↓
┆19┆┆a4┆┄┄1-2) the exact CPU clock. ↓
┆19┆┆a4┆┄┄(But intern in the 80287 it ↓
┆19┆┆a4┆┄┄is divided by three.↲
┆b0┆ ┆f0┆W11 1 - 2 ┆84┆On PCB715 it is the only standard ↓
┆19┆┆a4┆┆81┆┄detachable jumper. It used to ↓
┆19┆┆a4┆┆81┆┄27256 EPROM's. If 27128 or ↓
┆19┆┆a4┆┆81┆┄2764 EPROM's is use it is ↓
┆19┆┆a4┆┆81┆┄disconnected. On PCB771 it is ↓
┆19┆┆a4┆┆81┆┄opposite, here there is no ↓
┆19┆┆a4┆┆81┆┄standard jumpers.↲
┆b0┆----------------------------------------------------↲
╱04002d4e0a00060000000003014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
╱04002d4e0a00060000000002014131000000000000000000000000000000000000000000000000000a12232a37414b555f69737d8791ffff04╱
↓
↲
┆a1┆┆b0┆5.6 Enviromental Specification.↲
↲
Operating Temperature: 0┆81┆0┆82┆ - 55┆81┆0┆82┆↲
↲
Relative Humidity: 20% - 80% (Non condensing).↲
↲
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆5.7 Physical Specifications.↲
↲
Width: 304.8mm↲
↲
Lenght: 179.1mm↲
↲
Height: 12mm↲
↲
↲
┆a1┆┆b0┆5.8 Power Specifications.↲
↲
Power Dissipation 36.8 W (max).↲
╞ VCC +5V +/- 5% (7.1A max)↲
VDD+ +12V +/-10% (50mA max)↲
VDD- -12V +/-10% (50mA max)↲
════════════════════════════════════════════════════════════════════════
↓
↲
════════════════════════════════════════════════════════════════════════
↓
┆a1┆┆b0┆A References.↲
↲
1. ┆84┆INTEL Microsystem Components Handbook. 1984. ↓
┆19┆┆8e┆┄┄230843-001.↲
↲
2. INTEL MULTIBUS Specification 9800683-04↲
↲
3. INTEL iLBX Bus Specification 145695-REV A↲
↲
4. INTEL iSBX Bus Specification 142686-001↲
↲
5. ┆84┆Central Processor Unit CPU610. Rev 1.2 . Hardware ↓
┆19┆┆8e┆┄┄Reference Manual manual. RCSL 99-1 09863↲
↲
6. ┆84┆RC 3902 (CPU 610) Hardware Selftest. User's Manual. ↓
┆19┆┆8e┆┄┄RCSL 99-1 10176↲
↲
7. ┆84┆RC 39 Selftest Concept. User's Manual.RCSL 99-1 ↓
┆19┆┆8e┆┄┄10092↲
════════════════════════════════════════════════════════════════════════
↓
↲
┆1a┆┆1a┆ 15 - 30 ┆84┆Extended munterrupt 8 ↓
┆19┆┆a4┆┄┄tURN┆e1┆┆a1┆┆e1┆↲
0x00000…00020 (0,) 00 00 00 00 00 00 00 00 42 03 06 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 0a 4e 00 00 00 ┆ B N ┆
0x00020…00040 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ ┆
0x00040…00047 00 00 00 00 00 00 00 ┆ ┆
0x00047…00080 Params {
0x00047…00080 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x00047…00080 00 00 00 00 00 00 00 00 05 0f 19 23 2d 37 41 4b 55 5f 69 73 7d 87 91 ff 04 ┆ #-7AKU_iså ┆
0x00047…00080 }
0x00080…000a0 06 69 0d 0a 0d 0a a1 b0 54 41 42 4c 45 20 4f 46 20 43 4f 4e 54 45 4e 54 53 05 50 41 47 45 0d 0a ┆ i TABLE OF CONTENTS PAGE ┆
0x000a0…000c0 0d 0a 31 2e 20 49 4e 54 52 4f 44 55 43 54 49 4f 4e 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆ 1. INTRODUCTION ..............┆
0x000c0…000e0 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 ┆............................... ┆
0x000e0…00100 20 31 20 0d 0a 0d 0a 32 2e 20 47 45 4e 45 52 41 4c 20 44 45 53 43 52 49 50 54 49 4f 4e 20 4f 46 ┆ 1 2. GENERAL DESCRIPTION OF┆
0x00100…00120 20 43 50 55 36 31 30 58 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆ CPU610X .......................┆
0x00120…00140 2e 2e 2e 2e 20 20 32 0d 0a 0d 0a 33 2e 20 42 4c 4f 43 4b 20 44 49 41 47 52 41 4d 20 2e 2e 2e 2e ┆.... 2 3. BLOCK DIAGRAM ....┆
0x00140…00160 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆................................┆
0x00160…00180 2e 2e 2e 2e 2e 2e 2e 2e 20 20 33 0d 0a 0d 0a 34 2e 20 46 55 4e 43 54 49 4f 4e 41 4c 20 44 45 53 ┆........ 3 4. FUNCTIONAL DES┆
0x00180…001a0 43 52 49 50 54 49 4f 4e 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆CRIPTION .......................┆
0x001a0…001c0 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 34 0d 0a 20 20 20 34 2e 31 20 4f 6e 20 62 6f 61 72 64 ┆............ 4 4.1 On board┆
0x001c0…001e0 20 43 50 55 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆ CPU ...........................┆
0x001e0…00200 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 34 0d 0a 20 20 20 20 20 20 20 34 2e 31 2e 31 20 ┆.............. 4 4.1.1 ┆
0x00200…00220 (1,) 38 30 32 38 36 20 43 50 55 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆80286 CPU ......................┆
0x00220…00240 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 34 0d 0a 20 20 20 20 20 20 20 34 2e 31 2e ┆................ 4 4.1.┆
0x00240…00260 32 20 4f 70 74 69 6f 6e 61 6c 20 38 30 32 38 37 20 4e 75 6d 65 72 69 63 20 70 72 6f 63 65 73 73 ┆2 Optional 80287 Numeric process┆
0x00260…00280 6f 72 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 35 0d 0a 20 20 20 34 2e 32 20 49 2f ┆or ............... 5 4.2 I/┆
0x00280…002a0 4f 20 49 6e 74 65 72 66 61 63 65 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆O Interface ....................┆
0x002a0…002c0 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 35 0d 0a 20 20 20 20 20 20 20 ┆.................... 5 ┆
0x002c0…002e0 34 2e 32 2e 31 20 49 2f 4f 20 61 64 72 65 73 73 69 6e 67 20 6f 6e 20 62 6f 61 72 64 20 2e 2e 2e ┆4.2.1 I/O adressing on board ...┆
0x002e0…00300 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 35 0d 0a 20 20 20 20 20 ┆...................... 5 ┆
0x00300…00320 20 20 34 2e 32 2e 32 20 53 65 72 69 65 65 73 20 69 6e 74 65 72 66 61 63 65 20 2e 2e 2e 2e 2e 2e ┆ 4.2.2 Seriees interface ......┆
0x00320…00340 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 37 0d 0a 20 20 20 ┆........................ 7 ┆
0x00340…00360 20 20 20 20 34 2e 32 2e 33 20 50 61 72 61 6c 6c 65 6c 20 69 6e 74 65 72 66 61 63 65 20 2e 2e 2e ┆ 4.2.3 Parallel interface ...┆
0x00360…00380 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 38 0d 0a 20 ┆.......................... 8 ┆
0x00380…003a0 20 20 34 2e 33 20 43 6c 6f 63 6b 20 47 65 6e 65 72 61 74 6f 72 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆ 4.3 Clock Generator ..........┆
0x003a0…003c0 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 31 31 0d ┆............................ 11 ┆
0x003c0…003e0 0a 20 20 20 34 2e 34 20 49 6e 74 65 72 72 75 70 74 20 6f 70 65 72 61 74 69 6f 6e 20 2e 2e 2e 2e ┆ 4.4 Interrupt operation ....┆
0x003e0…00400 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 31 ┆.............................. 1┆
0x00400…00420 (2,) 31 0d 0a 20 20 20 20 20 20 20 34 2e 34 2e 31 20 49 6e 74 65 72 72 75 70 74 20 53 6f 75 72 63 65 ┆1 4.4.1 Interrupt Source┆
0x00420…00440 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆ ...............................┆
0x00440…00460 20 31 31 0d 0a 20 20 20 20 20 20 20 34 2e 34 2e 32 20 49 6e 74 65 72 72 75 70 74 20 47 65 6e 65 ┆ 11 4.4.2 Interrupt Gene┆
0x00460…00480 72 61 74 6f 72 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆rator ..........................┆
0x00480…004a0 2e 2e 20 31 34 0d 0a 20 20 20 34 2e 35 20 53 6f 66 74 77 61 72 65 20 52 65 73 65 74 20 61 6e 64 ┆.. 14 4.5 Software Reset and┆
0x004a0…004c0 20 50 6f 77 65 72 20 63 6f 6d 6d 61 6e 64 73 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆ Power commands ................┆
0x004c0…004e0 2e 2e 2e 2e 20 31 35 0d 0a 20 20 20 20 20 20 20 34 2e 35 2e 31 20 53 6f 66 74 77 61 72 65 20 52 ┆.... 15 4.5.1 Software R┆
0x004e0…00500 65 73 65 74 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆eset ...........................┆
0x00500…00520 2e 2e 2e 2e 2e 2e 20 31 35 0d 0a 20 20 20 20 20 20 20 34 2e 35 2e 32 20 50 6f 77 65 72 20 44 6f ┆...... 15 4.5.2 Power Do┆
0x00520…00540 77 6e 20 4f 70 65 72 61 74 69 6f 6e 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆wn Operation ...................┆
0x00540…00560 2e 2e 2e 2e 2e 2e 2e 2e 20 31 35 0d 0a 20 20 20 34 2e 36 20 4f 6e 20 62 6f 61 72 64 20 63 6c 6f ┆........ 15 4.6 On board clo┆
0x00560…00580 63 6b 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆ck .............................┆
0x00580…005a0 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 31 36 0d 0a 20 20 20 34 2e 37 20 4d 65 6d 6f 72 79 20 61 64 64 ┆.......... 16 4.7 Memory add┆
0x005a0…005c0 72 65 73 73 69 6e 67 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆ressing ........................┆
0x005c0…005e0 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 31 37 0d 0a 20 20 20 20 20 20 20 34 2e 37 2e 31 20 4f 6e ┆............ 17 4.7.1 On┆
0x005e0…00600 20 62 6f 61 72 64 20 45 50 52 4f 4d 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆ board EPROM ...................┆
0x00600…00620 (3,) 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 31 37 0d 0a 20 20 20 34 2e 38 20 42 75 73 20 49 6e ┆.............. 17 4.8 Bus In┆
0x00620…00640 74 65 72 66 61 63 65 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆terface ........................┆
0x00640…00660 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 31 38 0d 0a 20 20 20 20 20 20 20 34 2e 38 2e ┆................ 18 4.8.┆
0x00660…00680 31 20 4d 55 4c 54 49 42 55 53 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆1 MULTIBUS .....................┆
0x00680…006a0 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 31 38 0d 0a 20 20 20 20 20 20 20 34 2e ┆.................. 18 4.┆
0x006a0…006c0 38 2e 32 20 69 4c 42 58 20 62 75 73 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆8.2 iLBX bus ...................┆
0x006c0…006e0 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 31 39 0d 0a 20 20 20 20 20 20 20 ┆.................... 19 ┆
0x006e0…00700 34 2e 38 2e 33 20 69 53 42 58 20 62 75 73 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆4.8.3 iSBX bus .................┆
0x00700…0071e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 31 39 0d 0a 20 0d 0a ┆...................... 19 ┆
0x0071e…00721 FormFeed {
0x0071e…00721 0c 83 8c ┆ ┆
0x0071e…00721 }
0x00721…00740 0a 06 69 69 0d 0a 0d 0a a1 b0 54 41 42 4c 45 20 4f 46 20 43 4f 4e 54 45 4e 54 53 20 28 63 6f ┆ ii TABLE OF CONTENTS (co┆
0x00740…00760 6e 74 69 6e 75 65 64 29 05 50 41 47 45 0d 0a 0d 0a 35 2e 20 54 45 43 48 4e 49 43 41 4c 20 44 45 ┆ntinued) PAGE 5. TECHNICAL DE┆
0x00760…00780 53 43 52 49 50 54 49 4f 4e 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆SCRIPTION ......................┆
0x00780…007a0 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 32 30 0d 0a 20 20 20 35 2e 31 20 4c 6f 67 69 63 ┆.............. 20 5.1 Logic┆
0x007a0…007c0 20 44 69 61 67 72 61 6d 73 20 77 69 74 68 20 53 69 67 6e 61 6c 20 44 65 73 63 72 69 70 74 69 6f ┆ Diagrams with Signal Descriptio┆
0x007c0…007e0 6e 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 32 30 0d 0a 20 20 20 35 2e 32 20 50 41 ┆n ............... 20 5.2 PA┆
0x007e0…00800 4c 20 61 6e 64 20 50 52 4f 4d 20 44 65 73 63 72 69 70 74 69 6f 6e 73 20 2e 2e 2e 2e 2e 2e 2e 2e ┆L and PROM Descriptions ........┆
0x00800…00820 (4,) 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 36 36 0d 0a 20 20 20 35 2e 33 ┆.................... 66 5.3┆
0x00820…00840 20 54 69 6d 69 6e 67 20 44 69 61 67 72 61 6d 73 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆ Timing Diagrams ...............┆
0x00840…00860 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 38 34 0d 0a 20 20 20 ┆....................... 84 ┆
0x00860…00880 20 20 20 20 35 2e 33 2e 31 20 46 69 72 73 74 20 52 4f 4d 20 61 63 63 65 73 73 20 6f 6e 20 43 50 ┆ 5.3.1 First ROM access on CP┆
0x00880…008a0 55 36 31 30 42 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 38 35 0d 0a ┆U610B .................... 85 ┆
0x008a0…008c0 20 20 20 20 20 20 20 35 2e 33 2e 32 20 38 32 37 34 20 63 79 63 6c 65 20 6f 6e 20 43 50 55 36 31 ┆ 5.3.2 8274 cycle on CPU61┆
0x008c0…008e0 30 41 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 38 ┆0A .......................... 8┆
0x008e0…00900 36 0d 0a 09 20 20 20 35 2e 33 2e 33 20 52 54 43 20 63 79 63 6c 65 20 43 50 55 36 31 30 41 20 2e ┆6 5.3.3 RTC cycle CPU610A .┆
0x00900…00920 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 38 ┆............................. 8┆
0x00920…00940 37 0d 0a 09 20 20 20 35 2e 33 2e 34 20 4d 75 6c 74 69 62 75 73 20 63 79 63 6c 65 20 6f 6e 20 43 ┆7 5.3.4 Multibus cycle on C┆
0x00940…00960 50 55 36 31 30 42 20 74 6f 20 4d 45 4d 36 39 31 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 38 ┆PU610B to MEM691 ............ 8┆
0x00960…00980 38 0d 0a 09 20 20 20 35 2e 33 2e 35 20 69 4c 42 58 62 75 73 20 63 79 63 6c 65 20 43 50 55 36 31 ┆8 5.3.5 iLBXbus cycle CPU61┆
0x00980…009a0 30 42 20 74 6f 20 4d 45 4d 36 39 31 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 38 ┆0B to MEM691 ................ 8┆
0x009a0…009c0 39 0d 0a 20 20 20 35 2e 34 20 50 6c 75 67 73 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆9 5.4 Plugs ................┆
0x009c0…009e0 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆................................┆
0x009e0…00a00 20 20 39 30 0d 0a 09 20 20 20 35 2e 34 2e 31 20 50 31 20 4d 75 6c 74 69 62 75 73 20 43 6f 6e 6e ┆ 90 5.4.1 P1 Multibus Conn┆
0x00a00…00a20 (5,) 65 63 74 6f 72 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆ector ..........................┆
0x00a20…00a40 20 20 39 30 0d 0a 09 20 20 20 35 2e 34 2e 32 20 50 32 20 65 78 74 65 6e 64 65 64 20 4d 75 6c 74 ┆ 90 5.4.2 P2 extended Mult┆
0x00a40…00a60 69 62 75 73 20 43 6f 6e 6e 65 63 74 6f 72 20 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 28 69 ┆ibus Connector (i┆
0x00a60…00a80 4c 42 58 62 75 73 20 63 6f 6e 6e 65 63 74 6f 72 29 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆LBXbus connector) ..............┆
0x00a80…00aa0 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 39 31 0d 0a 09 20 20 20 35 2e 34 2e 33 20 4a 31 ┆.............. 91 5.4.3 J1┆
0x00aa0…00ac0 20 43 6f 6e 73 6f 6c 65 20 49 6e 74 65 72 66 61 63 65 20 43 6f 6e 6e 65 63 74 6f 72 20 2e 2e 2e ┆ Console Interface Connector ...┆
0x00ac0…00ae0 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 39 32 0d 0a 09 20 20 20 35 2e 34 2e 34 20 4a 32 ┆.............. 92 5.4.4 J2┆
0x00ae0…00b00 20 52 53 34 32 32 41 20 4d 75 6c 74 69 64 72 6f 70 20 49 6e 74 65 72 66 61 63 65 20 43 6f 6e 6e ┆ RS422A Multidrop Interface Conn┆
0x00b00…00b20 65 63 74 6f 72 20 2e 2e 2e 2e 2e 2e 2e 2e 20 20 39 33 0d 0a 09 20 20 20 35 2e 34 2e 35 20 4a 33 ┆ector ........ 93 5.4.5 J3┆
0x00b20…00b40 20 50 61 72 61 6c 6c 65 6c 20 50 72 69 6e 74 65 72 20 49 6e 74 65 72 66 61 63 65 20 43 6f 6e 6e ┆ Parallel Printer Interface Conn┆
0x00b40…00b60 65 63 74 6f 72 20 2e 2e 2e 2e 2e 2e 2e 2e 20 20 39 34 0d 0a 20 09 20 20 20 35 2e 34 2e 36 20 4a ┆ector ........ 94 5.4.6 J┆
0x00b60…00b80 34 20 4c 45 44 36 30 33 2c 20 42 42 43 36 30 31 20 61 6e 64 20 4b 65 79 20 49 6e 74 65 72 72 75 ┆4 LED603, BBC601 and Key Interru┆
0x00b80…00ba0 70 74 20 43 6f 6e 6e 65 63 74 6f 72 20 2e 2e 20 20 39 35 0d 0a 09 20 20 20 35 2e 34 2e 37 20 4a ┆pt Connector .. 95 5.4.7 J┆
0x00ba0…00bc0 35 20 69 53 42 58 62 75 73 20 49 6e 74 65 72 66 61 63 65 20 43 6f 6e 6e 65 63 74 6f 72 20 2e 2e ┆5 iSBXbus Interface Connector ..┆
0x00bc0…00be0 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 39 36 0d 0a 20 20 20 35 2e 35 20 4a 75 6d 70 ┆............... 96 5.5 Jump┆
0x00be0…00c00 65 72 73 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆ers ............................┆
0x00c00…00c20 (6,) 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 39 37 0d 0a 20 20 20 35 2e 36 20 45 ┆.................. 97 5.6 E┆
0x00c20…00c40 6e 76 69 72 6f 6e 6d 65 6e 74 61 6c 20 53 70 65 63 69 66 69 63 61 74 69 6f 6e 20 2e 2e 2e 2e 2e ┆nvironmental Specification .....┆
0x00c40…00c60 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 39 38 0d 0a 20 20 20 35 2e ┆..................... 98 5.┆
0x00c60…00c80 37 20 50 68 79 73 69 63 61 6c 20 53 70 65 63 69 66 69 63 61 74 69 6f 6e 73 20 2e 2e 2e 2e 2e 2e ┆7 Physical Specifications ......┆
0x00c80…00ca0 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 39 39 0d 0a 20 20 ┆........................ 99 ┆
0x00ca0…00cc0 20 35 2e 38 20 50 6f 77 65 72 20 53 70 65 63 69 66 69 63 61 74 69 6f 6e 73 20 2e 2e 2e 2e 2e 2e ┆ 5.8 Power Specifications ......┆
0x00cc0…00ce0 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 20 39 39 0d ┆........................... 99 ┆
0x00ce0…00d00 0a 0d 0a 0d 0a a1 b0 41 50 50 45 4e 44 49 58 0d 0a 0d 0a 41 2e 20 52 45 46 45 52 45 4e 43 45 53 ┆ APPENDIX A. REFERENCES┆
0x00d00…00d20 20 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e ┆ ...............................┆
0x00d20…00d36 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 2e 20 31 30 31 0d 0a ┆................ 101 ┆
0x00d36…00d39 FormFeed {
0x00d36…00d39 0c 82 f4 ┆ ┆
0x00d36…00d39 }
0x00d39…00d40 0a 14 b3 20 20 20 20 ┆ ┆
0x00d40…00d60 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 0b ┆ ┆
0x00d60…00d80 0d 0a a1 b0 b0 a1 b0 a1 31 2e 20 20 20 20 20 20 20 49 4e 54 52 4f 44 55 43 54 49 4f 4e 2e 0d 0a ┆ 1. INTRODUCTION. ┆
0x00d80…00da0 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 69 73 20 74 65 63 68 6e 69 63 61 6c 20 6d 61 6e 75 61 ┆ This technical manua┆
0x00da0…00dc0 6c 20 64 65 73 63 72 69 62 65 73 20 74 68 65 20 43 50 55 36 31 30 58 20 28 43 50 55 36 31 30 41 ┆l describes the CPU610X (CPU610A┆
0x00dc0…00de0 20 20 0a 19 89 80 80 36 4d 48 7a 20 61 6e 64 20 43 50 55 36 31 30 42 20 38 4d 48 7a 29 2e 0d 0a ┆ 6MHz and CPU610B 8MHz). ┆
0x00de0…00dec 20 20 20 20 20 20 20 20 20 84 0d 0a ┆ ┆
0x00dec…00def FormFeed {
0x00dec…00def 0c 80 bc ┆ ┆
0x00dec…00def }
0x00def…00e00 0a a1 b0 32 2e 20 20 20 20 20 20 20 47 45 4e 45 52 ┆ 2. GENER┆
0x00e00…00e20 (7,) 41 4c 20 44 45 53 43 52 49 50 54 49 4f 4e 20 4f 46 20 43 50 55 36 31 30 58 2e 0d 0a 0d 0a 20 20 ┆AL DESCRIPTION OF CPU610X. ┆
0x00e20…00e40 20 20 20 20 20 20 20 84 84 54 68 65 20 43 50 55 36 31 30 58 20 63 6f 6e 74 61 69 6e 73 3a 0d 0a ┆ The CPU610X contains: ┆
0x00e40…00e60 0d 0a 20 20 20 20 20 20 20 20 20 31 2e 20 49 4e 54 45 4c 27 73 20 69 20 41 50 58 20 38 30 32 38 ┆ 1. INTEL's i APX 8028┆
0x00e60…00e80 36 20 4d 69 63 72 6f 70 72 6f 63 65 73 73 6f 72 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 32 2e ┆6 Microprocessor. 2.┆
0x00e80…00ea0 20 4d 55 4c 54 49 42 55 53 20 69 6e 74 65 72 66 61 63 65 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 ┆ MULTIBUS interface. ┆
0x00ea0…00ec0 20 33 2e 20 84 69 4c 42 58 20 62 75 73 20 69 6e 74 65 72 66 61 63 65 2c 20 74 68 65 20 43 50 55 ┆ 3. iLBX bus interface, the CPU┆
0x00ec0…00ee0 36 31 30 58 20 61 63 74 73 20 61 73 20 61 20 70 72 69 6d 61 72 79 20 0a 19 8c 80 80 6d 61 73 74 ┆610X acts as a primary mast┆
0x00ee0…00f00 65 72 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 34 2e 20 4f 6e 65 20 69 53 42 58 20 62 75 73 20 ┆er. 4. One iSBX bus ┆
0x00f00…00f20 77 69 74 68 6f 75 74 20 44 4d 41 20 63 68 61 6e 6e 65 6c 20 73 75 70 70 6f 72 74 2e 0d 0a 0d 0a ┆without DMA channel support. ┆
0x00f20…00f40 20 20 20 20 20 20 20 20 20 35 2e 20 43 6f 6e 73 6f 6c 20 69 6e 74 65 72 66 61 63 65 2e 20 28 56 ┆ 5. Consol interface. (V┆
0x00f40…00f60 32 34 2f 52 53 32 33 32 43 29 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 36 2e 20 4d 75 6c 74 69 ┆24/RS232C). 6. Multi┆
0x00f60…00f80 64 72 6f 70 20 69 6e 74 65 72 66 61 63 65 2e 20 28 52 53 34 32 32 41 29 2e 0d 0a 0d 0a 20 20 20 ┆drop interface. (RS422A). ┆
0x00f80…00fa0 20 20 20 20 20 20 37 2e 20 84 50 61 72 61 6c 6c 65 6c 20 70 72 69 6e 74 65 72 20 69 6e 74 65 72 ┆ 7. Parallel printer inter┆
0x00fa0…00fc0 66 61 63 65 2e 20 28 43 65 6e 74 72 6f 6e 69 63 73 20 61 6e 64 20 52 43 37 35 30 20 0a 19 8c 80 ┆face. (Centronics and RC750 ┆
0x00fc0…00fe0 80 50 61 72 74 6e 65 72 20 63 6f 6d 70 61 74 69 62 65 6c 29 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 ┆ Partner compatibel). ┆
0x00fe0…01000 20 20 38 2e 20 84 49 6e 74 65 72 66 61 63 65 20 74 6f 20 74 68 65 20 6c 69 67 68 74 20 65 6d 6d ┆ 8. Interface to the light emm┆
0x01000…01020 (8,) 69 74 69 6e 67 20 70 72 69 6e 74 20 4c 45 44 36 30 33 20 61 6e 64 20 74 68 65 20 0a 19 8c 80 80 ┆iting print LED603 and the ┆
0x01020…01040 42 61 74 74 65 72 79 20 42 61 63 6b 75 70 20 63 6f 6e 74 72 6f 6c 20 75 6e 69 74 20 42 42 43 36 ┆Battery Backup control unit BBC6┆
0x01040…01060 30 31 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 39 2e 20 84 55 70 20 74 6f 20 36 34 4b 20 62 79 ┆01. 9. Up to 64K by┆
0x01060…01080 74 65 73 20 28 32 2a 33 32 4b 20 62 79 74 65 73 29 20 45 50 52 4f 4d 20 69 6e 20 74 77 6f 20 73 ┆tes (2*32K bytes) EPROM in two s┆
0x01080…010a0 74 61 6e 64 61 72 64 20 0a 19 8c 80 80 4a 45 44 45 43 20 73 6f 63 6b 65 74 73 2e 20 31 32 38 20 ┆tandard JEDEC sockets. 128 ┆
0x010a0…010c0 62 79 74 65 73 20 28 32 35 36 2a 34 20 62 69 74 29 20 62 69 70 6f 6c 61 72 20 50 52 4f 4d 2e 0d ┆bytes (256*4 bit) bipolar PROM. ┆
0x010c0…010e0 0a 0d 0a 20 20 20 20 20 20 20 20 31 30 2e 20 84 41 20 72 65 61 6c 20 74 69 6d 65 20 63 6c 6f 63 ┆ 10. A real time cloc┆
0x010e0…01100 6b 20 73 68 6f 77 73 20 74 68 65 20 74 69 6d 65 20 6f 66 20 64 61 79 2c 20 64 61 79 20 6f 66 20 ┆k shows the time of day, day of ┆
0x01100…01120 6d 6f 6e 74 68 20 0a 19 8c 80 80 61 6e 64 20 74 68 65 20 64 61 79 20 6f 66 20 74 68 65 20 79 65 ┆month and the day of the ye┆
0x01120…01140 61 72 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 31 31 2e 20 84 41 73 20 61 6e 20 6f 70 74 69 6f 6e ┆ar. 11. As an option┆
0x01140…01160 20 74 68 65 20 43 50 55 36 31 30 58 20 63 61 6e 20 69 6e 63 6c 75 64 65 20 61 20 6e 75 6d 65 72 ┆ the CPU610X can include a numer┆
0x01160…01180 69 63 20 0a 19 8c 80 80 70 72 6f 63 65 73 73 6f 72 20 38 30 32 38 37 20 66 72 6f 6d 20 49 4e 54 ┆ic processor 80287 from INT┆
0x01180…01187 45 4c 2e 0d 0a 0d 0a ┆EL. ┆
0x01187…0118a FormFeed {
0x01187…0118a 0c 83 80 ┆ ┆
0x01187…0118a }
0x0118a…011a0 0a b0 a1 b0 b0 a1 33 2e 20 20 20 20 20 20 20 42 4c 4f 43 4b 20 44 ┆ 3. BLOCK D┆
0x011a0…011ab 49 41 47 52 41 4d 2e 0d 0a 0d 0a ┆IAGRAM. ┆
0x011ab…011ae FormFeed {
0x011ab…011ae 0c 80 98 ┆ ┆
0x011ab…011ae }
0x011ae…011c0 0a b0 a1 b0 a1 34 2e 20 20 20 20 20 20 20 46 55 4e 43 ┆ 4. FUNC┆
0x011c0…011e0 54 49 4f 4e 41 4c 20 44 45 53 43 52 49 50 54 49 4f 4e 2e 0d 0a 0d 0a a1 b0 f0 e1 20 20 20 20 20 ┆TIONAL DESCRIPTION. ┆
0x011e0…01200 20 20 20 20 84 54 68 69 73 20 63 68 61 70 74 65 72 20 64 65 73 63 72 69 62 65 73 20 74 68 65 20 ┆ This chapter describes the ┆
0x01200…01220 (9,) 75 73 65 20 6f 66 20 74 68 65 20 65 6c 65 6d 65 6e 74 73 20 6f 6e 20 74 68 65 20 0a 19 89 81 80 ┆use of the elements on the ┆
0x01220…01240 43 50 55 20 62 6f 61 72 64 2e 0d 0a 0d 0a 0d 0a b0 a1 34 2e 31 20 20 20 20 20 20 4f 6e 20 62 6f ┆CPU board. 4.1 On bo┆
0x01240…01260 61 72 64 20 43 50 55 2e 0d 0a 0d 0a b0 a1 f0 e1 20 20 20 20 20 20 20 20 20 84 54 68 69 73 20 70 ┆ard CPU. This p┆
0x01260…01280 61 72 74 20 64 65 73 63 72 69 62 65 73 20 74 68 65 20 70 72 6f 63 65 73 73 6f 72 73 20 6f 6e 20 ┆art describes the processors on ┆
0x01280…012a0 74 68 65 20 43 50 55 20 62 6f 61 72 64 2e 20 54 68 65 20 0a 19 89 81 80 43 50 55 20 62 6f 61 72 ┆the CPU board. The CPU boar┆
0x012a0…012c0 64 20 75 73 65 20 49 4e 54 45 4c 27 73 20 38 30 32 38 36 20 61 73 20 74 68 65 20 63 65 6e 74 72 ┆d use INTEL's 80286 as the centr┆
0x012c0…012e0 61 6c 20 70 72 6f 63 65 73 73 6f 72 2e 20 41 73 20 0a 19 89 81 80 61 6e 20 6f 70 74 69 6f 6e 20 ┆al processor. As an option ┆
0x012e0…01300 74 68 65 20 43 50 55 20 62 6f 61 72 64 20 69 6e 63 6c 75 64 65 73 20 69 6e 74 65 72 66 61 63 65 ┆the CPU board includes interface┆
0x01300…01320 20 74 6f 20 74 68 65 20 38 30 32 38 37 20 0a 19 89 81 80 6e 75 6d 65 72 69 63 20 70 72 6f 63 65 ┆ to the 80287 numeric proce┆
0x01320…01340 73 73 6f 72 2e 20 28 53 65 65 20 6c 69 74 74 20 31 20 66 6f 72 20 66 75 72 74 68 65 72 20 64 65 ┆ssor. (See litt 1 for further de┆
0x01340…01360 74 61 69 6c 73 20 6f 66 20 0a 19 89 81 80 74 68 65 20 70 72 6f 63 65 73 73 6f 72 73 29 2e 0d 0a ┆tails of the processors). ┆
0x01360…01380 b0 a1 f0 e1 0d 0a 0d 0a a1 b0 34 2e 31 2e 31 20 20 20 20 38 30 32 38 36 20 43 50 55 2e 0d 0a 0d ┆ 4.1.1 80286 CPU. ┆
0x01380…013a0 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 20 49 4e 54 45 4c 27 73 20 38 30 32 38 36 2d 36 20 28 ┆ The INTEL's 80286-6 (┆
0x013a0…013c0 36 20 4d 48 7a 20 66 6f 72 20 43 50 55 36 31 30 41 29 20 6f 72 20 38 30 32 38 36 20 28 38 20 48 ┆6 MHz for CPU610A) or 80286 (8 H┆
0x013c0…013e0 7a 20 0a 19 89 80 80 66 6f 72 20 43 50 55 36 31 30 42 29 20 69 73 20 74 68 65 20 63 65 6e 74 72 ┆z for CPU610B) is the centr┆
0x013e0…01400 61 6c 20 70 72 6f 63 65 73 73 6f 72 20 6f 6e 20 74 68 65 20 43 50 55 20 62 6f 61 72 64 2e 20 0a ┆al processor on the CPU board. ┆
0x01400…01420 (10,) 19 89 80 80 54 68 65 20 6d 69 63 72 6f 70 72 6f 63 65 73 73 6f 72 20 77 6f 72 6b 20 69 6e 20 74 ┆ The microprocessor work in t┆
0x01420…01440 6f 20 64 69 66 66 65 72 65 6e 74 20 6d 6f 64 65 73 3a 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 31 ┆o different modes: 1┆
0x01440…01460 2e 20 54 68 65 20 72 65 61 6c 20 61 64 64 72 65 73 73 20 6d 6f 64 65 2e 0d 0a 0d 0a 20 20 20 20 ┆. The real address mode. ┆
0x01460…01480 20 20 20 20 20 32 2e 20 54 68 65 20 70 72 6f 74 65 63 74 65 64 20 76 69 72 74 75 61 6c 20 61 64 ┆ 2. The protected virtual ad┆
0x01480…014a0 64 72 65 73 73 20 6d 6f 64 65 2e 20 28 50 56 41 4d 29 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 ┆dress mode. (PVAM) ┆
0x014a0…014c0 49 6e 20 6d 6f 64 65 20 6e 72 20 31 20 74 68 65 20 70 72 6f 63 65 73 73 6f 72 20 61 64 64 72 65 ┆In mode nr 1 the processor addre┆
0x014c0…014e0 73 73 65 73 20 75 70 20 74 6f 20 31 20 4d 62 79 74 65 73 2e 20 49 6e 20 0a 19 89 80 80 6d 6f 64 ┆sses up to 1 Mbytes. In mod┆
0x014e0…01500 65 20 6e 72 20 32 20 69 74 20 61 64 64 72 84 65 73 73 20 75 70 20 31 36 20 4d 62 79 74 65 73 2e ┆e nr 2 it addr ess up 16 Mbytes.┆
0x01500…01520 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 20 70 72 6f 63 65 73 73 6f 72 20 6d 61 6b 65 ┆ The processor make┆
0x01520…01540 73 20 75 73 65 20 6f 66 20 61 6e 20 6f 6e 2d 63 68 69 70 20 6d 65 6d 6f 72 79 20 6d 61 6e 67 65 ┆s use of an on-chip memory mange┆
0x01540…01560 6d 65 6e 74 20 0a 19 89 80 80 69 6e 20 74 68 65 20 70 72 6f 74 65 63 74 65 64 20 76 69 72 74 75 ┆ment in the protected virtu┆
0x01560…01580 61 6c 20 61 64 64 72 65 73 73 20 6d 6f 64 65 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 ┆al address mode The┆
0x01580…015a0 20 43 50 55 20 62 6f 61 72 64 20 62 65 67 69 6e 73 20 69 6e 20 74 68 65 20 72 65 61 6c 20 61 64 ┆ CPU board begins in the real ad┆
0x015a0…015c0 64 72 65 73 73 20 6d 6f 64 65 2e 20 57 68 65 6e 20 74 68 65 20 0a 19 89 80 80 38 30 32 38 36 20 ┆dress mode. When the 80286 ┆
0x015c0…015e0 6d 61 6b 65 73 20 61 20 77 6f 72 64 20 4f 75 74 20 69 6e 73 74 72 75 74 69 6f 6e 20 6f 6e 20 49 ┆makes a word Out instrution on I┆
0x015e0…01600 2f 4f 20 61 64 64 72 65 73 73 20 30 30 43 41 20 74 6f 20 0a 19 89 80 80 74 68 65 20 66 69 72 73 ┆/O address 00CA to the firs┆
0x01600…01620 (11,) 74 20 70 61 72 61 6c 6c 65 6c 20 70 6f 72 74 2c 20 69 74 20 73 77 69 74 63 68 65 73 20 74 6f 20 ┆t parallel port, it switches to ┆
0x01620…01640 70 72 6f 74 65 63 74 65 64 20 6d 6f 64 65 2e 20 0a 19 89 80 80 54 68 65 6e 20 69 74 20 69 73 20 ┆protected mode. Then it is ┆
0x01640…01660 69 6d 70 6f 73 73 69 62 6c 65 20 74 6f 20 73 77 69 74 63 68 20 62 61 63 6b 20 74 6f 20 72 65 61 ┆impossible to switch back to rea┆
0x01660…01678 6c 20 61 64 64 72 65 73 73 20 0a 19 89 80 80 6d 6f 64 65 2e 0d 0a 0d 0a ┆l address mode. ┆
0x01678…0167b FormFeed {
0x01678…0167b 0c 83 bc ┆ ┆
0x01678…0167b }
0x0167b…01680 0a a1 b0 34 2e ┆ 4.┆
0x01680…016a0 31 2e 32 20 20 20 20 4f 70 74 69 6f 6e 61 6c 20 38 30 32 38 37 20 4e 75 6d 65 72 69 63 20 70 72 ┆1.2 Optional 80287 Numeric pr┆
0x016a0…016c0 6f 63 65 73 73 6f 72 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 20 43 50 55 20 62 6f ┆ocessor. The CPU bo┆
0x016c0…016e0 61 72 64 20 63 61 6e 20 62 65 20 65 78 70 61 6e 64 65 64 20 77 69 74 68 20 61 20 6e 75 6d 65 72 ┆ard can be expanded with a numer┆
0x016e0…01700 69 63 20 70 72 6f 63 65 73 73 6f 72 20 0a 19 89 80 80 49 4e 54 45 4c 27 73 20 38 30 32 38 37 20 ┆ic processor INTEL's 80287 ┆
0x01700…01720 28 38 20 4d 48 7a 29 20 6f 72 20 38 30 32 38 37 2d 33 20 28 35 20 4d 48 7a 29 2e 20 54 68 65 20 ┆(8 MHz) or 80287-3 (5 MHz). The ┆
0x01720…01740 70 72 6f 63 65 73 73 6f 72 20 0a 19 89 80 80 69 73 20 75 73 65 64 20 74 6f 20 66 6c 6f 61 74 69 ┆processor is used to floati┆
0x01740…01760 6e 67 20 70 6f 69 6e 74 20 6f 70 65 72 61 74 69 6f 6e 20 61 6e 64 20 6f 74 68 65 72 20 64 69 66 ┆ng point operation and other dif┆
0x01760…01780 66 69 63 75 6c 74 20 0a 19 89 80 80 6e 75 6d 65 72 69 63 20 6f 70 65 72 61 74 69 6f 6e 73 2e 0d ┆ficult numeric operations. ┆
0x01780…017a0 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 41 6c 6c 20 69 6e 74 65 72 66 61 63 65 20 74 6f 20 74 68 ┆ All interface to th┆
0x017a0…017c0 65 20 6e 75 6d 65 72 69 63 20 70 72 6f 63 65 73 73 6f 72 20 69 73 20 6f 6e 20 74 68 65 20 43 50 ┆e numeric processor is on the CP┆
0x017c0…017e0 55 20 0a 19 89 80 80 62 6f 61 72 64 2e 0d 0a 0d 0a 0d 0a f0 a1 b0 a1 b0 a1 34 2e 32 20 20 20 20 ┆U board. 4.2 ┆
0x017e0…01800 20 20 49 2f 4f 20 49 6e 74 65 72 66 61 63 65 2e 0d 0a b0 a1 0d 0a b0 a1 f0 e1 20 20 20 20 20 20 ┆ I/O Interface. ┆
0x01800…01820 (12,) 20 20 20 84 54 68 65 20 6e 65 78 74 20 70 61 72 74 20 6f 66 20 63 68 61 70 74 65 72 20 66 6f 75 ┆ The next part of chapter fou┆
0x01820…01840 72 20 64 65 73 63 72 69 62 65 73 20 74 68 65 20 75 73 65 20 6f 66 20 74 68 65 20 0a 19 89 81 80 ┆r describes the use of the ┆
0x01840…01860 69 41 50 58 32 38 36 20 49 2f 4f 20 61 64 64 72 65 73 73 20 73 70 61 63 65 2e 0d 0a 0d 0a 0d 0a ┆iAPX286 I/O address space. ┆
0x01860…01880 b0 a1 34 2e 32 2e 31 20 20 20 20 49 2f 4f 20 61 64 64 72 65 73 73 69 6e 67 20 6f 6e 20 62 6f 61 ┆ 4.2.1 I/O addressing on boa┆
0x01880…018a0 72 64 2e 0d 0a b0 a1 0d 0a 20 20 20 20 20 20 20 20 20 b0 a1 44 65 76 69 63 65 20 20 20 20 20 20 ┆rd. Device ┆
0x018a0…018c0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 44 61 74 61 20 73 69 7a 65 20 20 20 20 20 49 2f 4f ┆ Data size I/O┆
0x018c0…018e0 20 20 61 64 64 72 65 73 73 20 20 20 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 50 41 4c 30 31 32 2e ┆ address PAL012.┆
0x018e0…01900 20 28 49 6e 74 65 72 72 75 70 74 20 6f 75 74 29 2e 20 20 42 79 74 65 20 3a 20 52 65 73 65 74 20 ┆ (Interrupt out). Byte : Reset ┆
0x01900…01920 20 20 20 20 20 30 30 38 32 0d 0a 20 20 20 20 20 20 20 20 20 50 41 4c 30 31 32 2e 20 28 49 6e 74 ┆ 0082 PAL012. (Int┆
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0x01980…019a0 0a 20 20 20 20 20 20 20 20 20 52 54 43 2e 20 28 4d 4d 31 35 38 31 36 37 41 2f 52 54 43 35 38 33 ┆ RTC. (MM158167A/RTC583┆
0x019a0…019c0 32 31 29 20 42 79 74 65 2f 34 20 62 69 74 20 20 20 20 20 20 20 20 30 30 38 41 0d 0a 20 20 20 20 ┆21) Byte/4 bit 008A ┆
0x019c0…019e0 20 20 20 20 20 38 32 35 39 41 2d 32 20 50 49 43 2e 20 28 53 6c 61 76 65 32 29 2e 20 20 20 20 42 ┆ 8259A-2 PIC. (Slave2). B┆
0x019e0…01a00 79 74 65 3a 20 53 74 61 74 75 73 2e 20 20 20 20 20 30 30 39 34 e1 f0 e1 f0 e1 f0 e1 f0 e1 f0 0d ┆yte: Status. 0094 ┆
0x01a00…01a20 (13,) 0a 20 20 20 20 20 20 20 20 20 38 32 35 39 41 2d 32 20 50 49 43 2e 20 28 53 6c 61 76 65 32 29 2e ┆ 8259A-2 PIC. (Slave2).┆
0x01a20…01a40 20 20 20 20 42 79 74 65 3a 20 4d 41 53 4b 2e 20 20 20 20 20 20 20 30 30 39 36 e1 f0 e1 f0 e1 f0 ┆ Byte: MASK. 0096 ┆
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0x01aa0…01ac0 20 28 50 61 72 61 6c 6c 65 6c 20 32 29 20 42 79 74 65 3a 20 50 6f 72 74 20 42 20 49 6e 2e 20 20 ┆ (Parallel 2) Byte: Port B In. ┆
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0x01b00…01b20 f0 e1 f0 e1 f0 e1 f0 e1 f0 0d 0a 20 20 20 20 20 20 20 20 20 38 32 35 35 41 2d 35 20 50 50 49 2e ┆ 8255A-5 PPI.┆
0x01b20…01b40 20 28 50 61 72 61 6c 6c 65 6c 20 32 29 20 42 79 74 65 3a 20 43 6f 6e 74 72 6f 6c 2e 20 20 20 20 ┆ (Parallel 2) Byte: Control. ┆
0x01b40…01b60 30 30 39 45 e1 f0 e1 f0 e1 f0 e1 f0 e1 f0 0d 0a 20 20 20 20 20 20 20 20 20 69 53 42 58 20 62 75 ┆009E iSBX bu┆
0x01b60…01b80 73 2e 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 42 79 74 65 2f 77 6f 72 64 20 20 20 20 ┆s. Byte/word ┆
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0x01c20…01c40 0a 20 20 20 20 20 20 20 20 20 38 32 35 39 41 2d 32 20 50 49 43 2e 20 28 53 6c 61 76 65 31 29 2e ┆ 8259A-2 PIC. (Slave1).┆
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0x01c60…01c80 e1 f0 e1 f0 0d 0a 20 20 20 20 20 20 20 20 20 38 32 35 39 41 2d 32 20 50 49 43 2e 20 28 53 6c 61 ┆ 8259A-2 PIC. (Sla┆
0x01c80…01ca0 76 65 31 29 2e 20 20 20 20 42 79 74 65 3a 20 4d 41 53 4b 2e 20 20 20 20 20 20 20 30 30 43 36 e1 ┆ve1). Byte: MASK. 00C6 ┆
0x01ca0…01cab f0 e1 f0 e1 f0 e1 f0 e1 f0 0d 0a ┆ ┆
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0x01cab…01cae 0c 83 b0 ┆ ┆
0x01cab…01cae }
0x01cae…01cc0 0a 20 20 20 20 20 20 20 20 20 b0 a1 44 65 76 69 63 65 ┆ Device┆
0x01cc0…01ce0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 44 61 74 61 20 73 69 7a 65 20 20 ┆ Data size ┆
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0x01d40…01d60 20 20 20 20 38 32 35 35 41 2d 35 20 50 50 49 2e 20 28 50 61 72 61 6c 6c 65 6c 20 31 29 20 42 79 ┆ 8255A-5 PPI. (Parallel 1) By┆
0x01d60…01d80 74 65 3a 20 50 6f 72 74 20 42 20 49 6e 2e 20 20 30 30 43 41 0d 0a 20 20 20 20 20 20 20 20 20 20 ┆te: Port B In. 00CA ┆
0x01d80…01da0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 77 6f 72 64 3a 20 57 ┆ word: W┆
0x01da0…01dc0 52 20 50 56 41 4d 20 20 20 20 20 30 30 43 41 0d 0a 20 20 20 20 20 20 20 20 20 38 32 35 35 41 2d ┆R PVAM 00CA 8255A-┆
0x01dc0…01de0 35 20 50 50 49 2e 20 28 50 61 72 61 6c 6c 65 6c 20 31 29 20 42 79 74 65 3a 20 50 6f 72 74 20 43 ┆5 PPI. (Parallel 1) Byte: Port C┆
0x01de0…01e00 20 4f 75 74 2e 20 30 30 43 43 e1 f0 e1 f0 e1 f0 e1 f0 e1 f0 0d 0a 20 20 20 20 20 20 20 20 20 38 ┆ Out. 00CC 8┆
0x01e00…01e20 (15,) 32 35 35 41 2d 35 20 50 50 49 2e 20 28 50 61 72 61 6c 6c 65 6c 20 31 29 20 42 79 74 65 3a 20 43 ┆255A-5 PPI. (Parallel 1) Byte: C┆
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0x01e40…01e60 20 20 20 20 38 32 35 34 20 20 50 49 54 2e 20 28 54 69 6d 65 72 29 2e 20 20 20 20 20 20 20 42 79 ┆ 8254 PIT. (Timer). By┆
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0x01e80…01ea0 20 20 20 20 20 20 20 20 20 38 32 35 34 20 20 50 49 54 2e 20 28 54 69 6d 65 72 29 2e 20 20 20 20 ┆ 8254 PIT. (Timer). ┆
0x01ea0…01ec0 20 20 20 42 79 74 65 3a 20 43 6f 75 6e 74 65 72 20 31 20 20 20 30 30 44 32 e1 f0 e1 f0 e1 f0 e1 ┆ Byte: Counter 1 00D2 ┆
0x01ec0…01ee0 f0 e1 f0 0d 0a 20 20 20 20 20 20 20 20 20 38 32 35 34 20 20 50 49 54 2e 20 28 54 69 6d 65 72 29 ┆ 8254 PIT. (Timer)┆
0x01ee0…01f00 2e 20 20 20 20 20 20 20 42 79 74 65 3a 20 43 6f 75 6e 74 65 72 20 32 20 20 20 30 30 44 34 e1 f0 ┆. Byte: Counter 2 00D4 ┆
0x01f00…01f20 e1 f0 e1 f0 e1 f0 e1 f0 0d 0a 20 20 20 20 20 20 20 20 20 38 32 35 34 20 20 50 49 54 2e 20 28 54 ┆ 8254 PIT. (T┆
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0x01fa0…01fc0 34 20 20 4d 50 53 43 2e 20 43 48 20 42 2e 20 20 20 20 20 20 20 20 20 42 79 74 65 3a 20 44 61 74 ┆4 MPSC. CH B. Byte: Dat┆
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0x02020…02040 20 20 20 20 20 20 20 38 32 37 34 20 20 4d 50 53 43 2e 20 43 48 20 42 2e 20 20 20 20 20 20 20 20 ┆ 8274 MPSC. CH B. ┆
0x02040…02060 20 42 79 74 65 3a 20 43 6f 6e 74 72 6f 6c 2e 20 20 20 20 30 30 44 45 e1 f0 e1 f0 e1 f0 e1 f0 e1 ┆ Byte: Control. 00DE ┆
0x02060…02080 f0 0d 0a 20 20 20 20 20 20 20 20 20 38 30 32 38 37 20 4e 75 6d 72 69 63 20 50 72 6f 63 65 73 73 ┆ 80287 Numric Process┆
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0x020e0…02100 37 20 4e 75 6d 72 69 63 20 50 72 6f 63 65 73 73 6f 72 2e 20 20 20 57 6f 72 64 3a 20 44 61 74 61 ┆7 Numric Processor. Word: Data┆
0x02100…02120 2e 20 20 20 20 20 20 20 30 30 46 41 e1 f0 e1 f0 e1 f0 e1 f0 e1 f0 0d 0a 20 20 20 20 20 20 20 20 ┆. 00FA ┆
0x02120…02140 20 38 30 32 38 37 20 4e 75 6d 72 69 63 20 50 72 6f 63 65 73 73 6f 72 2e 20 20 20 57 6f 72 64 3a ┆ 80287 Numric Processor. Word:┆
0x02140…02160 20 41 64 64 72 65 73 73 2e 20 20 20 20 30 30 46 43 e1 f0 e1 f0 e1 f0 e1 f0 e1 f0 0d 0a 0d 0a 20 ┆ Address. 00FC ┆
0x02160…02180 b0 20 20 20 20 20 20 20 20 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆ -----------------------┆
0x02180…021a0 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆--------------------------------┆
0x021a0…021c0 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 46 69 67 20 34 2e 32 2e 31 20 84 49 2f 4f 20 61 64 64 72 ┆ Fig 4.2.1 I/O addr┆
0x021c0…021e0 65 73 73 65 73 20 6f 6e 20 74 68 65 20 43 50 55 20 62 6f 61 72 64 2e 0d 0a 0d 0a 20 20 20 20 20 ┆esses on the CPU board. ┆
0x021e0…02200 20 20 20 20 b0 a1 54 61 72 67 65 74 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ Target ┆
0x02200…02220 (17,) 20 44 61 74 61 20 73 69 7a 65 20 20 20 20 20 49 2f 4f 20 20 61 64 64 72 65 73 73 20 20 20 0d 0a ┆ Data size I/O address ┆
0x02220…02240 0d 0a 20 20 20 20 20 20 20 20 20 4d 55 4c 49 42 55 53 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ MULIBUS ┆
0x02240…02260 20 20 20 20 20 20 62 79 74 65 2f 77 6f 72 64 20 20 20 20 20 30 30 30 30 2d 30 30 37 46 0d 0a 20 ┆ byte/word 0000-007F ┆
0x02260…02280 20 20 20 20 20 20 20 20 20 20 2d 22 2d 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ -"- ┆
0x02280…022a0 20 20 20 20 20 20 2d 22 2d 20 20 20 20 20 20 20 20 30 31 30 30 2d 46 46 46 46 0d 0a 0d 0a 20 b0 ┆ -"- 0100-FFFF ┆
0x022a0…022c0 20 20 20 20 20 20 20 20 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆ ------------------------┆
0x022c0…022e0 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d ┆------------------------------- ┆
0x022e0…02300 0a 0d 0a 20 20 20 20 20 20 20 20 20 46 69 67 20 34 2e 32 2e 32 20 84 49 2f 4f 20 61 64 64 72 65 ┆ Fig 4.2.2 I/O addre┆
0x02300…02320 73 73 65 73 20 66 72 6f 6d 20 69 20 41 50 58 20 38 30 32 38 36 20 74 6f 20 74 68 65 20 0a 19 93 ┆sses from i APX 80286 to the ┆
0x02320…0232d 80 80 4d 55 4c 54 49 42 55 53 2e 0d 0a ┆ MULTIBUS. ┆
0x0232d…02330 FormFeed {
0x0232d…02330 0c 83 8c ┆ ┆
0x0232d…02330 }
0x02330…02340 0a 20 20 20 20 20 20 20 20 20 b0 a1 54 61 72 67 ┆ Targ┆
0x02340…02360 65 74 20 20 20 20 20 20 43 68 69 70 20 73 65 6c 65 63 74 20 20 20 20 20 44 61 74 61 20 73 69 7a ┆et Chip select Data siz┆
0x02360…02380 65 20 20 20 20 20 49 2f 4f 20 20 61 64 64 72 65 73 73 20 20 20 0d 0a 0d 0a 20 20 20 20 20 20 20 ┆e I/O address ┆
0x02380…023a0 20 20 69 53 42 58 20 62 75 73 20 20 20 20 20 20 2f 4d 43 53 30 20 20 20 20 20 20 20 20 20 20 20 ┆ iSBX bus /MCS0 ┆
0x023a0…023c0 20 62 79 74 65 20 20 20 20 20 20 20 30 30 41 30 2d 30 30 41 46 0d 0a 20 20 20 20 20 20 20 20 20 ┆ byte 00A0-00AF ┆
0x023c0…023e0 20 20 2d 22 2d 20 20 20 20 20 20 20 20 20 2f 4d 43 53 31 20 20 20 20 20 20 20 20 20 20 20 20 62 ┆ -"- /MCS1 b┆
0x023e0…02400 79 74 65 20 20 20 20 20 20 20 30 30 42 30 2d 30 30 42 46 0d 0a 20 20 20 20 20 20 20 20 20 69 53 ┆yte 00B0-00BF iS┆
0x02400…02420 (18,) 42 58 20 62 75 73 20 20 20 20 20 20 2f 4d 43 53 30 20 20 20 20 20 20 20 20 20 20 20 20 77 6f 72 ┆BX bus /MCS0 wor┆
0x02420…02440 64 20 20 20 20 20 20 20 30 30 41 30 2d 30 30 41 38 0d 0a 20 20 20 20 20 20 20 20 20 20 20 2d 22 ┆d 00A0-00A8 -"┆
0x02440…02460 2d 20 20 20 20 20 20 20 20 20 2f 4d 43 53 31 20 20 20 20 20 20 20 20 20 20 20 20 77 6f 72 64 20 ┆- /MCS1 word ┆
0x02460…02480 20 20 20 20 20 20 30 30 41 30 2d 30 30 41 46 0d 0a 0d 0a 20 b0 20 20 20 20 20 20 20 20 2d 2d 2d ┆ 00A0-00AF ---┆
0x02480…024a0 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆--------------------------------┆
0x024a0…024c0 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a 0d 0a 20 20 20 20 20 20 20 20 ┆-------------------- ┆
0x024c0…024e0 20 46 69 67 20 34 2e 32 2e 33 20 84 49 2f 4f 20 61 64 64 72 65 73 73 65 73 20 66 72 6f 6d 20 69 ┆ Fig 4.2.3 I/O addresses from i┆
0x024e0…02500 20 41 50 58 20 38 30 32 38 36 20 74 6f 20 74 68 65 20 69 53 42 58 20 0a 19 93 80 80 62 75 73 2e ┆ APX 80286 to the iSBX bus.┆
0x02500…02520 0d 0a 0d 0a 0d 0a b0 a1 34 2e 32 2e 32 20 20 20 20 53 65 72 69 65 65 73 20 a1 b0 69 6e 74 65 72 ┆ 4.2.2 Seriees inter┆
0x02520…02540 66 61 63 65 2e 0d 0a b0 a1 f0 e1 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 20 43 50 55 20 62 ┆face. The CPU b┆
0x02540…02560 6f 61 72 64 20 68 61 73 20 74 77 6f 20 73 65 72 69 65 65 73 20 63 68 61 6e 6e 65 6c 73 20 41 20 ┆oard has two seriees channels A ┆
0x02560…02580 61 6e 64 20 42 2e 20 43 68 61 6e 6e 65 6c 20 41 20 0a 19 89 80 80 6d 61 6b 65 73 20 74 68 65 20 ┆and B. Channel A makes the ┆
0x02580…025a0 63 6f 6e 6e 65 63 74 69 6f 6e 20 74 6f 20 74 68 65 20 6d 75 6c 74 69 64 72 6f 70 20 52 53 34 32 ┆connection to the multidrop RS42┆
0x025a0…025c0 32 41 20 6c 69 6e 65 2e 20 0a 19 89 80 80 43 68 61 6e 6e 65 6c 20 42 20 74 61 6b 65 73 20 63 61 ┆2A line. Channel B takes ca┆
0x025c0…025e0 72 65 20 6f 66 20 74 68 65 20 63 6f 6e 73 6f 6c 20 77 69 74 68 20 52 53 32 33 32 43 20 0a 19 89 ┆re of the consol with RS232C ┆
0x025e0…02600 80 80 69 6e 74 65 72 66 61 63 65 2e 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 20 49 4e 54 45 ┆ interface. The INTE┆
0x02600…02620 (19,) 4c 27 73 20 38 32 37 34 20 4d 75 6c 74 69 2d 70 72 6f 74 6f 63 6f 6c 20 53 65 72 69 61 6c 20 43 ┆L's 8274 Multi-protocol Serial C┆
0x02620…02640 6f 6e 74 72 6f 6c 6c 65 72 20 28 4d 50 53 43 29 20 0a 19 89 80 80 74 61 6b 65 73 20 63 61 72 65 ┆ontroller (MPSC) takes care┆
0x02640…02660 20 6f 66 20 6d 6f 73 74 20 6f 66 20 74 68 65 20 73 65 72 69 65 65 73 20 63 6f 6d 6d 75 6e 69 63 ┆ of most of the seriees communic┆
0x02660…02680 61 74 69 6f 6e 2e 20 54 77 6f 20 0a 19 89 80 80 65 78 74 72 61 20 73 69 67 6e 61 6c 73 20 69 6e ┆ation. Two extra signals in┆
0x02680…026a0 20 63 68 61 6e 6e 65 6c 20 42 20 2f 44 53 52 42 20 28 44 61 74 61 20 53 65 74 20 52 65 61 64 79 ┆ channel B /DSRB (Data Set Ready┆
0x026a0…026c0 29 20 61 6e 64 20 0a 19 89 80 80 2f 43 49 42 20 28 43 61 6c 6c 69 6e 67 20 49 6e 64 69 63 61 74 ┆) and /CIB (Calling Indicat┆
0x026c0…026e0 6f 72 29 20 69 6e 74 65 72 66 61 63 65 20 74 6f 20 74 68 65 20 70 61 72 61 6c 6c 65 6c 20 70 6f ┆or) interface to the parallel po┆
0x026e0…02700 72 74 20 0a 19 89 80 80 31 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 20 75 73 65 64 ┆rt 1. The used┆
0x02700…02720 20 73 69 67 6e 61 6c 73 20 69 6e 20 63 68 61 6e 6e 65 6c 20 41 20 61 72 65 20 3a 0d 0a 0d 0a 20 ┆ signals in channel A are : ┆
0x02720…02740 b0 20 20 20 20 20 20 20 84 20 b0 a1 53 69 67 6e 61 6c 20 20 20 20 20 20 20 20 20 20 4d 65 61 6e ┆ Signal Mean┆
0x02740…02760 69 6e 67 20 20 20 20 20 20 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 54 58 44 41 20 20 20 20 20 20 ┆ing TXDA ┆
0x02760…02780 20 20 20 54 72 61 6e 73 6d 69 74 74 65 64 20 44 61 74 61 0d 0a 20 20 20 20 20 20 20 20 20 52 58 ┆ Transmitted Data RX┆
0x02780…027a0 44 41 20 20 20 20 20 20 20 20 20 52 65 63 65 69 76 65 64 20 44 61 74 61 0d 0a 20 20 20 20 20 20 ┆DA Received Data ┆
0x027a0…027c0 20 20 20 2f 52 54 53 41 20 20 20 20 20 20 20 20 52 65 71 75 65 73 74 20 54 6f 20 53 65 6e 64 0d ┆ /RTSA Request To Send ┆
0x027c0…027e0 0a 20 20 20 20 20 20 20 20 20 2f 43 54 53 41 20 20 20 20 20 20 20 20 52 65 61 64 79 20 46 6f 72 ┆ /CTSA Ready For┆
0x027e0…02800 20 53 65 6e 64 69 6e 67 0d 0a 20 20 20 20 20 20 20 20 20 2f 43 44 41 20 20 20 20 20 20 20 20 20 ┆ Sending /CDA ┆
0x02800…02820 (20,) 43 61 72 72 69 65 72 20 4f 6e 0d 0a 20 20 20 20 20 20 20 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆Carrier On -------------┆
0x02820…02836 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a 0d 0a ┆------------------ ┆
0x02836…02839 FormFeed {
0x02836…02839 0c 83 b0 ┆ ┆
0x02836…02839 }
0x02839…02840 0a 20 20 20 20 20 20 ┆ ┆
0x02840…02860 20 20 20 84 54 68 65 20 75 73 65 64 20 73 69 67 6e 61 6c 73 20 69 6e 20 63 68 61 6e 6e 61 6c 20 ┆ The used signals in channal ┆
0x02860…02880 42 20 61 72 65 20 3a 0d 0a 0d 0a 20 b0 20 20 20 20 20 20 20 84 20 b0 a1 53 69 67 6e 61 6c 20 20 ┆B are : Signal ┆
0x02880…028a0 20 20 20 20 20 20 20 20 4d 65 61 6e 69 6e 67 20 20 20 20 20 20 0d 0a 0d 0a 20 20 20 20 20 20 20 ┆ Meaning ┆
0x028a0…028c0 20 20 54 58 44 42 20 20 20 20 20 20 20 20 20 54 72 61 6e 73 6d 69 74 74 65 64 20 44 61 74 61 0d ┆ TXDB Transmitted Data ┆
0x028c0…028e0 0a 20 20 20 20 20 20 20 20 20 52 58 44 42 20 20 20 20 20 20 20 20 20 52 65 63 65 69 76 65 64 20 ┆ RXDB Received ┆
0x028e0…02900 44 61 74 61 0d 0a 20 20 20 20 20 20 20 20 20 2f 52 54 53 42 20 20 20 20 20 20 20 20 52 65 71 75 ┆Data /RTSB Requ┆
0x02900…02920 65 73 74 20 54 6f 20 53 65 6e 64 0d 0a 20 20 20 20 20 20 20 20 20 2f 43 54 53 42 20 20 20 20 20 ┆est To Send /CTSB ┆
0x02920…02940 20 20 20 52 65 61 64 79 20 46 6f 72 20 53 65 6e 64 69 6e 67 0d 0a 20 20 20 20 20 20 20 20 20 2f ┆ Ready For Sending /┆
0x02940…02960 44 53 52 42 20 20 20 20 20 20 20 20 44 61 74 61 20 53 65 74 20 52 65 61 64 79 0d 0a 20 20 20 20 ┆DSRB Data Set Ready ┆
0x02960…02980 20 20 20 20 20 2f 43 44 42 20 20 20 20 20 20 20 20 20 43 61 72 72 69 65 72 20 4f 6e 0d 0a 20 20 ┆ /CDB Carrier On ┆
0x02980…029a0 20 20 20 20 20 20 20 2f 43 49 42 20 20 20 20 20 20 20 20 20 43 61 6c 6c 69 6e 67 20 49 6e 64 69 ┆ /CIB Calling Indi┆
0x029a0…029c0 63 61 74 6f 72 0d 0a 20 20 20 20 20 20 20 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆cator ------------------┆
0x029c0…029e0 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a 0d 0a 0d 0a b0 a1 34 2e 32 2e 33 20 20 20 20 50 61 ┆------------- 4.2.3 Pa┆
0x029e0…02a00 72 61 6c 6c 65 6c 20 69 6e 74 65 72 66 61 63 65 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 54 ┆rallel interface. T┆
0x02a00…02a20 (21,) 68 65 72 65 20 61 72 65 20 74 77 6f 20 70 61 72 61 6c 6c 65 6c 20 70 6f 72 74 73 20 6f 6e 20 74 ┆here are two parallel ports on t┆
0x02a20…02a40 68 65 20 62 6f 61 72 64 2e 20 54 68 65 20 49 4e 54 45 4c 27 73 20 0a 19 89 80 80 70 61 72 61 6c ┆he board. The INTEL's paral┆
0x02a40…02a60 6c 65 6c 20 70 6f 72 74 20 38 32 35 35 41 2d 35 20 69 73 20 75 73 65 64 20 69 6e 20 62 6f 74 68 ┆lel port 8255A-5 is used in both┆
0x02a60…02a80 20 63 61 73 65 73 2e 20 54 68 65 20 70 6f 72 74 20 41 20 0a 19 89 80 80 61 6e 64 20 43 20 61 72 ┆ cases. The port A and C ar┆
0x02a80…02aa0 65 20 6f 75 74 70 75 74 20 70 6f 72 74 73 20 61 6e 64 20 42 20 69 73 20 61 6e 20 69 6e 70 75 74 ┆e output ports and B is an input┆
0x02aa0…02ac0 20 70 6f 72 74 2e 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 20 66 69 72 73 74 20 70 61 72 61 ┆ port. The first para┆
0x02ac0…02ae0 6c 6c 65 6c 20 70 6f 72 74 20 63 6f 6e 6e 65 63 74 20 61 20 70 72 69 6e 74 65 72 20 74 6f 20 74 ┆llel port connect a printer to t┆
0x02ae0…02b00 68 65 20 43 50 55 20 0a 19 89 80 80 62 6f 61 72 64 2e 20 54 68 65 20 70 72 69 6e 74 65 72 20 69 ┆he CPU board. The printer i┆
0x02b00…02b20 6e 74 65 72 66 61 63 65 20 6d 75 73 74 20 62 65 20 61 20 52 43 37 35 30 20 28 22 50 41 52 54 4e ┆nterface must be a RC750 ("PARTN┆
0x02b20…02b40 45 52 22 29 20 0a 19 89 80 80 6f 72 20 43 65 6e 74 72 6f 6e 69 63 73 20 63 6f 6d 70 61 74 69 62 ┆ER") or Centronics compatib┆
0x02b40…02b60 6c 65 20 69 6e 74 65 72 66 61 63 65 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 20 6e ┆le interface. The n┆
0x02b60…02b80 65 78 74 20 70 61 72 61 6c 6c 65 6c 20 70 6f 72 74 20 69 6e 63 6c 75 64 65 73 20 74 68 65 20 61 ┆ext parallel port includes the a┆
0x02b80…02ba0 64 64 72 65 73 73 65 73 20 74 6f 20 74 68 65 20 0a 19 89 80 80 52 65 61 6c 20 54 69 6d 65 20 43 ┆ddresses to the Real Time C┆
0x02ba0…02bc0 6c 6f 63 6b 2c 20 74 68 65 20 62 69 70 6f 6c 61 72 20 50 52 4f 4d 20 61 6e 64 20 73 6f 6d 65 20 ┆lock, the bipolar PROM and some ┆
0x02bc0…02be0 73 70 65 63 69 61 6c 20 0a 19 89 80 80 73 69 67 6e 61 6c 73 2e 20 28 53 65 65 20 74 68 65 20 6c ┆special signals. (See the l┆
0x02be0…02c00 69 73 74 20 62 65 6c 6f 77 29 2e 0d 0a b0 a1 f0 e1 0d 0a 20 20 20 20 20 20 20 20 20 53 69 67 6e ┆ist below). Sign┆
0x02c00…02c20 (22,) 61 6c 73 20 66 72 6f 6d 20 70 61 72 61 6c 6c 65 6c 20 70 6f 72 74 20 6e 72 2e 20 31 0d 0a 0d 0a ┆als from parallel port nr. 1 ┆
0x02c20…02c40 20 20 20 20 20 20 20 20 20 a1 b0 50 69 6e 20 20 20 20 20 20 20 20 20 53 69 67 6e 61 6c 20 20 20 ┆ Pin Signal ┆
0x02c40…02c60 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ ┆
0x02c60…02c80 20 20 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 50 41 30 20 20 20 20 20 20 20 20 44 41 54 41 20 30 ┆ PA0 DATA 0┆
0x02c80…02ca0 20 28 50 72 69 6e 74 65 72 29 0d 0a 20 20 20 20 20 20 20 20 20 50 41 31 20 20 20 20 20 20 20 20 ┆ (Printer) PA1 ┆
0x02ca0…02cc0 44 41 54 41 20 31 20 28 50 72 69 6e 74 65 72 29 0d 0a 20 20 20 20 20 20 20 20 20 50 41 32 20 20 ┆DATA 1 (Printer) PA2 ┆
0x02cc0…02ce0 20 20 20 20 20 20 44 41 54 41 20 32 20 28 50 72 69 6e 74 65 72 29 0d 0a 20 20 20 20 20 20 20 20 ┆ DATA 2 (Printer) ┆
0x02ce0…02d00 20 50 41 33 20 20 20 20 20 20 20 20 44 41 54 41 20 33 20 28 50 72 69 6e 74 65 72 29 0d 0a 20 20 ┆ PA3 DATA 3 (Printer) ┆
0x02d00…02d20 20 20 20 20 20 20 20 50 41 34 20 20 20 20 20 20 20 20 44 41 54 41 20 34 20 28 50 72 69 6e 74 65 ┆ PA4 DATA 4 (Printe┆
0x02d20…02d40 72 29 0d 0a 20 20 20 20 20 20 20 20 20 50 41 35 20 20 20 20 20 20 20 20 44 41 54 41 20 35 20 28 ┆r) PA5 DATA 5 (┆
0x02d40…02d60 50 72 69 6e 74 65 72 29 0d 0a 20 20 20 20 20 20 20 20 20 50 41 36 20 20 20 20 20 20 20 20 44 41 ┆Printer) PA6 DA┆
0x02d60…02d80 54 41 20 36 20 28 50 72 69 6e 74 65 72 29 0d 0a 20 20 20 20 20 20 20 20 20 50 41 37 20 20 20 20 ┆TA 6 (Printer) PA7 ┆
0x02d80…02d98 20 20 20 20 44 41 54 41 20 37 20 28 50 72 69 6e 74 65 72 29 0d 0a 0d 0a ┆ DATA 7 (Printer) ┆
0x02d98…02d9b FormFeed {
0x02d98…02d9b 0c 83 e0 ┆ ┆
0x02d98…02d9b }
0x02d9b…02da0 0a 20 20 20 20 ┆ ┆
0x02da0…02dc0 20 20 20 20 20 a1 b0 50 69 6e 20 20 20 20 20 20 20 20 20 53 69 67 6e 61 6c 20 20 20 20 20 20 20 ┆ Pin Signal ┆
0x02dc0…02de0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 0d 0a ┆ ┆
0x02de0…02e00 0d 0a 20 20 20 20 20 20 20 20 20 50 42 30 20 20 20 20 20 20 20 20 4e 6f 74 20 69 6e 20 75 73 65 ┆ PB0 Not in use┆
0x02e00…02e20 (23,) 2e 0d 0a 20 20 20 20 20 20 20 20 20 50 42 31 20 20 20 20 20 20 20 20 2f 43 49 42 20 28 43 61 6c ┆. PB1 /CIB (Cal┆
0x02e20…02e40 6c 69 6e 67 20 49 6e 64 69 63 61 74 6f 72 20 74 6f 20 63 6f 6e 73 6f 6c 29 0d 0a 20 20 20 20 20 ┆ling Indicator to consol) ┆
0x02e40…02e60 20 20 20 20 50 42 32 20 20 20 20 20 20 20 20 2f 44 53 52 42 20 28 44 61 74 61 20 53 65 74 20 52 ┆ PB2 /DSRB (Data Set R┆
0x02e60…02e80 65 61 64 79 20 74 6f 20 63 6f 6e 73 6f 6c 29 0d 0a 20 20 20 20 20 20 20 20 20 50 42 33 20 20 20 ┆eady to consol) PB3 ┆
0x02e80…02ea0 20 20 20 20 20 42 55 53 59 20 28 50 72 69 6e 74 65 72 29 0d 0a 20 20 20 20 20 20 20 20 20 50 42 ┆ BUSY (Printer) PB┆
0x02ea0…02ec0 34 20 20 20 20 20 20 20 20 2f 41 43 4b 20 28 50 72 69 6e 74 65 72 29 0d 0a 20 20 20 20 20 20 20 ┆4 /ACK (Printer) ┆
0x02ec0…02ee0 20 20 50 42 35 20 20 20 20 20 20 20 20 2f 46 41 55 4c 54 20 28 50 72 69 6e 74 65 72 29 0d 0a 20 ┆ PB5 /FAULT (Printer) ┆
0x02ee0…02f00 20 20 20 20 20 20 20 20 50 42 36 20 20 20 20 20 20 20 20 53 45 4c 45 43 54 45 44 20 28 50 72 69 ┆ PB6 SELECTED (Pri┆
0x02f00…02f20 6e 74 65 72 29 0d 0a 20 20 20 20 20 20 20 20 20 50 42 37 20 20 20 20 20 20 20 20 50 41 50 45 52 ┆nter) PB7 PAPER┆
0x02f20…02f40 20 45 4e 44 20 28 50 72 69 6e 74 65 72 29 0d 0a 20 20 20 20 20 20 20 20 20 50 43 30 20 20 20 20 ┆ END (Printer) PC0 ┆
0x02f40…02f60 20 20 20 20 53 54 52 4f 42 45 20 28 50 72 69 6e 74 65 72 29 0d 0a 20 20 20 20 20 20 20 20 20 50 ┆ STROBE (Printer) P┆
0x02f60…02f80 43 31 20 20 20 20 20 20 20 20 2f 53 45 4c 45 43 54 20 28 50 72 69 6e 74 65 72 29 0d 0a 20 20 20 ┆C1 /SELECT (Printer) ┆
0x02f80…02fa0 20 20 20 20 20 20 50 43 32 20 20 20 20 20 20 20 20 2f 4c 50 49 4e 49 54 84 20 28 50 72 69 6e 74 ┆ PC2 /LPINIT (Print┆
0x02fa0…02fc0 65 72 29 0d 0a 20 20 20 20 20 20 20 20 20 50 43 33 20 20 20 20 20 20 20 20 2f 54 49 4d 45 4f 55 ┆er) PC3 /TIMEOU┆
0x02fc0…02fe0 54 20 49 4e 54 20 28 84 55 73 65 64 20 74 6f 20 67 65 6e 65 72 61 74 65 20 61 20 74 69 6d 65 6f ┆T INT ( Used to generate a timeo┆
0x02fe0…03000 75 74 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ut ┆
0x03000…03020 (24,) 20 20 20 20 0a 19 a2 80 80 69 6e 74 65 72 72 75 70 74 29 2e 0d 0a 20 20 20 20 20 20 20 20 20 50 ┆ interrupt). P┆
0x03020…03040 43 34 20 20 20 20 20 20 20 20 2f 41 55 54 4f 4c 46 20 28 50 72 69 6e 74 65 72 29 0d 0a 20 20 20 ┆C4 /AUTOLF (Printer) ┆
0x03040…03060 20 20 20 20 20 20 50 43 35 20 20 20 20 20 20 20 20 84 2f 4c 45 44 32 20 28 54 68 65 20 6c 69 67 ┆ PC5 /LED2 (The lig┆
0x03060…03080 68 74 20 73 69 67 6e 61 6c 20 63 6f 6e 74 72 6f 6c 20 61 20 6c 69 67 68 74 20 0a 19 94 80 80 65 ┆ht signal control a light e┆
0x03080…030a0 6d 69 74 69 6e 67 20 64 69 6f 64 65 2e 20 49 74 20 69 6e 64 69 63 61 74 65 73 20 77 68 65 6e 20 ┆miting diode. It indicates when ┆
0x030a0…030c0 74 68 65 20 43 50 55 20 0a 19 94 80 80 6d 61 6b 65 73 20 61 63 63 65 73 73 20 74 6f 20 61 20 64 ┆the CPU makes access to a d┆
0x030c0…030e0 69 73 6b 29 2e 0d 0a 20 20 20 20 20 20 20 20 20 50 43 36 20 20 20 20 20 20 20 20 84 53 45 52 20 ┆isk). PC6 SER ┆
0x030e0…03100 4c 42 20 28 55 73 65 64 20 74 6f 20 6c 6f 6f 70 62 61 63 6b 20 77 69 74 68 20 74 68 65 20 38 32 ┆LB (Used to loopback with the 82┆
0x03100…03120 37 34 20 6d 75 6c 74 69 2d 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆74 multi- ┆
0x03120…03140 20 20 20 20 20 20 0a 19 94 80 80 70 72 6f 74 6f 63 6f 6c 20 63 6f 6e 74 72 6f 6c 6c 65 72 29 2e ┆ protocol controller).┆
0x03140…03160 0d 0a 20 20 20 20 20 20 20 20 20 50 43 37 20 20 20 20 20 20 20 20 4c 50 49 4e 54 20 28 84 55 73 ┆ PC7 LPINT ( Us┆
0x03160…03180 65 64 20 69 66 20 2f 41 43 4b 20 69 73 20 6c 6f 77 20 74 6f 20 67 65 6e 65 72 61 74 65 20 61 6e ┆ed if /ACK is low to generate an┆
0x03180…031a0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 0a 19 9b 80 ┆ ┆
0x031a0…031c0 80 69 6e 74 65 72 72 75 70 74 20 66 72 6f 6d 20 74 68 65 20 6c 69 6e 65 70 72 69 6e 74 65 72 29 ┆ interrupt from the lineprinter)┆
0x031c0…031e0 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 b0 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆. -----------------┆
0x031e0…03200 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆--------------------------------┆
0x03200…03220 (25,) 2d 2d 2d 2d 2d 2d 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 53 69 67 6e 61 6c 73 20 66 72 6f 6d 20 ┆------ Signals from ┆
0x03220…03240 70 61 72 61 6c 6c 65 6c 20 70 6f 72 74 20 6e 72 2e 20 32 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 ┆parallel port nr. 2 ┆
0x03240…03260 a1 b0 50 69 6e 20 20 20 20 20 20 20 20 20 53 69 67 6e 61 6c 20 20 20 20 20 20 20 20 20 20 20 20 ┆ Pin Signal ┆
0x03260…03280 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 0d 0a 0d 0a 20 20 20 ┆ ┆
0x03280…032a0 20 20 20 20 20 20 50 41 30 20 20 20 20 20 20 20 20 53 4c 49 4f 41 44 52 20 30 20 28 52 54 43 20 ┆ PA0 SLIOADR 0 (RTC ┆
0x032a0…032c0 61 6e 64 20 42 50 52 4f 4d 20 61 64 64 72 65 73 73 29 0d 0a 20 20 20 20 20 20 20 20 20 50 41 31 ┆and BPROM address) PA1┆
0x032c0…032e0 20 20 20 20 20 20 20 20 53 4c 49 4f 41 44 52 20 31 20 28 52 54 43 20 61 6e 64 20 42 50 52 4f 4d ┆ SLIOADR 1 (RTC and BPROM┆
0x032e0…03300 20 61 64 64 72 65 73 73 29 0d 0a 20 20 20 20 20 20 20 20 20 50 41 32 20 20 20 20 20 20 20 20 53 ┆ address) PA2 S┆
0x03300…03320 4c 49 4f 41 44 52 20 32 20 28 52 54 43 20 61 6e 64 20 42 50 52 4f 4d 20 61 64 64 72 65 73 73 29 ┆LIOADR 2 (RTC and BPROM address)┆
0x03320…03340 0d 0a 20 20 20 20 20 20 20 20 20 50 41 33 20 20 20 20 20 20 20 20 53 4c 49 4f 41 44 52 20 33 20 ┆ PA3 SLIOADR 3 ┆
0x03340…03360 28 52 54 43 20 61 6e 64 20 42 50 52 4f 4d 20 61 64 64 72 65 73 73 29 0d 0a 20 20 20 20 20 20 20 ┆(RTC and BPROM address) ┆
0x03360…03380 20 20 50 41 34 20 20 20 20 20 20 20 20 53 4c 49 4f 41 44 52 20 34 20 28 52 54 43 20 61 6e 64 20 ┆ PA4 SLIOADR 4 (RTC and ┆
0x03380…033a0 42 50 52 4f 4d 20 61 64 64 72 65 73 73 29 0d 0a 20 20 20 20 20 20 20 20 20 50 41 35 20 20 20 20 ┆BPROM address) PA5 ┆
0x033a0…033c0 20 20 20 20 53 4c 49 4f 41 44 52 20 35 20 28 52 54 43 20 61 6e 64 20 42 50 52 4f 4d 20 61 64 64 ┆ SLIOADR 5 (RTC and BPROM add┆
0x033c0…033e0 72 65 73 73 29 0d 0a 20 20 20 20 20 20 20 20 20 50 41 36 20 20 20 20 20 20 20 20 53 4c 49 4f 41 ┆ress) PA6 SLIOA┆
0x033e0…03400 44 52 20 36 20 28 52 54 43 20 61 6e 64 20 42 50 52 4f 4d 20 61 64 64 72 65 73 73 29 0d 0a 20 20 ┆DR 6 (RTC and BPROM address) ┆
0x03400…03420 (26,) 20 20 20 20 20 20 20 50 41 37 20 20 20 20 20 20 20 20 53 4c 49 4f 41 44 52 20 37 20 28 52 54 43 ┆ PA7 SLIOADR 7 (RTC┆
0x03420…03437 20 61 6e 64 20 42 50 52 4f 4d 20 61 64 64 72 65 73 73 29 0d 0a 0d 0a ┆ and BPROM address) ┆
0x03437…0343a FormFeed {
0x03437…0343a 0c 83 d4 ┆ ┆
0x03437…0343a }
0x0343a…03440 0a 20 20 20 20 20 ┆ ┆
0x03440…03460 20 20 20 20 a1 b0 50 69 6e 20 20 20 20 20 20 20 20 20 53 69 67 6e 61 6c 20 20 20 20 20 20 20 20 ┆ Pin Signal ┆
0x03460…03480 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 0d 0a 0d ┆ ┆
0x03480…034a0 0a 20 20 20 20 20 20 20 20 20 50 42 30 20 20 20 20 20 20 20 20 84 2f 54 65 73 74 73 6c 61 76 65 ┆ PB0 /Testslave┆
0x034a0…034c0 2e 20 28 49 66 20 74 77 6f 20 43 50 55 20 69 73 20 75 73 65 64 2c 20 69 74 20 69 6e 64 69 63 61 ┆. (If two CPU is used, it indica┆
0x034c0…034e0 74 65 73 20 0a 19 94 80 80 77 68 69 63 68 20 69 73 20 74 68 65 20 74 65 73 74 20 6d 61 73 74 65 ┆tes which is the test maste┆
0x034e0…03500 72 29 2e 20 41 20 74 65 73 74 6d 61 73 74 65 72 20 69 73 20 0a 19 94 80 80 74 68 65 20 6d 75 6c ┆r). A testmaster is the mul┆
0x03500…03520 74 69 62 75 73 20 62 6f 61 72 64 20 77 68 69 63 68 20 74 65 73 74 73 74 68 65 20 0a 19 94 80 80 ┆tibus board which teststhe ┆
0x03520…03540 6d 75 6c 74 69 62 75 73 2e 28 53 65 65 20 6c 69 74 74 20 37 29 29 2e 0d 0a 20 20 20 20 20 20 20 ┆multibus.(See litt 7)). ┆
0x03540…03560 20 20 50 42 31 20 20 20 20 20 20 20 20 49 66 20 6c 6f 77 20 74 68 65 72 65 20 69 73 20 6f 6e 6c ┆ PB1 If low there is onl┆
0x03560…03580 79 20 61 63 63 65 73 73 20 74 6f 20 74 68 65 20 4d 75 6c 74 69 62 75 73 2e 0d 0a 20 20 20 20 20 ┆y access to the Multibus. ┆
0x03580…035a0 20 20 20 20 50 42 32 20 20 20 20 20 20 20 20 54 65 73 74 73 74 72 61 70 2e 0d 0a 20 20 20 20 20 ┆ PB2 Teststrap. ┆
0x035a0…035c0 20 20 20 20 50 42 33 20 20 20 20 20 20 20 20 2f 50 49 4e 54 52 32 20 75 6e 6c 6f 63 6b 84 20 70 ┆ PB3 /PINTR2 unlock p┆
0x035c0…035e0 6f 77 65 72 20 69 6e 74 65 72 72 75 70 74 20 66 72 6f 6d 20 74 68 65 20 62 61 74 74 65 72 69 20 ┆ower interrupt from the batteri ┆
0x035e0…03600 0a 19 94 80 80 62 61 63 6b 75 70 20 75 6e 69 74 20 42 42 43 36 30 31 2e 0d 0a 20 20 20 20 20 20 ┆ backup unit BBC601. ┆
0x03600…03620 (27,) 20 20 20 50 42 34 20 20 20 20 20 20 20 20 84 42 42 43 49 4e 54 20 61 20 6c 61 74 63 68 65 64 20 ┆ PB4 BBCINT a latched ┆
0x03620…03640 73 69 67 6e 61 6c 20 66 72 6f 6d 20 74 68 65 20 42 42 43 36 30 31 2e 0d 0a 20 20 20 20 20 20 20 ┆signal from the BBC601. ┆
0x03640…03660 20 20 50 42 35 20 20 20 20 20 20 20 20 84 58 4f 50 54 30 20 28 41 6e 20 75 6e 64 65 66 69 6e 69 ┆ PB5 XOPT0 (An undefini┆
0x03660…03680 74 65 20 73 69 67 6e 61 6c 20 66 72 6f 6d 20 74 68 65 20 69 53 42 58 20 0a 19 94 80 80 62 75 73 ┆te signal from the iSBX bus┆
0x03680…036a0 29 2e 0d 0a 20 20 20 20 20 20 20 20 20 50 42 36 20 20 20 20 20 20 20 20 84 58 4f 50 54 31 20 28 ┆). PB6 XOPT1 (┆
0x036a0…036c0 41 6e 20 75 6e 64 65 66 69 6e 69 74 65 20 73 69 67 6e 61 6c 20 66 72 6f 6d 20 74 68 65 20 69 53 ┆An undefinite signal from the iS┆
0x036c0…036e0 42 58 20 0a 19 94 80 80 62 75 73 29 2e 0d 0a 20 20 20 20 20 20 20 20 20 50 42 37 20 20 20 20 20 ┆BX bus). PB7 ┆
0x036e0…03700 20 20 20 84 2f 58 50 53 54 20 28 49 66 20 6c 6f 77 20 61 6e 20 69 53 42 58 20 6d 6f 64 75 6c 20 ┆ /XPST (If low an iSBX modul ┆
0x03700…03720 69 73 20 6f 6e 20 74 68 65 20 43 50 55 20 0a 19 94 80 80 62 6f 61 72 64 29 2e 0d 0a 20 20 20 20 ┆is on the CPU board). ┆
0x03720…03740 20 20 20 20 20 50 43 30 20 20 20 20 20 20 20 20 84 2f 4c 45 44 31 20 28 54 68 65 20 2f 4c 45 44 ┆ PC0 /LED1 (The /LED┆
0x03740…03760 31 20 73 69 67 6e 61 6c 20 63 6f 6e 74 72 6f 6c 20 61 20 6c 69 67 68 74 20 0a 19 94 80 80 65 6d ┆1 signal control a light em┆
0x03760…03780 69 74 69 6e 67 20 64 69 6f 64 65 20 77 68 69 63 68 20 69 6e 64 69 63 61 74 65 73 20 77 68 65 6e ┆iting diode which indicates when┆
0x03780…037a0 20 74 68 65 20 43 50 55 20 69 73 20 0a 19 94 80 80 69 6e 20 74 65 73 74 20 6d 6f 64 65 29 2e 0d ┆ the CPU is in test mode). ┆
0x037a0…037c0 0a 20 20 20 20 20 20 20 20 20 50 43 31 20 20 20 20 20 20 20 20 84 50 49 4e 54 32 45 4e 20 28 45 ┆ PC1 PINT2EN (E┆
0x037c0…037e0 6e 61 62 6c 65 20 61 20 42 42 43 36 30 31 20 69 6e 74 65 72 72 75 70 74 20 66 72 6f 6d 20 74 68 ┆nable a BBC601 interrupt from th┆
0x037e0…03800 65 20 0a 19 94 80 80 42 42 43 36 30 31 29 2e 0d 0a 20 20 20 20 20 20 20 20 20 50 43 32 20 20 20 ┆e BBC601). PC2 ┆
0x03800…03820 (28,) 20 20 20 20 20 84 2f 69 4c 42 58 20 28 57 68 65 6e 20 6c 6f 77 20 69 74 20 65 6e 61 62 6c 65 73 ┆ /iLBX (When low it enables┆
0x03820…03840 20 74 68 65 20 69 4c 42 58 20 62 75 73 3b 20 0a 19 94 80 80 6f 74 68 65 72 77 69 73 65 20 74 68 ┆ the iLBX bus; otherwise th┆
0x03840…03860 65 20 43 50 55 20 75 73 65 73 20 74 68 65 20 4d 55 4c 54 49 42 55 53 2e 0d 0a 20 20 20 20 20 20 ┆e CPU uses the MULTIBUS. ┆
0x03860…03880 20 20 20 50 43 33 20 20 20 20 20 20 20 20 4e 6f 74 20 69 6e 20 75 73 65 2e 0d 0a 20 20 20 20 20 ┆ PC3 Not in use. ┆
0x03880…038a0 20 20 20 20 50 43 34 20 20 20 20 20 20 20 20 4f 50 54 4f 30 20 28 41 6e 20 75 6e 64 65 66 69 6e ┆ PC4 OPTO0 (An undefin┆
0x038a0…038c0 69 74 65 20 73 69 67 6e 61 6c 20 74 6f 20 74 68 65 20 69 53 42 58 20 62 75 73 29 2e 0d 0a 20 20 ┆ite signal to the iSBX bus). ┆
0x038c0…038e0 20 20 20 20 20 20 20 50 43 35 20 20 20 20 20 20 20 20 84 2f 4f 50 54 30 45 4e 20 28 57 68 65 6e ┆ PC5 /OPT0EN (When┆
0x038e0…03900 20 6c 6f 77 20 74 68 65 20 69 74 20 65 6e 61 62 6c 65 73 20 74 68 65 20 73 69 67 6e 61 6c 20 0a ┆ low the it enables the signal ┆
0x03900…03920 19 94 80 80 4f 50 54 30 20 61 73 20 61 6e 20 6f 75 74 70 75 74 20 73 69 67 6e 61 6c 20 74 6f 20 ┆ OPT0 as an output signal to ┆
0x03920…03940 74 68 65 20 69 53 42 58 20 62 75 73 29 2e 0d 0a 20 20 20 20 20 20 20 20 20 50 43 36 20 20 20 20 ┆the iSBX bus). PC6 ┆
0x03940…03960 20 20 20 20 4f 50 54 4f 30 20 28 41 6e 20 75 6e 64 65 66 69 6e 69 74 65 20 73 69 67 6e 61 6c 20 ┆ OPTO0 (An undefinite signal ┆
0x03960…03980 74 6f 20 74 68 65 20 69 53 42 58 20 62 75 73 29 2e 0d 0a 20 20 20 20 20 20 20 20 20 50 43 37 20 ┆to the iSBX bus). PC7 ┆
0x03980…039a0 20 20 20 20 20 20 20 84 2f 4f 50 54 31 45 4e 20 28 57 68 65 6e 20 6c 6f 77 20 74 68 65 20 69 74 ┆ /OPT1EN (When low the it┆
0x039a0…039c0 20 65 6e 61 62 6c 65 73 20 74 68 65 20 73 69 67 6e 61 6c 20 0a 19 94 80 80 4f 50 54 31 20 61 73 ┆ enables the signal OPT1 as┆
0x039c0…039e0 20 61 6e 20 6f 75 74 70 75 74 20 73 69 67 6e 61 6c 20 74 6f 20 74 68 65 20 69 53 42 58 20 62 75 ┆ an output signal to the iSBX bu┆
0x039e0…03a00 73 29 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 b0 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆s). ---------------┆
0x03a00…03a20 (29,) 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆--------------------------------┆
0x03a20…03a2a 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a ┆-------- ┆
0x03a2a…03a2d FormFeed {
0x03a2a…03a2d 0c 83 8c ┆ ┆
0x03a2a…03a2d }
0x03a2d…03a40 0a b0 a1 a1 b0 b0 a1 34 2e 33 20 20 20 20 20 20 43 6c 6f ┆ 4.3 Clo┆
0x03a40…03a60 63 6b 20 47 65 6e 65 72 61 74 6f 72 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 20 43 ┆ck Generator. The C┆
0x03a60…03a80 50 55 20 62 6f 61 72 64 20 75 73 65 73 20 61 6e 20 65 78 74 65 72 6e 61 6c 20 63 6c 6f 63 6b 20 ┆PU board uses an external clock ┆
0x03a80…03aa0 67 65 6e 65 72 61 74 6f 72 20 38 32 32 38 34 2e 20 0a 19 89 80 80 28 38 32 32 38 34 2d 36 20 6f ┆generator 82284. (82284-6 o┆
0x03aa0…03ac0 6e 20 43 50 55 36 31 30 41 20 61 6e 64 20 38 32 32 38 34 2d 38 20 6f 6e 20 43 50 55 36 31 30 42 ┆n CPU610A and 82284-8 on CPU610B┆
0x03ac0…03ae0 29 2e 20 54 68 65 20 63 6c 6f 63 6b 20 0a 19 89 80 80 67 65 6e 65 72 61 74 6f 72 20 67 65 6e 65 ┆). The clock generator gene┆
0x03ae0…03b00 72 61 74 65 73 20 43 50 55 43 4c 4b 20 61 6e 64 20 61 20 63 6c 6f 63 6b 20 66 6f 72 20 74 68 65 ┆rates CPUCLK and a clock for the┆
0x03b00…03b20 20 38 32 35 34 20 0a 19 89 80 80 50 72 6f 67 72 61 6d 6d 61 62 6c 65 20 49 6e 74 65 72 76 61 6c ┆ 8254 Programmable Interval┆
0x03b20…03b40 20 54 69 6d 65 72 20 28 50 49 54 29 2e 20 07 54 68 65 20 69 6e 74 65 72 76 61 6c 20 74 69 6d 65 ┆ Timer (PIT). The interval time┆
0x03b40…03b60 72 20 0a 19 89 80 80 69 6e 63 6c 75 64 65 73 20 74 68 72 65 65 20 70 72 6f 67 72 61 6d 6d 61 62 ┆r includes three programmab┆
0x03b60…03b80 6c 65 20 63 6f 75 6e 74 65 72 73 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 72 65 20 ┆le counters. There ┆
0x03b80…03ba0 69 73 20 61 20 39 2c 38 34 30 35 20 4d 48 7a 20 63 6c 6f 63 6b 20 67 65 6e 65 72 61 74 6f 72 20 ┆is a 9,8405 MHz clock generator ┆
0x03ba0…03bc0 74 6f 20 74 68 65 20 6d 75 6c 74 69 62 75 73 2e 20 0a 19 89 80 80 54 68 69 73 20 63 6c 6f 63 6b ┆to the multibus. This clock┆
0x03bc0…03be0 20 69 73 20 64 69 76 69 64 65 64 20 62 79 20 74 77 6f 20 74 6f 20 67 65 6e 65 72 61 74 65 20 61 ┆ is divided by two to generate a┆
0x03be0…03c00 20 34 2c 39 20 4d 68 7a 20 63 6c 6f 63 6b 20 0a 19 89 80 80 73 69 67 6e 61 6c 2e 20 54 68 65 20 ┆ 4,9 Mhz clock signal. The ┆
0x03c00…03c20 (30,) 38 30 32 38 37 2d 33 20 6e 75 6d 65 72 69 63 20 70 72 6f 63 65 73 73 6f 72 20 65 78 74 65 6e 73 ┆80287-3 numeric processor extens┆
0x03c20…03c40 69 6f 6e 20 75 6e 69 74 20 63 61 6e 20 0a 19 89 80 80 72 75 6e 20 77 69 74 68 20 74 68 69 73 20 ┆ion unit can run with this ┆
0x03c40…03c60 63 6c 6f 63 6b 20 73 69 67 6e 61 6c 2e 0d 0a a1 b0 0d 0a 0d 0a b0 a1 34 2e 34 20 20 20 20 20 20 ┆clock signal. 4.4 ┆
0x03c60…03c80 49 6e 74 65 72 72 75 70 74 20 6f 70 65 72 61 74 69 6f 6e 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 ┆Interrupt operation. ┆
0x03c80…03ca0 20 84 54 68 65 20 43 50 55 36 31 30 58 20 69 6e 63 6c 75 64 65 73 20 74 68 72 65 65 20 70 72 6f ┆ The CPU610X includes three pro┆
0x03ca0…03cc0 67 72 61 6d 61 62 6c 65 20 69 6e 74 65 72 72 75 70 74 20 0a 19 89 80 80 63 6f 6e 74 72 6f 6c 6c ┆gramable interrupt controll┆
0x03cc0…03ce0 65 72 73 20 28 50 49 43 27 73 29 2e 20 54 68 65 20 69 6e 74 65 72 72 75 70 74 20 63 6f 6e 74 72 ┆ers (PIC's). The interrupt contr┆
0x03ce0…03d00 6f 6c 6c 65 72 73 20 74 61 6b 65 20 63 61 72 65 20 0a 19 89 80 80 6f 66 20 74 68 65 20 69 6e 74 ┆ollers take care of the int┆
0x03d00…03d20 65 72 72 75 70 74 20 69 6e 70 75 74 20 74 6f 20 74 68 65 20 38 30 32 38 36 2e 20 54 68 65 79 20 ┆errupt input to the 80286. They ┆
0x03d20…03d40 61 72 65 20 77 6f 72 6b 69 6e 67 20 69 6e 20 0a 19 89 80 80 6d 61 73 74 65 72 20 73 6c 61 76 65 ┆are working in master slave┆
0x03d40…03d60 20 72 65 6c 61 74 69 6f 6e 73 68 69 70 2e 20 54 68 65 20 69 6e 74 65 72 72 75 70 74 20 63 6f 6e ┆ relationship. The interrupt con┆
0x03d60…03d80 74 72 6f 6c 6c 65 72 73 20 0a 19 89 80 80 6d 61 6b 65 20 69 74 20 70 6f 73 73 69 62 6c 65 20 74 ┆trollers make it possible t┆
0x03d80…03da0 6f 20 63 6f 6e 6e 65 63 74 20 75 70 20 74 6f 20 32 32 20 69 6e 74 65 72 72 75 70 74 73 20 74 6f ┆o connect up to 22 interrupts to┆
0x03da0…03dc0 20 74 68 65 20 0a 19 89 80 80 38 30 32 38 36 2e 20 28 46 75 74 68 65 72 20 64 65 74 61 69 6c 73 ┆ the 80286. (Futher details┆
0x03dc0…03de0 20 61 72 65 20 69 6e 63 6c 75 64 65 64 20 69 6e 20 6c 69 74 74 20 36 29 2e 0d 0a 20 20 20 20 20 ┆ are included in litt 6). ┆
0x03de0…03e00 20 20 20 20 84 54 68 65 20 38 30 32 38 36 20 69 73 20 61 62 6c 65 20 74 6f 20 67 65 6e 65 72 61 ┆ The 80286 is able to genera┆
0x03e00…03e20 (31,) 74 65 20 75 70 20 74 6f 20 74 68 72 65 65 20 69 6e 64 65 70 65 6e 64 65 6e 74 20 0a 19 89 80 80 ┆te up to three independent ┆
0x03e20…03e40 6d 75 6c 74 69 62 75 73 20 69 6e 74 65 72 72 75 70 74 73 2e 20 41 20 50 41 4c 20 74 61 6b 65 73 ┆multibus interrupts. A PAL takes┆
0x03e40…03e60 20 63 61 72 65 20 6f 66 20 74 68 65 20 69 6e 74 65 72 72 75 70 74 20 0a 19 89 80 80 6f 75 74 70 ┆ care of the interrupt outp┆
0x03e60…03e80 75 74 20 63 6f 6e 74 72 6f 6c 2e 0d 0a 0d 0a 0d 0a a1 b0 34 2e 34 2e 31 20 20 20 20 49 6e 74 65 ┆ut control. 4.4.1 Inte┆
0x03e80…03ea0 72 72 75 70 74 20 53 6f 75 72 63 65 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 20 70 ┆rrupt Source. The p┆
0x03ea0…03ec0 72 69 6f 72 69 74 79 20 6f 66 20 74 68 65 20 69 6e 70 75 74 20 69 6e 74 65 72 72 75 70 74 73 20 ┆riority of the input interrupts ┆
0x03ec0…03ee0 61 72 65 20 73 68 6f 77 65 64 20 69 6e 20 66 69 67 20 0a 19 89 80 80 34 2e 34 2e 31 2e 31 2e 20 ┆are showed in fig 4.4.1.1. ┆
0x03ee0…03f00 49 74 20 69 73 20 70 6f 73 73 69 62 6c 65 20 74 6f 20 63 68 61 6e 67 65 20 70 72 69 6f 72 69 74 ┆It is possible to change priorit┆
0x03f00…03f20 79 2c 20 62 75 74 20 74 68 65 6e 20 74 68 65 20 0a 19 89 80 80 77 69 72 69 6e 67 20 6d 75 73 74 ┆y, but then the wiring must┆
0x03f20…03f34 20 62 65 20 6d 6f 64 69 66 69 63 61 74 65 64 2e 0d 0a 0d 0a ┆ be modificated. ┆
0x03f34…03f37 FormFeed {
0x03f34…03f37 0c 83 8c ┆ ┆
0x03f34…03f37 }
0x03f37…03f40 0a 20 20 20 20 20 20 20 20 ┆ ┆
0x03f40…03f60 20 b0 a1 49 6e 74 65 72 72 75 70 74 20 6e 72 2e 20 20 53 69 67 6e 61 6c 20 20 20 20 20 20 20 20 ┆ Interrupt nr. Signal ┆
0x03f60…03f80 53 6f 75 72 63 65 20 20 20 20 20 20 20 20 44 65 73 74 69 6e 61 74 69 6f 6e 2e 20 0d 0a 0d 0a 20 ┆Source Destination. ┆
0x03f80…03fa0 20 20 20 20 20 20 20 20 20 20 20 20 4e 4d 49 20 20 20 20 20 20 20 20 20 50 49 4e 54 52 31 2f 32 ┆ NMI PINTR1/2┆
0x03fa0…03fc0 20 20 4b 65 79 2f 42 42 43 36 30 31 20 20 20 20 20 20 20 20 43 50 55 38 30 32 38 36 0d 0a 20 20 ┆ Key/BBC601 CPU80286 ┆
0x03fc0…03fe0 20 20 20 20 20 20 20 20 20 20 20 20 30 20 20 20 20 20 20 20 20 20 43 4f 55 4e 54 20 20 30 20 20 ┆ 0 COUNT 0 ┆
0x03fe0…04000 49 6e 74 65 72 76 61 6c 20 74 69 6d 65 72 20 4d 61 73 74 65 72 20 20 50 49 43 20 49 52 20 30 0d ┆Interval timer Master PIC IR 0 ┆
0x04000…04020 (32,) 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 20 ┆ 1 MBINT ┆
0x04020…04040 31 20 20 20 20 4d 75 6c 74 69 62 75 73 20 20 20 20 20 4d 61 73 74 65 72 20 20 50 49 43 20 49 52 ┆1 Multibus Master PIC IR┆
0x04040…04060 20 31 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 32 20 20 20 20 20 20 20 20 20 4d 42 49 4e ┆ 1 2 MBIN┆
0x04060…04080 54 20 20 32 20 20 20 20 4d 75 6c 74 69 62 75 73 20 20 20 20 20 4d 61 73 74 65 72 20 20 50 49 43 ┆T 2 Multibus Master PIC┆
0x04080…040a0 20 49 52 20 32 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 33 20 20 20 20 20 20 20 20 20 4d ┆ IR 2 3 M┆
0x040a0…040c0 42 49 4e 54 20 20 33 20 20 20 20 4d 75 6c 74 69 62 75 73 20 20 20 20 20 4d 61 73 74 65 72 20 20 ┆BINT 3 Multibus Master ┆
0x040c0…040e0 50 49 43 20 49 52 20 33 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 34 20 20 20 20 20 20 20 ┆PIC IR 3 4 ┆
0x040e0…04100 20 20 4d 42 49 4e 54 20 20 34 20 20 20 20 4d 75 6c 74 69 62 75 73 20 20 20 20 20 4d 61 73 74 65 ┆ MBINT 4 Multibus Maste┆
0x04100…04120 72 20 20 50 49 43 20 49 52 20 34 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 35 20 20 20 20 ┆r PIC IR 4 5 ┆
0x04120…04140 20 20 20 20 20 4d 42 49 4e 54 20 20 35 20 20 20 20 4d 75 6c 74 69 62 75 73 20 20 20 20 20 4d 61 ┆ MBINT 5 Multibus Ma┆
0x04140…04160 73 74 65 72 20 20 50 49 43 20 49 52 20 35 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 36 20 ┆ster PIC IR 5 6 ┆
0x04160…04180 20 20 20 20 20 20 20 20 53 45 52 49 4e 54 20 20 20 20 20 53 65 72 69 61 6c 20 49 2f 4f 20 20 20 ┆ SERINT Serial I/O ┆
0x04180…041a0 20 4d 61 73 74 65 72 20 20 50 49 43 20 49 52 20 36 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ Master PIC IR 6 ┆
0x041a0…041c0 20 37 20 20 20 20 20 20 20 20 20 53 4c 49 4e 54 31 20 20 20 20 20 53 6c 61 76 65 31 20 50 49 43 ┆ 7 SLINT1 Slave1 PIC┆
0x041c0…041e0 20 20 20 20 4d 61 73 74 65 72 20 20 50 49 43 20 49 52 20 37 0d 0a 20 20 20 20 20 20 20 20 20 20 ┆ Master PIC IR 7 ┆
0x041e0…04200 20 20 20 20 38 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 20 36 20 20 20 20 4d 75 6c 74 69 62 ┆ 8 MBINT 6 Multib┆
0x04200…04220 (33,) 75 73 20 20 20 20 20 53 6c 61 76 65 31 20 20 50 49 43 20 49 52 20 30 0d 0a 20 20 20 20 20 20 20 ┆us Slave1 PIC IR 0 ┆
0x04220…04240 20 20 20 20 20 20 20 39 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 20 37 20 20 20 20 4d 75 6c ┆ 9 MBINT 7 Mul┆
0x04240…04260 74 69 62 75 73 20 20 20 20 20 53 6c 61 76 65 31 20 20 50 49 43 20 49 52 20 31 0d 0a 20 20 20 20 ┆tibus Slave1 PIC IR 1 ┆
0x04260…04280 20 20 20 20 20 20 20 20 20 31 30 20 20 20 20 20 20 20 20 20 54 4d 4f 55 54 49 4e 54 20 20 20 20 ┆ 10 TMOUTINT ┆
0x04280…042a0 54 69 6d 65 20 6f 75 74 20 20 20 20 20 53 6c 61 76 65 31 20 20 50 49 43 20 49 52 20 32 0d 0a 20 ┆Time out Slave1 PIC IR 2 ┆
0x042a0…042c0 20 20 20 20 20 20 20 20 20 20 20 20 31 31 20 20 20 20 20 20 20 20 20 58 49 4e 54 20 20 20 30 20 ┆ 11 XINT 0 ┆
0x042c0…042e0 20 20 20 69 53 42 58 20 62 75 73 20 20 20 20 20 53 6c 61 76 65 31 20 20 50 49 43 20 49 52 20 33 ┆ iSBX bus Slave1 PIC IR 3┆
0x042e0…04300 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 31 32 20 20 20 20 20 20 20 20 20 58 49 4e 54 20 20 ┆ 12 XINT ┆
0x04300…04320 20 31 20 20 20 20 69 53 42 58 20 62 75 73 20 20 20 20 20 53 6c 61 76 65 31 20 20 50 49 43 20 49 ┆ 1 iSBX bus Slave1 PIC I┆
0x04320…04340 52 20 34 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 31 33 20 20 20 20 20 20 20 20 20 4d 42 49 ┆R 4 13 MBI┆
0x04340…04360 4e 54 20 20 30 20 20 20 20 4d 75 6c 74 69 62 75 73 20 20 20 20 20 53 6c 61 76 65 31 20 20 50 49 ┆NT 0 Multibus Slave1 PI┆
0x04360…04380 43 20 49 52 20 35 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 31 34 20 20 20 20 20 20 20 20 20 ┆C IR 5 14 ┆
0x04380…043a0 4c 50 49 4e 54 20 20 20 20 20 4c 69 6e 65 20 70 72 69 6e 74 65 72 20 20 20 53 6c 61 76 65 31 20 ┆LPINT Line printer Slave1 ┆
0x043a0…043c0 20 50 49 43 20 49 52 20 36 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 31 35 20 20 20 20 20 20 ┆ PIC IR 6 15 ┆
0x043c0…043e0 20 20 20 53 4c 49 4e 54 32 20 20 20 20 20 53 6c 61 76 65 32 20 50 49 43 20 20 20 20 53 6c 61 76 ┆ SLINT2 Slave2 PIC Slav┆
0x043e0…04400 65 31 20 20 50 49 43 20 49 52 20 37 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 31 36 20 20 20 ┆e1 PIC IR 7 16 ┆
0x04400…04420 (34,) 20 20 20 20 20 20 4d 42 49 4e 54 20 20 38 20 20 20 20 4d 75 6c 74 69 62 75 73 20 20 20 20 20 53 ┆ MBINT 8 Multibus S┆
0x04420…04440 6c 61 76 65 32 20 20 50 49 43 20 49 52 20 30 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 31 37 ┆lave2 PIC IR 0 17┆
0x04440…04460 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 20 39 20 20 20 20 4d 75 6c 74 69 62 75 73 20 20 20 ┆ MBINT 9 Multibus ┆
0x04460…04480 20 20 53 6c 61 76 65 32 20 20 50 49 43 20 49 52 20 31 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 ┆ Slave2 PIC IR 1 ┆
0x04480…044a0 20 31 38 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 31 30 20 20 20 20 4d 75 6c 74 69 62 75 73 ┆ 18 MBINT 10 Multibus┆
0x044a0…044c0 20 20 20 20 20 53 6c 61 76 65 32 20 20 50 49 43 20 49 52 20 32 0d 0a 20 20 20 20 20 20 20 20 20 ┆ Slave2 PIC IR 2 ┆
0x044c0…044e0 20 20 20 20 31 39 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 31 31 20 20 20 20 4d 75 6c 74 69 ┆ 19 MBINT 11 Multi┆
0x044e0…04500 62 75 73 20 20 20 20 20 53 6c 61 76 65 32 20 20 50 49 43 20 49 52 20 33 0d 0a 20 20 20 20 20 20 ┆bus Slave2 PIC IR 3 ┆
0x04500…04520 20 20 20 20 20 20 20 32 30 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 31 32 20 20 20 20 4d 75 ┆ 20 MBINT 12 Mu┆
0x04520…04540 6c 74 69 62 75 73 20 20 20 20 20 53 6c 61 76 65 32 20 20 50 49 43 20 49 52 20 34 0d 0a 20 20 20 ┆ltibus Slave2 PIC IR 4 ┆
0x04540…04560 20 20 20 20 20 20 20 20 20 20 32 31 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 31 33 20 20 20 ┆ 21 MBINT 13 ┆
0x04560…04580 20 4d 75 6c 74 69 62 75 73 20 20 20 20 20 53 6c 61 76 65 32 20 20 50 49 43 20 49 52 20 35 0d 0a ┆ Multibus Slave2 PIC IR 5 ┆
0x04580…045a0 20 20 20 20 20 20 20 20 20 20 20 20 20 32 32 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 31 34 ┆ 22 MBINT 14┆
0x045a0…045c0 20 20 20 20 4d 75 6c 74 69 62 75 73 20 20 20 20 20 53 6c 61 76 65 32 20 20 50 49 43 20 49 52 20 ┆ Multibus Slave2 PIC IR ┆
0x045c0…045e0 36 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 32 33 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 ┆6 23 MBINT┆
0x045e0…04600 20 31 35 20 20 20 20 4d 75 6c 74 69 62 75 73 20 20 20 20 20 53 6c 61 76 65 32 20 20 50 49 43 20 ┆ 15 Multibus Slave2 PIC ┆
0x04600…04620 (35,) 49 52 20 37 0d 0a 0d 0a b0 20 20 20 20 20 20 20 20 20 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆IR 7 --------------┆
0x04620…04640 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆--------------------------------┆
0x04640…04660 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 46 69 67 20 34 2e 34 2e ┆---------- Fig 4.4.┆
0x04660…04680 31 2e 31 20 53 74 61 6e 64 61 72 64 20 69 6e 74 65 72 72 75 70 74 73 20 6f 6e 20 74 68 65 20 62 ┆1.1 Standard interrupts on the b┆
0x04680…046a0 6f 61 72 64 2e 20 54 68 65 20 0a 19 89 80 80 70 72 69 6f 72 69 74 79 20 69 73 20 66 72 6f 6d 20 ┆oard. The priority is from ┆
0x046a0…046c0 74 6f 70 20 74 6f 20 64 6f 77 6e 2e 20 54 68 65 20 4e 4d 49 20 69 73 20 61 20 6e 6f 6e 20 6d 61 ┆top to down. The NMI is a non ma┆
0x046c0…046e0 73 6b 20 61 62 6c 65 20 0a 19 89 80 80 69 6e 74 65 72 72 75 70 74 20 77 68 69 63 68 20 6f 63 63 ┆sk able interrupt which occ┆
0x046e0…04700 75 72 73 20 77 68 65 6e 20 6d 61 69 6e 73 20 69 73 20 6c 6f 77 20 6f 72 20 66 72 6f 6d 20 74 68 ┆urs when mains is low or from th┆
0x04700…04713 65 20 0a 19 89 80 80 66 72 6f 6e 74 20 6b 65 79 2e 0d 0a ┆e front key. ┆
0x04713…04716 FormFeed {
0x04713…04716 0c 83 98 ┆ ┆
0x04713…04716 }
0x04716…04720 0a 20 20 20 20 20 20 20 20 20 ┆ ┆
0x04720…04740 84 49 74 20 69 73 20 70 6f 73 73 69 62 6c 65 20 74 6f 20 73 65 6e 64 20 65 69 67 68 74 20 65 78 ┆ It is possible to send eight ex┆
0x04740…04760 74 72 61 20 6d 75 6c 74 69 62 75 73 20 69 6e 74 65 72 72 75 70 74 73 20 0a 19 89 80 80 74 6f 20 ┆tra multibus interrupts to ┆
0x04760…04780 74 68 65 20 43 50 55 20 66 72 6f 6d 20 74 68 65 20 6d 75 6c 74 69 62 75 73 2e 20 28 4d 42 49 4e ┆the CPU from the multibus. (MBIN┆
0x04780…047a0 54 20 38 20 2d 20 4d 42 49 4e 54 20 31 35 29 2e 20 41 6e 20 0a 19 89 80 80 49 2f 4f 20 77 72 69 ┆T 8 - MBINT 15). An I/O wri┆
0x047a0…047c0 74 65 20 77 69 74 68 20 74 68 65 20 66 6f 6c 6c 6f 77 69 6e 67 20 66 6f 72 6d 61 74 20 69 6e 74 ┆te with the following format int┆
0x047c0…047e0 65 72 72 75 70 74 73 20 74 68 65 20 43 50 55 2e 0d 0a f0 e1 a1 b0 0d 0a 20 20 20 20 20 20 20 20 ┆errupts the CPU. ┆
0x047e0…04800 20 84 46 6f 72 6d 61 74 20 6f 66 20 61 6e 20 49 2f 4f 20 77 72 69 74 65 20 65 78 74 65 6e 64 65 ┆ Format of an I/O write extende┆
0x04800…04820 (36,) 64 20 6d 75 6c 74 69 62 75 73 20 69 6e 74 65 72 72 75 70 74 20 0a 19 89 80 80 69 6e 73 74 72 75 ┆d multibus interrupt instru┆
0x04820…04840 63 74 69 6f 6e 20 74 6f 20 74 68 65 20 43 50 55 20 3a 0d 0a 0d 0a 20 20 20 20 20 20 20 20 b0 a1 ┆ction to the CPU : ┆
0x04840…04860 84 f0 e1 20 b0 a1 4d 55 4c 54 49 42 55 53 20 49 2f 4f 20 61 64 64 72 65 73 73 20 20 20 20 20 20 ┆ MULTIBUS I/O address ┆
0x04860…04880 44 65 73 74 69 6e 61 74 69 6f 6e 2e 20 20 20 0d 0a b0 a1 f0 0d 0a 20 20 20 20 20 20 20 20 20 20 ┆Destination. ┆
0x04880…048a0 20 20 20 20 20 20 20 20 30 39 30 30 20 20 20 20 20 20 20 20 20 20 54 65 73 74 6d 61 73 74 65 72 ┆ 0900 Testmaster┆
0x048a0…048c0 20 43 50 55 36 31 30 58 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 30 39 30 38 ┆ CPU610X 0908┆
0x048c0…048e0 20 20 20 20 20 20 20 20 20 20 54 65 73 74 73 6c 61 76 65 20 20 43 50 55 36 31 30 58 0d 0a 0d 0a ┆ Testslave CPU610X ┆
0x048e0…04900 20 20 20 20 20 20 20 20 20 b0 b0 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆ ---------------------┆
0x04900…04920 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a 0d 0a 20 20 20 20 20 20 20 20 ┆-------------------- ┆
0x04920…04940 20 b0 a1 84 4d 55 4c 54 49 42 55 53 20 44 61 74 61 20 66 69 65 6c 64 20 20 20 20 20 20 20 44 65 ┆ MULTIBUS Data field De┆
0x04940…04960 73 74 69 6e 61 74 69 6f 6e 2e 20 20 20 20 0d 0a b0 a1 f0 e1 0d 0a 20 20 20 20 20 20 20 20 20 20 ┆stination. ┆
0x04960…04980 20 20 20 20 20 20 20 30 30 46 46 20 20 20 20 20 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 20 ┆ 00FF MBINT ┆
0x04980…049a0 38 20 28 52 65 73 65 74 29 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 30 30 45 46 ┆8 (Reset) 00EF┆
0x049a0…049c0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 20 38 20 28 53 65 74 29 0d 0a 0d 0a ┆ MBINT 8 (Set) ┆
0x049c0…049e0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 30 30 44 46 20 20 20 20 20 20 20 20 20 20 20 ┆ 00DF ┆
0x049e0…04a00 20 20 20 4d 42 49 4e 54 20 20 39 20 28 52 65 73 65 74 29 0d 0a 20 20 20 20 20 20 20 20 20 20 20 ┆ MBINT 9 (Reset) ┆
0x04a00…04a20 (37,) 20 20 20 20 20 20 30 30 43 46 20 20 20 20 20 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 20 39 ┆ 00CF MBINT 9┆
0x04a20…04a40 20 28 53 65 74 29 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 30 30 42 46 20 ┆ (Set) 00BF ┆
0x04a40…04a60 20 20 20 20 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 31 30 20 28 52 65 73 65 74 29 0d 0a 20 ┆ MBINT 10 (Reset) ┆
0x04a60…04a80 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 30 30 41 46 20 20 20 20 20 20 20 20 20 20 20 20 ┆ 00AF ┆
0x04a80…04aa0 20 20 4d 42 49 4e 54 20 31 30 20 28 53 65 74 29 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 ┆ MBINT 10 (Set) ┆
0x04aa0…04ac0 20 20 20 20 20 30 30 39 46 20 20 20 20 20 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 31 31 20 ┆ 009F MBINT 11 ┆
0x04ac0…04ae0 28 52 65 73 65 74 29 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 30 30 38 46 20 20 ┆(Reset) 008F ┆
0x04ae0…04b00 20 20 20 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 31 31 20 28 53 65 74 29 0d 0a 0d 0a 20 20 ┆ MBINT 11 (Set) ┆
0x04b00…04b20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 30 30 37 46 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ 007F ┆
0x04b20…04b40 20 4d 42 49 4e 54 20 31 32 20 28 52 65 73 65 74 29 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ MBINT 12 (Reset) ┆
0x04b40…04b60 20 20 20 20 30 30 36 46 20 20 20 20 20 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 31 32 20 28 ┆ 006F MBINT 12 (┆
0x04b60…04b80 53 65 74 29 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 30 30 35 46 20 20 20 ┆Set) 005F ┆
0x04b80…04ba0 20 20 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 31 33 20 28 52 65 73 65 74 29 0d 0a 20 20 20 ┆ MBINT 13 (Reset) ┆
0x04ba0…04bc0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 30 30 34 46 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ 004F ┆
0x04bc0…04be0 4d 42 49 4e 54 20 31 33 20 28 53 65 74 29 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆MBINT 13 (Set) ┆
0x04be0…04c00 20 20 20 30 30 33 46 20 20 20 20 20 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 31 34 20 28 52 ┆ 003F MBINT 14 (R┆
0x04c00…04c20 (38,) 65 73 65 74 29 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 30 30 32 46 20 20 20 20 ┆eset) 002F ┆
0x04c20…04c40 20 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 31 34 20 28 53 65 74 29 0d 0a 0d 0a 20 20 20 20 ┆ MBINT 14 (Set) ┆
0x04c40…04c60 20 20 20 20 20 20 20 20 20 20 20 20 20 30 30 31 46 20 20 20 20 20 20 20 20 20 20 20 20 20 20 4d ┆ 001F M┆
0x04c60…04c80 42 49 4e 54 20 31 35 20 28 52 65 73 65 74 29 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆BINT 15 (Reset) ┆
0x04c80…04ca0 20 20 30 30 30 46 20 20 20 20 20 20 20 20 20 20 20 20 20 20 4d 42 49 4e 54 20 31 35 20 28 53 65 ┆ 000F MBINT 15 (Se┆
0x04ca0…04cc0 74 29 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 b0 b0 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆t) ---------------┆
0x04cc0…04cdd 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a ┆--------------------------- ┆
0x04cdd…04ce0 FormFeed {
0x04cdd…04ce0 0c 83 ec ┆ ┆
0x04cdd…04ce0 }
0x04ce0…04d00 0a b0 a1 34 2e 34 2e 32 20 20 20 20 49 6e 74 65 72 72 75 70 74 20 47 65 6e 65 72 61 74 6f 72 2e ┆ 4.4.2 Interrupt Generator.┆
0x04d00…04d20 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 20 43 50 55 20 69 73 20 61 62 6c 65 20 74 6f ┆ The CPU is able to┆
0x04d20…04d40 20 73 65 74 20 75 70 20 74 6f 20 74 68 72 65 65 20 69 6e 64 65 70 65 6e 64 74 20 6d 75 6c 74 69 ┆ set up to three independt multi┆
0x04d40…04d60 62 75 73 20 0a 19 89 80 80 69 6e 74 65 72 72 75 70 74 73 2e 20 28 4a 75 6d 70 65 72 73 20 6d 61 ┆bus interrupts. (Jumpers ma┆
0x04d60…04d80 6b 65 20 74 68 65 20 63 6f 6e 6e 65 63 74 69 6f 6e 29 2e 20 54 68 65 20 43 50 55 20 6f 72 20 0a ┆ke the connection). The CPU or ┆
0x04d80…04da0 19 89 80 80 61 6e 6f 74 68 65 72 20 6d 75 6c 74 69 62 75 73 20 6d 61 73 74 65 72 20 69 73 20 61 ┆ another multibus master is a┆
0x04da0…04dc0 62 6c 65 20 74 6f 20 72 65 73 65 74 20 74 68 65 73 65 20 0a 19 89 80 80 69 6e 74 65 72 72 75 70 ┆ble to reset these interrup┆
0x04dc0…04de0 74 73 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 46 6f 72 6d 61 74 20 6f 66 20 61 6e 20 49 2f ┆ts. Format of an I/┆
0x04de0…04e00 4f 20 77 72 69 74 65 20 65 78 74 65 6e 64 65 64 20 6d 75 6c 74 69 62 75 73 20 69 6e 74 65 72 72 ┆O write extended multibus interr┆
0x04e00…04e20 (39,) 75 70 74 20 72 65 73 65 74 20 0a 19 89 80 80 69 6e 73 74 72 75 63 74 69 6f 6e 20 74 6f 20 74 68 ┆upt reset instruction to th┆
0x04e20…04e40 65 20 43 50 55 20 3a 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 b0 a1 84 4d 55 4c 54 49 42 55 53 20 ┆e CPU : MULTIBUS ┆
0x04e40…04e60 49 2f 4f 20 61 64 64 72 65 73 73 20 20 20 20 20 20 44 65 73 74 69 6e 61 74 69 6f 6e 2e 20 20 20 ┆I/O address Destination. ┆
0x04e60…04e80 20 0d 0a b0 a1 f0 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 30 39 30 30 20 20 20 ┆ 0900 ┆
0x04e80…04ea0 20 20 20 20 20 20 20 20 20 54 65 73 74 6d 61 73 74 65 72 20 43 50 55 36 31 30 58 0d 0a 20 20 20 ┆ Testmaster CPU610X ┆
0x04ea0…04ec0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 30 39 30 38 20 20 20 20 20 20 20 20 20 20 20 20 54 65 ┆ 0908 Te┆
0x04ec0…04ee0 73 74 73 6c 61 76 65 20 20 43 50 55 36 31 30 58 0d 0a 0d 0a 20 20 20 20 20 20 20 20 b0 b0 2d 2d ┆stslave CPU610X --┆
0x04ee0…04f00 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆--------------------------------┆
0x04f00…04f20 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 b0 a1 84 4d 55 4c 54 49 42 55 ┆--------- MULTIBU┆
0x04f20…04f40 53 20 44 61 74 61 20 66 69 65 6c 64 20 20 20 20 20 20 44 65 73 74 69 6e 61 74 69 6f 6e 2e 0d 0a ┆S Data field Destination. ┆
0x04f40…04f60 b0 a1 f0 e1 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 30 30 30 39 20 20 20 20 20 ┆ 0009 ┆
0x04f60…04f80 20 20 20 20 20 20 20 20 20 2f 4d 42 4f 55 54 31 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ /MBOUT1 ┆
0x04f80…04fa0 20 20 20 30 30 30 41 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2f 4d 42 4f 55 54 32 0d 0a 20 20 ┆ 000A /MBOUT2 ┆
0x04fa0…04fc0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 30 30 30 42 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ 000B ┆
0x04fc0…04fe0 20 2f 4d 42 4f 55 54 33 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 b0 b0 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆ /MBOUT3 ---------┆
0x04fe0…05000 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a 0d 0a ┆---------------------------- ┆
0x05000…05020 (40,) 20 20 20 20 20 20 20 20 20 84 46 6f 72 6d 61 74 20 6f 66 20 61 6e 20 6f 75 74 70 75 74 20 69 6e ┆ Format of an output in┆
0x05020…05040 74 65 72 72 75 70 74 20 72 65 73 65 74 20 6f 72 20 73 65 74 20 69 6e 73 74 72 75 63 74 69 6f 6e ┆terrupt reset or set instruction┆
0x05040…05060 20 0a 19 89 80 80 66 72 6f 6d 20 74 68 65 20 43 50 55 20 3a 0d 0a 0d 0a 20 20 20 20 20 20 20 20 ┆ from the CPU : ┆
0x05060…05080 20 b0 a1 84 43 50 55 20 49 2f 4f 20 61 64 64 72 65 73 73 20 20 20 20 20 20 44 65 73 74 69 6e 61 ┆ CPU I/O address Destina┆
0x05080…050a0 74 69 6f 6e 2e 20 20 20 20 20 20 0d 0a b0 a1 f0 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆tion. ┆
0x050a0…050c0 20 30 30 38 36 20 20 20 20 20 20 20 20 20 20 20 52 65 73 65 74 20 4d 42 4f 55 54 58 20 20 2a 0d ┆ 0086 Reset MBOUTX * ┆
0x050c0…050e0 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 30 30 38 32 20 20 20 20 20 20 20 20 20 20 20 53 ┆ 0082 S┆
0x050e0…05100 65 74 20 4d 42 4f 55 54 58 0d 0a 0d 0a 20 20 20 20 20 20 20 20 b0 b0 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆et MBOUTX ---------┆
0x05100…05120 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d ┆------------------------------- ┆
0x05120…05140 0a 0d 0a 20 20 20 20 20 20 20 20 84 2a 20 54 68 65 20 64 61 74 61 20 66 69 65 6c 64 20 73 65 6c ┆ * The data field sel┆
0x05140…05160 65 63 74 73 20 74 68 65 20 4d 42 4f 55 54 58 20 73 69 67 6e 61 6c 2e 20 28 58 3d 31 2c 32 2c 33 ┆ects the MBOUTX signal. (X=1,2,3┆
0x05160…05166 29 2e 0d 0a 0d 0a ┆). ┆
0x05166…05169 FormFeed {
0x05166…05169 0c 83 bc ┆ ┆
0x05166…05169 }
0x05169…05180 0a 20 20 20 20 20 20 20 20 20 b0 a1 84 43 50 55 20 44 61 74 61 20 66 ┆ CPU Data f┆
0x05180…051a0 69 65 6c 64 20 20 20 20 20 20 44 65 73 74 69 6e 61 74 69 6f 6e 2e 20 20 20 20 20 0d 0a b0 a1 f0 ┆ield Destination. ┆
0x051a0…051c0 e1 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 30 30 30 39 20 20 20 20 20 20 20 20 20 20 ┆ 0009 ┆
0x051c0…051e0 20 2f 4d 42 4f 55 54 31 20 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 30 30 30 41 20 20 ┆ /MBOUT1 000A ┆
0x051e0…05200 20 20 20 20 20 20 20 20 20 2f 4d 42 4f 55 54 32 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ /MBOUT2 ┆
0x05200…05220 (41,) 20 30 30 30 42 20 20 20 20 20 20 20 20 20 20 20 2f 4d 42 4f 55 54 33 0d 0a 0d 0a 20 20 20 20 20 ┆ 000B /MBOUT3 ┆
0x05220…05240 20 20 20 20 b0 b0 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆ --------------------------┆
0x05240…05260 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a 0d 0a 0d 0a b0 a1 34 2e 35 20 20 20 20 20 20 53 6f 66 74 ┆----------- 4.5 Soft┆
0x05260…05280 77 61 72 65 20 52 65 73 65 74 20 61 6e 64 20 50 6f 77 65 72 20 63 6f 6d 6d 61 6e 64 73 2e 0d 0a ┆ware Reset and Power commands. ┆
0x05280…052a0 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 69 73 20 70 61 72 74 20 64 65 73 63 72 69 62 65 73 20 ┆ This part describes ┆
0x052a0…052c0 74 68 65 20 73 6f 66 74 77 61 72 65 20 52 65 73 65 74 20 61 6e 64 20 70 6f 77 65 72 20 64 6f 77 ┆the software Reset and power dow┆
0x052c0…052e0 6e 20 0a 19 89 80 80 66 75 6e 63 74 69 6f 6e 73 2e 0d 0a 0d 0a 0d 0a b0 a1 34 2e 35 2e 31 20 20 ┆n functions. 4.5.1 ┆
0x052e0…05300 20 20 53 6f 66 74 77 61 72 65 20 52 65 73 65 74 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 41 ┆ Software Reset. A┆
0x05300…05320 6e 20 6f 75 74 20 69 6e 73 74 72 75 63 74 69 6f 6e 20 74 6f 20 49 2f 4f 20 61 64 64 72 65 73 73 ┆n out instruction to I/O address┆
0x05320…05340 20 30 30 38 32 48 20 77 69 74 68 20 64 61 74 61 20 65 71 75 61 6c 20 0a 19 89 80 80 7a 65 72 6f ┆ 0082H with data equal zero┆
0x05340…05360 20 72 65 73 65 74 20 74 68 65 20 43 50 55 20 61 6e 64 20 74 68 65 20 6d 75 6c 74 69 62 75 73 20 ┆ reset the CPU and the multibus ┆
0x05360…05380 69 6e 20 35 6d 73 2e 0d 0a 0d 0a 0d 0a b0 a1 34 2e 35 2e 32 20 20 20 20 50 6f 77 65 72 20 44 6f ┆in 5ms. 4.5.2 Power Do┆
0x05380…053a0 77 6e 20 4f 70 65 72 61 74 69 6f 6e 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 69 73 20 ┆wn Operation. This ┆
0x053a0…053c0 70 61 72 74 20 64 65 73 72 69 62 65 73 20 74 68 65 20 70 6f 77 65 72 20 73 65 6e 73 65 20 61 6e ┆part desribes the power sense an┆
0x053c0…053e0 64 20 70 6f 77 65 72 20 73 77 69 63 68 20 0a 19 89 80 80 66 75 6e 63 74 69 6f 6e 20 6f 6e 20 74 ┆d power swich function on t┆
0x053e0…05400 68 65 20 43 50 55 20 62 6f 61 72 64 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 20 6e ┆he CPU board. The n┆
0x05400…05420 (42,) 6f 6e 2d 6d 61 73 6b 61 62 6c 65 20 69 6e 74 65 72 72 75 70 74 20 28 4e 4d 49 29 20 69 6e 20 38 ┆on-maskable interrupt (NMI) in 8┆
0x05420…05440 30 32 38 36 20 69 73 20 75 73 65 64 20 74 6f 20 0a 19 89 80 80 69 6e 64 69 63 61 74 65 20 70 6f ┆0286 is used to indicate po┆
0x05440…05460 77 65 72 20 64 6f 77 6e 20 69 6e 74 65 72 72 75 70 74 73 2e 20 54 68 65 72 65 20 69 73 20 74 77 ┆wer down interrupts. There is tw┆
0x05460…05480 6f 20 73 6f 75 72 63 65 20 74 6f 20 0a 19 89 80 80 67 65 6e 65 72 61 74 65 20 61 20 70 6f 77 65 ┆o source to generate a powe┆
0x05480…054a0 72 20 64 6f 77 6e 20 69 6e 74 65 72 72 75 70 74 2e 20 4f 6e 65 20 69 73 20 74 68 65 20 66 72 6f ┆r down interrupt. One is the fro┆
0x054a0…054c0 6e 74 20 70 61 6e 65 6c 20 0a 19 89 80 80 6b 65 79 20 61 6e 64 20 74 68 65 20 73 65 63 6f 75 6e ┆nt panel key and the secoun┆
0x054c0…054e0 64 20 69 73 20 74 68 65 20 6f 70 74 69 6f 6e 65 6c 20 62 61 74 74 65 72 69 20 62 61 63 6b 75 70 ┆d is the optionel batteri backup┆
0x054e0…054f6 20 75 6e 69 74 20 0a 19 89 80 80 42 42 43 36 30 31 2e 0d 0a 0d 0a ┆ unit BBC601. ┆
0x054f6…054f9 FormFeed {
0x054f6…054f9 0c 83 80 ┆ ┆
0x054f6…054f9 }
0x054f9…05500 0a 20 20 20 20 20 20 ┆ ┆
0x05500…05520 20 20 20 84 54 68 65 20 6b 65 79 20 61 74 20 74 68 65 20 66 72 6f 6e 74 20 70 61 6e 65 6c 20 67 ┆ The key at the front panel g┆
0x05520…05540 65 6e 65 72 61 74 65 20 61 20 4e 4d 49 20 69 6e 74 65 72 72 75 70 74 20 0a 19 89 80 80 28 50 49 ┆enerate a NMI interrupt (PI┆
0x05540…05560 4e 54 31 29 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 49 66 20 74 68 65 20 52 43 33 39 20 69 ┆NT1). If the RC39 i┆
0x05560…05580 6e 63 6c 75 64 65 73 20 61 20 62 61 74 74 65 72 69 20 62 61 63 6b 75 70 20 75 6e 69 74 20 42 42 ┆ncludes a batteri backup unit BB┆
0x05580…055a0 43 28 36 30 31 29 20 28 41 6e 20 0a 19 89 80 80 6f 70 74 69 6f 6e 29 2c 20 74 68 65 6e 20 74 68 ┆C(601) (An option), then th┆
0x055a0…055c0 65 20 4e 4d 49 20 69 6e 74 65 72 72 75 70 74 20 69 6e 70 75 74 20 69 73 20 20 63 6f 6e 6e 65 63 ┆e NMI interrupt input is connec┆
0x055c0…055e0 74 65 64 20 74 6f 20 0a 19 89 80 80 74 68 65 20 42 42 43 36 30 31 20 61 6e 64 20 69 73 20 61 63 ┆ted to the BBC601 and is ac┆
0x055e0…05600 74 69 76 61 74 65 64 20 75 6e 64 65 72 20 6d 61 69 6e 20 70 6f 77 65 72 20 66 61 69 6c 2e 20 49 ┆tivated under main power fail. I┆
0x05600…05620 (43,) 6e 20 0a 19 89 80 80 74 68 69 73 20 63 61 73 65 20 69 74 20 69 73 20 70 6f 73 69 62 6c 65 20 74 ┆n this case it is posible t┆
0x05620…05640 6f 20 64 69 73 74 69 6e 63 74 20 69 74 20 66 72 6f 6d 20 74 68 65 20 6b 65 79 20 0a 19 89 80 80 ┆o distinct it from the key ┆
0x05640…05660 69 6e 74 65 72 72 75 70 74 20 77 69 74 68 20 61 6e 20 69 6e 70 75 74 20 69 6e 73 74 72 75 63 74 ┆interrupt with an input instruct┆
0x05660…05680 69 6f 6e 20 74 6f 20 50 50 49 32 20 20 6f 6e 20 61 64 64 72 65 73 73 20 0a 19 89 80 80 30 30 39 ┆ion to PPI2 on address 009┆
0x05680…056a0 41 48 2e 20 49 66 20 64 61 74 61 20 62 69 74 20 66 6f 75 72 20 69 73 20 68 69 67 68 20 74 68 65 ┆AH. If data bit four is high the┆
0x056a0…056c0 6e 20 69 74 20 69 73 20 66 72 6f 6d 20 42 42 43 36 30 31 20 0a 19 89 80 80 61 6e 64 20 74 68 65 ┆n it is from BBC601 and the┆
0x056c0…056e0 20 62 61 74 74 65 72 69 65 73 20 69 73 20 6f 6e 20 65 6c 73 65 20 66 72 6f 6d 20 74 68 65 20 66 ┆ batteries is on else from the f┆
0x056e0…05700 72 6f 6e 74 20 6b 65 79 2e 20 49 66 20 69 74 20 0a 19 89 80 80 69 73 20 66 72 6f 6d 20 74 68 65 ┆ront key. If it is from the┆
0x05700…05720 20 42 42 43 36 30 31 2c 20 74 68 65 6e 20 64 61 74 61 62 69 74 20 74 68 72 65 65 20 69 6e 64 69 ┆ BBC601, then databit three indi┆
0x05720…05740 63 61 74 65 73 20 6d 61 69 6e 20 0a 19 89 80 80 70 6f 77 65 72 20 6f 6e 20 6f 72 20 6f 66 66 20 ┆cates main power on or off ┆
0x05740…05760 28 6f 6e 20 77 68 65 6e 20 68 69 67 68 29 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 ┆(on when high). The┆
0x05760…05780 20 43 50 55 36 31 30 58 20 70 6f 77 65 72 20 64 6f 77 6e 20 77 68 65 6e 20 69 74 20 6d 61 6b 65 ┆ CPU610X power down when it make┆
0x05780…057a0 20 61 6e 20 6f 75 74 70 75 74 20 0a 19 89 80 80 69 6e 73 74 72 75 63 74 69 6f 6e 20 74 6f 20 49 ┆ an output instruction to I┆
0x057a0…057c0 2f 4f 20 61 64 64 72 65 73 73 3a 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 30 30 39 43 48 20 77 69 ┆/O address: 009CH wi┆
0x057c0…057e0 74 68 20 64 61 74 61 20 65 71 75 61 6c 20 58 58 58 38 48 0d 0a 0d 0a 0d 0a b0 a1 34 2e 36 20 20 ┆th data equal XXX8H 4.6 ┆
0x057e0…05800 20 20 20 20 4f 6e 20 62 6f 61 72 64 20 63 6c 6f 63 6b 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 ┆ On board clock. ┆
0x05800…05820 (44,) 84 54 68 65 20 43 50 55 20 62 6f 61 72 64 20 69 6e 63 6c 75 64 65 73 20 61 20 52 65 61 6c 20 54 ┆ The CPU board includes a Real T┆
0x05820…05840 69 6d 65 20 43 6c 6f 63 6b 20 28 52 54 43 29 20 2e 20 54 68 65 20 52 54 43 20 0a 19 89 80 80 49 ┆ime Clock (RTC) . The RTC I┆
0x05840…05860 43 20 69 73 20 74 68 65 20 4d 4d 31 35 38 31 36 37 20 28 4e 61 74 69 6f 6e 61 6c 29 20 28 46 69 ┆C is the MM158167 (National) (Fi┆
0x05860…05880 73 74 20 73 6f 75 72 63 65 29 20 6f 72 20 52 54 43 35 38 33 32 31 20 0a 19 89 80 80 66 72 6f 6d ┆st source) or RTC58321 from┆
0x05880…058a0 20 53 75 77 61 20 53 65 69 6b 6f 73 68 61 20 28 73 65 63 6f 6e 64 20 73 6f 75 72 63 65 29 2e 20 ┆ Suwa Seikosha (second source). ┆
0x058a0…058c0 54 68 65 20 74 77 6f 20 73 6f 75 72 63 65 73 20 61 72 65 20 0a 19 89 80 80 6e 6f 74 20 63 6f 6d ┆The two sources are not com┆
0x058c0…058e0 70 61 74 69 62 6c 65 2e 20 53 70 65 63 69 61 6c 20 70 72 6f 67 72 61 6d 6d 69 6e 67 20 69 73 20 ┆patible. Special programming is ┆
0x058e0…05900 6e 65 63 65 73 73 61 72 79 20 69 6e 20 65 61 63 68 20 0a 19 89 80 80 63 61 73 65 2e 20 28 53 65 ┆necessary in each case. (Se┆
0x05900…05920 65 20 74 68 65 20 6d 61 6e 75 61 6c 73 20 66 72 6f 6d 20 74 68 65 20 66 61 63 74 6f 72 79 29 2e ┆e the manuals from the factory).┆
0x05920…05940 20 54 68 65 20 61 64 64 72 65 73 73 65 73 20 0a 19 89 80 80 74 6f 20 74 68 65 20 52 54 43 20 63 ┆ The addresses to the RTC c┆
0x05940…05960 6f 6d 65 20 66 72 6f 6d 20 74 68 65 20 73 65 63 6f 6e 64 20 70 61 72 61 6c 6c 65 6c 20 70 6f 72 ┆ome from the second parallel por┆
0x05960…05980 74 2e 20 54 68 65 20 52 54 43 20 0a 19 89 80 80 69 73 20 6e 6f 6e 20 73 65 6e 73 69 74 69 76 65 ┆t. The RTC is non sensitive┆
0x05980…059a0 20 74 6f 20 70 6f 77 65 72 20 66 61 69 6c 73 2e 20 54 68 65 20 43 50 55 20 62 6f 61 72 64 20 67 ┆ to power fails. The CPU board g┆
0x059a0…059c0 69 76 65 73 20 0a 19 89 80 80 62 61 74 74 65 72 79 20 62 61 63 6b 75 70 20 66 6f 72 20 61 74 20 ┆ives battery backup for at ┆
0x059c0…059e0 6c 65 61 73 74 20 6e 69 6e 65 20 79 65 61 72 73 2e 20 49 6e 20 61 20 6d 6f 6e 74 68 20 74 68 65 ┆least nine years. In a month the┆
0x059e0…05a00 20 0a 19 89 80 80 66 69 72 73 74 20 73 6f 75 72 63 65 20 77 69 6c 6c 20 64 69 66 66 65 72 20 61 ┆ first source will differ a┆
0x05a00…05a20 (45,) 74 20 74 68 65 20 6d 6f 73 74 20 30 2e 32 20 73 65 63 20 61 6e 64 20 74 68 65 20 0a 19 89 80 80 ┆t the most 0.2 sec and the ┆
0x05a20…05a3b 73 65 63 6f 6e 64 20 73 6f 75 72 63 65 20 34 30 20 73 65 63 2e 0d 0a b0 a1 0d 0a ┆second source 40 sec. ┆
0x05a3b…05a3e FormFeed {
0x05a3b…05a3e 0c 83 80 ┆ ┆
0x05a3b…05a3e }
0x05a3e…05a40 0a a1 ┆ ┆
0x05a40…05a60 b0 34 2e 37 20 20 20 20 20 20 4d 65 6d 6f 72 79 20 61 64 64 72 65 73 73 69 6e 67 2e 0d 0a b0 a1 ┆ 4.7 Memory addressing. ┆
0x05a60…05a80 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 20 45 50 52 4f 4d 73 20 61 72 65 20 81 82 74 68 65 ┆ The EPROMs are the┆
0x05a80…05aa0 20 6f 6e 6c 79 20 6f 6e 62 6f 61 72 64 20 6d 65 6d 6f 72 69 65 73 2e 20 28 54 68 65 20 62 69 70 ┆ only onboard memories. (The bip┆
0x05aa0…05ac0 6f 6c 61 72 20 0a 19 89 80 80 50 52 4f 4d 20 69 73 20 69 6e 20 49 2f 4f 20 61 64 64 72 65 73 73 ┆olar PROM is in I/O address┆
0x05ac0…05ae0 69 6e 67 20 73 70 61 63 65 29 2e 20 46 69 67 20 34 2e 37 2e 31 2d 32 20 20 73 68 6f 77 73 20 74 ┆ing space). Fig 4.7.1-2 shows t┆
0x05ae0…05b00 68 65 20 0a 19 89 80 80 74 6f 74 61 6c 20 6d 65 6d 6f 72 79 20 61 64 64 72 65 73 73 20 6d 61 70 ┆he total memory address map┆
0x05b00…05b20 20 6f 66 20 74 68 65 20 43 50 55 20 62 6f 61 72 64 20 69 6e 20 72 65 61 6c 20 61 6e 64 20 0a 19 ┆ of the CPU board in real and ┆
0x05b20…05b40 89 80 80 70 72 6f 74 65 63 74 65 64 20 76 69 72 74 75 61 6c 20 61 64 64 72 65 73 73 20 6d 6f 64 ┆ protected virtual address mod┆
0x05b40…05b60 65 2e 20 b0 a1 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 b0 a1 54 61 72 67 65 74 20 20 20 20 20 20 ┆e. Target ┆
0x05b60…05b80 20 20 20 20 20 20 20 20 20 20 6d 65 6d 6f 72 79 20 73 69 7a 65 20 20 20 20 52 65 61 6c 20 61 64 ┆ memory size Real ad┆
0x05b80…05ba0 64 72 65 73 73 20 73 70 61 63 65 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 45 50 52 4f 4d 20 28 55 ┆dress space EPROM (U┆
0x05ba0…05bc0 56 29 20 20 20 20 20 20 20 20 20 20 20 20 36 34 20 4b 20 62 79 74 65 73 20 20 20 20 20 20 20 30 ┆V) 64 K bytes 0┆
0x05bc0…05be0 46 30 30 30 30 2d 30 46 46 46 46 46 0d 0a 20 20 20 20 20 20 20 20 20 4d 55 4c 54 49 42 55 53 20 ┆F0000-0FFFFF MULTIBUS ┆
0x05be0…05c00 20 20 20 20 20 20 20 20 20 20 20 20 20 36 36 20 4b 20 62 79 74 65 73 20 20 20 20 20 20 20 30 45 ┆ 66 K bytes 0E┆
0x05c00…05c20 (46,) 30 30 30 30 2d 30 45 46 46 46 46 0d 0a 20 20 20 20 20 20 20 20 20 69 4c 42 58 20 62 75 73 20 20 ┆0000-0EFFFF iLBX bus ┆
0x05c20…05c40 20 20 20 20 20 20 20 20 20 20 20 38 39 36 20 4b 20 62 79 74 65 73 20 20 20 20 20 20 20 30 30 30 ┆ 896 K bytes 000┆
0x05c40…05c60 30 30 30 2d 30 44 46 46 46 46 0d 0a e1 f0 e1 f0 e1 f0 e1 f0 e1 f0 0d 0a b0 20 20 20 20 20 20 20 ┆000-0DFFFF ┆
0x05c60…05c80 20 20 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆ ------------------------------┆
0x05c80…05ca0 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a 0d 0a 20 20 20 ┆------------------------- ┆
0x05ca0…05cc0 20 20 20 20 20 20 46 69 67 20 34 2e 37 2e 31 20 84 54 68 65 20 4d 65 6d 6f 72 79 20 4d 61 70 20 ┆ Fig 4.7.1 The Memory Map ┆
0x05cc0…05ce0 6f 66 20 74 68 65 20 43 50 55 20 69 6e 20 52 65 61 6c 20 41 64 64 72 65 73 73 20 0a 19 93 80 80 ┆of the CPU in Real Address ┆
0x05ce0…05d00 4d 6f 64 65 2e 0d 0a b0 a1 f0 e1 20 20 20 20 20 20 20 20 20 b0 a1 54 61 72 67 65 74 20 20 20 20 ┆Mode. Target ┆
0x05d00…05d20 20 20 20 20 20 20 20 20 20 20 20 20 6d 65 6d 6f 72 79 20 73 69 7a 65 20 20 20 20 52 65 61 6c 20 ┆ memory size Real ┆
0x05d20…05d40 61 64 64 72 65 73 73 20 73 70 61 63 65 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 45 50 52 4f 4d 20 ┆address space EPROM ┆
0x05d40…05d60 28 55 56 29 20 20 20 20 20 20 20 20 20 20 20 20 36 34 20 4b 20 62 79 74 65 73 20 20 20 20 20 20 ┆(UV) 64 K bytes ┆
0x05d60…05d80 20 46 46 30 30 30 30 2d 46 46 46 46 46 46 0d 0a 20 20 20 20 20 20 20 20 20 4d 55 4c 54 49 42 55 ┆ FF0000-FFFFFF MULTIBU┆
0x05d80…05da0 53 20 20 20 20 20 20 20 20 20 20 20 20 38 31 32 38 20 4b 20 62 79 74 65 73 20 20 20 20 20 20 20 ┆S 8128 K bytes ┆
0x05da0…05dc0 38 30 30 30 30 30 2d 46 45 46 46 46 46 0d 0a 20 20 20 20 20 20 20 20 20 69 4c 42 58 20 62 75 73 ┆800000-FEFFFF iLBX bus┆
0x05dc0…05de0 20 20 20 20 20 20 20 20 20 20 20 20 38 31 39 32 20 4b 20 62 79 74 65 73 20 20 20 20 20 20 20 30 ┆ 8192 K bytes 0┆
0x05de0…05e00 30 30 30 30 30 2d 37 46 46 46 46 46 0d 0a e1 f0 e1 f0 e1 f0 e1 f0 e1 f0 0d 0a b0 20 20 20 20 20 ┆00000-7FFFFF ┆
0x05e00…05e20 (47,) 20 20 20 20 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆ ----------------------------┆
0x05e20…05e40 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a 0d 0a 20 ┆--------------------------- ┆
0x05e40…05e60 20 20 20 20 20 20 20 20 46 69 67 20 34 2e 37 2e 32 20 84 54 68 65 20 4d 65 6d 6f 72 79 20 4d 61 ┆ Fig 4.7.2 The Memory Ma┆
0x05e60…05e80 70 20 6f 66 20 74 68 65 20 43 50 55 20 69 6e 20 50 72 6f 74 65 63 74 65 64 20 56 69 72 74 75 61 ┆p of the CPU in Protected Virtua┆
0x05e80…05ea0 6c 20 0a 19 93 80 80 41 64 64 72 65 73 73 20 4d 6f 64 65 20 28 50 56 41 4d 29 2e 0d 0a 0d 0a 0d ┆l Address Mode (PVAM). ┆
0x05ea0…05ec0 0a b0 a1 81 b0 a1 34 2e 37 2e 31 20 20 20 20 4f 6e 20 62 6f 61 72 64 20 45 50 52 4f 4d 2e 0d 0a ┆ 4.7.1 On board EPROM. ┆
0x05ec0…05ee0 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 20 43 50 55 20 62 6f 61 72 64 20 63 6f 6e 74 61 69 ┆ The CPU board contai┆
0x05ee0…05f00 6e 73 20 74 77 6f 20 32 38 20 70 69 6e 73 20 4a 45 44 45 43 20 73 6f 63 6b 65 73 20 74 6f 20 74 ┆ns two 28 pins JEDEC sockes to t┆
0x05f00…05f20 68 65 20 0a 19 89 80 80 45 52 4f 4d 20 28 55 56 20 65 72 61 73 61 62 6c 65 29 2e 20 49 6e 20 65 ┆he EROM (UV erasable). In e┆
0x05f20…05f40 61 63 68 20 20 73 6f 63 6b 65 74 20 69 74 20 69 73 20 70 6f 73 73 69 62 6c 65 20 74 6f 20 0a 19 ┆ach socket it is possible to ┆
0x05f40…05f60 89 80 80 6d 6f 75 6e 74 20 49 43 27 73 20 6f 66 20 74 68 65 20 74 79 70 65 73 20 3a 20 32 37 33 ┆ mount IC's of the types : 273┆
0x05f60…05f80 32 20 28 34 6b 29 2c 20 32 37 36 34 20 28 38 6b 29 2c 20 32 37 31 32 38 20 0a 19 89 80 80 28 31 ┆2 (4k), 2764 (8k), 27128 (1┆
0x05f80…05fa0 36 6b 29 20 61 6e 64 20 32 37 32 35 36 20 28 33 32 6b 29 2e 20 41 20 6a 75 6d 70 65 72 20 6d 75 ┆6k) and 27256 (32k). A jumper mu┆
0x05fa0…05fc0 73 74 20 62 65 20 69 6e 73 65 72 74 20 77 68 65 6e 20 74 68 65 20 0a 19 89 80 80 32 37 32 35 36 ┆st be insert when the 27256┆
0x05fc0…05fe0 20 69 73 20 69 6e 20 75 73 65 2e 20 28 41 6c 6c 20 74 68 65 20 45 50 52 4f 4d 27 73 20 6d 75 73 ┆ is in use. (All the EPROM's mus┆
0x05fe0…05ff4 74 20 62 65 20 32 37 58 58 58 2c 20 20 20 20 20 20 20 20 0a ┆t be 27XXX, ┆
0x05ff4…05ff7 FormFeed {
0x05ff4…05ff7 0c 83 b0 ┆ ┆
0x05ff4…05ff7 }
0x05ff7…06000 0a 19 89 80 80 32 37 58 58 ┆ 27XX┆
0x06000…06020 (48,) 58 2d 32 2c 20 32 37 58 58 58 2d 32 2e 35 20 30 56 20 32 37 58 58 58 2d 33 2e 20 54 68 65 20 45 ┆X-2, 27XXX-2.5 0V 27XXX-3. The E┆
0x06020…06040 50 52 4f 4d 27 73 20 68 61 76 65 20 74 6f 20 62 65 20 0a 19 89 80 80 61 64 64 72 65 73 73 65 64 ┆PROM's have to be addressed┆
0x06040…06060 20 69 6e 20 74 68 65 20 74 6f 70 20 6f 66 20 74 68 65 20 6d 65 6d 6f 72 79 20 61 64 72 65 73 73 ┆ in the top of the memory adress┆
0x06060…06080 69 6e 67 20 73 70 61 63 65 2e 20 28 53 65 65 20 0a 19 89 80 80 74 68 65 20 61 64 64 72 65 73 73 ┆ing space. (See the address┆
0x06080…060a0 69 6e 67 20 6d 61 70 20 62 65 6c 6f 77 29 2e 0d 0a b0 a1 0d 0a 20 20 20 20 20 20 20 20 20 45 50 ┆ing map below). EP┆
0x060a0…060c0 52 4f 4d 27 73 20 61 64 64 72 65 73 73 20 6d 61 70 20 3a 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 ┆ROM's address map : ┆
0x060c0…060e0 b0 a1 54 79 70 65 20 20 20 20 6d 65 6d 6f 72 79 20 73 69 7a 65 20 20 20 52 65 61 6c 20 61 64 64 ┆ Type memory size Real add┆
0x060e0…06100 72 65 73 73 20 73 70 61 63 65 20 20 20 50 56 41 4d 20 73 70 61 63 65 b0 a1 20 20 0d 0a 0d 0a 20 ┆ress space PVAM space ┆
0x06100…06120 20 20 20 20 20 20 20 20 32 37 36 34 20 20 20 20 31 36 20 4b 20 62 79 74 65 73 20 20 20 20 20 20 ┆ 2764 16 K bytes ┆
0x06120…06140 30 46 43 30 30 30 2d 30 46 46 46 46 46 20 20 20 20 20 46 46 43 30 30 30 2d 46 46 46 46 46 46 0d ┆0FC000-0FFFFF FFC000-FFFFFF ┆
0x06140…06160 0a e1 f0 20 20 20 20 20 20 20 20 20 32 37 31 32 38 20 20 20 33 32 20 4b 20 62 79 74 65 73 20 20 ┆ 27128 32 K bytes ┆
0x06160…06180 20 20 20 20 30 46 38 30 30 30 2d 30 46 46 46 46 46 20 20 20 20 20 46 46 38 30 30 30 2d 46 46 46 ┆ 0F8000-0FFFFF FF8000-FFF┆
0x06180…061a0 46 46 46 0d 0a b0 a1 f0 e1 20 20 20 20 20 20 20 20 20 32 37 32 35 36 20 20 20 36 34 20 4b 20 62 ┆FFF 27256 64 K b┆
0x061a0…061c0 79 74 65 73 20 20 20 20 20 20 30 46 30 30 30 30 2d 30 46 46 46 46 46 20 20 20 20 20 46 46 30 30 ┆ytes 0F0000-0FFFFF FF00┆
0x061c0…061e0 30 30 2d 46 46 46 46 46 46 0d 0a 0d 0a b0 20 20 20 20 20 20 20 20 20 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆00-FFFFFF ---------┆
0x061e0…06200 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆--------------------------------┆
0x06200…06220 (49,) 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a 0d 0a 0d 0a b0 a1 b0 a1 34 2e 38 20 20 20 20 20 ┆-------------- 4.8 ┆
0x06220…06240 20 42 75 73 20 49 6e 74 65 72 66 61 63 65 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 ┆ Bus Interface. The┆
0x06240…06260 20 6e 65 78 74 20 70 61 72 74 20 73 68 6f 77 73 20 74 68 65 20 75 73 65 73 20 6f 66 20 62 75 73 ┆ next part shows the uses of bus┆
0x06260…06280 73 65 73 2e 20 41 6c 6c 20 74 68 65 20 62 75 73 73 65 73 20 0a 19 89 80 80 61 72 65 20 49 4e 54 ┆ses. All the busses are INT┆
0x06280…062a0 45 4c 20 63 6f 6d 70 61 74 69 62 6c 65 2e 20 28 53 65 65 20 6c 69 74 20 32 2c 33 20 61 6e 64 20 ┆EL compatible. (See lit 2,3 and ┆
0x062a0…062c0 34 20 66 6f 72 20 66 75 72 74 68 65 72 20 0a 19 89 80 80 69 6e 66 6f 72 6d 61 74 69 6f 6e 2e 29 ┆4 for further information.)┆
0x062c0…062e0 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 54 68 65 20 43 50 55 20 62 6f 61 72 64 20 75 73 65 20 ┆. The CPU board use ┆
0x062e0…06300 74 68 72 65 65 20 62 75 73 73 65 73 3a 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 31 2e 20 4d 55 4c ┆three busses: 1. MUL┆
0x06300…06320 54 49 42 55 53 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 32 2e 20 69 4c 42 58 20 62 75 73 2e 0d ┆TIBUS. 2. iLBX bus. ┆
0x06320…06340 0a 0d 0a 20 20 20 20 20 20 20 20 20 33 2e 20 69 53 42 58 20 62 75 73 2e 0d 0a 0d 0a 0d 0a a1 b0 ┆ 3. iSBX bus. ┆
0x06340…06360 34 2e 38 2e 31 20 20 20 20 4d 55 4c 54 49 42 55 53 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 ┆4.8.1 MULTIBUS. ┆
0x06360…06380 54 68 65 20 69 6e 74 65 72 66 61 63 65 20 74 6f 20 74 68 65 20 4d 55 4c 54 49 42 55 53 20 6d 61 ┆The interface to the MULTIBUS ma┆
0x06380…063a0 6b 65 73 20 75 73 65 20 6f 66 3a 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 31 2e 20 84 4f 6e 65 20 ┆kes use of: 1. One ┆
0x063a0…063c0 38 32 38 39 20 42 75 73 20 41 72 62 69 74 65 72 20 61 6e 64 20 61 20 50 41 4c 2e 0d 0a 0d 0a 20 ┆8289 Bus Arbiter and a PAL. ┆
0x063c0…063e0 20 20 20 20 20 20 20 20 32 2e 20 4f 6e 65 20 62 75 73 20 63 6f 6e 74 72 6f 6c 6c 65 72 20 38 32 ┆ 2. One bus controller 82┆
0x063e0…063e8 32 38 38 2e 0d 0a 0d 0a ┆288. ┆
0x063e8…063eb FormFeed {
0x063e8…063eb 0c 83 c8 ┆ ┆
0x063e8…063eb }
0x063eb…06400 0a b0 a1 34 2e 38 2e 32 20 20 20 20 69 4c 42 58 20 62 75 73 2e ┆ 4.8.2 iLBX bus.┆
0x06400…06420 (50,) 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 65 20 69 4c 42 58 20 62 75 73 20 69 73 20 61 20 ┆ The iLBX bus is a ┆
0x06420…06440 76 65 72 79 20 66 61 73 74 20 6d 65 6d 6f 72 79 20 62 75 73 2e 20 54 68 65 20 69 4c 42 58 20 62 ┆very fast memory bus. The iLBX b┆
0x06440…06460 75 73 20 0a 19 89 80 80 69 6e 74 65 72 66 61 63 65 73 20 74 6f 20 74 68 65 20 43 50 55 20 62 6f ┆us interfaces to the CPU bo┆
0x06460…06480 61 72 64 20 77 69 74 68 20 75 73 65 20 6f 66 20 73 74 61 6e 64 61 72 64 20 54 54 4c 20 0a 19 89 ┆ard with use of standard TTL ┆
0x06480…064a0 80 80 49 43 27 73 20 61 6e 64 20 50 41 4c 27 53 2e 20 54 68 65 20 43 50 55 20 62 6f 61 72 64 20 ┆ IC's and PAL'S. The CPU board ┆
0x064a0…064c0 61 6c 77 61 79 73 20 61 63 74 73 20 61 73 20 61 20 70 72 69 6d 61 72 79 20 0a 19 89 80 80 6d 61 ┆always acts as a primary ma┆
0x064c0…064e0 73 74 65 72 20 6f 6e 20 74 68 65 20 69 4c 42 58 20 62 75 73 2e 20 49 74 20 69 73 20 70 6f 73 73 ┆ster on the iLBX bus. It is poss┆
0x064e0…06500 69 62 6c 65 20 74 6f 20 64 69 73 63 6f 6e 6e 65 63 74 20 74 68 65 20 0a 19 89 80 80 69 4c 42 58 ┆ible to disconnect the iLBX┆
0x06500…06520 20 62 75 73 20 77 68 65 6e 20 74 68 65 20 50 43 32 20 62 69 74 20 69 6e 20 74 68 65 20 73 65 63 ┆ bus when the PC2 bit in the sec┆
0x06520…06540 6f 6e 64 20 70 61 72 61 6c 6c 65 6c 20 70 6f 72 74 20 69 73 20 0a 19 89 80 80 68 69 67 68 2e 0d ┆ond parallel port is high. ┆
0x06540…06560 0a 0d 0a 0d 0a b0 a1 a1 b0 34 2e 38 2e 33 20 20 20 20 69 53 42 58 20 62 75 73 2e 0d 0a 0d 0a 20 ┆ 4.8.3 iSBX bus. ┆
0x06560…06580 20 20 20 20 20 20 20 20 84 54 68 65 72 65 20 69 73 20 6f 6e 6c 79 20 6f 6e 65 20 69 53 42 58 20 ┆ There is only one iSBX ┆
0x06580…065a0 62 75 73 20 6f 6e 20 74 68 65 20 43 50 55 20 62 6f 61 72 64 2e 20 54 68 65 72 65 20 69 73 20 6e ┆bus on the CPU board. There is n┆
0x065a0…065c0 6f 20 0a 19 89 80 80 44 4d 41 20 73 75 70 70 6f 72 74 20 74 6f 20 74 68 65 20 69 53 42 58 20 62 ┆o DMA support to the iSBX b┆
0x065c0…065e0 75 73 20 6f 6e 20 74 68 65 20 62 6f 61 72 64 2e 20 54 68 65 20 69 53 42 58 20 62 75 73 20 0a 19 ┆us on the board. The iSBX bus ┆
0x065e0…06600 89 80 80 69 6e 74 65 72 66 61 63 65 73 20 74 6f 20 74 68 65 20 43 50 55 20 62 6f 61 72 64 20 77 ┆ interfaces to the CPU board w┆
0x06600…06620 (51,) 69 74 68 20 61 20 38 32 35 35 41 2d 35 20 70 61 72 61 6c 6c 65 6c 20 70 6f 72 74 20 0a 19 89 80 ┆ith a 8255A-5 parallel port ┆
0x06620…06640 80 61 6e 64 20 77 69 74 68 20 6e 6f 20 65 78 74 72 61 20 6c 61 74 63 68 20 6f 72 20 74 72 61 6e ┆ and with no extra latch or tran┆
0x06640…0664a 63 69 65 76 65 72 73 2e 0d 0a ┆cievers. ┆
0x0664a…0664d FormFeed {
0x0664a…0664d 0c 81 c0 ┆ ┆
0x0664a…0664d }
0x0664d…06660 0a a1 b0 35 20 20 20 20 20 20 20 20 54 45 43 48 4e 49 43 ┆ 5 TECHNIC┆
0x06660…06680 41 4c 20 44 45 53 43 52 49 50 54 49 4f 4e 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 69 ┆AL DESCRIPTION. Thi┆
0x06680…066a0 73 20 63 68 61 70 74 65 72 20 69 6e 63 6c 75 64 65 73 20 6c 6f 67 69 63 20 64 69 61 67 72 61 6d ┆s chapter includes logic diagram┆
0x066a0…066c0 73 2c 20 50 41 4c 2c 20 50 52 4f 4d 20 0a 19 89 80 80 64 65 73 63 72 69 70 74 69 6f 6e 20 61 6e ┆s, PAL, PROM description an┆
0x066c0…066e0 64 20 74 69 6d 6d 69 6e 67 20 64 69 61 67 72 61 6d 73 2e 0d 0a 0d 0a 0d 0a b0 a1 35 2e 31 20 20 ┆d timming diagrams. 5.1 ┆
0x066e0…06700 20 20 20 20 4c 6f 67 69 63 20 44 69 61 67 72 61 6d 73 20 77 69 74 68 20 53 69 67 6e 61 6c 20 44 ┆ Logic Diagrams with Signal D┆
0x06700…06720 65 73 63 72 69 70 74 69 6f 6e 73 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 84 54 68 69 73 20 70 ┆escriptions. This p┆
0x06720…06740 61 72 74 20 69 6e 63 6c 75 64 65 73 20 74 68 65 20 6c 6f 67 69 63 20 64 69 61 67 72 61 6d 73 20 ┆art includes the logic diagrams ┆
0x06740…06760 61 6e 64 20 73 69 67 6e 61 6c 20 0a 19 89 80 80 64 65 73 63 72 69 70 74 69 6f 6e 73 2e 20 54 68 ┆and signal descriptions. Th┆
0x06760…06780 65 20 6e 6f 74 61 74 69 6f 6e 20 6f 66 20 74 68 65 20 73 69 67 6e 61 6c 73 20 69 73 3a 0d 0a 0d ┆e notation of the signals is: ┆
0x06780…067a0 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 41 30 2c 20 61 63 74 69 76 65 20 b0 68 69 67 68 f0 ┆ A0, active high ┆
0x067a0…067c0 20 28 32 2e 34 56 20 2d 20 35 2e 32 35 56 29 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2f ┆ (2.4V - 5.25V) /┆
0x067c0…067de 41 30 2c 20 61 63 74 69 76 65 20 b0 6c 6f 77 f0 20 28 30 56 20 2d 20 30 2e 38 56 29 0d 0a ┆A0, active low (0V - 0.8V) ┆
0x067de…06817 Params {
0x067de…06817 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x067de…06817 00 00 00 00 00 00 00 00 0a 1a 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff ff 04 ┆ *7AKU_iså ┆
0x067de…06817 }
0x06817…06850 Params {
0x06817…06850 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x06817…06850 00 00 00 00 00 00 00 00 05 0f 19 23 2d 37 41 4b 55 5f 69 73 7d 87 91 ff 04 ┆ #-7AKU_iså ┆
0x06817…06850 }
0x06850…06851 0a ┆ ┆
0x06851…06854 FormFeed {
0x06851…06854 0c 81 9c ┆ ┆
0x06851…06854 }
0x06854…06857 0a 0d 0a ┆ ┆
0x06857…0685a FormFeed {
0x06857…0685a 0c 80 8c ┆ ┆
0x06857…0685a }
0x0685a…06860 0a 20 20 20 20 20 ┆ ┆
0x06860…06880 20 20 20 20 a1 b0 20 53 69 67 6e 61 6c e1 a1 20 20 e1 20 20 20 20 20 a1 e1 20 a1 44 65 73 74 69 ┆ Signal Desti┆
0x06880…068a0 6e 61 74 69 6f 6e e1 20 20 20 20 20 a1 e1 20 20 a1 44 65 73 63 72 69 70 74 69 6f 6e 0d 0a 0d 0a ┆nation Description ┆
0x068a0…068c0 20 20 20 20 20 20 20 20 20 20 41 30 20 2d 20 41 32 20 20 20 20 20 20 20 20 33 2c 35 2c 31 35 20 ┆ A0 - A2 3,5,15 ┆
0x068c0…068e0 20 20 20 20 20 20 20 20 20 41 30 2d 41 31 37 20 69 73 20 61 20 32 34 20 62 69 74 0d 0a 20 20 20 ┆ A0-A17 is a 24 bit ┆
0x068e0…06900 20 20 20 20 20 20 20 41 33 20 2d 20 41 37 20 20 20 20 20 20 20 20 33 2c 35 2c 31 35 2c 31 39 20 ┆ A3 - A7 3,5,15,19 ┆
0x06900…06920 20 20 20 20 20 20 61 64 64 72 65 73 73 20 62 75 73 2e 20 42 69 74 73 20 28 30 2d 46 29 0d 0a 20 ┆ address bus. Bits (0-F) ┆
0x06920…06940 20 20 20 20 20 20 20 20 20 41 38 20 2d 20 41 41 20 20 20 20 20 20 20 20 33 2c 35 2c 36 2c 31 35 ┆ A8 - AA 3,5,6,15┆
0x06940…06960 2c 31 39 20 20 20 20 20 61 72 65 20 75 73 65 64 20 66 6f 72 20 62 6f 74 68 20 6d 65 6d 6f 72 79 ┆,19 are used for both memory┆
0x06960…06980 0d 0a 20 20 20 20 20 20 20 20 20 20 41 42 20 2d 20 41 46 20 20 20 20 20 20 20 20 33 2c 35 2c 31 ┆ AB - AF 3,5,1┆
0x06980…069a0 35 2c 31 39 20 20 20 20 20 20 20 61 6e 64 20 49 2f 4f 20 61 64 64 72 65 73 73 69 6e 67 2e 20 42 ┆5,19 and I/O addressing. B┆
0x069a0…069c0 69 74 73 0d 0a 20 20 20 20 20 20 20 20 20 41 31 30 20 2d 20 41 31 37 20 20 20 20 20 20 20 35 2c ┆its A10 - A17 5,┆
0x069c0…069e0 31 35 2c 31 39 20 20 20 20 20 20 20 20 20 28 31 30 2d 31 37 29 20 61 72 65 20 74 68 65 20 38 20 ┆15,19 (10-17) are the 8 ┆
0x069e0…06a00 6d 6f 73 74 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆most ┆
0x06a00…06a20 (53,) 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 73 69 67 6e 69 66 69 63 69 61 6e 74 20 6d 65 6d 6f ┆ significiant memo┆
0x06a20…06a40 72 79 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ry ┆
0x06a40…06a60 20 20 20 20 20 20 20 20 20 20 20 20 20 61 64 64 72 65 73 73 20 62 69 74 73 2e 0d 0a 0d 0a 20 20 ┆ address bits. ┆
0x06a60…06a80 20 20 20 20 20 20 20 44 30 20 2d 20 44 37 20 20 20 20 20 20 20 20 20 33 2c 35 2c 31 31 2c 31 35 ┆ D0 - D7 3,5,11,15┆
0x06a80…06aa0 20 20 20 20 20 20 20 31 36 20 62 69 74 20 62 69 64 69 72 65 63 74 69 6f 6e 6e 61 6c 0d 0a 20 20 ┆ 16 bit bidirectionnal ┆
0x06aa0…06ac0 20 20 20 20 20 20 20 44 38 20 2d 20 44 46 20 20 20 20 20 20 20 20 20 33 2c 35 2c 31 31 2c 31 35 ┆ D8 - DF 3,5,11,15┆
0x06ac0…06ae0 2c 31 36 20 20 20 20 64 61 74 61 20 62 75 73 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 2f 42 48 ┆,16 data bus. /BH┆
0x06ae0…06b00 45 20 20 20 20 20 20 20 20 20 20 20 20 34 2c 31 38 20 20 20 20 20 20 20 20 20 20 20 20 84 43 6f ┆E 4,18 Co┆
0x06b00…06b20 6e 74 72 6f 6c 73 20 62 79 74 65 20 74 72 61 6e 73 66 65 72 20 0a 19 a9 80 80 6f 6e 20 64 61 74 ┆ntrols byte transfer on dat┆
0x06b20…06b40 61 20 62 75 73 20 6c 69 6e 65 73 20 44 38 2d 44 46 2e 0d 0a 0d 0a 09 2f 53 30 20 20 20 20 20 20 ┆a bus lines D8-DF. /S0 ┆
0x06b40…06b60 20 20 20 20 20 20 20 32 2c 34 2c 31 34 2c 32 31 20 20 20 20 20 20 20 43 50 55 20 73 74 61 74 75 ┆ 2,4,14,21 CPU statu┆
0x06b60…06b80 73 20 6c 69 6e 65 2e 0d 0a 09 2f 53 31 20 20 20 20 20 20 20 20 20 20 20 20 20 32 2c 34 2c 31 34 ┆s line. /S1 2,4,14┆
0x06b80…06ba0 2c 31 38 2c 32 31 20 20 20 20 43 50 55 20 73 74 61 74 75 73 20 6c 69 6e 65 2e 0d 0a 20 20 20 20 ┆,18,21 CPU status line. ┆
0x06ba0…06bc0 20 20 20 20 20 4d 28 2f 49 4f 29 20 20 20 20 20 20 20 20 20 20 31 2c 34 2c 31 34 2c 31 39 20 20 ┆ M(/IO) 1,4,14,19 ┆
0x06bc0…06be0 20 20 20 20 20 43 50 55 20 73 74 61 74 75 73 20 6c 69 6e 65 2e 0d 0a 20 20 20 20 20 20 20 20 20 ┆ CPU status line. ┆
0x06be0…06c00 43 4f 44 28 2f 49 4e 54 41 29 20 20 20 20 20 20 31 2c 32 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆COD(/INTA) 1,2 ┆
0x06c00…06c20 (54,) 43 50 55 20 73 74 61 74 75 73 20 6c 69 6e 65 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 2f 4c 4f ┆CPU status line. /LO┆
0x06c20…06c40 43 4b 20 20 20 20 20 20 20 20 20 20 20 31 34 20 20 20 20 20 20 20 20 20 20 20 20 20 20 84 55 73 ┆CK 14 Us┆
0x06c40…06c60 65 64 20 74 6f 20 67 69 76 65 20 74 68 65 20 43 50 55 20 0a 19 a9 80 80 65 78 63 6c 75 73 69 76 ┆ed to give the CPU exclusiv┆
0x06c60…06c80 65 20 61 63 63 65 73 73 20 74 6f 20 74 68 65 20 0a 19 a9 80 80 4d 75 6c 74 69 62 75 73 20 61 6e ┆e access to the Multibus an┆
0x06c80…06ca0 64 20 74 68 65 20 0a 19 a9 80 80 69 4c 42 58 62 75 73 2e 0d 0a 0d 0a 09 2f 50 45 41 43 4b 20 20 ┆d the iLBXbus. /PEACK ┆
0x06ca0…06cc0 20 20 20 20 20 20 20 20 32 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 84 55 73 65 20 74 6f 20 ┆ 2 Use to ┆
0x06cc0…06ce0 73 69 67 6e 61 6c 73 20 74 68 65 20 0a 19 a9 80 80 70 72 6f 63 65 73 73 6f 72 20 65 78 74 65 6e ┆signals the processor exten┆
0x06ce0…06d00 73 69 6f 6e 20 77 68 65 6e 20 0a 19 a9 80 80 74 68 65 20 72 65 71 75 65 73 74 65 64 20 6f 70 65 ┆sion when the requested ope┆
0x06d00…06d20 72 61 6e 64 20 69 73 20 0a 19 a9 80 80 62 65 69 6e 67 20 74 72 61 6e 73 66 65 72 72 65 64 2e 0d ┆rand is being transferred. ┆
0x06d20…06d40 0a 0d 0a 09 48 4c 44 41 20 20 20 20 20 20 20 20 20 20 20 20 32 2c 31 38 20 20 20 20 20 20 20 20 ┆ HLDA 2,18 ┆
0x06d40…06d60 20 20 20 20 84 55 73 65 64 20 74 6f 20 70 61 73 73 20 63 6f 6e 74 72 6f 6c 20 6f 66 20 0a 19 a9 ┆ Used to pass control of ┆
0x06d60…06d80 80 80 74 68 65 20 69 4c 42 58 62 75 73 20 74 6f 20 61 20 0a 19 a9 80 80 73 65 63 6f 6e 64 61 72 ┆ the iLBXbus to a secondar┆
0x06d80…06da0 79 20 6d 61 73 74 65 72 20 62 6f 61 72 64 2e 0d 0a 0d 0a 09 49 4e 54 52 20 43 59 43 09 34 2c 31 ┆y master board. INTR CYC 4,1┆
0x06da0…06dc0 39 09 84 49 6e 64 69 63 61 74 65 73 20 61 6e 20 69 6e 74 65 72 72 75 70 74 20 0a 19 a9 80 80 63 ┆9 Indicates an interrupt c┆
0x06dc0…06de0 79 63 6c 65 2e 0d 0a 0d 0a 09 49 4e 54 41 2f 28 2f 43 29 09 31 39 09 84 41 20 73 74 61 74 75 73 ┆ycle. INTA/(/C) 19 A status┆
0x06de0…06e00 20 73 69 67 6e 61 6c 20 66 72 6f 6d 20 74 68 65 20 0a 19 a9 80 80 38 30 32 38 36 2e 0d 0a 0d 0a ┆ signal from the 80286. ┆
0x06e00…06e20 (55,) 09 42 4d 2f 28 2f 49 4f 29 09 31 09 84 41 20 73 74 61 74 75 73 20 73 69 67 6e 61 6c 20 66 72 6f ┆ BM/(/IO) 1 A status signal fro┆
0x06e20…06e33 6d 20 74 68 65 20 0a 19 a9 80 80 38 30 32 38 36 2e 0d 0a ┆m the 80286. ┆
0x06e33…06e36 FormFeed {
0x06e33…06e36 0c 84 84 ┆ ┆
0x06e33…06e36 }
0x06e36…06e39 0a 0d 0a ┆ ┆
0x06e39…06e3c FormFeed {
0x06e39…06e3c 0c 80 8c ┆ ┆
0x06e39…06e3c }
0x06e3c…06e40 0a 20 20 20 ┆ ┆
0x06e40…06e60 20 20 20 20 20 20 a1 b0 20 53 69 67 6e 61 6c e1 a1 20 20 e1 20 20 20 20 20 a1 44 65 73 74 69 6e ┆ Signal Destin┆
0x06e60…06e80 61 74 69 6f 6e e1 20 20 20 20 20 a1 e1 20 20 a1 44 65 73 63 72 69 70 74 69 6f 6e 0d 0a 0d 0a 09 ┆ation Description ┆
0x06e80…06ea0 2f 49 4e 49 54 20 20 20 20 20 20 20 20 20 20 20 32 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆/INIT 2 ┆
0x06ea0…06ec0 84 52 65 73 65 74 20 74 68 65 20 6d 75 6c 74 69 62 75 73 20 61 6e 64 20 0a 19 a9 80 80 74 68 65 ┆ Reset the multibus and the┆
0x06ec0…06ee0 20 43 50 55 20 62 6f 61 72 64 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 38 30 32 38 37 52 45 53 ┆ CPU board. 80287RES┆
0x06ee0…06f00 45 54 20 20 20 20 20 20 32 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 52 65 73 65 74 20 74 68 ┆ET 2 Reset th┆
0x06f00…06f20 65 20 38 30 32 38 37 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 52 45 53 45 54 20 20 20 20 20 20 ┆e 80287. RESET ┆
0x06f20…06f40 20 20 20 20 20 31 2c 32 2c 34 2c 38 2c 31 32 2c 31 36 20 20 20 52 65 73 65 74 20 74 68 65 20 43 ┆ 1,2,4,8,12,16 Reset the C┆
0x06f40…06f60 50 55 20 62 6f 61 72 64 2e 0d 0a 09 2f 52 45 53 45 54 20 20 20 20 20 20 20 20 20 20 37 2c 39 2c ┆PU board. /RESET 7,9,┆
0x06f60…06f80 31 32 2c 31 33 2c 31 34 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆12,13,14 ┆
0x06f80…06fa0 20 20 20 31 37 2c 31 38 2c 32 30 2c 32 31 0d 0a 0d 0a 09 43 50 55 43 4c 4b 20 20 20 20 20 20 20 ┆ 17,18,20,21 CPUCLK ┆
0x06fa0…06fc0 20 20 20 31 2c 32 2c 34 2c 31 32 2c 31 34 20 20 20 20 20 84 31 32 4d 48 7a 20 28 43 50 55 36 31 ┆ 1,2,4,12,14 12MHz (CPU61┆
0x06fc0…06fe0 30 41 29 20 6f 72 20 31 36 4d 48 7a 20 0a 19 a9 80 80 28 43 50 55 36 31 30 42 29 20 63 6c 6f 63 ┆0A) or 16MHz (CPU610B) cloc┆
0x06fe0…07000 6b 20 77 69 74 68 20 35 30 25 20 0a 19 a9 80 80 64 75 74 79 20 63 79 63 6c 65 2e 0d 0a 20 09 2f ┆k with 50% duty cycle. /┆
0x07000…07020 (56,) 43 50 55 43 4c 4b 20 20 20 20 20 20 20 20 20 31 34 2c 32 30 2c 32 31 0d 0a 0d 0a 20 20 20 20 20 ┆CPUCLK 14,20,21 ┆
0x07020…07040 20 20 20 20 50 43 4c 4b 20 20 20 20 20 20 20 20 20 20 20 20 32 2c 34 2c 31 32 2c 31 34 20 20 20 ┆ PCLK 2,4,12,14 ┆
0x07040…07060 20 20 20 20 84 36 4d 48 7a 20 28 43 50 55 36 31 30 41 29 20 6f 72 20 38 4d 48 7a 20 0a 19 a9 80 ┆ 6MHz (CPU610A) or 8MHz ┆
0x07060…07080 80 28 43 50 55 36 31 30 42 29 20 63 6c 6f 63 6b 20 77 69 74 68 20 35 30 25 20 0a 19 a9 80 80 64 ┆ (CPU610B) clock with 50% d┆
0x07080…070a0 75 74 79 20 63 79 63 6c 65 2e 0d 0a 0d 0a 20 09 4d 43 4c 4b 20 20 20 20 20 20 20 20 20 20 20 20 ┆uty cycle. MCLK ┆
0x070a0…070c0 32 2c 33 2c 34 2c 31 36 20 20 20 20 20 20 20 20 84 31 30 4d 48 7a 20 63 6c 6f 63 6b 20 77 69 74 ┆2,3,4,16 10MHz clock wit┆
0x070c0…070e0 68 20 35 30 25 20 0a 19 a9 80 80 64 75 74 79 20 63 79 63 6c 65 2e 0d 0a 09 2f 4d 43 4c 4b 20 20 ┆h 50% duty cycle. /MCLK ┆
0x070e0…07100 20 20 20 20 20 20 20 20 20 33 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 2f 52 45 41 44 59 20 20 20 ┆ 3 /READY ┆
0x07100…07120 20 20 20 20 20 20 20 31 2c 32 2c 34 2c 31 32 2c 31 34 20 20 20 20 20 84 49 74 20 69 6e 64 69 63 ┆ 1,2,4,12,14 It indic┆
0x07120…07140 61 74 65 73 20 77 68 65 6e 20 74 68 65 20 0a 19 a9 80 80 63 75 72 72 65 6e 74 20 62 75 73 20 63 ┆ates when the current bus c┆
0x07140…07160 79 63 6c 65 20 69 73 20 74 6f 20 0a 19 a9 80 80 62 65 20 63 6f 6d 70 6c 65 74 65 64 2e 0d 0a 0d ┆ycle is to be completed. ┆
0x07160…07180 0a 09 38 30 32 38 37 43 4c 4b 20 20 20 20 20 20 20 20 32 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ 80287CLK 2 ┆
0x07180…071a0 20 20 84 41 20 63 6c 6f 63 6b 20 73 69 67 6e 61 6c 20 74 6f 20 74 68 65 20 0a 19 a9 80 80 38 30 ┆ A clock signal to the 80┆
0x071a0…071c0 32 38 37 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 50 45 52 45 51 20 20 20 20 20 20 20 20 20 20 ┆287. PEREQ ┆
0x071c0…071e0 20 31 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 84 49 74 20 69 6e 64 69 63 61 74 65 73 20 77 ┆ 1 It indicates w┆
0x071e0…07200 68 65 6e 20 74 68 65 20 0a 19 a9 80 80 38 30 32 38 37 20 69 73 20 72 65 61 64 79 20 74 6f 20 0a ┆hen the 80287 is ready to ┆
0x07200…07220 (57,) 19 a9 80 80 74 72 61 6e 73 66 65 72 20 64 61 74 61 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 2f ┆ transfer data. /┆
0x07220…07240 42 55 53 59 20 20 20 20 20 20 20 20 20 20 20 31 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 84 ┆BUSY 1 ┆
0x07240…07260 38 30 32 38 37 20 69 73 20 63 75 72 72 65 6e 74 6c 79 20 0a 19 a9 80 80 65 78 65 63 75 74 69 6e ┆80287 is currently executin┆
0x07260…07280 67 20 61 20 63 6f 6d 6d 61 6e 64 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 2f 45 52 52 4f 52 20 ┆g a command. /ERROR ┆
0x07280…072a0 20 20 20 20 20 20 20 20 20 31 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 84 41 6e 20 75 6e 6d ┆ 1 An unm┆
0x072a0…072c0 61 73 6b 65 64 20 65 72 72 6f 72 20 0a 19 a9 80 80 63 6f 6e 64 69 74 69 6f 6e 20 65 78 69 73 74 ┆asked error condition exist┆
0x072c0…072d4 73 20 69 6e 20 0a 19 a9 80 80 38 30 32 38 37 2e 0d 0a 0d 0a ┆s in 80287. ┆
0x072d4…072d7 FormFeed {
0x072d4…072d7 0c 83 f8 ┆ ┆
0x072d4…072d7 }
0x072d7…072da 0a 0d 0a ┆ ┆
0x072da…072dd FormFeed {
0x072da…072dd 0c 80 8c ┆ ┆
0x072da…072dd }
0x072dd…072e0 0a 20 20 ┆ ┆
0x072e0…07300 20 20 20 20 20 20 20 a1 b0 20 53 69 67 6e 61 6c e1 a1 20 20 e1 20 20 20 20 20 a1 44 65 73 74 69 ┆ Signal Desti┆
0x07300…07320 6e 61 74 69 6f 6e e1 20 20 20 20 20 a1 e1 20 20 a1 44 65 73 63 72 69 70 74 69 6f 6e 0d 0a 0d 0a ┆nation Description ┆
0x07320…07340 09 50 55 41 44 52 30 20 20 20 20 20 20 20 20 20 20 32 30 2c 32 31 20 20 20 20 20 20 20 20 20 20 ┆ PUADR0 20,21 ┆
0x07340…07360 20 50 55 41 44 52 30 2d 50 55 41 44 52 46 20 69 73 20 61 20 31 36 0d 0a 09 50 55 41 44 52 31 20 ┆ PUADR0-PUADRF is a 16 PUADR1 ┆
0x07360…07380 20 20 20 20 20 20 20 20 20 32 2c 36 2c 37 2c 38 2c 39 20 20 20 20 20 20 20 62 69 74 20 61 64 64 ┆ 2,6,7,8,9 bit add┆
0x07380…073a0 72 65 73 73 20 62 75 73 20 74 6f 20 62 6f 74 68 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ress bus to both ┆
0x073a0…073c0 20 20 20 20 20 20 20 20 20 20 20 31 30 2c 31 31 2c 31 32 2c 31 33 2c 20 20 20 20 6d 65 6d 6f 72 ┆ 10,11,12,13, memor┆
0x073c0…073e0 79 20 61 6e 64 20 49 2f 4f 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆y and I/O. ┆
0x073e0…07400 20 20 20 20 20 31 34 2c 32 30 20 20 20 20 20 20 20 20 20 20 20 43 6f 6d 62 69 6e 61 74 69 6f 6e ┆ 14,20 Combination┆
0x07400…07420 (58,) 73 20 6f 66 20 50 55 41 44 52 30 0d 0a 09 50 55 41 44 52 32 20 20 20 20 20 20 20 20 20 20 32 2c ┆s of PUADR0 PUADR2 2,┆
0x07420…07440 36 2c 37 2c 38 2c 39 2c 20 20 20 20 20 20 61 6e 64 20 2f 42 48 45 20 69 6e 64 69 63 61 74 65 20 ┆6,7,8,9, and /BHE indicate ┆
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0x07460…07480 30 2c 31 31 2c 31 32 2c 31 33 2c 20 20 20 20 6f 72 20 77 6f 72 64 20 74 72 61 6e 73 66 65 72 2e ┆0,11,12,13, or word transfer.┆
0x07480…074a0 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 34 2c 32 30 ┆ 14,20┆
0x074a0…074c0 0d 0a 09 50 55 41 44 52 33 20 20 20 20 20 20 20 20 20 20 31 31 2c 31 36 2c 32 30 0d 0a 20 20 20 ┆ PUADR3 11,16,20 ┆
0x074c0…074e0 20 20 20 20 20 20 50 55 41 44 52 34 20 20 20 20 20 20 20 20 20 20 31 31 2c 32 30 0d 0a 20 20 20 ┆ PUADR4 11,20 ┆
0x074e0…07500 20 20 20 20 20 20 50 55 41 44 52 35 2d 50 55 41 44 52 46 20 20 20 31 31 0d 0a 0d 0a 09 2f 42 43 ┆ PUADR5-PUADRF 11 /BC┆
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0x07520…07540 4d 48 7a 20 63 6c 6f 63 6b 20 73 69 67 6e 61 6c 20 66 6f 72 20 0a 19 a9 80 80 74 68 65 20 38 32 ┆MHz clock signal for the 82┆
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0x07580…075a0 84 31 30 4d 48 7a 20 63 6c 6f 63 6b 20 73 69 67 6e 61 6c 2e 20 0a 19 a9 80 80 2f 43 43 4c 4b 20 ┆ 10MHz clock signal. /CCLK ┆
0x075a0…075c0 20 69 73 20 69 6e 76 65 72 73 65 20 74 6f 20 0a 19 a9 80 80 2f 42 43 4c 4b 2e 0d 0a 0d 0a 09 2f ┆ is inverse to /BCLK. /┆
0x075c0…075e0 4d 42 49 4f 57 43 20 20 20 20 20 20 20 20 20 37 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 4d ┆MBIOWC 7 M┆
0x075e0…07600 75 6c 74 69 62 75 73 20 49 2f 4f 20 77 72 69 74 65 2e 0d 0a 0d 0a 09 2f 4d 42 41 43 4b 09 32 30 ┆ultibus I/O write. /MBACK 20┆
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0x07640…07660 31 36 20 62 69 74 20 62 69 64 69 72 65 63 74 69 6f 6e 61 6c 0d 0a 20 20 20 20 20 20 20 20 20 20 ┆16 bit bidirectional ┆
0x07660…07680 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 31 2c 31 32 2c 31 33 2c 31 36 2c 31 37 20 20 64 ┆ 11,12,13,16,17 d┆
0x07680…076a0 61 74 61 20 62 75 73 20 66 6f 72 20 6f 6e 20 62 6f 61 72 64 0d 0a 09 49 4f 44 41 54 32 2d 49 4f ┆ata bus for on board IODAT2-IO┆
0x076a0…076c0 44 41 54 33 09 32 2c 36 2c 38 2c 39 2c 31 30 2c 31 31 2c 20 20 64 65 76 69 63 65 73 2e 20 28 4e ┆DAT3 2,6,8,9,10,11, devices. (N┆
0x076c0…076e0 6f 74 65 20 74 68 61 74 0d 0a 09 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 32 2c 31 33 ┆ote that 12,13┆
0x076e0…07700 2c 31 36 2c 31 37 20 20 20 20 20 74 68 65 20 69 53 42 58 62 75 73 20 61 63 74 73 20 61 73 20 61 ┆,16,17 the iSBXbus acts as a┆
0x07700…07720 6e 0d 0a 09 49 4f 44 41 54 34 2d 49 4f 44 41 54 37 20 20 20 32 2c 36 2c 38 2c 39 2c 31 30 2c 31 ┆n IODAT4-IODAT7 2,6,8,9,10,1┆
0x07720…07740 32 20 20 20 6f 6e 62 6f 61 72 64 20 64 65 76 69 63 65 29 2e 0d 0a 09 09 31 33 2c 31 36 2c 31 37 ┆2 onboard device). 13,16,17┆
0x07740…0775b 0d 0a 09 49 4f 44 41 54 37 2d 49 4f 44 41 54 46 20 20 20 32 2c 31 36 0d 0a 0d 0a ┆ IODAT7-IODATF 2,16 ┆
0x0775b…0775e FormFeed {
0x0775b…0775e 0c 83 8c ┆ ┆
0x0775b…0775e }
0x0775e…07760 0a 0d ┆ ┆
0x07760…07761 0a ┆ ┆
0x07761…07764 FormFeed {
0x07761…07764 0c 80 8c ┆ ┆
0x07761…07764 }
0x07764…07765 0a ┆ ┆
0x07765…0779e Params {
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0x07765…0779e }
0x0779e…077d7 Params {
0x0779e…077d7 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
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0x0779e…077d7 }
0x077d7…077e0 0a 20 20 20 20 20 20 20 20 ┆ ┆
0x077e0…07800 20 a1 b0 20 53 69 67 6e 61 6c e1 a1 20 20 e1 20 20 20 20 20 a1 44 65 73 74 69 6e 61 74 69 6f 6e ┆ Signal Destination┆
0x07800…07820 (60,) e1 20 20 20 20 20 a1 e1 20 20 a1 44 65 73 63 72 69 70 74 69 6f 6e 0d 0a 0d 0a 09 2f 4c 4d 52 44 ┆ Description /LMRD┆
0x07820…07840 43 09 31 31 2c 31 38 09 84 4c 6f 63 61 6c 20 4d 65 6d 6f 72 79 20 52 65 61 64 20 0a 19 a9 80 80 ┆C 11,18 Local Memory Read ┆
0x07840…07860 43 6f 6d 6d 61 6e 64 2e 28 4e 6f 74 65 20 74 68 61 74 20 74 68 65 20 0a 19 a9 80 80 69 4c 42 58 ┆Command.(Note that the iLBX┆
0x07860…07880 62 75 73 20 61 63 74 73 20 61 73 20 6f 6e 20 62 6f 61 72 64 20 0a 19 a9 80 80 6d 65 6d 6f 72 79 ┆bus acts as on board memory┆
0x07880…078a0 29 2e 0d 0a 09 2f 4c 4d 57 54 43 09 20 31 38 09 84 4c 6f 63 61 6c 20 4d 65 6d 6f 72 79 20 57 72 ┆). /LMWTC 18 Local Memory Wr┆
0x078a0…078c0 69 74 65 20 0a 19 a9 80 80 43 6f 6d 6d 61 6e 64 2e 0d 0a 09 2f 4c 49 4f 52 44 20 20 20 20 20 20 ┆ite Command. /LIORD ┆
0x078c0…078e0 20 20 20 20 32 2c 36 2c 38 2c 39 2c 31 30 2c 31 31 2c 20 20 4c 6f 63 61 6c 20 49 2f 4f 20 52 65 ┆ 2,6,8,9,10,11, Local I/O Re┆
0x078e0…07900 61 64 2e 0d 0a 09 09 31 32 2c 31 33 2c 31 36 2c 31 37 2c 31 38 0d 0a 09 4c 49 4f 52 44 20 20 20 ┆ad. 12,13,16,17,18 LIORD ┆
0x07900…07920 20 09 31 37 0d 0a 09 2f 4c 49 4f 57 52 20 20 20 20 20 20 20 20 20 20 32 2c 36 2c 37 2c 38 2c 39 ┆ 17 /LIOWR 2,6,7,8,9┆
0x07920…07940 2c 31 30 2c 20 20 20 4c 6f 63 61 6c 20 49 2f 4f 20 57 72 69 74 65 2e 0d 0a 09 09 31 31 2c 31 32 ┆,10, Local I/O Write. 11,12┆
0x07940…07960 2c 31 33 2c 31 36 2c 0d 0a 09 09 31 37 2c 31 38 0d 0a 09 2f 4c 49 4e 54 41 09 36 2c 31 33 2c 31 ┆,13,16, 17,18 /LINTA 6,13,1┆
0x07960…07980 39 2c 32 30 20 20 20 20 20 20 84 4c 6f 63 61 6c 20 49 6e 74 65 72 72 75 70 74 20 0a 19 a9 80 80 ┆9,20 Local Interrupt ┆
0x07980…079a0 41 63 6b 6e 6f 77 6c 65 64 67 65 2e 0d 0a 09 4f 42 44 54 2f 52 09 33 2c 35 2c 32 31 09 84 43 6f ┆Acknowledge. OBDT/R 3,5,21 Co┆
0x079a0…079c0 6e 74 72 6f 6c 73 20 74 68 65 20 64 69 72 65 63 74 69 6f 6e 20 0a 19 a9 80 80 74 68 65 20 64 61 ┆ntrols the direction the da┆
0x079c0…079e0 74 61 20 66 6c 6f 77 2e 20 49 66 20 68 69 67 68 20 0a 19 a9 80 80 74 68 65 6e 20 61 20 77 72 69 ┆ta flow. If high then a wri┆
0x079e0…07a00 74 65 20 63 79 63 6c 65 20 69 73 20 0a 19 a9 80 80 70 65 72 66 6f 72 6d 65 64 2e 0d 0a 09 4c 42 ┆te cycle is performed. LB┆
0x07a00…07a20 (61,) 58 44 45 4e 09 31 39 09 84 45 6e 61 62 6c 65 73 20 74 68 65 20 64 61 74 61 20 74 6f 20 74 68 65 ┆XDEN 19 Enables the data to the┆
0x07a20…07a40 20 0a 19 a9 80 80 69 4c 42 58 62 75 73 2e 0d 0a 09 4c 4d 43 45 09 36 20 20 20 20 20 20 20 20 20 ┆ iLBXbus. LMCE 6 ┆
0x07a40…07a60 20 20 20 20 20 20 84 45 6e 61 62 6c 65 73 20 63 61 73 63 61 64 65 20 20 0a 19 a9 80 80 61 64 64 ┆ Enables cascade add┆
0x07a60…07a80 72 65 73 73 65 73 20 66 72 6f 6d 20 74 68 65 20 0a 19 a9 80 80 6d 61 73 74 65 72 20 38 32 35 39 ┆resses from the master 8259┆
0x07a80…07aa0 41 20 69 6e 74 65 72 72 75 70 74 20 0a 19 a9 80 80 63 6f 6e 74 72 6f 6c 6c 65 72 20 74 6f 20 74 ┆A interrupt controller to t┆
0x07aa0…07ac0 68 65 20 43 50 55 20 0a 19 a9 80 80 61 64 64 72 65 73 73 20 62 75 73 2e 0d 0a 09 2f 4c 41 4c 45 ┆he CPU address bus. /LALE┆
0x07ac0…07ae0 09 33 2c 34 2c 31 32 2c 31 34 2c 31 39 2c 20 20 20 43 6f 6e 74 72 6f 6c 73 20 74 68 65 20 61 64 ┆ 3,4,12,14,19, Controls the ad┆
0x07ae0…07b00 64 72 65 73 73 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆dress ┆
0x07b00…07b20 32 31 20 20 20 20 20 20 20 20 20 20 20 20 20 20 6c 61 74 63 68 73 2e 0d 0a 09 4c 41 4c 45 09 32 ┆21 latchs. LALE 2┆
0x07b20…07b40 30 0d 0a 09 2f 4f 42 44 45 4e 09 33 09 84 45 6e 61 62 6c 65 73 20 74 68 65 20 6f 6e 62 61 72 64 ┆0 /OBDEN 3 Enables the onbard┆
0x07b40…07b60 20 64 61 74 61 20 0a 19 a9 80 80 74 72 61 6e 73 65 69 76 65 72 73 2e 0d 0a 09 4d 42 49 4e 54 30 ┆ data transeivers. MBINT0┆
0x07b60…07b80 2d 4d 42 49 4e 54 37 09 31 33 09 84 49 6e 74 65 72 72 75 70 74 73 20 66 72 6f 6d 20 74 68 65 20 ┆-MBINT7 13 Interrupts from the ┆
0x07b80…07ba0 0a 19 a9 80 80 6d 75 6c 74 69 62 75 73 2e 0d 0a 09 35 20 4d 48 7a 20 43 4c 4b 09 32 20 20 20 20 ┆ multibus. 5 MHz CLK 2 ┆
0x07ba0…07bc0 20 20 20 20 20 20 20 20 20 20 20 84 35 30 25 20 64 75 74 79 20 63 79 63 6c 65 20 63 6c 6f 63 6b ┆ 50% duty cycle clock┆
0x07bc0…07be0 20 74 6f 20 0a 19 a9 80 80 74 68 65 20 38 30 32 38 37 20 69 6e 20 35 2e 30 20 4d 48 7a 20 0a 19 ┆ to the 80287 in 5.0 MHz ┆
0x07be0…07c00 a9 80 80 76 65 72 73 69 6f 6e 2e 0d 0a 09 53 45 52 43 4c 4b 09 39 20 20 20 20 20 20 20 20 20 20 ┆ version. SERCLK 9 ┆
0x07c00…07c20 (62,) 20 20 20 20 20 84 49 73 20 74 68 65 20 43 50 55 43 4c 4b 20 64 69 76 69 64 65 64 20 62 79 20 0a ┆ Is the CPUCLK divided by ┆
0x07c20…07c40 19 a9 80 80 66 6f 75 72 20 74 6f 20 74 68 65 20 38 32 37 34 20 4d 50 53 43 2e 0d 0a 09 54 43 4c ┆ four to the 8274 MPSC. TCL┆
0x07c40…07c60 4b 09 31 30 09 84 31 2e 32 35 4d 48 7a 20 35 30 25 20 64 75 74 79 20 63 79 63 6c 65 20 0a 19 a9 ┆K 10 1.25MHz 50% duty cycle ┆
0x07c60…07c80 80 80 63 6c 6f 63 6b 20 74 6f 20 62 61 75 64 20 72 61 74 65 20 0a 19 a9 80 80 67 65 6e 65 72 61 ┆ clock to baud rate genera┆
0x07c80…07ca0 74 69 6f 6e 2e 0d 0a 09 2f 4c 42 48 45 09 31 38 2c 32 30 2c 32 31 20 20 20 20 20 20 20 20 84 49 ┆tion. /LBHE 18,20,21 I┆
0x07ca0…07cc0 74 20 63 6f 6e 74 72 6f 6c 73 20 74 68 65 20 64 61 74 61 20 0a 19 a9 80 80 66 6c 6f 77 20 74 6f ┆t controls the data flow to┆
0x07cc0…07ce0 20 74 68 65 20 6d 75 6c 74 69 62 75 73 20 6f 6e 20 0a 19 a9 80 80 74 68 65 20 64 61 74 61 20 6c ┆ the multibus on the data l┆
0x07ce0…07d00 69 6e 65 73 20 44 38 2d 44 46 2e 0d 0a 09 4c 49 4e 54 52 20 43 59 43 09 32 2c 34 20 20 20 20 20 ┆ines D8-DF. LINTR CYC 2,4 ┆
0x07d00…07d20 20 20 20 20 20 20 20 20 84 49 74 20 69 6e 64 69 63 61 74 65 73 20 74 68 65 20 63 75 72 72 65 6e ┆ It indicates the curren┆
0x07d20…07d40 74 20 0a 19 a9 80 80 62 75 73 20 63 79 63 6c 65 20 73 65 72 76 69 63 65 73 20 61 20 0a 19 a9 80 ┆t bus cycle services a ┆
0x07d40…07d60 80 6c 6f 63 61 6c 20 69 6e 74 65 72 72 75 70 74 2e 0d 0a 09 2f 4c 42 55 53 20 45 4e 09 34 09 84 ┆ local interrupt. /LBUS EN 4 ┆
0x07d60…07d80 54 68 65 20 63 75 72 72 65 6e 74 20 62 75 73 20 63 79 63 6c 65 20 69 73 20 0a 19 a9 80 80 61 20 ┆The current bus cycle is a ┆
0x07d80…07da0 6c 6f 63 61 6c 20 49 2f 4f 20 63 79 63 6c 65 0d 0a 09 4d 42 52 45 51 09 31 34 2c 32 30 20 20 20 ┆local I/O cycle MBREQ 14,20 ┆
0x07da0…07dc0 20 20 20 20 20 20 20 20 84 54 68 65 20 63 75 72 72 65 6e 74 20 62 75 73 20 63 79 63 6c 65 20 69 ┆ The current bus cycle i┆
0x07dc0…07de0 73 20 0a 19 a9 80 80 61 20 6d 75 6c 74 69 62 75 73 20 63 79 63 6c 65 2e 0d 0a 09 53 4c 43 53 09 ┆s a multibus cycle. SLCS ┆
0x07de0…07e00 32 30 20 20 20 20 20 20 20 20 20 20 20 20 20 20 84 43 68 69 70 20 73 65 6c 65 63 74 20 73 69 67 ┆20 Chip select sig┆
0x07e00…07e20 (63,) 6e 61 6c 20 74 6f 20 0a 19 a9 80 80 74 68 65 20 69 6e 74 65 72 72 75 70 74 20 0a 19 a9 80 80 63 ┆nal to the interrupt c┆
0x07e20…07e40 6f 6e 74 72 6f 6c 6c 65 72 73 2c 20 74 68 65 20 0a 19 a9 80 80 69 6e 74 65 72 72 75 70 74 20 6f ┆ontrollers, the interrupt o┆
0x07e40…07e60 75 74 70 75 74 73 2c 20 74 68 65 20 0a 19 a9 80 80 52 54 43 20 61 6e 64 20 74 68 65 20 62 69 70 ┆utputs, the RTC and the bip┆
0x07e60…07e73 6f 6c 61 72 20 0a 19 a9 80 80 50 52 4f 4d 27 73 2e 0d 0a ┆olar PROM's. ┆
0x07e73…07e76 FormFeed {
0x07e73…07e76 0c 83 d0 ┆ ┆
0x07e73…07e76 }
0x07e76…07e77 0a ┆ ┆
0x07e77…07eb0 Params {
0x07e77…07eb0 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x07e77…07eb0 00 00 00 00 00 00 00 00 0a 1a 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff ff 04 ┆ *7AKU_iså ┆
0x07e77…07eb0 }
0x07eb0…07ee9 Params {
0x07eb0…07ee9 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x07eb0…07ee9 00 00 00 00 00 00 00 00 0a 1a 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff ff 04 ┆ *7AKU_iså ┆
0x07eb0…07ee9 }
0x07ee9…07eec 0a 0d 0a ┆ ┆
0x07eec…07eef FormFeed {
0x07eec…07eef 0c 80 8c ┆ ┆
0x07eec…07eef }
0x07eef…07f00 0a 20 20 20 20 20 20 20 20 20 a1 b0 20 53 69 67 6e ┆ Sign┆
0x07f00…07f20 61 6c e1 a1 20 20 e1 20 20 20 20 20 a1 44 65 73 74 69 6e 61 74 69 6f 6e e1 20 20 20 20 20 a1 e1 ┆al Destination ┆
0x07f20…07f40 20 20 a1 44 65 73 63 72 69 70 74 69 6f 6e 0d 0a 0d 0a 09 41 42 30 2d 41 42 32 33 09 35 09 84 69 ┆ Description AB0-AB23 5 i┆
0x07f40…07f60 4c 42 58 62 75 73 20 61 64 64 72 65 73 73 20 0a 19 a9 80 80 74 72 61 6e 73 65 69 76 65 72 73 2e ┆LBXbus address transeivers.┆
0x07f60…07f80 0d 0a 0d 0a 09 44 42 30 2d 44 42 31 35 20 09 35 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 84 ┆ DB0-DB15 5 ┆
0x07f80…07fa0 69 4c 42 58 62 75 73 20 64 61 74 61 20 0a 19 a9 80 80 74 72 61 6e 73 65 69 76 65 72 73 2e 0d 0a ┆iLBXbus data transeivers. ┆
0x07fa0…07fa3 FormFeed {
0x07fa0…07fa3 0c 80 d4 ┆ ┆
0x07fa0…07fa3 }
0x07fa3…07fa6 0a 0d 0a ┆ ┆
0x07fa6…07fa9 FormFeed {
0x07fa6…07fa9 0c 80 8c ┆ ┆
0x07fa6…07fa9 }
0x07fa9…07fc0 0a 20 20 20 20 20 20 20 20 20 a1 b0 20 53 69 67 6e 61 6c e1 a1 20 20 ┆ Signal ┆
0x07fc0…07fe0 e1 20 20 20 20 20 a1 44 65 73 74 69 6e 61 74 69 6f 6e e1 20 20 20 20 20 a1 e1 20 20 a1 44 65 73 ┆ Destination Des┆
0x07fe0…08000 63 72 69 70 74 69 6f 6e 0d 0a 0d 0a 09 49 4e 54 52 09 31 09 84 49 6e 74 65 72 72 75 70 74 20 74 ┆cription INTR 1 Interrupt t┆
0x08000…08020 (64,) 6f 20 38 30 32 38 36 2e 0d 0a 0d 0a 09 2f 4d 45 4e 09 31 34 20 20 20 20 20 20 20 20 20 20 20 20 ┆o 80286. /MEN 14 ┆
0x08020…08040 20 20 84 4d 61 73 74 65 72 20 65 6e 61 62 6c 65 73 20 73 69 67 6e 61 6c 20 74 6f 20 0a 19 a9 80 ┆ Master enables signal to ┆
0x08040…08060 80 74 68 65 20 64 61 74 61 20 6c 61 74 63 68 2e 0d 0a 0d 0a 09 43 41 53 20 30 2d 43 41 53 20 32 ┆ the data latch. CAS 0-CAS 2┆
0x08060…08080 20 20 20 20 20 36 2c 31 33 2c 32 30 20 20 20 20 20 20 20 20 20 84 55 73 65 64 20 69 6e 20 74 68 ┆ 6,13,20 Used in th┆
0x08080…080a0 65 20 73 65 63 6f 6e 64 20 0a 19 a9 80 80 69 6e 74 65 72 72 75 70 74 20 61 63 6b 6e 6f 77 6c 65 ┆e second interrupt acknowle┆
0x080a0…080c0 64 67 65 20 0a 19 a9 80 80 63 79 63 6c 65 20 74 6f 20 73 65 6c 65 63 74 20 61 20 73 6c 61 76 65 ┆dge cycle to select a slave┆
0x080c0…080e0 20 0a 19 a9 80 80 69 6e 74 65 72 72 72 75 70 74 20 63 6f 6e 74 72 6f 6c 6c 65 72 20 6f 72 20 0a ┆ interrrupt controller or ┆
0x080e0…08100 19 a9 80 80 74 68 65 20 38 32 37 34 20 4d 50 53 43 2e 0d 0a 0d 0a 09 41 38 2c 41 39 2c 41 41 09 ┆ the 8274 MPSC. A8,A9,AA ┆
0x08100…08120 31 2c 33 2c 31 35 2c 31 39 20 20 20 20 20 20 20 84 41 64 64 72 65 73 73 65 73 20 6f 6e 20 74 68 ┆1,3,15,19 Addresses on th┆
0x08120…08140 65 20 6c 6f 63 61 6c 20 0a 19 a9 80 80 61 64 64 72 65 73 73 20 62 75 73 20 75 73 65 64 20 74 6f ┆e local address bus used to┆
0x08140…08160 20 74 68 65 20 0a 19 a9 80 80 63 61 73 63 61 64 65 64 20 61 64 64 72 65 73 73 2e 0d 0a 20 0d 0a ┆ the cascaded address. ┆
0x08160…08180 09 53 4c 49 4e 54 31 09 36 09 84 49 6e 74 65 72 72 75 70 74 73 20 74 6f 20 74 68 65 20 6d 61 73 ┆ SLINT1 6 Interrupts to the mas┆
0x08180…081a0 74 65 72 20 0a 19 a9 80 80 69 6e 74 65 72 72 75 70 74 20 63 6f 6e 74 72 6f 6c 6c 65 72 2e 0d 0a ┆ter interrupt controller. ┆
0x081a0…081c0 0d 0a 09 2f 53 4c 45 4e 20 31 09 31 34 09 84 55 73 65 64 20 74 6f 20 65 6e 61 62 6c 65 20 74 68 ┆ /SLEN 1 14 Used to enable th┆
0x081c0…081da 65 20 64 61 74 61 20 0a 19 a9 80 80 74 72 61 6e 73 65 69 76 65 72 73 2e 0d 0a ┆e data transeivers. ┆
0x081da…081dd FormFeed {
0x081da…081dd 0c 82 88 ┆ ┆
0x081da…081dd }
0x081dd…081e0 0a 0d 0a ┆ ┆
0x081e0…081e3 FormFeed {
0x081e0…081e3 0c 80 8c ┆ ┆
0x081e0…081e3 }
0x081e3…08200 0a 20 20 20 20 20 20 20 20 20 a1 b0 20 53 69 67 6e 61 6c e1 a1 20 20 e1 20 20 20 20 20 ┆ Signal ┆
0x08200…08220 (65,) a1 44 65 73 74 69 6e 61 74 69 6f 6e e1 20 20 20 20 20 a1 e1 20 20 a1 44 65 73 63 72 69 70 74 69 ┆ Destination Descripti┆
0x08220…08240 6f 6e 0d 0a 0d 0a 09 2f 4d 42 49 4e 54 43 53 09 37 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆on /MBINTCS 7 ┆
0x08240…08260 84 4f 70 65 6e 73 20 74 68 65 20 6d 75 6c 74 69 62 75 73 20 0a 19 a9 80 80 69 6e 74 65 72 72 75 ┆ Opens the multibus interru┆
0x08260…08280 70 74 20 6c 6f 67 69 63 2e 0d 0a 0d 0a 09 2f 53 57 52 45 53 45 54 09 32 09 84 52 65 73 65 74 73 ┆pt logic. /SWRESET 2 Resets┆
0x08280…082a0 20 74 68 65 20 6d 75 6c 74 69 62 75 73 20 61 6e 64 20 0a 19 a9 80 80 74 68 65 20 43 50 55 20 62 ┆ the multibus and the CPU b┆
0x082a0…082c0 6f 61 72 64 2e 0d 0a 0d 0a 09 2f 4d 42 4f 55 54 31 2d 09 37 09 84 47 65 6e 65 72 61 74 65 73 20 ┆oard. /MBOUT1- 7 Generates ┆
0x082c0…082e0 61 20 69 6e 74 65 72 72 75 70 74 20 74 6f 0d 0a 20 20 20 20 20 20 20 20 20 2f 4d 42 4f 55 54 33 ┆a interrupt to /MBOUT3┆
0x082e0…08300 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 74 68 65 20 6d 75 6c ┆ the mul┆
0x08300…08320 74 69 62 75 73 2e 0d 0a 0d 0a 09 2f 50 57 44 45 4e 09 31 32 09 84 45 6e 61 62 6c 65 73 20 74 68 ┆tibus. /PWDEN 12 Enables th┆
0x08320…08340 65 20 70 6f 77 65 72 20 64 6f 77 6e 20 0a 19 a9 80 80 73 69 67 6e 61 6c 20 66 72 6f 6d 20 74 68 ┆e power down signal from th┆
0x08340…08360 65 20 50 50 49 32 0d 0a 0d 0a 09 2f 58 41 43 4b 09 33 2c 37 20 09 84 41 63 6b 6e 6f 77 6c 65 64 ┆e PPI2 /XACK 3,7 Acknowled┆
0x08360…08380 67 65 73 20 66 72 6f 6d 20 61 20 0a 19 a9 80 80 64 65 76 69 63 65 20 6f 6e 20 74 68 65 20 6d 75 ┆ges from a device on the mu┆
0x08380…083a0 6c 74 69 62 75 73 2e 0d 0a 0d 0a 09 4d 42 49 4e 54 38 2d 4d 42 49 4e 54 31 35 09 31 33 20 20 20 ┆ltibus. MBINT8-MBINT15 13 ┆
0x083a0…083c0 20 20 20 20 20 20 20 20 20 20 20 84 45 78 74 65 6e 64 65 64 20 6d 75 6c 74 69 62 75 73 20 0a 19 ┆ Extended multibus ┆
0x083c0…083e0 a9 80 80 69 6e 74 65 72 72 75 70 74 73 2e 20 49 74 20 69 73 20 73 65 74 20 6f 72 20 0a 19 a9 80 ┆ interrupts. It is set or ┆
0x083e0…08400 80 72 65 73 65 74 20 66 72 6f 6d 20 61 6e 6f 74 68 65 72 20 0a 19 a9 80 80 6d 75 6c 74 69 62 75 ┆ reset from another multibu┆
0x08400…08420 (66,) 73 20 6d 61 73 74 65 72 2e 0d 0a 0d 0a 09 2f 49 4e 54 30 2d 2f 49 4e 54 37 09 34 2c 37 09 84 4d ┆s master. /INT0-/INT7 4,7 M┆
0x08420…08439 75 6c 74 69 62 75 73 20 69 6e 74 65 72 72 75 70 74 20 6c 69 6e 65 73 0d 0a ┆ultibus interrupt lines ┆
0x08439…0843c FormFeed {
0x08439…0843c 0c 82 94 ┆ ┆
0x08439…0843c }
0x0843c…0843f 0a 0d 0a ┆ ┆
0x0843f…08442 FormFeed {
0x0843f…08442 0c 80 8c ┆ ┆
0x0843f…08442 }
0x08442…08460 0a 20 20 20 20 20 20 20 20 20 a1 b0 20 53 69 67 6e 61 6c e1 a1 20 20 e1 20 20 20 20 20 a1 ┆ Signal ┆
0x08460…08480 44 65 73 74 69 6e 61 74 69 6f 6e e1 20 20 20 20 20 a1 e1 20 20 a1 44 65 73 63 72 69 70 74 69 6f ┆Destination Descriptio┆
0x08480…084a0 6e 0d 0a 0d 0a 09 44 41 54 41 30 2d 44 41 54 41 37 09 38 09 84 44 61 74 61 20 6c 69 6e 65 73 20 ┆n DATA0-DATA7 8 Data lines ┆
0x084a0…084c0 74 6f 20 74 68 65 20 0a 19 a9 80 80 63 65 6e 74 72 6f 6e 69 63 73 20 70 61 72 61 6c 6c 65 6c 20 ┆to the centronics parallel ┆
0x084c0…084e0 0a 19 a9 80 80 70 72 69 6e 74 65 72 2e 0d 0a 0d 0a 09 2f 53 54 52 4f 42 45 09 38 09 44 61 74 61 ┆ printer. /STROBE 8 Data┆
0x084e0…08500 20 73 74 72 6f 62 65 20 73 69 67 6e 61 6c 2e 0d 0a 0d 0a 09 2f 4c 50 49 4e 49 54 09 38 09 4c 69 ┆ strobe signal. /LPINIT 8 Li┆
0x08500…08520 6e 65 70 72 69 6e 74 65 72 20 72 65 73 65 74 2e 0d 0a 0d 0a 20 09 2f 41 55 54 4f 4c 46 09 38 09 ┆neprinter reset. /AUTOLF 8 ┆
0x08520…08540 41 75 74 6f 20 6c 69 6e 65 20 66 65 65 64 2e 0d 0a 0d 0a 09 2f 4c 45 44 32 09 38 09 84 53 69 67 ┆Auto line feed. /LED2 8 Sig┆
0x08540…08560 6e 61 6c 20 74 6f 20 74 68 65 20 64 69 73 6b 20 0a 19 a9 80 80 61 63 63 65 73 73 20 69 6e 64 69 ┆nal to the disk access indi┆
0x08560…08580 63 61 74 69 6f 6e 20 6c 65 64 2e 0d 0a 0d 0a 09 53 45 52 4c 42 09 31 31 09 84 55 73 65 64 20 69 ┆cation led. SERLB 11 Used i┆
0x08580…085a0 6e 20 74 65 73 74 20 6d 6f 64 65 20 74 6f 20 0a 19 a9 80 80 6c 6f 6f 70 62 61 63 6b 20 69 6e 20 ┆n test mode to loopback in ┆
0x085a0…085c0 74 68 65 20 52 53 34 32 32 41 20 0a 19 a9 80 80 69 6e 74 65 72 66 61 63 65 2e 0d 0a 0d 0a 09 4c ┆the RS422A interface. L┆
0x085c0…085e0 50 49 4e 54 09 31 33 09 84 4c 69 6e 65 70 72 69 6e 74 65 72 20 69 6e 74 65 72 72 75 70 74 2e 0d ┆PINT 13 Lineprinter interrupt. ┆
0x085e0…08600 0a 0d 0a 09 4b 45 59 49 4e 54 09 38 09 84 49 6e 74 65 72 72 75 70 74 20 66 72 6f 6d 20 74 68 65 ┆ KEYINT 8 Interrupt from the┆
0x08600…08620 (67,) 20 66 72 6f 6e 74 20 0a 19 a9 80 80 6b 65 79 2e 0d 0a 0d 0a 09 54 49 4d 45 20 4f 55 54 20 49 4e ┆ front key. TIME OUT IN┆
0x08620…08640 54 09 31 33 09 84 54 69 6d 65 6f 75 74 20 69 6e 74 65 72 72 75 70 74 2e 0d 0a 0d 0a 09 4e 4d 49 ┆T 13 Timeout interrupt. NMI┆
0x08640…0865c 09 31 09 4e 6f 6e 20 4d 61 73 6b 61 62 6c 65 20 49 6e 74 65 72 72 75 70 74 2e 0d 0a ┆ 1 Non Maskable Interrupt. ┆
0x0865c…0865f FormFeed {
0x0865c…0865f 0c 82 c4 ┆ ┆
0x0865c…0865f }
0x0865f…08660 0a ┆ ┆
0x08660…08662 0d 0a ┆ ┆
0x08662…08665 FormFeed {
0x08662…08665 0c 80 8c ┆ ┆
0x08662…08665 }
0x08665…08680 0a 20 20 20 20 20 20 20 20 20 a1 b0 20 53 69 67 6e 61 6c e1 a1 20 20 e1 20 20 20 ┆ Signal ┆
0x08680…086a0 20 20 a1 44 65 73 74 69 6e 61 74 69 6f 6e e1 20 20 20 20 20 a1 e1 20 20 a1 44 65 73 63 72 69 70 ┆ Destination Descrip┆
0x086a0…086c0 74 69 6f 6e 0d 0a 0d 0a 09 53 45 52 49 4e 54 09 31 33 09 84 49 6e 74 65 72 72 75 70 74 73 20 66 ┆tion SERINT 13 Interrupts f┆
0x086c0…086e0 72 6f 6d 20 74 68 65 20 38 32 37 34 20 0a 19 a9 80 80 4d 50 53 43 2e 0d 0a 0d 0a 09 54 78 44 41 ┆rom the 8274 MPSC. TxDA┆
0x086e0…08700 4c 4f 4f 50 09 31 31 09 84 54 72 61 6e 73 6d 69 74 73 20 64 61 74 61 2e 20 28 43 68 61 6e 6e 65 ┆LOOP 11 Transmits data. (Channe┆
0x08700…08720 6c 20 0a 19 a9 80 80 41 29 2e 0d 0a 0d 0a 09 2f 52 54 53 41 09 31 30 09 84 52 65 71 75 65 73 74 ┆l A). /RTSA 10 Request┆
0x08720…08740 20 54 6f 20 53 65 6e 64 20 28 43 68 61 6e 6e 65 6c 20 0a 19 a9 80 80 41 29 2e 0d 0a 0d 0a 09 2f ┆ To Send (Channel A). /┆
0x08740…08760 44 54 52 41 09 31 30 09 84 44 61 74 61 20 54 65 72 6d 69 6e 61 6c 20 52 65 61 64 79 20 0a 19 a9 ┆DTRA 10 Data Terminal Ready ┆
0x08760…08780 80 80 28 43 68 61 6e 6e 65 6c 20 61 29 2e 0d 0a 0d 0a 09 54 78 44 42 09 39 09 84 54 72 61 6e 73 ┆ (Channel a). TxDB 9 Trans┆
0x08780…087a0 6d 69 74 20 44 61 74 61 20 28 43 68 61 6e 6e 65 6c 20 0a 19 a9 80 80 42 29 2e 0d 0a 0d 0a 09 2f ┆mit Data (Channel B). /┆
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0x087e0…08800 6d 69 6e 61 6c 20 52 65 61 64 79 20 0a 19 a9 80 80 28 43 68 61 6e 6e 65 6c 20 42 29 2e 0d 0a 0d ┆minal Ready (Channel B). ┆
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0x08820…08840 61 6e 6e 65 6c 42 29 2e 0d 0a 0d 0a 09 2f 43 54 53 42 09 39 09 84 43 6c 65 61 72 20 54 6f 20 53 ┆annelB). /CTSB 9 Clear To S┆
0x08840…08860 65 6e 64 20 0a 19 a9 80 80 28 43 68 61 6e 6e 65 6c 42 29 2e 0d 0a 0d 0a 09 2f 44 53 52 42 09 38 ┆end (ChannelB). /DSRB 8┆
0x08860…08880 09 84 44 61 74 61 20 53 65 74 20 52 65 61 64 79 20 0a 19 a9 80 80 28 43 68 61 6e 6e 65 6c 42 29 ┆ Data Set Ready (ChannelB)┆
0x08880…088a0 2e 0d 0a 0d 0a 09 2f 43 44 42 09 39 09 84 43 61 72 72 69 65 72 20 44 65 74 65 63 74 20 0a 19 a9 ┆. /CDB 9 Carrier Detect ┆
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0x088c0…088df 67 20 49 6e 64 69 63 61 74 6f 72 20 0a 19 a9 80 80 28 43 68 61 6e 6e 65 6c 20 42 29 2e 0d 0a ┆g Indicator (Channel B). ┆
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0x088df…088e2 }
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0x088e5…088e8 FormFeed {
0x088e5…088e8 0c 80 8c ┆ ┆
0x088e5…088e8 }
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0x08920…08940 72 69 70 74 69 6f 6e 0d 0a 0d 0a 09 43 4f 55 4e 54 30 09 31 33 09 84 49 6e 74 65 72 72 75 70 74 ┆ription COUNT0 13 Interrupt┆
0x08940…08960 20 66 72 6f 6d 20 74 69 6d 65 72 2e 0d 0a 0d 0a 09 42 41 55 44 41 2c 42 41 55 44 42 09 39 09 84 ┆ from timer. BAUDA,BAUDB 9 ┆
0x08960…08980 42 61 75 64 20 72 61 74 65 20 63 6c 6f 63 6b 20 73 69 67 6e 61 6c 73 20 0a 19 a9 80 80 74 6f 20 ┆Baud rate clock signals to ┆
0x08980…089a0 63 68 61 6e 6e 65 6c 20 41 20 61 6e 64 20 42 20 69 6e 20 0a 19 a9 80 80 38 32 37 34 20 4d 50 53 ┆channel A and B in 8274 MPS┆
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0x08aa0…08ac0 74 61 2e 20 28 43 68 61 6e 6e 65 6c 20 0a 19 a9 80 80 41 29 2e 0d 0a 09 52 44 28 42 29 09 31 30 ┆ta. (Channel A). RD(B) 10┆
0x08ac0…08ae0 09 49 6e 76 65 72 74 65 64 20 73 69 67 6e 61 6c 2e 0d 0a 0d 0a 09 52 54 28 41 29 09 31 30 09 84 ┆ Inverted signal. RT(A) 10 ┆
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0x08b00…08b20 29 2e 0d 0a 09 52 54 28 42 29 09 31 30 09 49 6e 76 65 72 74 65 64 20 73 69 67 6e 61 6c 2e 0d 0a ┆). RT(B) 10 Inverted signal. ┆
0x08b20…08b40 0d 0a 20 09 43 53 28 41 29 09 31 30 09 84 52 65 61 64 79 20 54 6f 20 53 65 6e 64 2e 20 28 43 68 ┆ CS(A) 10 Ready To Send. (Ch┆
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0x08b60…08b80 65 64 20 73 69 67 6e 61 6c 2e 0d 0a 0d 0a 09 44 4d 28 41 29 09 31 30 09 84 44 61 74 61 20 4d 6f ┆ed signal. DM(A) 10 Data Mo┆
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0x08ba0…08baf 65 72 74 65 64 20 73 69 67 6e 61 6c 2e 0d 0a ┆erted signal. ┆
0x08baf…08bb2 FormFeed {
0x08baf…08bb2 0c 83 b0 ┆ ┆
0x08baf…08bb2 }
0x08bb2…08bb5 0a 0d 0a ┆ ┆
0x08bb5…08bb8 FormFeed {
0x08bb5…08bb8 0c 80 8c ┆ ┆
0x08bb5…08bb8 }
0x08bb8…08bc0 0a 20 20 20 20 20 20 20 ┆ ┆
0x08bc0…08be0 20 20 a1 b0 20 53 69 67 6e 61 6c e1 a1 20 20 e1 20 20 20 20 20 a1 44 65 73 74 69 6e 61 74 69 6f ┆ Signal Destinatio┆
0x08be0…08c00 6e e1 20 20 20 20 20 a1 e1 20 20 a1 44 65 73 63 72 69 70 74 69 6f 6e 0d 0a 0d 0a 20 20 20 20 20 ┆n Description ┆
0x08c00…08c20 (70,) 20 20 20 20 44 30 20 2d 20 44 37 20 20 20 20 20 20 20 20 20 33 2c 35 2c 31 31 2c 31 35 20 20 20 ┆ D0 - D7 3,5,11,15 ┆
0x08c20…08c40 20 20 20 20 31 36 20 62 69 74 20 62 69 64 69 72 65 63 74 69 6f 6e 6e 61 6c 0d 0a 20 20 20 20 20 ┆ 16 bit bidirectionnal ┆
0x08c40…08c60 20 20 20 20 44 38 20 2d 20 44 46 20 20 20 20 20 20 20 20 20 33 2c 35 2c 31 31 2c 31 35 2c 31 36 ┆ D8 - DF 3,5,11,15,16┆
0x08c60…08c80 20 20 20 20 64 61 74 61 20 62 75 73 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 49 4f 44 41 54 30 ┆ data bus. IODAT0┆
0x08c80…08ca0 2d 49 4f 44 41 54 31 09 32 2c 36 2c 37 2c 38 2c 39 2c 31 30 2c 20 20 20 31 36 20 62 69 74 20 62 ┆-IODAT1 2,6,7,8,9,10, 16 bit b┆
0x08ca0…08cc0 69 64 69 72 65 63 74 69 6f 6e 61 6c 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆idirectional ┆
0x08cc0…08ce0 20 20 20 20 20 20 20 31 31 2c 31 32 2c 31 33 2c 31 36 2c 31 37 20 20 64 61 74 61 20 62 75 73 20 ┆ 11,12,13,16,17 data bus ┆
0x08ce0…08d00 66 6f 72 20 6f 6e 20 62 6f 61 72 64 0d 0a 09 49 4f 44 41 54 32 2d 49 4f 44 41 54 33 09 32 2c 36 ┆for on board IODAT2-IODAT3 2,6┆
0x08d00…08d20 2c 38 2c 39 2c 31 30 2c 31 31 2c 20 20 64 65 76 69 63 65 73 2e 0d 0a 09 20 20 20 20 20 20 20 20 ┆,8,9,10,11, devices. ┆
0x08d20…08d40 20 20 20 20 20 20 20 20 31 32 2c 31 33 2c 31 36 2c 31 37 0d 0a 0d 0a 09 54 78 44 41 09 31 30 09 ┆ 12,13,16,17 TxDA 10 ┆
0x08d40…08d60 84 54 72 61 6e 73 6d 69 74 73 20 44 61 74 61 2e 20 28 43 68 61 6e 6e 65 6c 20 0a 19 a9 80 80 41 ┆ Transmits Data. (Channel A┆
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0x08d80…08da0 68 61 6e 6e 65 6c 20 0a 19 a9 80 80 41 29 2e 0d 0a 0d 0a 09 2f 52 78 43 41 09 39 09 84 52 65 63 ┆hannel A). /RxCA 9 Rec┆
0x08da0…08dc0 65 69 76 65 72 20 43 6c 6f 63 6b 2e 20 28 43 68 61 6e 6e 65 6c 20 0a 19 a9 80 80 41 29 2e 0d 0a ┆eiver Clock. (Channel A). ┆
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0x08dee…08df1 }
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0x08df4…08df7 FormFeed {
0x08df4…08df7 0c 80 8c ┆ ┆
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0x08e31…08e6a }
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0x08ec0…08ee0 73 20 62 75 73 0d 0a 20 20 20 20 20 20 20 20 20 53 4c 49 4f 41 44 52 34 20 20 20 20 20 20 20 20 ┆s bus SLIOADR4 ┆
0x08ee0…08f00 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 74 6f 20 61 64 64 72 65 73 73 20 69 6e 66 72 65 ┆ to address infre┆
0x08f00…08f20 71 65 6e 74 6c 79 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆qently ┆
0x08f20…08f40 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 75 73 65 64 20 6f 6e 62 6f 61 72 64 20 63 6f ┆ used onboard co┆
0x08f40…08f60 6d 70 6f 6e 65 6e 74 73 2e 0d 0a 09 53 4c 49 4f 41 44 52 35 2d 09 31 31 0d 0a 09 53 4c 49 4f 41 ┆mponents. SLIOADR5- 11 SLIOA┆
0x08f60…08f80 44 52 38 0d 0a 0d 0a 09 2f 4c 45 44 31 09 31 32 09 53 69 67 6e 61 6c 20 74 6f 20 74 68 65 20 74 ┆DR8 /LED1 12 Signal to the t┆
0x08f80…08fa0 65 73 74 20 6c 65 64 2e 0d 0a 0d 0a 09 50 49 4e 54 32 45 4e 09 38 09 84 45 6e 61 62 6c 65 73 20 ┆est led. PINT2EN 8 Enables ┆
0x08fa0…08fc0 74 68 65 20 6b 65 79 20 0a 19 a9 80 80 69 6e 74 65 72 72 75 70 74 2e 0d 0a 0d 0a 09 2f 69 4c 42 ┆the key interrupt. /iLB┆
0x08fc0…08fe0 58 09 31 38 2c 31 39 09 84 49 66 20 6c 6f 77 20 74 68 65 20 69 4c 42 58 62 75 73 20 69 73 20 0a ┆X 18,19 If low the iLBXbus is ┆
0x08fe0…09000 19 a9 80 80 73 65 6c 65 63 74 65 64 20 74 6f 20 6d 65 6d 6f 72 79 20 0a 19 a9 80 80 74 72 61 6e ┆ selected to memory tran┆
0x09000…09020 (72,) 73 66 65 72 73 2e 0d 0a 0d 0a 09 4f 50 54 4f 30 09 31 36 09 84 4f 70 74 69 6f 6e 61 6c 20 73 69 ┆sfers. OPTO0 16 Optional si┆
0x09020…09040 67 6e 61 6c 20 7a 65 72 6f 20 74 6f 20 0a 19 a9 80 80 74 68 65 20 69 53 42 58 62 75 73 2e 0d 0a ┆gnal zero to the iSBXbus. ┆
0x09040…09060 0d 0a 09 2f 4f 50 54 30 45 4e 09 31 36 09 84 45 6e 61 62 6c 65 73 20 73 69 67 6e 61 6c 20 4f 50 ┆ /OPT0EN 16 Enables signal OP┆
0x09060…09080 54 30 30 20 74 6f 20 0a 19 a9 80 80 74 68 65 20 69 53 42 58 62 75 73 2e 0d 0a 0d 0a 09 4f 50 54 ┆T00 to the iSBXbus. OPT┆
0x09080…090a0 31 30 09 31 36 09 84 4f 70 74 69 6f 6e 61 6c 20 73 69 67 6e 61 6c 20 6f 6e 65 20 74 6f 20 0a 19 ┆10 16 Optional signal one to ┆
0x090a0…090c0 a9 80 80 74 68 65 20 69 53 42 58 62 75 73 2e 0d 0a 0d 0a 09 2f 4f 50 54 31 45 4e 09 31 36 09 84 ┆ the iSBXbus. /OPT1EN 16 ┆
0x090c0…090e0 45 6e 61 62 6c 65 73 20 73 69 67 6e 61 6c 20 4f 50 54 31 30 20 74 6f 20 0a 19 a9 80 80 74 68 65 ┆Enables signal OPT10 to the┆
0x090e0…09100 20 69 53 42 58 62 75 73 2e 0d 0a 0d 0a 09 50 44 4d 44 09 31 32 09 50 6f 77 65 72 20 44 6f 77 6e ┆ iSBXbus. PDMD 12 Power Down┆
0x09100…09120 20 44 65 6d 61 6e 64 2e 0d 0a 0d 0a 09 54 45 53 54 53 4c 41 56 45 09 33 09 84 49 66 20 6c 6f 77 ┆ Demand. TESTSLAVE 3 If low┆
0x09120…09140 20 74 68 65 20 43 50 55 20 62 6f 61 72 64 20 69 73 20 0a 19 a9 80 80 74 65 73 74 73 6c 61 76 65 ┆ the CPU board is testslave┆
0x09140…09160 2e 0d 0a 0d 0a 09 2f 54 45 53 54 53 4c 41 56 45 09 37 0d 0a 0d 0a 09 2f 50 49 4e 54 52 32 09 38 ┆. /TESTSLAVE 7 /PINTR2 8┆
0x09160…09180 09 84 55 6e 20 6c 61 74 63 68 65 64 20 6b 65 79 20 0a 19 a9 80 80 69 6e 74 65 72 72 75 70 74 2e ┆ Un latched key interrupt.┆
0x09180…091a0 0d 0a 0d 0a 09 2f 43 4c 54 4d 4f 55 54 09 31 32 09 84 43 6c 65 61 72 73 20 74 68 65 20 74 69 6d ┆ /CLTMOUT 12 Clears the tim┆
0x091a0…091c0 65 6f 75 74 20 0a 19 a9 80 80 63 69 72 63 75 69 74 2e 0d 0a 0d 0a 09 2f 54 4d 4f 55 54 09 38 2c ┆eout circuit. /TMOUT 8,┆
0x091c0…091d4 32 30 09 54 69 6d 65 6f 75 74 20 73 69 67 6e 61 6c 2e 0d 0a ┆20 Timeout signal. ┆
0x091d4…0920d Params {
0x091d4…0920d 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x091d4…0920d 00 00 00 00 00 00 00 00 0a 1a 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff ff 04 ┆ *7AKU_iså ┆
0x091d4…0920d }
0x0920d…09246 Params {
0x0920d…09246 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x0920d…09246 00 00 00 00 00 00 00 00 0a 1a 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff ff 04 ┆ *7AKU_iså ┆
0x0920d…09246 }
0x09246…09247 0a ┆ ┆
0x09247…0924a FormFeed {
0x09247…0924a 0c 82 d8 ┆ ┆
0x09247…0924a }
0x0924a…0924d 0a 0d 0a ┆ ┆
0x0924d…09250 FormFeed {
0x0924d…09250 0c 80 8c ┆ ┆
0x0924d…09250 }
0x09250…09260 0a 20 20 20 20 20 20 20 20 20 a1 b0 20 53 69 67 ┆ Sig┆
0x09260…09280 6e 61 6c e1 a1 20 20 e1 20 20 20 20 20 a1 44 65 73 74 69 6e 61 74 69 6f 6e e1 20 20 20 20 20 a1 ┆nal Destination ┆
0x09280…092a0 e1 20 20 a1 44 65 73 63 72 69 70 74 69 6f 6e 0d 0a 0d 0a 09 49 52 4d 30 2d 49 52 4d 36 09 36 09 ┆ Description IRM0-IRM6 6 ┆
0x092a0…092c0 84 49 6e 74 65 72 72 75 70 74 73 20 74 6f 20 74 68 65 20 6d 61 73 74 65 72 20 0a 19 a9 80 80 69 ┆ Interrupts to the master i┆
0x092c0…092e0 6e 74 65 72 72 75 70 74 20 63 6f 6e 74 72 6f 6c 6c 65 72 2e 0d 0a 0d 0a 09 49 52 53 4c 31 20 30 ┆nterrupt controller. IRSL1 0┆
0x092e0…09300 2d 49 52 53 4c 31 20 37 09 36 09 84 49 6e 74 65 72 72 75 70 74 73 20 74 6f 20 74 68 65 20 73 6c ┆-IRSL1 7 6 Interrupts to the sl┆
0x09300…09320 61 76 65 20 0a 19 a9 80 80 6f 6e 65 20 69 6e 74 65 72 72 75 70 74 20 0a 19 a9 80 80 63 6f 6e 74 ┆ave one interrupt cont┆
0x09320…09340 72 6f 6c 6c 65 72 2e 0d 0a 0d 0a 09 49 52 53 4c 32 20 30 2d 49 52 53 4c 32 20 37 09 36 09 84 49 ┆roller. IRSL2 0-IRSL2 7 6 I┆
0x09340…09360 6e 74 65 72 72 75 70 74 73 20 74 6f 20 74 68 65 20 73 6c 61 76 65 20 0a 19 a9 80 80 74 77 6f 20 ┆nterrupts to the slave two ┆
0x09360…09380 69 6e 74 65 72 72 75 70 74 20 0a 19 a9 80 80 63 6f 6e 74 72 6f 6c 6c 65 72 2e 0d 0a 0d 0a 09 53 ┆interrupt controller. S┆
0x09380…093a0 4c 49 4e 54 32 09 36 09 84 49 6e 74 65 72 72 75 70 74 20 74 6f 20 74 68 65 20 6d 61 73 74 65 72 ┆LINT2 6 Interrupt to the master┆
0x093a0…093c0 20 0a 19 a9 80 80 69 6e 74 65 72 72 75 70 74 20 63 6f 6e 74 72 6f 6c 6c 65 72 2e 0d 0a 0d 0a 09 ┆ interrupt controller. ┆
0x093c0…093e0 2f 53 4c 45 4e 32 09 31 34 09 84 45 6e 61 62 6c 65 73 20 74 68 65 20 64 61 74 61 20 0a 19 a9 80 ┆/SLEN2 14 Enables the data ┆
0x093e0…09400 80 74 72 61 6e 73 65 69 76 65 72 73 2e 0d 0a 0d 0a 09 32 4e 44 49 4e 54 52 43 59 43 09 32 30 09 ┆ transeivers. 2NDINTRCYC 20 ┆
0x09400…09420 (74,) 49 6e 64 69 63 61 74 65 73 20 74 68 65 20 73 65 63 6f 6e 64 0d 0a 20 20 20 20 20 20 20 20 20 2f ┆Indicates the second /┆
0x09420…09440 32 4e 44 49 4e 54 52 43 59 43 20 20 20 20 20 31 33 20 20 20 20 20 20 20 20 20 20 20 20 20 20 69 ┆2NDINTRCYC 13 i┆
0x09440…09460 6e 74 65 72 72 75 70 74 20 61 63 6b 6e 6f 77 6c 65 64 67 65 0d 0a 20 20 20 20 20 20 20 20 20 20 ┆nterrupt acknowledge ┆
0x09460…09480 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 63 ┆ c┆
0x09480…09487 79 63 6c 65 2e 0d 0a ┆ycle. ┆
0x09487…0948a FormFeed {
0x09487…0948a 0c 82 88 ┆ ┆
0x09487…0948a }
0x0948a…0948d 0a 0d 0a ┆ ┆
0x0948d…09490 FormFeed {
0x0948d…09490 0c 80 8c ┆ ┆
0x0948d…09490 }
0x09490…094a0 0a 20 20 20 20 20 20 20 20 20 a1 b0 20 53 69 67 ┆ Sig┆
0x094a0…094c0 6e 61 6c e1 a1 20 20 e1 20 20 20 20 20 a1 44 65 73 74 69 6e 61 74 69 6f 6e e1 20 20 20 20 20 a1 ┆nal Destination ┆
0x094c0…094e0 e1 20 20 a1 44 65 73 63 72 69 70 74 69 6f 6e 0d 0a 0d 0a 20 09 2f 44 45 4c 42 55 53 41 45 4e 09 ┆ Description /DELBUSAEN ┆
0x094e0…09500 32 30 09 84 55 73 65 64 20 74 6f 20 64 65 6c 61 79 20 74 68 65 20 42 55 53 41 45 4e 20 0a 19 a9 ┆20 Used to delay the BUSAEN ┆
0x09500…09520 80 80 73 69 67 6e 61 6c 2e 0d 0a 0d 0a 09 42 55 53 41 45 4e 09 31 34 09 4d 75 6c 74 69 62 75 73 ┆ signal. BUSAEN 14 Multibus┆
0x09520…09540 20 61 64 64 72 65 73 73 20 65 6e 61 62 6c 65 0d 0a 20 20 20 20 20 20 20 20 20 2f 42 55 53 41 45 ┆ address enable /BUSAE┆
0x09540…09560 4e 20 20 20 20 20 20 20 20 20 31 34 2c 31 35 2c 32 30 20 20 20 20 20 20 20 20 73 69 67 6e 61 6c ┆N 14,15,20 signal┆
0x09560…09580 2e 0d 0a 0d 0a 09 2f 4c 4f 43 4b 09 31 34 09 84 49 73 20 75 73 65 64 20 74 6f 20 65 78 74 65 6e ┆. /LOCK 14 Is used to exten┆
0x09580…095a0 64 20 6d 75 74 75 61 6c 20 0a 19 a9 80 80 65 78 63 6c 75 73 69 6f 6e 20 74 6f 20 64 75 61 6c 70 ┆d mutual exclusion to dualp┆
0x095a0…095c0 6f 72 74 20 0a 19 a9 80 80 52 41 4d 27 73 20 6f 6e 20 74 68 65 20 6d 75 6c 74 69 62 75 73 2e 0d ┆ort RAM's on the multibus. ┆
0x095c0…095e0 0a 0d 0a 09 4f 42 4c 4f 43 4b 09 31 38 09 49 74 20 69 6e 64 69 63 61 74 65 73 20 74 68 61 74 20 ┆ OBLOCK 18 It indicates that ┆
0x095e0…09600 74 68 65 0d 0a 20 20 20 20 20 20 20 20 20 2f 4f 42 4c 4f 43 4b 09 31 34 20 20 20 20 20 20 20 20 ┆the /OBLOCK 14 ┆
0x09600…09620 (75,) 20 20 20 20 20 20 43 50 55 20 6c 6f 63 6b 20 64 75 61 6c 70 6f 72 74 20 52 41 4d 27 73 0d 0a 20 ┆ CPU lock dualport RAM's ┆
0x09620…09640 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ ┆
0x09640…09660 20 20 20 20 20 20 20 20 6f 6e 20 74 68 65 20 69 4c 42 58 62 75 73 0d 0a 0d 0a 09 41 45 4e 09 31 ┆ on the iLBXbus AEN 1┆
0x09660…09680 34 09 84 45 6e 61 62 6c 65 73 20 74 68 65 20 61 64 64 72 72 65 73 73 20 0a 19 a9 80 80 6c 69 6e ┆4 Enables the addrress lin┆
0x09680…096a0 65 73 20 6f 6e 20 74 68 65 20 6d 75 6c 74 69 62 75 73 2e 0d 0a 0d 0a 09 2f 42 50 52 4f 09 31 34 ┆es on the multibus. /BPRO 14┆
0x096a0…096c0 09 84 55 73 65 64 20 69 6e 20 61 70 70 6c 69 63 61 74 69 6f 6e 73 20 0a 19 a9 80 80 77 69 74 68 ┆ Used in applications with┆
0x096c0…096e0 20 73 65 72 69 65 6c 20 70 72 69 6f 72 69 74 79 20 69 6e 20 0a 19 a9 80 80 74 68 65 20 61 72 62 ┆ seriel priority in the arb┆
0x096e0…09700 69 74 72 61 74 69 6f 6e 20 70 68 61 73 65 20 6f 6e 20 0a 19 a9 80 80 74 68 65 20 6d 75 6c 74 69 ┆itration phase on the multi┆
0x09700…09720 62 75 73 2e 0d 0a 0d 0a 09 2f 42 52 45 51 09 31 34 20 09 4d 75 6c 74 69 62 75 73 20 72 65 71 75 ┆bus. /BREQ 14 Multibus requ┆
0x09720…09740 65 73 74 2e 0d 0a 0d 0a 09 2f 42 55 53 59 09 31 34 09 84 55 73 65 64 20 77 68 65 6e 20 61 20 6d ┆est. /BUSY 14 Used when a m┆
0x09740…09760 61 73 74 65 72 20 75 73 65 20 0a 19 a9 80 80 74 68 65 20 6d 75 6c 74 69 62 75 73 20 74 6f 20 61 ┆aster use the multibus to a┆
0x09760…09780 20 64 61 74 61 20 0a 19 a9 80 80 74 72 61 6e 73 66 65 72 2e 0d 0a 0d 0a 20 09 2f 43 42 52 51 09 ┆ data transfer. /CBRQ ┆
0x09780…097a0 31 34 09 84 49 74 20 69 6e 73 74 72 75 63 74 73 20 74 68 65 20 61 72 62 69 74 65 72 20 0a 19 a9 ┆14 It instructs the arbiter ┆
0x097a0…097c0 80 80 69 66 20 74 68 65 72 65 20 61 72 65 20 61 6e 79 20 6f 74 68 65 72 20 0a 19 a9 80 80 61 72 ┆ if there are any other ar┆
0x097c0…097e0 62 69 74 65 72 73 20 6f 66 20 6c 6f 77 65 72 20 0a 19 a9 80 80 70 72 6f 72 69 74 79 20 72 65 71 ┆biters of lower prority req┆
0x097e0…09800 75 65 73 74 69 6e 67 20 74 68 65 20 0a 19 a9 80 80 75 73 65 20 6f 66 20 74 68 65 20 6d 75 6c 74 ┆uesting the use of the mult┆
0x09800…09820 (76,) 69 62 75 73 2e 0d 0a 0d 0a 09 2f 4d 42 52 44 43 09 31 34 09 84 4d 75 6c 74 69 62 75 73 20 6d 65 ┆ibus. /MBRDC 14 Multibus me┆
0x09820…09839 6d 6f 72 79 20 72 65 61 64 73 20 0a 19 a9 80 80 73 69 67 6e 61 6c 2e 0d 0a ┆mory reads signal. ┆
0x09839…0983c FormFeed {
0x09839…0983c 0c 83 c8 ┆ ┆
0x09839…0983c }
0x0983c…0983d 0a ┆ ┆
0x0983d…09876 Params {
0x0983d…09876 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x0983d…09876 00 00 00 00 00 00 00 00 0a 1a 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff ff 04 ┆ *7AKU_iså ┆
0x0983d…09876 }
0x09876…098af Params {
0x09876…098af 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x09876…098af 00 00 00 00 00 00 00 00 0a 1a 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff ff 04 ┆ *7AKU_iså ┆
0x09876…098af }
0x098af…098c0 0a 0d 0a 8c 80 88 0a 20 20 20 20 20 20 20 20 20 a1 ┆ ┆
0x098c0…098e0 b0 20 53 69 67 6e 61 6c e1 a1 20 20 e1 20 20 20 20 20 a1 44 65 73 74 69 6e 61 74 69 6f 6e e1 20 ┆ Signal Destination ┆
0x098e0…09900 20 20 20 20 a1 e1 20 20 a1 44 65 73 63 72 69 70 74 69 6f 6e 0d 0a 0d 0a 09 2f 4d 42 57 54 43 09 ┆ Description /MBWTC ┆
0x09900…09920 31 34 09 84 4d 75 6c 74 69 62 75 73 20 6d 65 6d 6f 72 79 20 77 72 69 74 65 73 20 0a 19 a9 80 80 ┆14 Multibus memory writes ┆
0x09920…09940 73 69 67 6e 61 6c 2e 0d 0a 0d 0a 09 2f 4d 42 49 4f 52 43 09 31 34 09 84 4d 75 6c 74 69 62 75 73 ┆signal. /MBIORC 14 Multibus┆
0x09940…09960 20 49 2f 4f 20 72 65 61 64 73 20 0a 19 a9 80 80 73 69 67 6e 61 6c 2e 0d 0a 0d 0a 09 2f 4d 42 49 ┆ I/O reads signal. /MBI┆
0x09960…09980 4f 57 43 09 31 34 09 84 4d 75 6c 74 69 62 75 73 20 49 2f 4f 20 77 72 69 74 65 73 20 0a 19 a9 80 ┆OWC 14 Multibus I/O writes ┆
0x09980…099a0 80 73 69 67 6e 61 6c 2e 0d 0a 0d 0a 09 2f 4d 42 49 4e 54 41 09 31 34 09 84 4d 75 6c 74 69 62 75 ┆ signal. /MBINTA 14 Multibu┆
0x099a0…099c0 73 20 49 6e 74 65 72 72 75 70 74 20 0a 19 a9 80 80 41 63 6b 6e 6f 77 6c 65 64 67 65 2e 0d 0a 0d ┆s Interrupt Acknowledge. ┆
0x099c0…099e0 0a 09 4d 42 44 54 28 2f 52 29 09 31 35 2c 31 36 09 84 84 49 6e 64 69 63 61 74 65 73 20 74 68 65 ┆ MBDT(/R) 15,16 Indicates the┆
0x099e0…09a00 20 64 69 72 65 63 74 69 6f 6e 20 0a 19 a9 80 80 6f 66 20 74 68 65 20 64 61 74 61 20 66 6c 6f 77 ┆ direction of the data flow┆
0x09a00…09a20 (77,) 20 6f 6e 20 74 68 65 20 0a 19 a9 80 80 6d 75 6c 74 69 62 75 73 2e 0d 0a 0d 0a 09 4d 42 41 4c 45 ┆ on the multibus. MBALE┆
0x09a20…09a40 09 31 35 09 84 4c 61 74 63 68 20 74 68 65 20 61 64 64 72 65 73 73 65 73 20 74 6f 20 0a 19 a9 80 ┆ 15 Latch the addresses to ┆
0x09a40…09a60 80 74 68 65 20 6d 75 6c 74 69 62 75 73 2e 0d 0a 0d 0a 09 2f 49 4e 54 45 4e 09 34 2c 32 30 09 84 ┆ the multibus. /INTEN 4,20 ┆
0x09a60…09a80 45 6e 61 62 6c 65 73 20 74 68 65 20 69 6e 74 65 72 72 75 70 74 20 0a 19 a9 80 80 76 65 74 6f 72 ┆Enables the interrupt vetor┆
0x09a80…09aa0 73 20 74 6f 20 74 68 65 20 49 2f 4f 20 64 61 74 61 20 0a 19 a9 80 80 62 75 73 2e 0d 0a 0d 0a 09 ┆s to the I/O data bus. ┆
0x09aa0…09ac0 4d 42 44 45 4e 09 32 31 09 84 45 6e 61 62 6c 65 73 20 74 68 65 20 64 61 74 61 20 0a 19 a9 80 80 ┆MBDEN 21 Enables the data ┆
0x09ac0…09ae0 74 72 61 6e 73 65 69 76 65 72 73 20 74 6f 20 74 68 65 20 0a 19 a9 80 80 6d 75 6c 74 69 62 75 73 ┆transeivers to the multibus┆
0x09ae0…09b00 2e 0d 0a 0d 0a 09 2f 44 41 54 30 2d 2f 44 41 54 31 09 37 2c 31 35 2c 31 36 09 44 61 74 61 20 73 ┆. /DAT0-/DAT1 7,15,16 Data s┆
0x09b00…09b20 69 67 6e 61 6c 73 20 6f 6e 20 74 68 65 0d 0a 20 20 20 20 20 20 20 20 20 2f 44 41 54 32 2d 2f 44 ┆ignals on the /DAT2-/D┆
0x09b20…09b40 41 54 33 20 20 20 20 20 31 35 2c 31 36 20 20 20 20 20 20 20 20 20 20 20 6d 75 6c 74 69 62 75 73 ┆AT3 15,16 multibus┆
0x09b40…09b60 2e 0d 0a 09 2f 44 41 54 34 2d 2f 44 41 54 37 20 20 20 20 20 37 2c 31 35 2c 31 36 0d 0a 09 2f 44 ┆. /DAT4-/DAT7 7,15,16 /D┆
0x09b60…09b80 41 54 38 2d 2f 44 41 54 46 09 31 35 0d 0a 0d 0a 09 2f 41 44 52 30 2d 2f 41 44 52 32 09 31 35 09 ┆AT8-/DATF 15 /ADR0-/ADR2 15 ┆
0x09b80…09ba0 41 64 64 72 65 73 73 20 73 69 67 6e 61 6c 73 20 6f 6e 20 74 68 65 0d 0a 09 2f 41 44 52 33 09 37 ┆Address signals on the /ADR3 7┆
0x09ba0…09bc0 2c 31 35 20 20 20 20 20 20 20 20 20 20 20 20 6d 75 6c 74 69 62 75 73 2e 0d 0a 09 2f 41 44 52 34 ┆,15 multibus. /ADR4┆
0x09bc0…09be0 2d 2f 41 44 52 35 09 31 35 0d 0a 09 2f 41 44 52 36 2d 2f 41 44 52 46 09 37 2c 31 35 0d 0a 09 2f ┆-/ADR5 15 /ADR6-/ADRF 7,15 /┆
0x09be0…09bf0 41 44 52 31 30 2d 41 44 52 32 33 09 31 35 0d 0a ┆ADR10-ADR23 15 ┆
0x09bf0…09bf3 FormFeed {
0x09bf0…09bf3 0c 82 b8 ┆ ┆
0x09bf0…09bf3 }
0x09bf3…09bf4 0a ┆ ┆
0x09bf4…09c2d Params {
0x09bf4…09c2d 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x09bf4…09c2d 00 00 00 00 00 00 00 00 0a 1a 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff ff 04 ┆ *7AKU_iså ┆
0x09bf4…09c2d }
0x09c2d…09c66 Params {
0x09c2d…09c66 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x09c2d…09c66 00 00 00 00 00 00 00 00 0a 1a 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff ff 04 ┆ *7AKU_iså ┆
0x09c2d…09c66 }
0x09c66…09c69 0a 0d 0a ┆ ┆
0x09c69…09c6c FormFeed {
0x09c69…09c6c 0c 80 8c ┆ ┆
0x09c69…09c6c }
0x09c6c…09c80 0a 0a 20 20 20 20 20 20 20 20 20 a1 b0 20 53 69 67 6e 61 6c ┆ Signal┆
0x09c80…09ca0 e1 a1 20 20 e1 20 20 20 20 20 a1 44 65 73 74 69 6e 61 74 69 6f 6e e1 20 20 20 20 20 a1 e1 20 20 ┆ Destination ┆
0x09ca0…09cc0 a1 44 65 73 63 72 69 70 74 69 6f 6e 0d 0a 0a 0d 0a 09 4d 44 30 2d 4d 44 46 09 31 36 09 84 69 53 ┆ Description MD0-MDF 16 iS┆
0x09cc0…09ce0 42 58 62 75 73 20 62 69 64 69 72 65 63 74 69 6f 6e 61 6c 20 0a 19 a9 80 80 64 61 74 61 20 6c 69 ┆BXbus bidirectional data li┆
0x09ce0…09d00 6e 65 73 2e 0d 0a 0d 0a 09 4d 41 30 2d 4d 41 32 09 31 36 09 84 69 53 42 58 62 75 73 20 61 64 64 ┆nes. MA0-MA2 16 iSBXbus add┆
0x09d00…09d20 72 65 73 73 20 6c 69 6e 65 73 2e 0d 0a 0d 0a 09 52 45 53 45 54 09 31 36 09 52 65 73 65 74 20 74 ┆ress lines. RESET 16 Reset t┆
0x09d20…09d40 6f 20 74 68 65 20 69 53 42 58 62 75 73 2e 0d 0a 0d 0a 09 4d 43 4c 4b 09 31 36 09 84 31 30 20 4d ┆o the iSBXbus. MCLK 16 10 M┆
0x09d40…09d60 48 7a 20 35 30 25 20 64 75 74 79 20 63 79 63 6c 65 20 0a 19 a9 80 80 63 6c 6f 63 6b 20 74 6f 20 ┆Hz 50% duty cycle clock to ┆
0x09d60…09d80 74 68 65 20 69 53 42 58 62 75 73 2e 0d 0a 0d 0a 09 2f 49 4f 52 44 09 31 36 09 84 49 2f 4f 20 72 ┆the iSBXbus. /IORD 16 I/O r┆
0x09d80…09da0 65 61 64 20 74 6f 20 74 68 65 20 69 53 42 58 62 75 73 2e 0d 0a 0d 0a 09 2f 49 4f 57 52 54 09 31 ┆ead to the iSBXbus. /IOWRT 1┆
0x09da0…09dc0 36 09 84 49 2f 4f 20 77 72 69 74 65 20 74 6f 20 74 68 65 20 0a 19 a9 80 80 69 53 42 58 62 75 73 ┆6 I/O write to the iSBXbus┆
0x09dc0…09de0 2e 0d 0a 0d 0a 09 2f 4d 43 53 30 2d 2f 4d 43 53 31 20 20 20 20 20 31 36 09 84 43 68 69 70 20 73 ┆. /MCS0-/MCS1 16 Chip s┆
0x09de0…09e00 65 6c 65 63 74 20 6c 69 6e 65 73 20 74 6f 20 74 68 65 20 0a 19 a9 80 80 69 53 42 58 62 75 73 2e ┆elect lines to the iSBXbus.┆
0x09e00…09e20 (79,) 0d 0a 0d 0a 09 4f 50 54 30 2d 4f 50 54 31 09 31 32 09 84 4f 70 74 69 6f 6e 61 6c 20 6c 69 6e 65 ┆ OPT0-OPT1 12 Optional line┆
0x09e20…09e40 73 20 74 6f 20 6f 72 20 0a 19 a9 80 80 66 72 6f 6d 20 74 68 65 20 69 53 42 58 62 75 73 2e 0d 0a ┆s to or from the iSBXbus. ┆
0x09e40…09e60 0d 0a 09 2f 58 50 53 54 09 31 32 2c 31 39 09 84 49 6e 64 69 63 61 74 65 73 20 74 68 61 74 20 61 ┆ /XPST 12,19 Indicates that a┆
0x09e60…09e80 6e 20 69 53 42 58 20 0a 19 a9 80 80 62 6f 61 72 64 20 69 73 20 70 72 65 73 65 6e 74 2e 0d 0a 0d ┆n iSBX board is present. ┆
0x09e80…09ea0 0a 09 58 49 4e 54 30 2d 58 49 4e 54 31 09 31 33 09 84 49 6e 74 65 72 72 75 70 74 73 20 66 72 6f ┆ XINT0-XINT1 13 Interrupts fro┆
0x09ea0…09ec0 6d 20 74 68 65 20 69 53 42 58 20 0a 19 a9 80 80 62 6f 61 72 64 2e 0d 0a 0d 0a 09 2f 58 57 41 49 ┆m the iSBX board. /XWAI┆
0x09ec0…09ee0 54 09 32 30 09 84 55 73 65 64 20 74 6f 20 69 6e 64 69 63 61 74 65 73 20 74 68 61 74 20 0a 19 a9 ┆T 20 Used to indicates that ┆
0x09ee0…09f00 80 80 74 68 65 20 69 53 42 58 20 62 6f 61 72 64 20 69 73 20 62 75 73 79 2e 0d 0a 0d 0a 09 2f 44 ┆ the iSBX board is busy. /D┆
0x09f00…09f20 41 54 30 2d 2f 44 41 54 31 09 37 2c 31 35 2c 31 36 09 44 61 74 61 20 73 69 67 6e 61 6c 73 20 6f ┆AT0-/DAT1 7,15,16 Data signals o┆
0x09f20…09f40 6e 20 74 68 65 0d 0a 20 20 20 20 20 20 20 20 20 2f 44 41 54 32 2d 2f 44 41 54 33 20 20 20 20 20 ┆n the /DAT2-/DAT3 ┆
0x09f40…09f60 31 35 2c 31 36 20 20 20 20 20 20 20 20 20 20 20 6d 75 6c 74 69 62 75 73 2e 0d 0a 09 2f 44 41 54 ┆15,16 multibus. /DAT┆
0x09f60…09f75 34 2d 2f 44 41 54 37 20 20 20 20 20 37 2c 31 35 2c 31 36 0d 0a ┆4-/DAT7 7,15,16 ┆
0x09f75…09f78 FormFeed {
0x09f75…09f78 0c 83 bc ┆ ┆
0x09f75…09f78 }
0x09f78…09f7b 0a 0d 0a ┆ ┆
0x09f7b…09f7e FormFeed {
0x09f7b…09f7e 0c 80 8c ┆ ┆
0x09f7b…09f7e }
0x09f7e…09f80 0a 20 ┆ ┆
0x09f80…09fa0 20 20 20 20 20 20 20 20 a1 b0 20 53 69 67 6e 61 6c e1 a1 20 20 e1 20 20 20 20 20 a1 e1 20 20 a1 ┆ Signal ┆
0x09fa0…09fc0 44 65 73 74 69 6e 61 74 69 6f 6e e1 20 20 20 20 20 a1 e1 20 20 a1 44 65 73 63 72 69 70 74 69 6f ┆Destination Descriptio┆
0x09fc0…09fe0 6e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 49 4f 44 41 54 30 2d 49 4f 44 41 54 31 09 32 2c 36 2c ┆n IODAT0-IODAT1 2,6,┆
0x09fe0…0a000 37 2c 38 2c 39 2c 31 30 2c 20 20 20 31 36 20 62 69 74 20 62 69 64 69 72 65 63 74 69 6f 6e 61 6c ┆7,8,9,10, 16 bit bidirectional┆
0x0a000…0a020 (80,) 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 31 2c 31 32 ┆ 11,12┆
0x0a020…0a040 2c 31 33 2c 31 36 2c 31 37 20 20 64 61 74 61 20 62 75 73 20 66 6f 72 20 6f 6e 20 62 6f 61 72 64 ┆,13,16,17 data bus for on board┆
0x0a040…0a060 0d 0a 09 49 4f 44 41 54 32 2d 49 4f 44 41 54 33 09 32 2c 36 2c 38 2c 39 2c 31 30 2c 31 31 2c 20 ┆ IODAT2-IODAT3 2,6,8,9,10,11, ┆
0x0a060…0a080 20 64 65 76 69 63 65 73 2e 0d 0a 09 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 32 2c 31 ┆ devices. 12,1┆
0x0a080…0a0a0 33 2c 31 36 2c 31 37 0d 0a 09 49 4f 44 41 54 34 2d 49 4f 44 41 54 37 20 20 20 32 2c 36 2c 38 2c ┆3,16,17 IODAT4-IODAT7 2,6,8,┆
0x0a0a0…0a0c0 39 2c 31 30 2c 31 32 0d 0a 09 09 31 33 2c 31 36 2c 31 37 0d 0a 0d 0a 09 2f 52 54 43 42 55 53 59 ┆9,10,12 13,16,17 /RTCBUSY┆
0x0a0c0…0a0e0 31 09 32 30 09 55 73 65 64 20 77 68 65 6e 20 74 68 65 20 52 54 43 20 69 73 0d 0a 20 20 20 20 20 ┆1 20 Used when the RTC is ┆
0x0a0e0…0a100 20 20 20 20 2f 52 54 43 42 55 53 59 32 20 20 20 20 20 20 20 32 30 20 20 20 20 20 20 20 20 20 20 ┆ /RTCBUSY2 20 ┆
0x0a100…0a120 20 20 20 20 62 75 73 79 2e 0d 0a 0d 0a 09 56 42 42 55 09 31 37 09 84 50 6f 77 65 72 20 74 6f 20 ┆ busy. VBBU 17 Power to ┆
0x0a120…0a140 74 68 65 20 52 54 43 73 20 66 72 6f 6d 20 0a 19 a9 80 80 74 68 65 20 62 61 74 74 65 72 79 2e 0d ┆the RTCs from the battery. ┆
0x0a140…0a141 0a ┆ ┆
0x0a141…0a144 FormFeed {
0x0a141…0a144 0c 81 a8 ┆ ┆
0x0a141…0a144 }
0x0a144…0a147 0a 0d 0a ┆ ┆
0x0a147…0a14a FormFeed {
0x0a147…0a14a 0c 80 8c ┆ ┆
0x0a147…0a14a }
0x0a14a…0a160 0a 20 20 20 20 20 20 20 20 20 a1 b0 20 53 69 67 6e 61 6c e1 a1 20 ┆ Signal ┆
0x0a160…0a180 20 e1 20 20 20 20 20 a1 44 65 73 74 69 6e 61 74 69 6f 6e e1 20 20 20 20 20 a1 e1 20 20 a1 44 65 ┆ Destination De┆
0x0a180…0a1a0 73 63 72 69 70 74 69 6f 6e 0d 0a 0d 0a 09 52 54 43 41 57 52 09 31 37 2c 31 38 09 84 54 68 69 73 ┆scription RTCAWR 17,18 This┆
0x0a1a0…0a1c0 20 73 69 67 6e 61 6c 20 69 73 20 75 73 65 64 20 74 6f 20 0a 19 a9 80 80 74 72 61 6e 73 66 65 72 ┆ signal is used to transfer┆
0x0a1c0…0a1e0 20 61 6e 20 61 64 64 72 65 73 73 20 74 6f 20 0a 19 a9 80 80 74 68 65 20 73 65 63 6f 75 6e 64 20 ┆ an address to the secound ┆
0x0a1e0…0a200 73 6f 75 72 63 65 20 52 54 43 2e 0d 0a 0d 0a 09 52 54 43 44 57 52 09 31 37 20 20 20 09 84 54 68 ┆source RTC. RTCDWR 17 Th┆
0x0a200…0a220 (81,) 69 73 20 73 69 67 6e 61 6c 20 69 73 20 75 73 65 64 20 74 6f 20 0a 19 a9 80 80 74 72 61 6e 73 66 ┆is signal is used to transf┆
0x0a220…0a240 65 72 20 64 61 74 61 20 74 6f 20 74 68 65 20 0a 19 a9 80 80 73 65 63 6f 75 6e 64 20 73 6f 75 72 ┆er data to the secound sour┆
0x0a240…0a260 63 65 20 52 54 43 2e 0d 0a 0d 0a 09 55 41 45 4e 09 31 39 09 84 54 68 69 73 20 62 69 74 20 69 73 ┆ce RTC. UAEN 19 This bit is┆
0x0a260…0a280 20 73 65 74 20 77 68 65 6e 20 74 68 65 20 0a 19 a9 80 80 38 30 32 38 36 20 73 77 69 74 63 68 20 ┆ set when the 80286 switch ┆
0x0a280…0a2a0 74 6f 20 0a 19 a9 80 80 70 72 6f 74 65 63 74 65 64 20 76 69 72 74 75 61 6c 20 0a 19 a9 80 80 61 ┆to protected virtual a┆
0x0a2a0…0a2c0 64 64 72 65 73 73 20 6d 6f 64 65 2e 0d 0a 0d 0a 09 2f 41 53 54 42 09 31 39 09 69 4c 42 58 62 75 ┆ddress mode. /ASTB 19 iLBXbu┆
0x0a2c0…0a2e0 73 20 61 64 64 72 65 73 73 20 73 74 72 6f 62 65 2e 0d 0a 0d 0a 09 42 48 45 4e 09 31 39 09 84 54 ┆s address strobe. BHEN 19 T┆
0x0a2e0…0a300 68 69 73 20 73 69 67 6e 61 6c 20 74 6f 67 65 74 68 65 72 20 0a 19 a9 80 80 77 69 74 68 20 61 64 ┆his signal together with ad┆
0x0a300…0a320 64 72 65 73 73 20 6c 69 6e 65 20 41 42 30 20 0a 19 a9 80 80 69 6e 64 69 63 61 74 65 73 20 77 68 ┆dress line AB0 indicates wh┆
0x0a320…0a340 65 6e 20 74 68 65 20 64 61 74 61 20 0a 19 a9 80 80 74 72 61 6e 73 70 6f 72 74 20 6f 6e 20 74 68 ┆en the data transport on th┆
0x0a340…0a360 65 20 69 4c 42 58 62 75 73 20 0a 19 a9 80 80 69 73 20 61 20 62 79 74 65 20 74 72 61 6e 73 66 65 ┆e iLBXbus is a byte transfe┆
0x0a360…0a380 72 20 28 4c 6f 77 20 0a 19 a9 80 80 62 79 74 65 20 6f 72 20 68 69 67 68 20 62 79 74 65 29 20 6f ┆r (Low byte or high byte) o┆
0x0a380…0a3a0 72 20 61 20 0a 19 a9 80 80 77 6f 72 64 20 74 72 61 6e 73 66 65 72 2e 0d 0a 0d 0a 09 52 28 2f 57 ┆r a word transfer. R(/W┆
0x0a3a0…0a3c0 29 09 31 38 09 84 49 66 20 68 69 67 68 20 74 68 65 20 43 50 55 20 62 6f 61 72 64 20 0a 19 a9 80 ┆) 18 If high the CPU board ┆
0x0a3c0…0a3e0 80 72 65 61 64 20 66 72 6f 6d 20 74 68 65 20 69 4c 42 58 62 75 73 20 0a 19 a9 80 80 6f 74 68 65 ┆ read from the iLBXbus othe┆
0x0a3e0…0a400 72 77 69 73 65 20 69 74 20 77 72 69 74 65 20 66 72 6f 6d 20 0a 19 a9 80 80 74 68 65 20 62 75 73 ┆rwise it write from the bus┆
0x0a400…0a420 (82,) 2e 0d 0a 0d 0a 09 2f 4c 4f 43 4b 09 31 38 09 84 49 73 20 75 73 65 64 20 74 6f 20 65 78 74 65 6e ┆. /LOCK 18 Is used to exten┆
0x0a420…0a440 64 20 6d 75 74 75 61 6c 20 0a 19 a9 80 80 65 78 63 6c 75 73 69 6f 6e 20 74 6f 20 64 75 61 6c 70 ┆d mutual exclusion to dualp┆
0x0a440…0a460 6f 72 74 20 0a 19 a9 80 80 52 41 4d 27 73 20 6f 6e 20 74 68 65 20 69 4c 42 58 62 75 73 2e 0d 0a ┆ort RAM's on the iLBXbus. ┆
0x0a460…0a480 0d 0a 09 2f 44 53 54 42 09 31 38 20 09 84 44 61 74 61 20 73 74 72 6f 62 65 20 74 6f 20 74 68 65 ┆ /DSTB 18 Data strobe to the┆
0x0a480…0a4a0 20 0a 19 a9 80 80 69 4c 42 58 62 75 73 2e 0d 0a 0d 0a 09 53 4d 41 43 4b 09 35 09 84 53 65 63 6f ┆ iLBXbus. SMACK 5 Seco┆
0x0a4a0…0a4c0 6e 64 61 72 79 20 4d 61 73 74 65 72 20 0a 19 a9 80 80 41 63 6b 6e 6f 77 6c 65 64 67 65 2e 20 49 ┆ndary Master Acknowledge. I┆
0x0a4c0…0a4e0 74 20 67 69 76 65 73 20 61 20 0a 19 a9 80 80 73 65 63 6f 6e 64 61 72 79 20 6d 61 73 74 65 72 20 ┆t gives a secondary master ┆
0x0a4e0…0a500 6f 6e 20 74 68 65 20 0a 19 a9 80 80 69 4c 42 58 62 75 73 20 74 68 65 20 63 6f 6e 74 72 6f 6c 20 ┆on the iLBXbus the control ┆
0x0a500…0a516 6f 66 20 0a 19 a9 80 80 74 68 65 20 69 4c 42 58 62 75 73 2e 0d 0a ┆of the iLBXbus. ┆
0x0a516…0a519 FormFeed {
0x0a516…0a519 0c 83 f8 ┆ ┆
0x0a516…0a519 }
0x0a519…0a51c 0a 0d 0a ┆ ┆
0x0a51c…0a555 Params {
0x0a51c…0a555 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x0a51c…0a555 00 00 00 00 00 00 00 00 0a 1a 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff ff 04 ┆ *7AKU_iså ┆
0x0a51c…0a555 }
0x0a555…0a58e Params {
0x0a555…0a58e 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x0a555…0a58e 00 00 00 00 00 00 00 00 0a 1a 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff ff 04 ┆ *7AKU_iså ┆
0x0a555…0a58e }
0x0a58e…0a58f 0a ┆ ┆
0x0a58f…0a592 FormFeed {
0x0a58f…0a592 0c 80 8c ┆ ┆
0x0a58f…0a592 }
0x0a592…0a5a0 0a 20 20 20 20 20 20 20 20 20 a1 b0 20 53 ┆ S┆
0x0a5a0…0a5c0 69 67 6e 61 6c e1 a1 20 20 e1 20 20 20 20 20 a1 44 65 73 74 69 6e 61 74 69 6f 6e e1 20 20 20 20 ┆ignal Destination ┆
0x0a5c0…0a5e0 20 a1 44 65 73 63 72 69 70 74 69 6f 6e 0d 0a 0d 0a 09 2f 45 50 52 4f 4d 43 53 09 31 31 2c 32 30 ┆ Description /EPROMCS 11,20┆
0x0a5e0…0a600 09 84 43 68 69 70 20 73 65 6c 65 63 74 20 74 6f 20 74 68 65 20 0a 19 a9 80 80 45 50 52 4f 4d 27 ┆ Chip select to the EPROM'┆
0x0a600…0a620 (83,) 73 2e 0d 0a 0d 0a 09 2f 42 56 49 09 31 39 2c 32 30 09 84 42 75 73 20 76 65 63 74 6f 72 20 69 6e ┆s. /BVI 19,20 Bus vector in┆
0x0a620…0a640 74 65 72 72 75 70 74 2e 0d 0a 0d 0a 09 2f 45 50 43 53 09 31 39 09 84 55 6e 20 6c 61 74 63 68 20 ┆terrupt. /EPCS 19 Un latch ┆
0x0a640…0a660 63 68 69 70 20 73 65 6c 65 63 74 20 74 6f 20 0a 19 a9 80 80 74 68 65 20 45 50 52 4f 4d 27 73 2e ┆chip select to the EPROM's.┆
0x0a660…0a680 0d 0a 0d 0a 09 2f 69 4c 42 58 43 53 09 31 39 09 84 43 68 69 70 20 73 65 6c 65 63 74 20 74 6f 20 ┆ /iLBXCS 19 Chip select to ┆
0x0a680…0a6a0 74 68 65 20 0a 19 a9 80 80 69 4c 42 58 62 75 73 2e 0d 0a 0d 0a 09 69 4c 42 58 42 55 53 45 4e 09 ┆the iLBXbus. iLBXBUSEN ┆
0x0a6a0…0a6c0 32 30 09 45 6e 61 62 6c 65 20 74 68 65 20 69 4c 42 58 62 75 73 2e 0d 0a 0d 0a 09 2f 69 4c 42 58 ┆20 Enable the iLBXbus. /iLBX┆
0x0a6c0…0a6e0 44 45 4e 09 35 09 84 69 4c 42 58 20 64 61 74 61 20 65 6e 61 62 6c 65 20 73 69 67 6e 61 6c 2e 0d ┆DEN 5 iLBX data enable signal. ┆
0x0a6e0…0a700 0a 0d 0a 09 2f 49 4f 41 43 43 45 53 53 09 34 2c 31 39 2c 32 30 09 84 54 68 65 20 63 75 72 72 65 ┆ /IOACCESS 4,19,20 The curre┆
0x0a700…0a720 6e 74 20 63 79 63 6c 65 20 69 73 20 61 6e 20 0a 19 a9 80 80 49 2f 4f 20 63 79 63 6c 65 2e 0d 0a ┆nt cycle is an I/O cycle. ┆
0x0a720…0a740 0d 0a 09 53 4c 52 45 51 09 34 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 84 41 6e 20 75 6e 6c ┆ SLREQ 4 An unl┆
0x0a740…0a760 61 74 63 68 20 63 68 69 70 20 73 65 6c 65 63 74 20 0a 19 a9 80 80 73 69 67 6e 61 6c 20 74 6f 20 ┆atch chip select signal to ┆
0x0a760…0a780 74 68 65 0a 19 a9 80 80 69 6e 74 65 72 72 75 70 74 20 6f 75 74 70 75 74 73 2c 20 74 68 65 20 0a ┆the interrupt outputs, the ┆
0x0a780…0a7a0 19 a9 80 80 52 54 43 20 61 6e 64 20 74 68 65 20 62 69 70 6f 6c 61 72 20 0a 19 a9 80 80 50 52 4f ┆ RTC and the bipolar PRO┆
0x0a7a0…0a7c0 4d 27 73 2e 0d 0a 0d 0a 09 2f 50 49 43 43 53 09 32 30 09 84 43 68 69 70 20 73 65 6c 65 63 74 20 ┆M's. /PICCS 20 Chip select ┆
0x0a7c0…0a7e0 74 6f 20 74 68 65 20 0a 19 a9 80 80 69 6e 74 65 72 72 75 70 74 20 63 6f 6e 74 72 6f 6c 6c 65 72 ┆to the interrupt controller┆
0x0a7e0…0a800 73 2e 0d 0a 0d 0a 09 2f 50 50 49 43 53 09 32 30 2c 32 31 09 84 43 68 69 70 20 73 65 6c 65 63 74 ┆s. /PPICS 20,21 Chip select┆
0x0a800…0a820 (84,) 20 74 6f 20 74 68 65 20 0a 19 a9 80 80 70 61 72 61 6c 6c 65 6c 20 70 6f 72 74 73 2e 0d 0a 0d 0a ┆ to the parallel ports. ┆
0x0a820…0a840 09 2f 50 49 54 43 53 09 31 30 09 54 69 6d 65 72 20 63 68 69 70 20 73 65 6c 65 63 74 2e 0d 0a 0d ┆ /PITCS 10 Timer chip select. ┆
0x0a840…0a860 0a 09 2f 53 45 52 43 53 09 39 2c 32 31 09 84 38 32 37 34 20 4d 50 53 43 20 63 68 69 70 20 73 65 ┆ /SERCS 9,21 8274 MPSC chip se┆
0x0a860…0a880 6c 65 63 74 2e 0d 0a 0d 0a 09 2f 50 45 43 53 09 32 09 38 30 32 38 37 20 63 68 69 70 20 73 65 6c ┆lect. /PECS 2 80287 chip sel┆
0x0a880…0a8a0 65 63 74 2e 0d 0a 0d 0a 09 2f 53 42 58 43 53 09 32 30 09 69 53 42 58 20 63 68 69 70 20 73 65 6c ┆ect. /SBXCS 20 iSBX chip sel┆
0x0a8a0…0a8c0 65 63 74 2e 0d 0a 0d 0a 09 2f 4f 42 41 43 43 45 53 53 20 09 34 2c 31 34 09 84 4f 6e 62 6f 61 72 ┆ect. /OBACCESS 4,14 Onboar┆
0x0a8c0…0a8e0 64 20 61 63 63 65 73 73 2e 20 28 4e 6f 74 65 20 0a 19 a9 80 80 74 68 61 74 20 69 4c 42 58 20 63 ┆d access. (Note that iLBX c┆
0x0a8e0…0a900 79 63 6c 65 73 20 69 73 20 0a 19 a9 80 80 6f 6e 62 6f 72 64 20 61 63 63 65 73 73 65 73 29 2e 0d ┆ycles is onbord accesses). ┆
0x0a900…0a920 0a 0d 0a 09 41 53 54 42 09 31 38 09 84 41 64 64 72 65 73 73 20 73 74 72 6f 62 65 20 74 6f 20 74 ┆ ASTB 18 Address strobe to t┆
0x0a920…0a932 68 65 20 0a 19 a9 80 80 69 4c 42 58 62 75 73 2e 0d 0a ┆he iLBXbus. ┆
0x0a932…0a935 FormFeed {
0x0a932…0a935 0c 82 f0 ┆ ┆
0x0a932…0a935 }
0x0a935…0a938 0a 0d 0a ┆ ┆
0x0a938…0a93b FormFeed {
0x0a938…0a93b 0c 80 88 ┆ ┆
0x0a938…0a93b }
0x0a93b…0a940 0a 20 20 20 20 ┆ ┆
0x0a940…0a960 20 20 20 20 20 a1 b0 20 53 69 67 6e 61 6c e1 a1 20 20 e1 20 20 20 20 20 a1 44 65 73 74 69 6e 61 ┆ Signal Destina┆
0x0a960…0a980 74 69 6f 6e e1 20 20 20 20 20 a1 e1 20 20 a1 44 65 73 63 72 69 70 74 69 6f 6e 0d 0a 0d 0a 09 2f ┆tion Description /┆
0x0a980…0a9a0 50 49 43 53 31 2d 2f 50 49 43 53 32 09 36 09 84 43 68 69 70 20 73 65 6c 65 63 74 20 74 6f 20 74 ┆PICS1-/PICS2 6 Chip select to t┆
0x0a9a0…0a9c0 68 65 20 0a 19 a9 80 80 6d 61 73 74 65 72 20 61 6e 64 20 73 6c 61 76 65 20 6e 75 6d 62 65 72 20 ┆he master and slave number ┆
0x0a9c0…0a9e0 0a 19 a9 80 80 6f 6e 65 20 69 6e 74 65 72 72 75 70 74 20 0a 19 a9 80 80 63 6f 6e 74 72 6f 6c 6c ┆ one interrupt controll┆
0x0a9e0…0aa00 65 72 73 2e 0d 0a 0d 0a 09 2f 50 49 43 53 33 09 31 09 84 43 68 69 70 20 73 65 6c 65 63 74 20 74 ┆ers. /PICS3 1 Chip select t┆
0x0aa00…0aa20 (85,) 6f 20 73 6c 61 76 65 20 0a 19 a9 80 80 69 6e 74 65 72 72 75 70 74 20 63 6f 6e 74 72 6f 6c 6c 65 ┆o slave interrupt controlle┆
0x0aa20…0aa40 72 20 0a 19 a9 80 80 6e 75 6d 62 65 72 20 74 77 6f 2e 0d 0a 0d 0a 09 2f 50 50 49 43 53 31 09 38 ┆r number two. /PPICS1 8┆
0x0aa40…0aa60 2c 31 38 09 84 43 68 69 70 20 73 65 6c 65 63 74 20 74 6f 20 70 61 72 61 6c 6c 65 6c 20 0a 19 a9 ┆,18 Chip select to parallel ┆
0x0aa60…0aa80 80 80 70 6f 72 74 20 6f 6e 65 2e 0d 0a 0d 0a 09 2f 50 50 49 43 53 32 09 31 32 20 09 84 43 68 69 ┆ port one. /PPICS2 12 Chi┆
0x0aa80…0aaa0 70 20 73 65 6c 65 63 74 20 74 6f 20 70 61 72 61 6c 6c 65 6c 20 0a 19 a9 80 80 70 6f 72 74 20 74 ┆p select to parallel port t┆
0x0aaa0…0aac0 77 6f 2e 0d 0a 0d 0a 09 2f 4d 43 53 30 2d 2f 4d 43 53 31 09 31 36 09 84 43 68 69 70 20 73 65 6c ┆wo. /MCS0-/MCS1 16 Chip sel┆
0x0aac0…0aae0 65 63 74 73 20 74 6f 20 74 68 65 20 0a 19 a9 80 80 69 53 42 58 62 75 73 2e 0d 0a 0d 0a 09 2f 49 ┆ects to the iSBXbus. /I┆
0x0aae0…0ab00 4e 54 4f 55 54 43 53 09 37 09 84 43 68 69 70 20 73 65 6c 65 63 74 20 74 6f 20 6d 75 6c 74 69 62 ┆NTOUTCS 7 Chip select to multib┆
0x0ab00…0ab20 75 73 20 0a 19 a9 80 80 69 6e 74 65 72 72 75 70 74 20 67 65 6e 65 72 61 74 69 6f 6e 2e 0d 0a 0d ┆us interrupt generation. ┆
0x0ab20…0ab40 0a 09 52 54 43 53 09 31 37 2c 31 38 2c 32 30 09 43 68 69 70 20 73 65 6c 65 63 74 20 74 6f 20 74 ┆ RTCS 17,18,20 Chip select to t┆
0x0ab40…0ab60 68 65 0d 0a 20 20 20 20 20 20 20 20 20 2f 52 54 43 53 20 20 20 20 20 20 20 20 20 20 20 31 37 20 ┆he /RTCS 17 ┆
0x0ab60…0ab80 20 20 20 20 20 20 20 20 20 20 20 20 20 52 65 61 6c 20 54 69 6d 65 20 43 6c 6f 63 6b 2e 0d 0a 0d ┆ Real Time Clock. ┆
0x0ab80…0aba0 0a 09 2f 42 50 52 4f 4d 43 53 09 31 31 09 84 42 69 70 6f 6c 61 72 20 50 52 4f 4d 20 63 68 69 70 ┆ /BPROMCS 11 Bipolar PROM chip┆
0x0aba0…0abc0 20 0a 19 a9 80 80 73 65 6c 65 63 74 2e 0d 0a 0d 0a 09 2f 53 52 44 59 09 32 09 53 79 6e 63 72 6f ┆ select. /SRDY 2 Syncro┆
0x0abc0…0abe0 6e 20 52 65 61 64 79 2e 0d 0a 0d 0a 09 2f 44 4c 59 49 4e 54 41 09 39 2c 32 30 09 84 44 65 6c 61 ┆n Ready. /DLYINTA 9,20 Dela┆
0x0abe0…0ac00 79 73 20 74 68 65 20 69 6e 74 65 72 72 75 70 74 20 0a 19 a9 80 80 61 63 6b 6e 6f 77 6c 65 64 67 ┆ys the interrupt acknowledg┆
0x0ac00…0ac20 (86,) 65 20 74 6f 20 74 68 65 20 38 32 37 34 20 0a 19 a9 80 80 4d 50 53 43 2e 0d 0a 0d 0a 09 2f 49 4f ┆e to the 8274 MPSC. /IO┆
0x0ac20…0ac40 57 41 49 54 09 32 30 09 84 47 65 6e 65 72 61 74 65 73 20 6c 6f 6e 67 65 72 20 6f 6e 62 6f 61 72 ┆WAIT 20 Generates longer onboar┆
0x0ac40…0ac60 64 20 0a 19 a9 80 80 49 2f 4f 20 63 79 63 6c 65 73 2e 0d 0a 0d 0a 09 53 45 52 45 4e 09 31 34 2c ┆d I/O cycles. SEREN 14,┆
0x0ac60…0ac80 32 30 09 84 45 6e 61 62 6c 65 73 20 74 68 65 20 69 6e 74 65 72 72 75 70 74 20 0a 19 a9 80 80 76 ┆20 Enables the interrupt v┆
0x0ac80…0aca0 65 63 74 6f 72 73 20 66 72 6f 6d 20 74 68 65 20 38 32 37 34 20 0a 19 a9 80 80 4d 50 53 43 20 74 ┆ectors from the 8274 MPSC t┆
0x0aca0…0acc0 6f 20 74 68 65 20 6c 6f 63 61 6c 20 64 61 74 61 20 0a 19 a9 80 80 62 75 73 2e 0d 0a 0d 0a 09 2f ┆o the local data bus. /┆
0x0acc0…0ace0 54 49 4d 45 4f 55 54 20 54 52 49 47 09 31 32 09 84 49 6e 69 74 69 61 74 65 73 20 74 68 65 20 74 ┆TIMEOUT TRIG 12 Initiates the t┆
0x0ace0…0ad00 69 6d 65 6f 75 74 20 0a 19 a9 80 80 6c 6f 67 69 63 2e 0d 0a 0d 0a 09 2f 41 53 59 4e 43 20 52 44 ┆imeout logic. /ASYNC RD┆
0x0ad00…0ad15 59 09 32 09 41 73 79 6e 63 72 6f 6e 20 52 65 61 64 79 2e 0d 0a ┆Y 2 Asyncron Ready. ┆
0x0ad15…0ad18 FormFeed {
0x0ad15…0ad18 0c 82 f8 ┆ ┆
0x0ad15…0ad18 }
0x0ad18…0ad1b 0a 0d 0a ┆ ┆
0x0ad1b…0ad54 Params {
0x0ad1b…0ad54 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x0ad1b…0ad54 00 00 00 00 00 00 00 00 0a 1a 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff ff 04 ┆ *7AKU_iså ┆
0x0ad1b…0ad54 }
0x0ad54…0ad8d Params {
0x0ad54…0ad8d 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x0ad54…0ad8d 00 00 00 00 00 00 00 00 0a 1a 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff ff 04 ┆ *7AKU_iså ┆
0x0ad54…0ad8d }
0x0ad8d…0ad8e 0a ┆ ┆
0x0ad8e…0ad91 FormFeed {
0x0ad8e…0ad91 0c 80 88 ┆ ┆
0x0ad8e…0ad91 }
0x0ad91…0ada0 0a 20 20 20 20 20 20 20 20 20 a1 b0 20 53 69 ┆ Si┆
0x0ada0…0adc0 67 6e 61 6c e1 a1 20 20 e1 20 20 20 20 20 a1 44 65 73 74 69 6e 61 74 69 6f 6e e1 20 20 20 20 20 ┆gnal Destination ┆
0x0adc0…0ade0 a1 e1 20 20 a1 44 65 73 63 72 69 70 74 69 6f 6e 0d 0a 0d 0a 09 2f 4d 42 53 57 41 50 09 31 36 09 ┆ Description /MBSWAP 16 ┆
0x0ade0…0ae00 84 45 78 63 68 61 6e 67 65 20 64 61 74 61 20 62 79 74 65 73 20 0a 19 a9 80 80 62 65 74 77 65 65 ┆ Exchange data bytes betwee┆
0x0ae00…0ae20 (87,) 6e 20 74 68 65 20 68 69 67 68 20 61 6e 64 20 6c 6f 77 20 0a 19 a9 80 80 65 6e 64 20 6f 66 20 74 ┆n the high and low end of t┆
0x0ae20…0ae40 68 65 20 64 61 74 61 20 6c 69 6e 65 73 2e 0d 0a 0d 0a 09 2f 42 48 45 4e 09 32 31 09 84 54 68 69 ┆he data lines. /BHEN 21 Thi┆
0x0ae40…0ae60 73 20 73 69 67 6e 61 6c 20 74 6f 67 65 74 68 65 72 20 0a 19 a9 80 80 77 69 74 68 20 61 64 64 72 ┆s signal together with addr┆
0x0ae60…0ae80 65 73 73 20 6c 69 6e 65 20 2f 41 44 52 30 20 0a 19 a9 80 80 69 6e 64 69 63 61 74 65 73 20 77 68 ┆ess line /ADR0 indicates wh┆
0x0ae80…0aea0 65 6e 20 74 68 65 20 64 61 74 61 20 0a 19 a9 80 80 74 72 61 6e 73 70 6f 72 74 20 6f 6e 20 74 68 ┆en the data transport on th┆
0x0aea0…0aec0 65 20 0a 19 a9 80 80 6d 75 6c 74 69 62 75 73 20 69 73 20 61 20 62 79 74 65 20 0a 19 a9 80 80 74 ┆e multibus is a byte t┆
0x0aec0…0aee0 72 61 6e 73 66 65 72 20 28 4c 6f 77 20 62 79 74 65 20 6f 72 20 0a 19 a9 80 80 68 69 67 68 20 62 ┆ransfer (Low byte or high b┆
0x0aee0…0af00 79 74 65 29 20 6f 72 20 61 20 77 6f 72 64 20 0a 19 a9 80 80 74 72 61 6e 73 66 65 72 2e 0d 0a 0d ┆yte) or a word transfer. ┆
0x0af00…0af20 0a 09 2f 4d 42 48 45 4e 09 31 35 09 84 45 6e 61 62 6c 65 73 20 74 68 65 20 68 69 67 68 20 62 79 ┆ /MBHEN 15 Enables the high by┆
0x0af20…0af40 74 65 73 20 0a 19 a9 80 80 74 6f 20 74 68 65 20 6d 75 6c 74 69 62 75 73 2e 0d 0a 0d 0a 09 2f 4d ┆tes to the multibus. /M┆
0x0af40…0af60 42 4c 45 4e 09 31 35 09 84 45 6e 61 62 6c 65 73 20 74 68 65 20 6c 6f 77 20 62 79 74 65 73 20 74 ┆BLEN 15 Enables the low bytes t┆
0x0af60…0af80 6f 20 0a 19 a9 80 80 74 68 65 20 6d 75 6c 74 69 62 75 73 2e 0d 0a 0d 0a 09 2f 44 4c 59 43 4d 44 ┆o the multibus. /DLYCMD┆
0x0af80…0afa0 09 34 2c 32 30 09 84 44 65 6c 61 79 73 20 74 68 65 20 63 6f 6d 6d 61 6e 64 73 20 66 72 6f 6d 20 ┆ 4,20 Delays the commands from ┆
0x0afa0…0afc0 0a 19 a9 80 80 74 68 65 20 6c 6f 63 61 6c 20 62 75 73 20 0a 19 a9 80 80 63 6f 6e 74 72 6f 6c 6c ┆ the local bus controll┆
0x0afc0…0afe0 65 72 2e 0d 0a 0d 0a 09 2f 41 52 44 59 45 4e 09 32 09 84 45 6e 61 62 6c 65 73 20 74 68 65 20 61 ┆er. /ARDYEN 2 Enables the a┆
0x0afe0…0aff5 73 79 6e 63 72 6f 6e 20 0a 19 a9 80 80 72 65 61 64 79 2e 0d 0a ┆syncron ready. ┆
0x0aff5…0aff8 FormFeed {
0x0aff5…0aff8 0c 82 c4 ┆ ┆
0x0aff5…0aff8 }
0x0aff8…0affb 0a 0d 0a ┆ ┆
0x0affb…0affe FormFeed {
0x0affb…0affe 0c 80 8c ┆ ┆
0x0affb…0affe }
0x0affe…0b000 0a 0d ┆ ┆
0x0b000…0b001 (88,) 0a ┆ ┆
0x0b001…0b004 FormFeed {
0x0b001…0b004 0c 80 8c ┆ ┆
0x0b001…0b004 }
0x0b004…0b007 0a 0d 0a ┆ ┆
0x0b007…0b00a FormFeed {
0x0b007…0b00a 0c 80 8c ┆ ┆
0x0b007…0b00a }
0x0b00a…0b00b 0a ┆ ┆
0x0b00b…0b044 Params {
0x0b00b…0b044 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x0b00b…0b044 00 00 00 00 00 00 00 00 0a 1a 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff ff 04 ┆ *7AKU_iså ┆
0x0b00b…0b044 }
0x0b044…0b07d Params {
0x0b044…0b07d 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x0b044…0b07d 00 00 00 00 00 00 00 00 0a 1a 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff ff 04 ┆ *7AKU_iså ┆
0x0b044…0b07d }
0x0b07d…0b080 0a b0 a1 ┆ ┆
0x0b080…0b0a0 35 2e 32 20 20 20 20 20 20 50 41 4c 20 61 6e 64 20 50 52 4f 4d 20 44 65 73 63 72 69 70 74 69 6f ┆5.2 PAL and PROM Descriptio┆
0x0b0a0…0b0c0 6e 73 2e 0d 0a 0d 0a 50 41 4c 31 36 4c 38 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ns. PAL16L8 ┆
0x0b0c0…0b0e0 20 20 20 20 20 20 20 50 41 4c 20 44 45 53 49 47 4e 20 53 50 45 43 49 46 49 43 41 54 49 4f 4e 53 ┆ PAL DESIGN SPECIFICATIONS┆
0x0b0e0…0b100 0d 0a 50 41 54 30 31 32 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ PAT012 ┆
0x0b100…0b120 20 20 38 32 31 32 32 38 20 41 41 4a 0d 0a 33 2d 42 49 54 20 41 44 46 44 52 45 53 53 41 42 4c 45 ┆ 821228 AAJ 3-BIT ADFDRESSABLE┆
0x0b120…0b140 20 4c 41 54 43 48 0d 0a 0d 0a 2f 49 4e 49 54 20 2f 57 52 54 20 2f 43 53 20 41 36 20 41 31 20 49 ┆ LATCH /INIT /WRT /CS A6 A1 I┆
0x0b140…0b160 4f 44 4f 20 49 4f 44 31 20 2f 43 4c 52 20 2f 4d 42 44 4f 20 47 4e 44 0d 0a 2f 4d 42 44 31 20 4e ┆ODO IOD1 /CLR /MBDO GND /MBD1 N┆
0x0b160…0b180 43 20 51 33 20 49 51 33 20 51 32 20 49 51 32 20 51 31 20 49 51 31 20 2f 46 4f 20 56 43 43 0d 0a ┆C Q3 IQ3 Q2 IQ2 Q1 IQ1 /FO VCC ┆
0x0b180…0b1a0 0d 0a 49 46 28 56 43 43 29 20 46 4f 3d 20 57 52 54 2a 43 53 2a 41 36 2a 2f 41 31 2a 2f 49 4f 44 ┆ IF(VCC) FO= WRT*CS*A6*/A1*/IOD┆
0x0b1a0…0b1c0 31 2a 2f 49 4f 44 4f 0d 0a 0d 0a 49 46 28 56 43 43 29 20 2f 51 31 3d 20 49 4e 49 54 0d 0a 20 20 ┆1*/IODO IF(VCC) /Q1= INIT ┆
0x0b1c0…0b1e0 20 20 20 20 20 20 20 20 20 2b 57 52 54 2a 43 53 2a 41 36 2a 41 31 2a 2f 49 4f 44 31 2a 49 4f 44 ┆ +WRT*CS*A6*A1*/IOD1*IOD┆
0x0b1e0…0b200 4f 0d 0a 20 20 20 20 20 20 20 20 20 20 20 2b 43 4c 52 2a 2f 4d 42 44 31 2a 4d 42 44 4f 0d 0a 20 ┆O +CLR*/MBD1*MBDO ┆
0x0b200…0b220 (89,) 20 20 20 20 20 20 20 20 20 20 2b 49 51 31 0d 0a 0d 0a 49 46 28 56 43 43 29 20 2f 49 51 31 3d 20 ┆ +IQ1 IF(VCC) /IQ1= ┆
0x0b220…0b240 57 52 54 2a 43 53 2a 41 36 2a 2f 41 31 2a 2f 49 4f 44 31 2a 49 4f 44 4f 0d 0a 20 20 20 20 20 20 ┆WRT*CS*A6*/A1*/IOD1*IODO ┆
0x0b240…0b260 20 20 20 20 20 20 20 2b 51 31 0d 0a 0d 0a 49 46 28 56 43 43 29 20 2f 51 32 3d 20 49 4e 49 54 0d ┆ +Q1 IF(VCC) /Q2= INIT ┆
0x0b260…0b280 0a 20 20 20 20 20 20 20 20 20 20 20 20 2b 57 52 54 2a 43 53 2a 41 36 2a 41 31 2a 49 4f 44 31 2a ┆ +WRT*CS*A6*A1*IOD1*┆
0x0b280…0b2a0 2f 49 4f 44 4f 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 2b 43 4c 52 2a 4d 42 44 31 2a 2f 4d 42 ┆/IODO +CLR*MBD1*/MB┆
0x0b2a0…0b2c0 44 4f 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 2b 49 51 32 0d 0a 0d 0a 49 46 28 56 43 43 29 20 ┆DO +IQ2 IF(VCC) ┆
0x0b2c0…0b2e0 2f 49 51 32 3d 20 57 52 54 2a 43 53 2a 41 36 2a 2f 41 31 2a 49 4f 44 31 2a 2f 49 4f 44 4f 0d 0a ┆/IQ2= WRT*CS*A6*/A1*IOD1*/IODO ┆
0x0b2e0…0b300 20 20 20 20 20 20 20 20 20 20 20 20 20 2b 51 32 0d 0a 0d 0a 49 46 28 56 43 43 29 20 2f 51 33 3d ┆ +Q2 IF(VCC) /Q3=┆
0x0b300…0b320 20 49 4e 49 54 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 2b 57 52 54 2a 43 53 2a 41 36 2a 41 31 ┆ INIT +WRT*CS*A6*A1┆
0x0b320…0b340 2a 49 4f 44 31 2a 49 4f 44 4f 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 2b 43 4c 52 2a 4d 42 44 ┆*IOD1*IODO +CLR*MBD┆
0x0b340…0b360 31 2a 4d 42 44 4f 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 2b 49 51 33 0d 0a 0d 0a 49 46 28 56 ┆1*MBDO +IQ3 IF(V┆
0x0b360…0b380 43 43 29 20 2f 49 51 33 3d 20 57 52 54 2a 43 53 2a 41 36 2a 2f 41 31 2a 49 4f 44 31 2a 49 4f 44 ┆CC) /IQ3= WRT*CS*A6*/A1*IOD1*IOD┆
0x0b380…0b3a0 4f 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 2b 51 33 0d 0a 0d 0a 44 45 53 43 52 49 50 54 49 ┆O +Q3 DESCRIPTI┆
0x0b3a0…0b3c0 4f 4e 3a 0d 0a 0d 0a 54 48 45 20 43 49 52 43 55 49 54 20 43 4f 4e 54 41 49 4e 53 20 54 48 52 45 ┆ON: THE CIRCUIT CONTAINS THRE┆
0x0b3c0…0b3e0 45 20 53 45 54 2d 52 45 53 45 54 20 4c 41 54 43 48 45 53 20 28 51 31 2c 51 32 2c 51 33 29 20 41 ┆E SET-RESET LATCHES (Q1,Q2,Q3) A┆
0x0b3e0…0b400 4e 44 0d 0a 4e 4f 4e 20 4c 41 54 43 48 45 44 20 4f 55 54 50 55 54 20 28 46 4f 29 2e 0d 0a 57 52 ┆ND NON LATCHED OUTPUT (FO). WR┆
0x0b400…0b420 (90,) 54 2a 43 53 2a 41 36 2a 2f 41 31 20 53 45 54 53 20 54 48 45 20 4c 41 54 43 48 20 28 51 3d 31 2c ┆T*CS*A6*/A1 SETS THE LATCH (Q=1,┆
0x0b420…0b440 49 51 3d 30 29 20 53 45 4c 45 43 54 45 44 20 42 59 20 49 4f 44 31 2c 49 4f 44 4f 2c 0d 0a 4f 52 ┆IQ=0) SELECTED BY IOD1,IODO, OR┆
0x0b440…0b460 20 50 55 4c 53 45 53 20 54 48 45 20 4f 55 54 50 55 54 20 46 4f 20 49 46 20 49 4f 44 41 31 3d 49 ┆ PULSES THE OUTPUT FO IF IODA1=I┆
0x0b460…0b480 4f 44 4f 3d 30 2e 0d 0a 57 52 54 2a 43 53 2a 41 36 2a 41 31 20 52 45 53 45 54 53 20 54 48 45 20 ┆ODO=0. WRT*CS*A6*A1 RESETS THE ┆
0x0b480…0b4a0 4c 41 54 43 48 20 28 51 3d 30 2c 49 51 3d 31 29 20 53 45 4c 45 43 54 45 44 20 42 59 20 49 4f 44 ┆LATCH (Q=0,IQ=1) SELECTED BY IOD┆
0x0b4a0…0b4c0 31 2c 49 4f 44 4f 0d 0a 43 4c 52 20 52 45 53 45 54 53 20 54 48 45 20 4c 41 54 43 48 20 53 45 4c ┆1,IODO CLR RESETS THE LATCH SEL┆
0x0b4c0…0b4e0 45 43 54 45 44 20 42 59 20 4d 42 44 31 2c 4d 42 44 4f 2e 0d 0a 49 4e 49 54 20 52 45 53 45 54 53 ┆ECTED BY MBD1,MBDO. INIT RESETS┆
0x0b4e0…0b4f1 20 41 4c 4c 20 4c 41 54 43 48 45 53 2e 0d 0a 0d 0a ┆ ALL LATCHES. ┆
0x0b4f1…0b4f4 FormFeed {
0x0b4f1…0b4f4 0c 82 e8 ┆ ┆
0x0b4f1…0b4f4 }
0x0b4f4…0b500 0a 20 20 20 20 20 20 20 20 20 20 20 ┆ ┆
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0x0b520…0b540 2a 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 20 20 20 20 20 20 20 ┆***** * ┆
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0x0c7a0…0c7c0 20 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 20 20 20 20 20 20 20 ┆ **** * ┆
0x0c7c0…0c7e0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 0d 0a 20 20 20 20 20 20 20 ┆ * ┆
0x0c7e0…0c800 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ **** ┆
0x0c800…0c820 (100,) 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 20 47 4e 44 20 20 20 20 2a 31 30 2a ┆ **** GND *10*┆
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0x0c840…0c860 2a 20 20 20 20 47 4e 44 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 20 ┆* GND **** ┆
0x0c860…0c880 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 ┆ **** ┆
0x0c880…0c8a0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ * ┆
0x0c8a0…0c8c0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ * ┆
0x0c8c0…0c8e0 20 20 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a ┆ ******************************┆
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0x0ca20…0ca40 4f 2a 2f 55 41 45 4e 2a 2f 41 31 31 20 3b 20 52 45 41 4c 20 41 44 44 52 45 53 53 20 4d 4f 44 45 ┆O*/UAEN*/A11 ; REAL ADDRESS MODE┆
0x0ca40…0ca60 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2b 49 4c 42 58 2a 4d 49 4f 2a 55 41 45 4e ┆. +ILBX*MIO*UAEN┆
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0x0cac0…0cae0 4f 2a 55 41 45 4e 2a 41 31 30 2a 41 31 31 2a 41 31 32 2a 41 31 33 2a 41 31 34 2a 41 31 35 2a 41 ┆O*UAEN*A10*A11*A12*A13*A14*A15*A┆
0x0cae0…0cb00 31 36 2a 41 31 37 20 3b 20 50 56 41 4d 2e 0d 0a 0d 0a 49 46 28 56 43 43 29 20 42 56 49 3d 20 49 ┆16*A17 ; PVAM. IF(VCC) BVI= I┆
0x0cb00…0cb20 4e 54 43 59 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 3b 20 42 55 53 20 56 45 43 54 ┆NTCY ; BUS VECT┆
0x0cb20…0cb40 4f 52 20 49 4e 54 45 52 52 55 50 54 0d 0a 0d 0a 44 45 53 43 52 49 50 54 49 4f 4e 3a 0d 0a 0d 0a ┆OR INTERRUPT DESCRIPTION: ┆
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0x0cba0…0cbc0 56 45 43 54 4f 52 20 49 4e 54 45 52 52 55 50 54 53 2e 0d 0a 28 43 48 45 43 4b 53 55 4d 20 3d 20 ┆VECTOR INTERRUPTS. (CHECKSUM = ┆
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0x0cbc7…0cbca }
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0x0cbe0…0cc00 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 20 20 20 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 0d 0a 20 ┆************ ************** ┆
0x0cc00…0cc20 (102,) 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 20 ┆ * * ┆
0x0cc20…0cc40 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a ┆* * *┆
0x0cc40…0cc60 2a 2a 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆*** ┆
0x0cc60…0cc80 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 20 41 31 30 20 20 20 20 2a 20 31 2a 20 20 20 20 20 20 20 20 ┆**** A10 * 1* ┆
0x0cc80…0cca0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 32 30 2a 20 20 20 20 56 43 43 ┆ *20* VCC┆
0x0cca0…0ccc0 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 20 20 20 20 20 20 20 20 20 ┆ **** ┆
0x0ccc0…0cce0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 20 20 20 ┆ **** ┆
0x0cce0…0cd00 20 20 20 20 20 20 20 20 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ * ┆
0x0cd00…0cd20 20 20 20 20 20 20 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 20 20 ┆ * **** ┆
0x0cd20…0cd40 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 ┆ **** ┆
0x0cd40…0cd60 20 20 20 20 20 41 31 31 20 20 20 20 2a 20 32 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ A11 * 2* ┆
0x0cd60…0cd80 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 31 39 2a 20 20 20 20 2f 49 4c 42 58 43 53 0d 0a 20 20 ┆ *19* /ILBXCS ┆
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0x0d640…0d660 2a 2f 41 36 2a 41 37 20 3b 20 50 41 52 41 4c 4c 45 4c 20 50 4f 52 54 20 32 0d 0a 0d 0a 50 49 54 ┆*/A6*A7 ; PARALLEL PORT 2 PIT┆
0x0d660…0d680 43 53 3a 3d 20 41 2a 42 2a 2f 41 33 2a 41 34 2a 2f 41 35 2a 41 36 2a 41 37 20 3b 20 49 4e 54 45 ┆CS:= A*B*/A3*A4*/A5*A6*A7 ; INTE┆
0x0d680…0d6a0 52 56 41 4c 20 54 49 4d 45 52 0d 0a 0d 0a 53 45 52 43 53 3a 3d 20 41 2a 42 2a 41 33 2a 41 34 2a ┆RVAL TIMER SERCS:= A*B*A3*A4*┆
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0x0d6c0…0d6e0 3d 20 41 2a 42 2a 41 33 2a 41 34 2a 41 35 2a 41 36 2a 41 37 20 3b 20 4e 55 4d 45 52 49 43 20 50 ┆= A*B*A3*A4*A5*A6*A7 ; NUMERIC P┆
0x0d6e0…0d700 52 4f 43 45 53 53 4f 52 20 45 58 54 45 4e 53 49 4f 4e 0d 0a 0d 0a 53 42 58 43 53 3a 3d 20 58 50 ┆ROCESSOR EXTENSION SBXCS:= XP┆
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0x0d740…0d760 3d 20 2f 41 20 20 20 20 20 20 20 20 20 20 3b 20 52 54 43 2c 20 42 50 52 4f 4d 20 41 4e 44 20 49 ┆= /A ; RTC, BPROM AND I┆
0x0d760…0d780 4e 54 45 52 52 55 50 54 20 4f 55 54 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2b 2f 42 20 ┆NTERRUPT OUT +/B ┆
0x0d780…0d7a0 20 20 20 20 20 20 20 20 20 3b 20 43 48 49 50 20 53 45 4c 45 43 54 49 4f 4e 0d 0a 20 20 20 20 20 ┆ ; CHIP SELECTION ┆
0x0d7a0…0d7c0 20 20 20 20 20 20 20 20 20 2b 41 34 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2b 41 35 0d ┆ +A4 +A5 ┆
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0x0d7e0…0d800 20 20 2b 2f 41 37 0d 0a 0d 0a 44 45 53 43 52 49 50 54 49 4f 4e 3a 0d 0a 0d 0a 50 41 54 30 37 31 ┆ +/A7 DESCRIPTION: PAT071┆
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0x0d851…0d854 }
0x0d854…0d860 0a 0d 0a 20 20 20 20 20 20 20 20 20 ┆ ┆
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0x0d880…0d8a0 2a 2a 2a 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 20 20 20 20 20 ┆******* * ┆
0x0d8a0…0d8c0 20 20 20 20 20 20 20 20 2a 20 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 0d 0a 20 20 20 20 20 ┆ * * * ┆
0x0d8c0…0d8e0 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ **** ┆
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0x0d980…0d9a0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ * ┆
0x0d9a0…0d9c0 20 2a 2a 2a 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ **** ┆
0x0d9c0…0d9e0 20 20 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 20 20 20 41 20 20 20 20 2a 20 32 2a 20 20 20 20 20 20 ┆ **** A * 2* ┆
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0x0daa0…0dac0 0d 0a 20 20 20 20 20 20 20 20 41 37 20 20 20 20 2a 20 33 2a 20 20 20 20 20 20 20 20 20 20 20 20 ┆ A7 * 3* ┆
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0x0dae0…0db00 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ **** ┆
0x0db00…0db20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 ┆ **** ┆
0x0db20…0db40 20 20 20 20 20 20 20 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ * ┆
0x0db40…0db60 20 20 20 20 20 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 20 20 20 ┆ * **** ┆
0x0db60…0db80 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 ┆ **** ┆
0x0db80…0dba0 20 20 20 20 20 41 33 20 20 20 20 2a 20 34 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ A3 * 4* ┆
0x0dba0…0dbc0 20 20 20 20 20 20 20 20 20 20 20 20 2a 31 37 2a 20 20 20 20 2f 50 45 43 53 0d 0a 20 20 20 20 20 ┆ *17* /PECS ┆
0x0dbc0…0dbe0 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ **** ┆
0x0dbe0…0dc00 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ **** ┆
0x0dc00…0dc20 (110,) 20 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a ┆ * *┆
0x0dc20…0dc40 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 20 20 20 20 20 20 20 20 20 ┆ **** ┆
0x0dc40…0dc60 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 20 20 41 ┆ **** A┆
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0x0dcc0…0dce0 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 20 20 20 ┆ **** * ┆
0x0dce0…0dd00 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 0d 0a 20 20 20 ┆ * ┆
0x0dd00…0dd20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ **** ┆
0x0dd20…0dd40 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 20 20 41 35 20 20 20 20 ┆ **** A5 ┆
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0x0dda0…0ddc0 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 20 20 20 20 20 20 20 20 ┆**** * ┆
0x0ddc0…0dde0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 0d 0a 20 20 20 20 20 20 20 20 ┆ * ┆
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0x0e2a0…0e2c0 49 43 43 53 2a 2f 50 55 41 44 52 34 2a 50 55 41 44 52 32 20 20 20 20 20 20 20 20 20 3b 20 53 4c ┆ICCS*/PUADR4*PUADR2 ; SL┆
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0x0e320…0e340 2a 2f 50 55 41 44 52 34 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 3b 20 50 50 49 20 31 0d ┆*/PUADR4 ; PPI 1 ┆
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0x0ee60…0ee80 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ * ┆
0x0ee80…0eea0 20 20 20 20 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a ┆ ****************************┆
0x0eea0…0eea5 2a 2a 2a 0d 0a ┆*** ┆
0x0eea5…0eea8 FormFeed {
0x0eea5…0eea8 0c 82 e0 ┆ ┆
0x0eea5…0eea8 }
0x0eea8…0eec0 0a 50 41 54 30 37 33 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ PAT073 ┆
0x0eec0…0eee0 20 20 20 20 20 20 20 20 20 38 34 31 30 32 33 20 48 45 50 0d 0a 43 50 55 36 31 30 20 57 41 49 54 ┆ 841023 HEP CPU610 WAIT┆
0x0eee0…0ef00 20 53 54 41 54 45 20 47 45 4e 45 52 41 54 4f 52 2e 0d 0a 0d 0a 2f 43 50 55 43 4c 4b 20 53 45 52 ┆ STATE GENERATOR. /CPUCLK SER┆
0x0ef00…0ef20 45 4e 20 4c 49 4e 54 52 20 32 49 4e 54 43 59 20 2f 49 4e 54 45 4e 20 2f 49 4f 41 43 43 20 2f 45 ┆EN LINTR 2INTCY /INTEN /IOACC /E┆
0x0ef20…0ef40 50 52 4f 4d 20 2f 44 4c 59 43 4d 44 20 2f 4c 41 4c 45 20 47 4e 44 0d 0a 47 4e 44 20 2f 44 45 42 ┆PROM /DLYCMD /LALE GND GND /DEB┆
0x0ef40…0ef60 55 41 45 20 2f 4c 49 4e 54 41 20 2f 51 30 20 2f 51 31 20 2f 51 32 20 2f 49 4f 4d 42 57 41 20 2f ┆UAE /LINTA /Q0 /Q1 /Q2 /IOMBWA /┆
0x0ef60…0ef80 44 4c 49 4e 54 41 20 2f 49 4f 57 41 49 54 20 56 43 43 0d 0a 0d 0a 51 30 3a 3d 20 2f 4c 41 4c 45 ┆DLINTA /IOWAIT VCC Q0:= /LALE┆
0x0ef80…0efa0 2a 2f 44 4c 59 43 4d 44 2a 2f 51 30 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆*/DLYCMD*/Q0 ┆
0x0efa0…0efc0 3b 20 33 20 42 49 54 20 43 4f 55 4e 54 45 52 0d 0a 0d 0a 51 31 3a 3d 20 2f 4c 41 4c 45 2a 2f 44 ┆; 3 BIT COUNTER Q1:= /LALE*/D┆
0x0efc0…0efe0 4c 59 43 4d 44 2a 2f 51 31 2a 51 30 0d 0a 20 20 20 20 2b 2f 4c 41 4c 45 2a 2f 44 4c 59 43 4d 44 ┆LYCMD*/Q1*Q0 +/LALE*/DLYCMD┆
0x0efe0…0f000 2a 2f 51 30 2a 51 31 0d 0a 0d 0a 51 32 3a 3d 20 2f 4c 41 4c 45 2a 2f 44 4c 59 43 4d 44 2a 2f 51 ┆*/Q0*Q1 Q2:= /LALE*/DLYCMD*/Q┆
0x0f000…0f020 (120,) 32 2a 51 31 2a 51 30 0d 0a 20 20 20 20 2b 2f 4c 41 4c 45 2a 2f 44 4c 59 43 4d 44 2a 2f 51 30 2a ┆2*Q1*Q0 +/LALE*/DLYCMD*/Q0*┆
0x0f020…0f040 2f 51 31 2a 51 32 0d 0a 20 20 20 20 2b 2f 4c 41 4c 45 2a 2f 44 4c 59 43 4d 44 2a 51 30 2a 2f 51 ┆/Q1*Q2 +/LALE*/DLYCMD*Q0*/Q┆
0x0f040…0f060 31 2a 51 32 0d 0a 20 20 20 20 2b 2f 4c 41 4c 45 2a 2f 44 4c 59 43 4d 44 2a 2f 51 30 2a 51 31 2a ┆1*Q2 +/LALE*/DLYCMD*/Q0*Q1*┆
0x0f060…0f080 51 32 0d 0a 0d 0a 49 4f 4d 42 57 41 3a 3d 20 49 4f 41 43 43 2a 2f 51 31 20 20 20 20 20 20 20 20 ┆Q2 IOMBWA:= IOACC*/Q1 ┆
0x0f080…0f0a0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 3b 20 49 2f 4f 20 28 4f 4e 42 4f 41 52 44 29 20 ┆ ; I/O (ONBOARD) ┆
0x0f0a0…0f0c0 41 4e 44 0d 0a 20 20 20 20 20 20 20 20 2b 44 45 42 55 41 45 20 20 20 20 20 20 20 20 20 20 20 20 ┆AND +DEBUAE ┆
0x0f0c0…0f0e0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 3b 20 4d 55 4c 54 49 42 55 53 20 57 41 49 54 53 54 ┆ ; MULTIBUS WAITST┆
0x0f0e0…0f100 41 54 45 53 0d 0a 20 20 20 20 20 20 20 20 2b 2f 49 4f 41 43 43 2a 2f 51 32 20 20 20 20 20 20 20 ┆ATES +/IOACC*/Q2 ┆
0x0f100…0f120 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 3b 20 47 45 4e 45 52 41 54 49 4f 4e 0d 0a 0d 0a ┆ ; GENERATION ┆
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0x0f140…0f160 20 20 20 20 20 20 20 20 20 20 3b 20 46 49 52 53 54 20 45 50 52 4f 4d 20 57 41 49 54 53 54 41 54 ┆ ; FIRST EPROM WAITSTAT┆
0x0f160…0f180 45 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2b 45 50 52 4f 4d 2a 2f 51 32 20 20 20 20 ┆E +EPROM*/Q2 ┆
0x0f180…0f1a0 20 20 20 20 20 20 20 20 20 20 20 20 20 3b 20 32 20 45 50 52 4f 4d 20 57 41 49 54 53 54 41 54 45 ┆ ; 2 EPROM WAITSTATE┆
0x0f1a0…0f1c0 53 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2b 4c 41 4c 45 2a 49 4f 41 43 43 20 20 20 ┆S +LALE*IOACC ┆
0x0f1c0…0f1e0 20 20 20 20 20 20 20 20 20 20 20 20 20 3b 20 46 49 52 53 54 20 49 2f 4f 20 57 41 49 54 53 54 41 ┆ ; FIRST I/O WAITSTA┆
0x0f1e0…0f200 54 45 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2b 49 4f 4d 42 57 41 20 20 20 20 20 20 ┆TE +IOMBWA ┆
0x0f200…0f220 (121,) 20 20 20 20 20 20 20 20 20 20 20 20 20 20 3b 20 4d 55 4c 54 49 42 55 53 20 41 4e 44 20 49 2f 4f ┆ ; MULTIBUS AND I/O┆
0x0f220…0f240 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2b 4c 41 4c 45 2a 4c 49 4e 54 52 20 20 20 20 ┆ +LALE*LINTR ┆
0x0f240…0f260 20 20 20 20 20 20 20 20 20 20 20 20 3b 20 46 49 52 53 54 20 49 4e 54 45 52 52 55 50 54 20 0a 57 ┆ ; FIRST INTERRUPT W┆
0x0f260…0f280 41 49 54 53 54 41 54 45 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2b 53 45 52 45 4e 2a ┆AITSTATE +SEREN*┆
0x0f280…0f2a0 32 49 4e 54 43 59 2a 2f 51 32 20 20 20 20 20 20 20 20 20 20 3b 20 38 32 37 34 20 49 4e 54 45 52 ┆2INTCY*/Q2 ; 8274 INTER┆
0x0f2a0…0f2c0 52 55 50 54 20 0a 57 41 49 54 53 54 41 54 45 0d 0a 0d 0a 49 46 28 56 43 43 29 20 44 4c 49 4e 54 ┆RUPT WAITSTATE IF(VCC) DLINT┆
0x0f2c0…0f2e0 41 3d 20 53 45 52 45 4e 2a 2f 32 49 4e 54 43 59 2a 4c 49 4e 54 41 20 20 20 20 20 20 20 3b 20 44 ┆A= SEREN*/2INTCY*LINTA ; D┆
0x0f2e0…0f300 45 4c 41 59 20 4f 46 20 49 4e 54 45 52 52 55 50 54 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ELAY OF INTERRUPT ┆
0x0f300…0f320 20 20 2b 53 45 52 45 4e 2a 32 49 4e 54 43 59 2a 4c 49 4e 54 41 20 20 20 20 20 20 20 20 3b 20 41 ┆ +SEREN*2INTCY*LINTA ; A┆
0x0f320…0f340 43 4b 4e 4f 57 4c 45 44 47 45 20 54 4f 20 38 32 37 34 0d 0a 0d 0a 44 45 53 43 52 49 50 54 49 4f ┆CKNOWLEDGE TO 8274 DESCRIPTIO┆
0x0f340…0f360 4e 3a 0d 0a 0d 0a 50 41 54 30 37 33 20 49 53 20 41 20 57 41 49 54 20 53 54 41 54 45 20 47 45 4e ┆N: PAT073 IS A WAIT STATE GEN┆
0x0f360…0f380 45 52 41 54 4f 52 2e 20 46 55 52 54 48 45 52 20 49 54 20 44 45 4c 41 59 20 54 48 45 20 49 4e 54 ┆ERATOR. FURTHER IT DELAY THE INT┆
0x0f380…0f3a0 41 0d 0a 53 49 47 4e 41 4c 20 54 4f 20 54 48 45 20 38 32 37 34 0d 0a 28 43 48 45 43 4b 53 55 4d ┆A SIGNAL TO THE 8274 (CHECKSUM┆
0x0f3a0…0f3aa 20 3d 20 30 36 43 36 29 0d 0a ┆ = 06C6) ┆
0x0f3aa…0f3ad FormFeed {
0x0f3aa…0f3ad 0c 82 a8 ┆ ┆
0x0f3aa…0f3ad }
0x0f3ad…0f3c0 0a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ ┆
0x0f3c0…0f3e0 20 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 20 20 20 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a ┆ ************** **************┆
0x0f3e0…0f400 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 20 20 20 20 20 20 20 20 20 20 20 20 ┆ * ┆
0x0f400…0f420 (122,) 20 2a 20 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 ┆ * * * ┆
0x0f420…0f440 20 20 2a 2a 2a 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ **** ┆
0x0f440…0f460 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 2f 43 50 55 43 4c 4b 20 20 20 20 2a 20 31 2a 20 20 20 20 20 ┆ **** /CPUCLK * 1* ┆
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0x0f480…0f4a0 56 43 43 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 20 20 20 20 20 20 ┆VCC **** ┆
0x0f4a0…0f4c0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 ┆ **** ┆
0x0f4c0…0f4e0 20 20 20 20 20 20 20 20 20 20 20 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ * ┆
0x0f4e0…0f500 20 20 20 20 20 20 20 20 20 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 ┆ * **** ┆
0x0f500…0f520 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d ┆ **** ┆
0x0f520…0f540 0a 20 20 20 20 20 53 45 52 45 4e 20 20 20 20 2a 20 32 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ SEREN * 2* ┆
0x0f540…0f560 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 31 39 2a 20 20 20 20 2f 49 4f 57 41 49 54 0d ┆ *19* /IOWAIT ┆
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0x0f580…0f5a0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 ┆ **** ┆
0x0f5a0…0f5c0 20 20 20 20 20 20 20 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ * ┆
0x0f5c0…0f5e0 20 20 20 20 20 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 20 20 20 ┆ * **** ┆
0x0f5e0…0f600 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 ┆ **** ┆
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0x103c0…103e0 20 20 20 20 20 20 20 20 20 20 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 ┆ * **** ┆
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0x10680…106a0 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 20 2f 54 4d 4f 55 54 20 20 20 20 2a 20 ┆ **** /TMOUT * ┆
0x106a0…106c0 37 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a ┆7* *┆
0x106c0…106e0 31 34 2a 20 20 20 20 43 41 53 30 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 ┆14* CAS0 **** ┆
0x106e0…10700 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a ┆ ****┆
0x10700…10720 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 20 20 20 20 20 20 20 20 20 20 20 20 ┆ * ┆
0x10720…10740 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 ┆ * ┆
0x10740…10760 20 20 2a 2a 2a 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ **** ┆
0x10760…10780 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 20 2f 42 55 41 45 4e 20 20 20 20 2a 20 38 2a 20 20 20 20 20 ┆ **** /BUAEN * 8* ┆
0x10780…107a0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 31 33 2a 20 20 20 20 ┆ *13* ┆
0x107a0…107c0 4e 43 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 20 20 20 20 20 20 20 ┆NC **** ┆
0x107c0…107e0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 20 ┆ **** ┆
0x107e0…10800 20 20 20 20 20 20 20 20 20 20 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ * ┆
0x10800…10820 (132,) 20 20 20 20 20 20 20 20 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 ┆ * **** ┆
0x10820…10840 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a ┆ **** ┆
0x10840…10860 20 20 20 20 20 4c 42 58 45 4e 20 20 20 20 2a 20 39 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ LBXEN * 9* ┆
0x10860…10880 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 31 32 2a 20 20 20 20 53 45 52 45 4e 0d 0a 20 20 ┆ *12* SEREN ┆
0x10880…108a0 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ **** ┆
0x108a0…108c0 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ **** ┆
0x108c0…108e0 20 20 20 20 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ * ┆
0x108e0…10900 20 20 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 20 20 20 20 20 20 ┆ * **** ┆
0x10900…10920 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 ┆ **** ┆
0x10920…10940 20 47 4e 44 20 20 20 20 2a 31 30 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ GND *10* ┆
0x10940…10960 20 20 20 20 20 20 20 20 20 2a 31 31 2a 20 20 20 20 4d 42 52 45 51 0d 0a 20 20 20 20 20 20 20 20 ┆ *11* MBREQ ┆
0x10960…10980 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ **** ┆
0x10980…109a0 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 20 ┆ **** * ┆
0x109a0…109c0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 0d 0a 20 ┆ * ┆
0x109c0…109e0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a ┆ ****************┆
0x109e0…109f3 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 2a 0d 0a 0d 0a ┆*************** ┆
0x109f3…109f6 FormFeed {
0x109f3…109f6 0c 82 e0 ┆ ┆
0x109f3…109f6 }
0x109f6…10a00 0a 50 41 4c 31 36 52 36 41 20 ┆ PAL16R6A ┆
0x10a00…10a20 (133,) 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 50 41 4c 20 44 45 53 49 47 ┆ PAL DESIG┆
0x10a20…10a40 4e 20 53 50 45 43 49 46 49 43 41 54 49 4f 4e 53 0d 0a 50 41 54 30 37 35 20 20 20 20 20 20 20 20 ┆N SPECIFICATIONS PAT075 ┆
0x10a40…10a60 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 38 34 31 30 32 33 20 48 45 50 0d 0a 43 50 ┆ 841023 HEP CP┆
0x10a60…10a80 55 36 31 30 20 43 4f 4d 4d 41 4e 44 20 44 45 4c 41 59 20 47 45 4e 45 52 41 54 4f 52 0d 0a 0d 0a ┆U610 COMMAND DELAY GENERATOR ┆
0x10a80…10aa0 2f 43 50 55 43 4c 4b 20 2f 53 30 20 2f 53 31 20 4f 42 44 54 52 20 4e 43 20 4c 41 4c 45 20 2f 53 ┆/CPUCLK /S0 /S1 OBDTR NC LALE /S┆
0x10aa0…10ac0 45 52 43 53 20 2f 52 45 53 45 54 20 2f 43 50 55 43 4c 4b 20 47 4e 44 0d 0a 47 4e 44 20 2f 50 50 ┆ERCS /RESET /CPUCLK GND GND /PP┆
0x10ac0…10ae0 49 43 53 20 2f 44 54 52 20 2f 51 30 20 2f 44 4c 59 43 4d 44 20 2f 51 31 20 2f 51 32 20 2f 51 33 ┆ICS /DTR /Q0 /DLYCMD /Q1 /Q2 /Q3┆
0x10ae0…10b00 20 2f 41 52 44 59 45 4e 20 56 43 43 0d 0a 0d 0a 51 30 3a 3d 20 2f 52 45 53 45 54 2a 44 4c 59 43 ┆ /ARDYEN VCC Q0:= /RESET*DLYC┆
0x10b00…10b20 4d 44 2a 2f 51 30 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 3b 20 43 4f 4d 4d ┆MD*/Q0 ; COMM┆
0x10b20…10b40 41 4e 44 20 44 45 4c 41 59 20 43 4f 55 4e 54 45 52 0d 0a 0d 0a 51 31 3a 3d 20 2f 52 45 53 45 54 ┆AND DELAY COUNTER Q1:= /RESET┆
0x10b40…10b60 2a 44 4c 59 43 4d 44 2a 2f 51 31 2a 51 30 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 3b ┆*DLYCMD*/Q1*Q0 ;┆
0x10b60…10b80 20 20 20 20 20 20 20 20 20 20 2d 22 2d 0d 0a 20 20 20 20 2b 2f 52 45 53 45 54 2a 44 4c 59 43 4d ┆ -"- +/RESET*DLYCM┆
0x10b80…10ba0 44 2a 2f 51 30 2a 51 31 0d 0a 0d 0a 51 32 3a 3d 20 2f 52 45 53 45 54 2a 44 4c 59 43 4d 44 2a 51 ┆D*/Q0*Q1 Q2:= /RESET*DLYCMD*Q┆
0x10ba0…10bc0 30 2a 51 31 2a 2f 51 32 20 20 20 20 20 20 20 20 20 20 20 20 20 20 3b 20 20 20 20 20 20 20 20 20 ┆0*Q1*/Q2 ; ┆
0x10bc0…10be0 20 2d 22 2d 0d 0a 20 20 20 20 2b 2f 52 45 53 45 54 2a 44 4c 59 43 4d 44 2a 2f 51 30 2a 2f 51 31 ┆ -"- +/RESET*DLYCMD*/Q0*/Q1┆
0x10be0…10c00 2a 51 32 0d 0a 20 20 20 20 2b 2f 52 45 53 45 54 2a 44 4c 59 43 4d 44 2a 51 30 2a 2f 51 31 2a 51 ┆*Q2 +/RESET*DLYCMD*Q0*/Q1*Q┆
0x10c00…10c20 (134,) 32 0d 0a 20 20 20 20 2b 2f 52 45 53 45 54 2a 44 4c 59 43 4d 44 2a 2f 51 30 2a 51 31 2a 51 32 0d ┆2 +/RESET*DLYCMD*/Q0*Q1*Q2 ┆
0x10c20…10c40 0a 0d 0a 51 33 3a 3d 20 2f 52 45 53 45 54 2a 44 4c 59 43 4d 44 2a 51 30 2a 51 31 2a 51 32 2a 2f ┆ Q3:= /RESET*DLYCMD*Q0*Q1*Q2*/┆
0x10c40…10c60 51 33 20 20 20 20 20 20 20 20 20 20 20 3b 20 20 20 20 20 20 20 20 20 20 2d 22 2d 0d 0a 20 20 20 ┆Q3 ; -"- ┆
0x10c60…10c80 20 2b 2f 52 45 53 45 54 2a 44 4c 59 43 4d 44 2a 2f 51 30 2a 2f 51 31 2a 2f 51 32 2a 51 33 0d 0a ┆ +/RESET*DLYCMD*/Q0*/Q1*/Q2*Q3 ┆
0x10c80…10ca0 20 20 20 20 2b 2f 52 45 53 45 54 2a 44 4c 59 43 4d 44 2a 51 30 2a 2f 51 31 2a 2f 51 32 2a 51 33 ┆ +/RESET*DLYCMD*Q0*/Q1*/Q2*Q3┆
0x10ca0…10cc0 0d 0a 20 20 20 20 2b 2f 52 45 53 45 54 2a 44 4c 59 43 4d 44 2a 2f 51 30 2a 51 31 2a 2f 51 32 2a ┆ +/RESET*DLYCMD*/Q0*Q1*/Q2*┆
0x10cc0…10ce0 51 33 0d 0a 20 20 20 20 2b 2f 52 45 53 45 54 2a 44 4c 59 43 4d 44 2a 51 30 2a 51 31 2a 2f 51 32 ┆Q3 +/RESET*DLYCMD*Q0*Q1*/Q2┆
0x10ce0…10d00 2a 51 33 0d 0a 20 20 20 20 2b 2f 52 45 53 45 54 2a 44 4c 59 43 4d 44 2a 2f 51 30 2a 2f 51 31 2a ┆*Q3 +/RESET*DLYCMD*/Q0*/Q1*┆
0x10d00…10d20 51 32 2a 51 33 0d 0a 20 20 20 20 2b 2f 52 45 53 45 54 2a 44 4c 59 43 4d 44 2a 51 30 2a 2f 51 31 ┆Q2*Q3 +/RESET*DLYCMD*Q0*/Q1┆
0x10d20…10d40 2a 51 32 2a 51 33 0d 0a 0d 0a 2f 44 54 52 3a 3d 20 2f 4f 42 44 54 52 2a 52 45 53 45 54 20 20 20 ┆*Q2*Q3 /DTR:= /OBDTR*RESET ┆
0x10d40…10d60 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 3b 20 57 52 49 54 45 20 49 2f 4f 20 ┆ ; WRITE I/O ┆
0x10d60…10d80 43 59 43 4c 45 0d 0a 0d 0a 44 4c 59 43 4d 44 3a 3d 20 2f 52 45 53 45 54 2a 53 45 52 43 53 2a 2f ┆CYCLE DLYCMD:= /RESET*SERCS*/┆
0x10d80…10da0 53 30 2a 53 31 2a 2f 4c 41 4c 45 20 20 20 20 20 20 20 20 3b 20 38 32 37 34 20 53 54 41 54 55 53 ┆S0*S1*/LALE ; 8274 STATUS┆
0x10da0…10dc0 20 43 59 43 4c 45 0d 0a 20 20 20 20 20 20 20 20 2b 2f 52 45 53 45 54 2a 53 45 52 43 53 2a 53 30 ┆ CYCLE +/RESET*SERCS*S0┆
0x10dc0…10de0 2a 2f 53 31 2a 2f 4c 41 4c 45 20 20 20 20 20 20 20 20 3b 20 20 20 20 20 20 20 2d 22 2d 0d 0a 20 ┆*/S1*/LALE ; -"- ┆
0x10de0…10e00 20 20 20 20 20 20 20 2b 2f 52 45 53 45 54 2a 53 45 52 43 53 2a 2f 51 31 2a 2f 51 32 2a 2f 51 33 ┆ +/RESET*SERCS*/Q1*/Q2*/Q3┆
0x10e00…10e20 (135,) 2a 44 4c 59 43 4d 44 20 20 3b 20 38 32 37 34 20 43 4f 4d 4d 41 4e 44 20 44 45 4c 41 59 0d 0a 20 ┆*DLYCMD ; 8274 COMMAND DELAY ┆
0x10e20…10e40 20 20 20 20 20 20 20 2b 2f 52 45 53 45 54 2a 50 50 49 43 53 2a 2f 53 30 2a 53 31 2a 2f 4c 41 4c ┆ +/RESET*PPICS*/S0*S1*/LAL┆
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0x10e60…10e80 20 20 20 20 20 20 2b 2f 52 45 53 45 54 2a 50 50 49 43 53 2a 53 30 2a 2f 53 31 2a 2f 4c 41 4c 45 ┆ +/RESET*PPICS*S0*/S1*/LALE┆
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0x10f20…10f40 2a 53 31 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 3b 20 45 4e 41 42 4c 45 ┆*S1 ; ENABLE┆
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0x11030…11033 }
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0x110a0…110c0 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ **** ┆
0x110c0…110e0 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 2f 43 50 55 43 4c 4b 20 20 20 20 2a 20 31 ┆ **** /CPUCLK * 1┆
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0x11160…11180 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ * ┆
0x11180…111a0 2a 2a 2a 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆**** ┆
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0x11300…11320 20 20 20 20 20 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ * ┆
0x11320…11340 20 20 20 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 20 20 20 20 20 20 20 20 ┆ * **** ┆
0x11340…11360 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 20 20 ┆ **** ┆
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0x113c0…113e0 20 20 20 20 20 20 2a 2a 2a 2a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2a 20 20 ┆ **** * ┆
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0x115c0…115e0 2a 2a 2a 2a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆**** ┆
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0x11e40…11e60 30 33 45 41 20 20 20 20 46 46 46 46 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 09 44 ┆03EA FFFF D┆
0x11e60…11e80 57 09 30 46 46 46 46 48 09 3b 0d 0a 20 20 30 33 45 43 20 20 20 20 46 46 46 46 20 20 20 20 20 20 ┆W 0FFFFH ; 03EC FFFF ┆
0x11e80…11ea0 20 20 20 20 20 20 20 20 20 20 20 20 09 44 57 09 30 46 46 46 46 48 09 3b 0d 0a 20 20 30 33 45 45 ┆ DW 0FFFFH ; 03EE┆
0x11ea0…11ec0 20 20 20 20 46 46 46 46 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 09 44 57 09 30 46 ┆ FFFF DW 0F┆
0x11ec0…11ee0 46 46 46 48 09 3b 0d 0a 20 20 30 33 46 30 20 20 20 20 46 46 46 46 20 20 20 20 20 20 20 20 20 20 ┆FFFH ; 03F0 FFFF ┆
0x11ee0…11f00 20 20 20 20 20 20 20 20 09 44 57 09 30 46 46 46 46 48 09 3b 0d 0a 20 20 30 33 46 32 20 20 20 20 ┆ DW 0FFFFH ; 03F2 ┆
0x11f00…11f20 46 46 46 46 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 09 44 57 09 30 46 46 46 46 48 ┆FFFF DW 0FFFFH┆
0x11f20…11f40 09 3b 0d 0a 20 20 30 33 46 34 20 20 20 20 46 46 46 46 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ ; 03F4 FFFF ┆
0x11f40…11f60 20 20 20 20 09 44 57 09 30 46 46 46 46 48 09 3b 0d 0a 20 20 30 33 46 36 20 20 20 20 46 46 46 46 ┆ DW 0FFFFH ; 03F6 FFFF┆
0x11f60…11f80 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 09 44 57 09 30 46 46 46 46 48 09 3b 0d 0a ┆ DW 0FFFFH ; ┆
0x11f80…11fa0 20 20 30 33 46 38 20 20 20 20 46 46 46 46 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ 03F8 FFFF ┆
0x11fa0…11fc0 09 44 57 09 30 46 46 46 46 48 09 3b 0d 0a 20 20 30 33 46 41 20 20 20 20 46 46 46 46 20 20 20 20 ┆ DW 0FFFFH ; 03FA FFFF ┆
0x11fc0…11fe0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 09 44 57 09 30 46 46 46 46 48 09 3b 0d 0a 20 20 30 33 ┆ DW 0FFFFH ; 03┆
0x11fe0…12000 46 43 20 20 20 20 46 46 46 46 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 09 44 57 09 ┆FC FFFF DW ┆
0x12000…12020 (144,) 30 46 46 46 46 48 09 3b 0d 0a 20 20 30 33 46 45 20 20 20 20 46 46 46 46 20 20 20 20 20 20 20 20 ┆0FFFFH ; 03FE FFFF ┆
0x12020…12040 20 20 20 20 20 20 20 20 20 20 09 44 57 09 30 46 46 46 46 48 09 3b 0d 0a 20 20 20 20 20 20 20 20 ┆ DW 0FFFFH ; ┆
0x12040…12060 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 3b 0d 0a 20 20 20 20 20 ┆ ; ┆
0x12060…12080 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 09 45 4e 44 0d ┆ END ┆
0x12080…12081 0a ┆ ┆
0x12081…12084 FormFeed {
0x12081…12084 0c 82 d0 ┆ ┆
0x12081…12084 }
0x12084…120a0 0a b0 a1 b0 a1 35 2e 33 20 20 20 20 20 20 54 69 6d 69 6e 67 20 44 69 61 67 72 61 6d ┆ 5.3 Timing Diagram┆
0x120a0…120c0 73 2e 0d 0a 0d 0a 09 84 54 68 69 73 20 70 61 72 74 20 64 65 73 63 72 69 62 65 73 20 74 68 65 20 ┆s. This part describes the ┆
0x120c0…120e0 62 65 68 61 76 69 6f 75 72 20 6f 66 20 74 68 65 20 73 69 67 6e 61 6c 73 20 69 6e 20 0a 19 89 80 ┆behaviour of the signals in ┆
0x120e0…12100 80 74 69 6d 65 2e 20 54 68 65 20 64 6f 6b 75 6d 65 6e 74 61 74 69 6f 6e 20 69 73 20 66 72 6f 6d ┆ time. The dokumentation is from┆
0x12100…12120 20 61 20 6c 6f 67 69 63 20 61 6e 61 6c 79 7a 65 72 20 6d 6f 64 65 6c 20 0a 19 89 80 80 31 36 33 ┆ a logic analyzer model 163┆
0x12120…1213b 30 44 20 66 72 6f 6d 20 48 65 77 65 6c 74 20 50 61 63 6b 61 72 64 2e 0d 0a 0d 0a ┆0D from Hewelt Packard. ┆
0x1213b…1213e FormFeed {
0x1213b…1213e 0c 80 c8 ┆ ┆
0x1213b…1213e }
0x1213e…12140 0a b0 ┆ ┆
0x12140…12160 a1 35 2e 33 2e 31 20 20 20 20 46 69 72 73 74 20 52 4f 4d 20 61 63 63 65 73 73 20 6f 6e 20 43 50 ┆ 5.3.1 First ROM access on CP┆
0x12160…1216a 55 36 31 30 42 2e 0d 0a 0d 0a ┆U610B. ┆
0x1216a…1216d FormFeed {
0x1216a…1216d 0c 80 98 ┆ ┆
0x1216a…1216d }
0x1216d…12180 0a b0 a1 35 2e 33 2e 32 20 20 20 20 38 32 37 34 20 63 79 ┆ 5.3.2 8274 cy┆
0x12180…12193 63 6c 65 20 6f 6e 20 43 50 55 36 31 30 41 2e 0d 0a 0d 0a ┆cle on CPU610A. ┆
0x12193…12196 FormFeed {
0x12193…12196 0c 80 98 ┆ ┆
0x12193…12196 }
0x12196…121a0 0a 88 b0 a1 35 2e 33 2e 33 20 ┆ 5.3.3 ┆
0x121a0…121b9 20 20 20 52 54 43 20 63 79 63 6c 65 20 43 50 55 36 31 30 41 2e 0d 0a 0d 0a ┆ RTC cycle CPU610A. ┆
0x121b9…121bc FormFeed {
0x121b9…121bc 0c 80 98 ┆ ┆
0x121b9…121bc }
0x121bc…121c0 0a b0 a1 35 ┆ 5┆
0x121c0…121e0 2e 33 2e 34 20 20 20 20 4d 75 6c 74 69 62 75 73 20 63 79 63 6c 65 20 6f 6e 20 43 50 55 36 31 30 ┆.3.4 Multibus cycle on CPU610┆
0x121e0…121f0 42 20 74 6f 20 4d 45 4d 36 39 31 2e 0d 0a 0d 0a ┆B to MEM691. ┆
0x121f0…121f3 FormFeed {
0x121f0…121f3 0c 80 98 ┆ ┆
0x121f0…121f3 }
0x121f3…12200 0a b0 a1 35 2e 33 2e 35 20 20 20 20 69 ┆ 5.3.5 i┆
0x12200…12220 (145,) 4c 42 58 62 75 73 20 63 79 63 6c 65 20 43 50 55 36 31 30 42 20 74 6f 20 4d 45 4d 36 39 31 2e 0d ┆LBXbus cycle CPU610B to MEM691. ┆
0x12220…12223 0a 0d 0a ┆ ┆
0x12223…12226 FormFeed {
0x12223…12226 0c 80 98 ┆ ┆
0x12223…12226 }
0x12226…12240 0a a1 b0 35 2e 34 20 20 20 20 20 20 20 50 6c 75 67 73 2e 0d 0a 0d 0a 20 20 20 ┆ 5.4 Plugs. ┆
0x12240…12260 20 20 20 20 20 20 20 84 54 68 69 73 20 70 61 72 74 20 64 65 73 63 69 62 65 73 20 74 68 65 20 70 ┆ This part descibes the p┆
0x12260…12280 6c 75 67 73 20 6f 6e 20 43 50 55 36 31 30 58 2e 20 54 68 65 20 4d 75 6c 74 69 62 75 73 20 0a 19 ┆lugs on CPU610X. The Multibus ┆
0x12280…122a0 8a 80 80 28 50 31 29 20 20 61 6e 64 20 69 4c 42 58 20 28 50 32 29 20 63 6f 6e 6e 65 63 74 6f 72 ┆ (P1) and iLBX (P2) connector┆
0x122a0…122c0 73 20 69 73 20 65 64 67 65 20 63 6f 6e 6e 65 63 74 6f 72 73 2e 20 54 68 65 20 0a 19 8a 80 80 72 ┆s is edge connectors. The r┆
0x122c0…122e0 65 73 74 20 63 6f 6e 6e 65 63 74 6f 72 73 20 69 73 20 49 54 54 20 43 41 4e 4e 4f 4e 20 47 30 38 ┆est connectors is ITT CANNON G08┆
0x122e0…12300 20 63 6f 6e 6e 65 63 74 6f 72 73 2e 0d 0a 0d 0a b0 a1 35 2e 34 2e 31 20 20 20 20 50 31 20 4d 75 ┆ connectors. 5.4.1 P1 Mu┆
0x12300…12313 6c 74 69 62 75 73 20 43 6f 6e 6e 65 63 74 6f 72 2e 0d 0a ┆ltibus Connector. ┆
0x12313…1234c Params {
0x12313…1234c 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x12313…1234c 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x12313…1234c }
0x1234c…12385 Params {
0x1234c…12385 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x1234c…12385 00 00 00 00 00 00 00 00 0a 1a 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff ff 04 ┆ *7AKU_iså ┆
0x1234c…12385 }
0x12385…123a0 0a 0d 0a 09 b0 a1 50 69 6e 09 53 69 67 6e 61 6c 09 50 69 6e 09 53 69 67 6e 61 6c ┆ Pin Signal Pin Signal┆
0x123a0…123c0 2e 20 0d 0a 0d 0a 09 31 09 47 4e 44 09 32 09 47 4e 44 0d 0a 09 33 09 2b 35 56 09 34 09 2b 35 56 ┆. 1 GND 2 GND 3 +5V 4 +5V┆
0x123c0…123e0 0d 0a 09 35 09 2b 35 56 09 36 09 2b 35 56 0d 0a 09 37 09 2b 31 32 56 09 38 09 2b 31 32 56 0d 0a ┆ 5 +5V 6 +5V 7 +12V 8 +12V ┆
0x123e0…12400 09 39 09 52 65 73 65 72 76 65 64 09 31 30 09 52 65 73 65 72 76 65 64 0d 0a 09 31 31 09 47 4e 44 ┆ 9 Reserved 10 Reserved 11 GND┆
0x12400…12420 (146,) 09 31 32 09 47 4e 44 0d 0a 09 31 33 09 2f 42 43 4c 4b 09 31 34 09 2f 49 4e 49 54 0d 0a 09 31 35 ┆ 12 GND 13 /BCLK 14 /INIT 15┆
0x12420…12440 09 2f 42 50 52 4e 09 31 36 09 2f 42 50 52 4f 0d 0a 09 31 37 09 2f 42 55 53 59 09 31 38 09 2f 42 ┆ /BPRN 16 /BPRO 17 /BUSY 18 /B┆
0x12440…12460 52 45 51 0d 0a 09 31 39 09 2f 4d 52 44 43 09 32 30 09 2f 4d 57 54 43 0d 0a 09 32 31 09 2f 49 4f ┆REQ 19 /MRDC 20 /MWTC 21 /IO┆
0x12460…12480 52 43 09 32 32 09 2f 49 4f 57 43 0d 0a 09 32 33 09 2f 58 41 43 4b 09 32 34 09 2f 49 4e 48 31 0d ┆RC 22 /IOWC 23 /XACK 24 /INH1 ┆
0x12480…124a0 0a 09 32 35 09 2f 4c 4f 43 4b 09 32 36 09 2f 49 4e 48 32 0d 0a 09 32 37 09 2f 42 48 45 4e 09 32 ┆ 25 /LOCK 26 /INH2 27 /BHEN 2┆
0x124a0…124c0 38 09 2f 41 44 31 30 0d 0a 09 32 39 09 2f 43 42 52 51 09 33 30 09 2f 41 44 31 31 0d 0a 09 33 31 ┆8 /AD10 29 /CBRQ 30 /AD11 31┆
0x124c0…124e0 09 2f 43 43 4c 4b 09 33 32 09 2f 41 44 31 32 0d 0a 09 33 33 09 2f 49 4e 54 41 09 33 34 09 2f 41 ┆ /CCLK 32 /AD12 33 /INTA 34 /A┆
0x124e0…12500 44 31 33 0d 0a 09 33 35 09 2f 49 4e 54 36 09 33 36 09 2f 49 4e 54 37 0d 0a 09 33 37 09 2f 49 4e ┆D13 35 /INT6 36 /INT7 37 /IN┆
0x12500…12520 54 34 09 33 38 09 2f 49 4e 54 35 0d 0a 09 33 39 09 2f 49 4e 54 32 09 34 30 09 2f 49 4e 54 33 0d ┆T4 38 /INT5 39 /INT2 40 /INT3 ┆
0x12520…12540 0a 09 34 31 09 2f 49 4e 54 30 09 34 32 09 2f 49 4e 54 31 0d 0a 09 34 33 09 2f 41 44 52 45 09 34 ┆ 41 /INT0 42 /INT1 43 /ADRE 4┆
0x12540…12560 34 09 2f 41 44 52 46 0d 0a 09 34 35 09 2f 41 44 52 43 09 34 36 09 2f 41 44 52 44 0d 0a 09 34 37 ┆4 /ADRF 45 /ADRC 46 /ADRD 47┆
0x12560…12580 09 2f 41 44 52 41 09 34 38 09 2f 41 44 52 42 0d 0a 09 34 39 09 2f 41 44 52 38 09 35 30 09 2f 41 ┆ /ADRA 48 /ADRB 49 /ADR8 50 /A┆
0x12580…125a0 44 52 39 0d 0a 09 35 31 09 2f 41 44 52 36 09 35 32 09 2f 41 44 52 37 0d 0a 09 35 33 09 2f 41 44 ┆DR9 51 /ADR6 52 /ADR7 53 /AD┆
0x125a0…125c0 52 34 09 35 34 09 2f 41 44 52 35 0d 0a 09 35 35 09 2f 41 44 52 32 09 35 36 09 2f 41 44 52 33 0d ┆R4 54 /ADR5 55 /ADR2 56 /ADR3 ┆
0x125c0…125e0 0a 09 35 37 09 2f 41 44 52 30 09 35 38 09 2f 41 44 52 31 0d 0a 09 35 39 09 2f 44 41 54 45 09 36 ┆ 57 /ADR0 58 /ADR1 59 /DATE 6┆
0x125e0…12600 30 09 2f 44 41 54 46 0d 0a 09 36 31 09 2f 44 41 54 43 09 36 32 09 2f 44 41 54 44 0d 0a 09 36 33 ┆0 /DATF 61 /DATC 62 /DATD 63┆
0x12600…12620 (147,) 09 2f 44 41 54 41 09 36 34 09 2f 44 41 54 42 0d 0a 09 36 35 09 2f 44 41 54 38 09 36 36 09 2f 44 ┆ /DATA 64 /DATB 65 /DAT8 66 /D┆
0x12620…12640 41 54 39 0d 0a 09 36 37 09 2f 44 41 54 36 09 36 38 09 2f 44 41 54 37 0d 0a 09 36 39 09 2f 44 41 ┆AT9 67 /DAT6 68 /DAT7 69 /DA┆
0x12640…12660 54 34 09 37 30 09 2f 44 41 54 35 0d 0a 09 37 31 09 2f 44 41 54 32 09 37 32 09 2f 44 41 54 33 0d ┆T4 70 /DAT5 71 /DAT2 72 /DAT3 ┆
0x12660…12680 0a 09 37 33 09 2f 44 41 54 30 09 37 34 09 2f 44 41 54 31 0d 0a 09 37 35 09 47 4e 44 09 37 36 09 ┆ 73 /DAT0 74 /DAT1 75 GND 76 ┆
0x12680…126a0 47 4e 44 0d 0a 09 37 37 09 52 65 73 65 72 76 65 64 09 37 38 09 52 65 73 65 72 76 65 64 0d 0a 09 ┆GND 77 Reserved 78 Reserved ┆
0x126a0…126c0 37 39 09 2d 31 32 56 09 38 30 09 2d 31 32 56 0d 0a 09 38 31 09 2b 35 56 09 38 32 09 2b 35 56 0d ┆79 -12V 80 -12V 81 +5V 82 +5V ┆
0x126c0…126e0 0a 09 38 33 09 2b 35 56 09 38 34 09 2b 35 56 0d 0a 09 38 35 09 47 4e 44 09 38 36 09 47 4e 44 0d ┆ 83 +5V 84 +5V 85 GND 86 GND ┆
0x126e0…12700 0a 09 b0 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆ -----------------------------┆
0x12700…1270c 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a ┆---------- ┆
0x1270c…1270f FormFeed {
0x1270c…1270f 0c 83 cc ┆ ┆
0x1270c…1270f }
0x1270f…12710 0a ┆ ┆
0x12710…12749 Params {
0x12710…12749 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x12710…12749 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x12710…12749 }
0x12749…12782 Params {
0x12749…12782 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x12749…12782 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x12749…12782 }
0x12782…127a0 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 ┆ ┆
0x127a0…127c0 46 69 67 20 35 2e 34 2e 31 20 50 31 20 61 6e 64 20 50 32 20 50 69 6e 20 61 73 73 69 67 6e 6d 65 ┆Fig 5.4.1 P1 and P2 Pin assignme┆
0x127c0…127c7 6e 74 2e 0d 0a 0d 0a ┆nt. ┆
0x127c7…12800 Params {
0x127c7…12800 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x127c7…12800 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x127c7…12800 }
0x12800…12839 (148,) Params {
0x12800…12839 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x12800…12839 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x12800…12839 }
0x12839…12840 0a 0d 0a a1 b0 35 2e ┆ 5.┆
0x12840…12860 34 2e 32 20 20 20 20 50 32 20 65 78 74 65 6e 64 65 64 20 4d 75 6c 74 69 62 75 73 20 43 6f 6e 6e ┆4.2 P2 extended Multibus Conn┆
0x12860…12880 65 63 74 6f 72 20 28 69 4c 42 58 62 75 73 20 63 6f 6e 6e 65 63 74 6f 72 29 2e 0d 0a 0d 0a 09 b0 ┆ector (iLBXbus connector). ┆
0x12880…128a0 a1 50 69 6e 09 53 69 67 6e 61 6c 09 50 69 6e 09 53 69 67 6e 61 6c 2e 20 0d 0a 0d 0a 09 31 09 44 ┆ Pin Signal Pin Signal. 1 D┆
0x128a0…128c0 42 30 09 32 09 44 42 31 0d 0a 09 33 09 44 42 32 09 34 09 44 42 33 0d 0a 09 35 09 44 42 34 09 36 ┆B0 2 DB1 3 DB2 4 DB3 5 DB4 6┆
0x128c0…128e0 09 44 42 35 0d 0a 09 37 09 44 42 36 20 09 38 09 44 42 37 0d 0a 09 39 09 47 4e 44 20 20 20 20 20 ┆ DB5 7 DB6 8 DB7 9 GND ┆
0x128e0…12900 09 31 30 09 44 42 38 0d 0a 09 31 31 09 44 42 39 20 09 31 32 09 44 42 31 30 0d 0a 09 31 33 09 44 ┆ 10 DB8 11 DB9 12 DB10 13 D┆
0x12900…12920 42 31 31 20 09 31 34 09 44 42 31 32 0d 0a 09 31 35 09 44 42 31 33 20 09 31 36 09 44 42 31 34 0d ┆B11 14 DB12 15 DB13 16 DB14 ┆
0x12920…12940 0a 09 31 37 09 44 42 31 35 20 09 31 38 09 47 4e 44 0d 0a 09 31 39 09 41 42 30 20 20 09 32 30 09 ┆ 17 DB15 18 GND 19 AB0 20 ┆
0x12940…12960 41 42 31 0d 0a 09 32 31 09 41 42 32 20 20 09 32 32 09 41 42 33 0d 0a 09 32 33 09 41 42 34 20 20 ┆AB1 21 AB2 22 AB3 23 AB4 ┆
0x12960…12980 09 32 34 09 41 42 35 0d 0a 09 32 35 09 41 42 36 20 20 09 32 36 09 41 42 37 0d 0a 09 32 37 09 47 ┆ 24 AB5 25 AB6 26 AB7 27 G┆
0x12980…129a0 4e 44 20 20 09 32 38 09 41 42 38 0d 0a 09 32 39 09 41 42 39 20 09 33 30 09 41 42 31 30 0d 0a 09 ┆ND 28 AB8 29 AB9 30 AB10 ┆
0x129a0…129c0 33 31 09 41 42 31 31 20 09 33 32 09 41 42 31 32 0d 0a 09 33 33 09 41 42 31 33 20 09 33 34 09 41 ┆31 AB11 32 AB12 33 AB13 34 A┆
0x129c0…129e0 42 31 34 0d 0a 09 33 35 09 41 42 31 35 20 09 33 36 09 47 4e 44 0d 0a 09 33 37 09 41 42 31 36 09 ┆B14 35 AB15 36 GND 37 AB16 ┆
0x129e0…12a00 33 38 09 41 42 31 37 0d 0a 09 33 39 09 41 42 31 38 20 09 34 30 09 41 42 31 39 0d 0a 09 34 31 09 ┆38 AB17 39 AB18 40 AB19 41 ┆
0x12a00…12a20 (149,) 41 42 32 30 20 09 34 32 09 41 42 32 31 0d 0a 09 34 33 09 41 42 32 32 20 09 34 34 09 41 42 32 33 ┆AB20 42 AB21 43 AB22 44 AB23┆
0x12a20…12a40 0d 0a 09 34 35 09 47 4e 44 20 20 09 34 36 09 2f 41 43 4b 0d 0a 09 34 37 09 42 48 45 4e 20 09 34 ┆ 45 GND 46 /ACK 47 BHEN 4┆
0x12a40…12a60 38 09 52 2f 28 2f 57 29 0d 0a 09 34 39 09 2f 41 53 54 42 09 35 30 09 2f 44 53 54 42 0d 0a 09 35 ┆8 R/(/W) 49 /ASTB 50 /DSTB 5┆
0x12a60…12a80 31 09 2f 53 4d 52 51 09 35 32 09 2f 53 4d 41 43 4b 0d 0a 09 35 33 09 2f 4c 4f 43 4b 09 35 34 09 ┆1 /SMRQ 52 /SMACK 53 /LOCK 54 ┆
0x12a80…12aa0 47 4e 44 0d 0a 09 35 35 09 2f 41 44 52 32 32 09 35 36 09 2f 41 44 52 32 33 0d 0a 09 35 37 09 2f ┆GND 55 /ADR22 56 /ADR23 57 /┆
0x12aa0…12ac0 41 44 52 32 30 09 35 38 09 2f 41 44 52 32 31 0d 0a 09 35 39 09 52 65 73 65 72 76 65 64 09 36 30 ┆ADR20 58 /ADR21 59 Reserved 60┆
0x12ac0…12ae0 09 2f 54 50 41 52 0d 0a 09 b0 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆ /TPAR ----------------------┆
0x12ae0…12af3 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a ┆----------------- ┆
0x12af3…12af6 FormFeed {
0x12af3…12af6 0c 83 b0 ┆ ┆
0x12af3…12af6 }
0x12af6…12af7 0a ┆ ┆
0x12af7…12b30 Params {
0x12af7…12b30 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x12af7…12b30 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x12af7…12b30 }
0x12b30…12b69 Params {
0x12b30…12b69 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x12b30…12b69 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x12b30…12b69 }
0x12b69…12b80 0a b0 a1 35 2e 34 2e 33 20 20 20 20 4a 31 20 43 6f 6e 73 6f 6c 65 20 ┆ 5.4.3 J1 Console ┆
0x12b80…12b98 69 6e 74 65 72 66 61 63 65 20 63 6f 6e 6e 65 63 74 6f 72 2e 0d 0a 0d 0a ┆interface connector. ┆
0x12b98…12bd1 Params {
0x12b98…12bd1 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x12b98…12bd1 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x12b98…12bd1 }
0x12bd1…12c0a Params {
0x12bd1…12c0a 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x12bd1…12c0a 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x12bd1…12c0a }
0x12c0a…12c20 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 a1 ┆ ┆
0x12c20…12c40 b0 f0 a1 e1 a1 b0 4a 31 20 20 20 20 20 20 20 43 6f 6e 73 6f 6c 65 20 28 52 53 32 33 32 43 29 20 ┆ J1 Console (RS232C) ┆
0x12c40…12c60 53 69 67 6e 61 6c 73 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆Signals ┆
0x12c60…12c80 31 a1 e1 20 20 e1 a1 e1 20 20 20 20 20 20 20 20 20 20 20 20 20 52 45 54 55 52 a1 e1 4e 0d 0a 20 ┆1 RETUR N ┆
0x12c80…12ca0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 32 20 20 a1 e1 20 20 20 20 20 20 20 ┆ 2 ┆
0x12ca0…12cc0 20 a1 e1 20 4e 6f 6e 20 43 6f 6e 6e 65 63 74 65 64 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ Non Connected ┆
0x12cc0…12ce0 20 20 20 20 20 20 20 20 33 20 a1 e1 20 20 20 20 20 20 20 20 20 20 4e 6f 6e 20 43 6f 6e 6e 65 63 ┆ 3 Non Connec┆
0x12ce0…12d00 74 65 64 0d 0a e1 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 34 20 20 a1 a1 ┆ted 4 ┆
0x12d00…12d20 e1 20 20 20 20 20 20 20 20 20 4e 6f 6e 20 43 6f 6e 6e 65 63 74 65 64 0d 0a 20 20 20 20 20 20 20 ┆ Non Connected ┆
0x12d20…12d40 20 20 20 20 20 20 20 20 20 20 20 20 20 20 35 20 a1 e1 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ 5 ┆
0x12d40…12d60 52 45 54 55 52 4e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 36 20 20 ┆RETURN 6 ┆
0x12d60…12d80 a1 a1 e1 20 20 20 20 20 20 20 20 20 4e 6f 6e 20 43 6f 6e 6e 65 63 74 65 64 0d 0a 20 20 20 20 20 ┆ Non Connected ┆
0x12d80…12da0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 37 20 20 20 20 a1 e1 20 20 20 20 20 43 41 4c 4c ┆ 7 CALL┆
0x12da0…12dc0 49 4e 47 20 49 4e 44 49 43 41 54 4f 52 20 42 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ING INDICATOR B ┆
0x12dc0…12de0 20 20 20 20 20 20 38 20 20 a1 a1 e1 20 20 20 20 20 20 20 20 20 43 41 52 52 49 45 52 20 44 45 54 ┆ 8 CARRIER DET┆
0x12de0…12e00 20 42 0d 0a b0 a1 f0 e1 b0 a1 e1 f0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ B ┆
0x12e00…12e20 (151,) 20 39 20 a1 e1 20 20 20 20 20 20 20 20 20 20 20 20 20 20 52 45 54 55 52 4e 0d 0a 20 20 20 20 20 ┆ 9 RETURN ┆
0x12e20…12e40 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 30 20 20 a1 e1 20 20 20 20 20 20 20 44 41 54 41 ┆ 10 DATA┆
0x12e40…12e60 20 54 45 52 4d 2e 20 52 44 59 20 42 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ TERM. RDY B ┆
0x12e60…12e80 20 20 31 31 a1 e1 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 52 45 54 55 52 4e 0d 0a 20 20 20 ┆ 11 RETURN ┆
0x12e80…12ea0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 32 20 20 20 20 20 20 20 20 20 44 41 54 41 ┆ 12 DATA┆
0x12ea0…12ec0 20 53 45 54 20 52 45 41 44 59 20 42 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ SET READY B ┆
0x12ec0…12ee0 20 20 31 33 20 a1 e1 20 20 20 20 20 20 20 20 20 20 20 20 20 20 52 45 54 55 52 4e 0d 0a 20 20 20 ┆ 13 RETURN ┆
0x12ee0…12f00 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 34 20 20 a1 e1 20 20 20 20 20 20 20 43 a1 ┆ 14 C ┆
0x12f00…12f20 e1 4c 45 41 52 20 54 4f 20 53 45 4e e1 a1 e1 44 20 42 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 ┆ LEAR TO SEN D B ┆
0x12f20…12f40 20 20 20 20 20 20 20 20 31 35 20 a1 e1 20 20 20 20 20 20 20 20 20 20 20 20 20 20 52 45 54 55 52 ┆ 15 RETUR┆
0x12f40…12f60 4e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 36 20 a1 e1 20 20 20 20 ┆N 16 ┆
0x12f60…12f80 20 20 20 20 a1 e1 52 45 51 55 45 53 54 20 54 4f 20 53 45 4e 44 20 42 0d 0a 20 20 20 20 20 20 20 ┆ REQUEST TO SEND B ┆
0x12f80…12fa0 20 20 20 20 20 20 20 20 20 20 20 20 20 31 37 20 a1 e1 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ 17 ┆
0x12fa0…12fc0 52 45 54 55 52 4e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 38 20 20 ┆RETURN 18 ┆
0x12fc0…12fe0 a1 e1 20 20 20 20 20 20 20 a1 e1 2f 52 45 43 49 45 56 45 20 44 41 54 41 20 42 0d 0a 20 20 20 20 ┆ /RECIEVE DATA B ┆
0x12fe0…13000 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 39 20 a1 e1 20 20 20 20 20 20 20 20 20 20 20 ┆ 19 ┆
0x13000…13020 (152,) 20 20 20 52 45 54 55 52 4e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 32 ┆ RETURN 2┆
0x13020…13040 30 20 20 20 20 20 20 20 20 20 2f 54 52 41 4e 53 4d 49 54 20 44 41 54 41 20 42 0d 0a 20 20 20 20 ┆0 /TRANSMIT DATA B ┆
0x13040…13060 20 20 20 20 20 b0 20 20 20 20 20 20 20 20 20 20 20 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆ ---------------┆
0x13060…13074 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a ┆------------------ ┆
0x13074…130ad Params {
0x13074…130ad 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x13074…130ad 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x13074…130ad }
0x130ad…130e6 Params {
0x130ad…130e6 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x130ad…130e6 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x130ad…130e6 }
0x130e6…13100 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 20 ┆ ┆
0x13100…13120 20 20 20 20 20 20 20 20 46 69 67 20 35 2e 34 2e 32 20 4a 31 20 70 69 6e 20 61 73 73 69 67 6e 6d ┆ Fig 5.4.2 J1 pin assignm┆
0x13120…1312a 65 6e 74 2e 0d 0a 0d 0a 0d 0a ┆ent. ┆
0x1312a…1312d FormFeed {
0x1312a…1312d 0c 83 84 ┆ ┆
0x1312a…1312d }
0x1312d…13140 0a b0 a1 35 2e 34 2e 34 20 20 20 20 4a 32 20 52 53 34 32 ┆ 5.4.4 J2 RS42┆
0x13140…13160 32 41 20 4d 75 6c 74 69 64 72 6f 70 20 49 6e 74 65 72 66 61 63 65 20 43 6f 6e 6e 65 63 74 6f 72 ┆2A Multidrop Interface Connector┆
0x13160…13165 2e 0d 0a 0d 0a ┆. ┆
0x13165…1319e Params {
0x13165…1319e 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x13165…1319e 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x13165…1319e }
0x1319e…131d7 Params {
0x1319e…131d7 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x1319e…131d7 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x1319e…131d7 }
0x131d7…131e0 0a b0 a1 e1 20 20 20 20 20 ┆ ┆
0x131e0…13200 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 a1 b0 f0 a1 e1 a1 b0 4a 32 20 20 20 20 20 20 20 20 ┆ J2 ┆
0x13200…13220 (153,) 20 20 20 50 72 69 6e 74 65 72 20 53 69 67 6e 61 6c 73 20 20 0d 0a 0d 0a 20 20 20 20 20 20 20 20 ┆ Printer Signals ┆
0x13220…13240 20 20 20 20 20 20 20 20 20 20 20 20 20 31 a1 e1 20 20 e1 a1 e1 20 20 20 20 20 20 20 20 20 20 20 ┆ 1 ┆
0x13240…13260 20 20 52 45 54 55 52 4e a1 a1 a1 e1 a1 a1 e1 a1 b0 e1 f0 0d 0a 20 20 20 20 20 20 20 20 20 20 20 ┆ RETURN ┆
0x13260…13280 20 20 20 20 20 20 20 20 20 20 32 20 20 a1 e1 20 20 20 20 20 20 20 a1 e1 20 20 52 45 43 49 45 56 ┆ 2 RECIEV┆
0x13280…132a0 45 20 e1 a1 e1 43 4f 4d 4d 4f 4e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆E COMMON ┆
0x132a0…132c0 20 20 33 20 a1 e1 20 20 20 20 20 20 20 20 20 20 20 4e 6f 6e 20 43 6f 6e 6e 65 63 74 65 64 0d 0a ┆ 3 Non Connected ┆
0x132c0…132e0 e1 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 34 20 20 a1 a1 e1 20 20 20 20 ┆ 4 ┆
0x132e0…13300 20 20 20 20 20 54 45 52 4d 49 4e 41 4c 20 54 49 4d 4d 49 4e 47 0d 0a 20 20 20 20 20 20 20 20 20 ┆ TERMINAL TIMMING ┆
0x13300…13320 20 20 20 20 20 20 20 20 20 20 20 20 35 20 20 20 20 20 20 20 20 a1 e1 20 20 2f 54 45 52 4d 49 4e ┆ 5 /TERMIN┆
0x13320…13340 41 4c 20 54 49 4d 4d 49 4e 47 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆AL TIMMING ┆
0x13340…13360 20 36 20 20 a1 a1 e1 20 20 20 20 20 20 20 20 20 20 20 20 53 45 4e 44 20 44 41 54 41 0d 0a 20 20 ┆ 6 SEND DATA ┆
0x13360…13380 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 37 20 a1 e1 20 20 20 20 20 20 20 20 20 ┆ 7 ┆
0x13380…133a0 20 20 20 2f 53 45 4e 44 20 44 41 54 41 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ /SEND DATA ┆
0x133a0…133c0 20 20 20 20 38 20 20 a1 a1 e1 20 20 20 20 20 20 20 20 20 20 4e 6f 6e 20 43 6f 6e 6e 65 63 74 65 ┆ 8 Non Connecte┆
0x133c0…133e0 64 0d 0a b0 a1 f0 e1 b0 a1 e1 f0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆d ┆
0x133e0…13400 39 20 a1 e1 20 20 20 20 20 20 20 20 20 20 20 4e 6f 6e 20 43 6f 6e 6e 65 63 74 65 64 0d 0a 20 20 ┆9 Non Connected ┆
0x13400…13420 (154,) 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 30 20 20 a1 e1 20 20 20 20 20 20 20 20 ┆ 10 ┆
0x13420…13440 20 a1 e1 20 52 45 43 45 49 56 45 20 44 e1 a1 e1 41 54 41 0d 0a 20 20 20 20 20 20 20 20 20 20 20 ┆ RECEIVE D ATA ┆
0x13440…13460 20 20 20 20 20 20 20 20 20 31 31 20 a1 e1 20 20 20 20 20 20 20 20 20 20 2f 52 45 43 45 49 56 45 ┆ 11 /RECEIVE┆
0x13460…13480 20 44 41 54 41 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 32 20 20 20 ┆ DATA 12 ┆
0x13480…134a0 a1 e1 20 20 20 20 20 20 20 20 20 a1 e1 52 45 51 55 45 53 54 20 54 4f 20 53 45 4e 44 0d 0a 20 20 ┆ REQUEST TO SEND ┆
0x134a0…134c0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 33 20 a1 e1 20 a1 e1 20 20 20 20 20 20 ┆ 13 ┆
0x134c0…134e0 20 20 20 2f 52 45 51 55 45 53 54 20 54 4f 20 53 45 4e 44 0d 0a 20 20 20 20 20 20 20 20 20 20 20 ┆ /REQUEST TO SEND ┆
0x134e0…13500 20 20 20 20 20 20 20 20 20 31 34 20 20 20 a1 e1 20 20 20 20 20 20 20 20 52 e1 45 43 45 49 56 45 ┆ 14 R ECEIVE┆
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0x13820…13840 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 46 69 67 20 ┆ Fig ┆
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0x138d2…1390b }
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0x13a40…13a60 20 20 20 44 41 54 41 20 31 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ DATA 1 ┆
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0x13aa0…13ac0 20 44 41 54 41 20 32 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 38 20 ┆ DATA 2 8 ┆
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0x13b00…13b20 20 20 20 20 20 20 20 20 20 44 41 54 41 20 33 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ DATA 3 ┆
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0x13b60…13b80 20 20 20 20 20 20 20 20 20 20 20 44 41 54 41 20 34 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ DATA 4 ┆
0x13b80…13ba0 20 20 20 20 20 20 20 31 32 20 20 a1 e1 20 20 20 20 20 20 20 20 a1 e1 20 20 20 20 20 52 45 54 55 ┆ 12 RETU┆
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0x13c00…13c20 (158,) 52 45 54 55 52 4e e1 a1 e1 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 ┆RETURN 1┆
0x13c20…13c40 35 20 a1 e1 20 20 20 20 20 20 20 20 20 20 20 20 20 44 41 54 41 20 36 0d 0a 20 20 20 20 20 20 20 ┆5 DATA 6 ┆
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0x13c60…13c80 20 52 45 54 55 52 4e e1 a1 e1 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ RETURN ┆
0x13c80…13ca0 31 37 20 a1 e1 20 20 20 20 20 20 20 20 20 20 20 20 20 44 41 54 41 20 37 0d 0a 20 20 20 20 20 20 ┆17 DATA 7 ┆
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0x13cc0…13ce0 20 20 52 45 54 55 52 4e e1 a1 e1 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ RETURN ┆
0x13ce0…13d00 20 31 39 20 a1 e1 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2f 41 43 4b 0d 0a 20 20 20 20 20 20 ┆ 19 /ACK ┆
0x13d00…13d20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 32 30 20 20 20 20 20 20 20 20 20 20 20 20 20 20 52 45 ┆ 20 RE┆
0x13d20…13d40 54 55 52 4e e1 a1 e1 e1 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 32 31 ┆TURN 21┆
0x13d40…13d60 20 20 a1 e1 20 20 20 20 20 20 20 20 20 20 20 20 20 42 55 53 59 0d 0a 20 20 20 20 20 20 20 20 20 ┆ BUSY ┆
0x13d60…13d80 20 20 20 20 20 20 20 20 20 20 20 32 32 20 a1 e1 20 20 20 20 20 20 20 20 a1 e1 20 20 20 20 20 52 ┆ 22 R┆
0x13d80…13da0 45 54 55 52 4e e1 a1 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 32 33 20 ┆ETURN 23 ┆
0x13da0…13dc0 20 a1 e1 20 20 20 20 20 20 20 20 20 20 20 50 41 50 45 52 20 45 4e 44 0d 0a 20 20 20 20 20 20 20 ┆ PAPER END ┆
0x13dc0…13de0 20 20 20 20 20 20 20 20 20 20 20 20 20 32 34 20 a1 e1 20 20 20 20 20 20 20 20 a1 e1 20 20 20 20 ┆ 24 ┆
0x13de0…13e00 20 52 45 54 55 52 4e e1 a1 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 32 ┆ RETURN 2┆
0x13e00…13e20 (159,) 35 20 20 a1 a1 e1 20 20 20 20 20 20 20 20 20 20 20 53 45 4c 45 43 54 45 44 0d 0a 20 20 20 20 20 ┆5 SELECTED ┆
0x13e20…13e40 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 32 36 20 20 20 20 20 20 20 20 20 20 20 6e 6f 6e 20 ┆ 26 non ┆
0x13e40…13e60 63 6f 6e 6e 65 63 74 65 64 0d 0a 20 20 20 20 20 20 20 20 20 b0 20 20 20 20 20 20 20 20 20 20 20 ┆connected ┆
0x13e60…13e7e 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a ┆---------------------------- ┆
0x13e7e…13eb7 Params {
0x13e7e…13eb7 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x13e7e…13eb7 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x13e7e…13eb7 }
0x13eb7…13ef0 Params {
0x13eb7…13ef0 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x13eb7…13ef0 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x13eb7…13ef0 }
0x13ef0…13f00 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d ┆ ┆
0x13f00…13f20 0a 0d 0a 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 46 69 67 20 35 2e 34 2e 34 20 4a 33 20 70 69 6e ┆ Fig 5.4.4 J3 pin┆
0x13f20…13f32 20 61 73 73 69 67 6e 6d 65 6e 74 2e 0d 0a 0d 0a 0d 0a ┆ assignment. ┆
0x13f32…13f35 FormFeed {
0x13f32…13f35 0c 83 a8 ┆ ┆
0x13f32…13f35 }
0x13f35…13f40 0a a1 b0 35 2e 34 2e 36 20 20 20 ┆ 5.4.6 ┆
0x13f40…13f60 20 84 4a 34 20 4c 45 44 36 30 33 2c 20 42 42 43 36 30 31 20 61 6e 64 20 4b 65 79 20 49 6e 74 65 ┆ J4 LED603, BBC601 and Key Inte┆
0x13f60…13f74 72 72 75 70 74 20 43 6f 6e 6e 65 63 74 6f 72 2e 0d 0a 0d 0a ┆rrupt Connector. ┆
0x13f74…13fad Params {
0x13f74…13fad 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x13f74…13fad 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x13f74…13fad }
0x13fad…13fe6 Params {
0x13fad…13fe6 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x13fad…13fe6 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x13fad…13fe6 }
0x13fe6…14000 0a b0 a1 b0 a1 e1 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ ┆
0x14000…14020 (160,) a1 b0 f0 a1 e1 a1 b0 4a 34 20 20 20 20 20 20 20 20 20 20 20 20 20 53 69 67 6e 61 6c 73 20 20 20 ┆ J4 Signals ┆
0x14020…14040 20 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 a1 e1 20 20 e1 ┆ 1 ┆
0x14040…14060 a1 e1 20 20 20 20 20 20 20 20 4c 45 44 20 31 20 43 41 54 48 4f 44 45 0d 0a 20 20 20 20 20 20 20 ┆ LED 1 CATHODE ┆
0x14060…14080 20 20 20 20 20 20 20 20 20 20 20 20 20 20 32 20 20 a1 e1 20 20 20 20 20 20 20 a1 e1 20 4c 45 44 ┆ 2 LED┆
0x14080…140a0 20 31 20 41 4e 4f 44 a1 e1 45 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ 1 ANOD E ┆
0x140a0…140c0 20 33 20 a1 e1 20 20 20 20 20 20 20 20 20 4c 45 44 20 32 20 43 41 54 48 4f 44 45 e1 e1 0d 0a e1 ┆ 3 LED 2 CATHODE ┆
0x140c0…140e0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 34 20 20 a1 a1 e1 20 20 20 20 20 ┆ 4 ┆
0x140e0…14100 20 20 20 4c 45 44 20 32 20 41 4e 4f 44 45 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ LED 2 ANODE ┆
0x14100…14120 20 20 20 20 20 35 20 a1 e1 20 20 20 20 20 20 20 20 20 20 2f 50 49 4e 54 52 31 0d 0a 20 20 20 20 ┆ 5 /PINTR1 ┆
0x14120…14140 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 36 20 20 a1 a1 e1 20 20 20 20 20 20 20 20 20 ┆ 6 ┆
0x14140…14160 20 52 45 54 55 52 4e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 37 20 ┆ RETURN 7 ┆
0x14160…14180 a1 e1 20 20 20 20 20 20 20 20 20 20 2f 50 49 4e 54 52 32 0d 0a 20 20 20 20 20 20 20 20 20 20 20 ┆ /PINTR2 ┆
0x14180…141a0 20 20 20 20 20 20 20 20 20 20 38 20 20 a1 a1 e1 20 20 20 20 20 20 20 20 20 20 52 45 54 55 52 4e ┆ 8 RETURN┆
0x141a0…141c0 0d 0a b0 a1 f0 e1 b0 a1 e1 f0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 39 ┆ 9┆
0x141c0…141e0 20 a1 e1 20 20 20 20 20 20 20 20 20 20 20 20 50 44 4d 44 0d 0a 20 20 20 20 20 20 20 20 20 20 20 ┆ PDMD ┆
0x141e0…14200 20 20 20 20 20 20 20 20 20 31 30 20 20 a1 e1 20 20 20 20 20 20 20 20 a1 e1 20 20 52 45 54 55 52 ┆ 10 RETUR┆
0x14200…14220 (161,) 4e e1 a1 e1 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 31 20 a1 e1 20 ┆N 11 ┆
0x14220…14240 20 20 20 20 20 20 20 20 2b 31 32 56 20 53 45 4e 53 45 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 ┆ +12V SENSE ┆
0x14240…14260 20 20 20 20 20 20 20 20 31 32 20 a1 e1 20 20 20 20 20 20 20 20 a1 e1 20 20 2b 35 56 20 53 45 4e ┆ 12 +5V SEN┆
0x14260…14280 53 45 e1 a1 e1 a1 e1 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 33 a1 ┆SE 13 ┆
0x14280…142a0 e1 20 20 20 20 20 20 20 20 20 20 20 20 2f 50 49 4e 54 52 32 0d 0a 20 20 20 20 20 20 20 20 20 20 ┆ /PINTR2 ┆
0x142a0…142c0 20 20 20 20 20 20 20 20 20 20 31 34 20 a1 e1 20 20 20 20 20 20 20 20 a1 e1 20 20 20 52 45 54 55 ┆ 14 RETU┆
0x142c0…142e0 52 4e e1 a1 e1 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 35 20 a1 e1 ┆RN 15 ┆
0x142e0…14300 20 20 20 20 20 20 20 20 4e 6f 6e 20 43 6f 6e 6e 65 63 74 65 64 0d 0a 20 20 20 20 20 20 20 20 20 ┆ Non Connected ┆
0x14300…14320 20 20 20 20 20 20 20 20 20 20 20 31 36 20 a1 e1 20 20 20 20 20 20 20 20 a1 e1 4e 6f 6e 20 43 6f ┆ 16 Non Co┆
0x14320…14340 6e 6e 65 63 74 65 64 0d 0a 20 20 20 20 20 20 20 20 20 b0 20 20 20 20 20 20 20 20 20 20 20 2d 2d ┆nnected --┆
0x14340…1435c 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a ┆-------------------------- ┆
0x1435c…14395 Params {
0x1435c…14395 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x1435c…14395 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x1435c…14395 }
0x14395…143ce Params {
0x14395…143ce 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x14395…143ce 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x14395…143ce }
0x143ce…143e0 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d ┆ ┆
0x143e0…14400 0a 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 46 69 67 20 35 2e 34 2e 35 20 4a 34 20 70 69 6e 20 61 ┆ Fig 5.4.5 J4 pin a┆
0x14400…1440e (162,) 73 73 69 67 6e 6d 65 6e 74 2e 0d 0a 0d 0a ┆ssignment. ┆
0x1440e…14411 FormFeed {
0x1440e…14411 0c 82 cc ┆ ┆
0x1440e…14411 }
0x14411…14420 0a b0 a1 35 2e 34 2e 37 20 20 20 20 4a 35 20 ┆ 5.4.7 J5 ┆
0x14420…1443e 69 53 42 58 62 75 73 20 49 6e 74 65 72 66 61 63 65 20 43 6f 6e 6e 65 63 74 6f 72 2e 0d 0a ┆iSBXbus Interface Connector. ┆
0x1443e…14477 Params {
0x1443e…14477 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x1443e…14477 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x1443e…14477 }
0x14477…144b0 Params {
0x14477…144b0 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x14477…144b0 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x14477…144b0 }
0x144b0…144c0 0a 0d 0a 09 b0 a1 50 69 6e 09 53 69 67 6e 61 6c ┆ Pin Signal┆
0x144c0…144e0 09 50 69 6e 09 53 69 67 6e 61 6c 2e 20 0d 0a 0d 0a 09 31 09 2b 31 32 56 09 32 09 2d 31 32 56 0d ┆ Pin Signal. 1 +12V 2 -12V ┆
0x144e0…14500 0a 09 33 09 47 4e 44 09 34 09 2b 35 56 0d 0a 09 35 09 52 45 53 45 54 09 36 09 4d 43 4c 4b 0d 0a ┆ 3 GND 4 +5V 5 RESET 6 MCLK ┆
0x14500…14520 09 37 09 4d 41 32 20 09 38 09 2f 4d 50 53 54 0d 0a 09 39 09 4d 41 31 20 20 20 20 20 09 31 30 09 ┆ 7 MA2 8 /MPST 9 MA1 10 ┆
0x14520…14540 52 65 73 65 72 76 65 64 0d 0a 09 31 31 09 4d 41 30 20 09 31 32 09 4d 49 4e 54 52 31 0d 0a 09 31 ┆Reserved 11 MA0 12 MINTR1 1┆
0x14540…14560 33 09 2f 49 4f 57 52 54 09 31 34 09 4d 49 4e 54 52 30 0d 0a 09 31 35 09 2f 49 4f 52 44 09 31 36 ┆3 /IOWRT 14 MINTR0 15 /IORD 16┆
0x14560…14580 09 2f 4d 57 41 49 54 0d 0a 09 31 37 20 20 20 20 20 20 47 4e 44 20 20 20 20 09 31 38 09 2b 35 0d ┆ /MWAIT 17 GND 18 +5 ┆
0x14580…145a0 0a 09 31 39 09 4d 44 37 20 20 20 20 20 09 32 30 09 2f 4d 43 53 31 0d 0a 09 32 31 09 4d 44 36 20 ┆ 19 MD7 20 /MCS1 21 MD6 ┆
0x145a0…145c0 20 09 32 32 09 2f 4d 43 53 30 0d 0a 09 32 33 09 4d 44 35 20 20 09 32 34 09 52 65 73 65 72 76 65 ┆ 22 /MCS0 23 MD5 24 Reserve┆
0x145c0…145e0 64 0d 0a 09 32 35 09 4d 44 34 20 20 09 32 36 09 28 54 44 4d 41 29 2a 0d 0a 09 32 37 09 4d 44 33 ┆d 25 MD4 26 (TDMA)* 27 MD3┆
0x145e0…14600 20 20 09 32 38 09 4f 50 54 31 0d 0a 09 32 39 09 4d 44 32 20 09 33 30 09 4f 50 54 30 0d 0a 09 33 ┆ 28 OPT1 29 MD2 30 OPT0 3┆
0x14600…14620 (163,) 31 09 4d 44 31 20 20 09 33 32 09 28 2f 4d 44 41 43 4b 29 2a 0d 0a 09 33 33 09 4d 44 30 20 20 09 ┆1 MD1 32 (/MDACK)* 33 MD0 ┆
0x14620…14640 33 34 09 28 4d 44 52 51 54 29 2a 0d 0a 09 33 35 09 47 4e 44 20 20 09 33 36 09 2b 35 56 0d 0a 09 ┆34 (MDRQT)* 35 GND 36 +5V ┆
0x14640…14660 33 37 09 4d 44 45 20 09 33 38 09 4d 44 46 0d 0a 09 33 39 09 4d 44 43 20 20 09 34 30 09 4d 44 44 ┆37 MDE 38 MDF 39 MDC 40 MDD┆
0x14660…14680 0d 0a 09 34 31 09 4d 44 41 20 20 09 34 32 09 4d 44 42 0d 0a 09 34 33 09 4d 44 38 20 20 09 34 34 ┆ 41 MDA 42 MDB 43 MD8 44┆
0x14680…146a0 09 4d 44 39 0d 0a 09 b0 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆ MD9 ------------------------┆
0x146a0…146b1 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a ┆--------------- ┆
0x146b1…146ea Params {
0x146b1…146ea 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x146b1…146ea 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x146b1…146ea }
0x146ea…14723 Params {
0x146ea…14723 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x146ea…14723 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x146ea…14723 }
0x14723…14740 0a 09 2a 20 84 4e 6f 74 65 20 74 68 69 73 20 44 4d 41 20 73 69 67 6e 61 6c 73 20 61 72 ┆ * Note this DMA signals ar┆
0x14740…14760 65 20 6e 6f 74 20 69 6e 63 6c 75 64 65 64 20 6f 6e 20 74 68 65 20 43 50 55 36 31 30 58 20 20 20 ┆e not included on the CPU610X ┆
0x14760…14780 0a 19 8b 80 80 62 6f 61 72 64 2e 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d 0a 0d ┆ board. ┆
0x14780…147a0 0a 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 46 69 67 20 35 2e 34 2e 36 20 4a 35 20 70 69 6e 20 61 ┆ Fig 5.4.6 J5 pin a┆
0x147a0…147ae 73 73 69 67 6e 6d 65 6e 74 2e 0d 0a 0d 0a ┆ssignment. ┆
0x147ae…147b1 FormFeed {
0x147ae…147b1 0c 83 9c ┆ ┆
0x147ae…147b1 }
0x147b1…147c0 0a a1 b0 35 2e 35 20 09 4a 75 6d 70 65 72 73 ┆ 5.5 Jumpers┆
0x147c0…147e0 2e 0d 0a 0d 0a 09 84 54 68 65 20 43 50 55 20 62 6f 61 72 64 20 69 6e 63 6c 75 64 65 73 20 6f 6e ┆. The CPU board includes on┆
0x147e0…14800 6c 79 20 6f 6e 65 20 73 74 61 6e 64 61 72 64 20 64 65 74 61 63 68 61 62 6c 65 20 0a 19 89 80 80 ┆ly one standard detachable ┆
0x14800…14820 (164,) 6a 75 6d 70 65 72 20 57 31 31 2e 20 54 68 65 20 72 65 73 74 20 6f 66 20 74 68 65 20 6a 75 6d 70 ┆jumper W11. The rest of the jump┆
0x14820…14840 65 72 73 20 69 73 20 63 6f 6e 6e 65 63 74 65 64 20 64 69 72 65 63 74 20 0a 19 89 80 80 6f 6e 20 ┆ers is connected direct on ┆
0x14840…14860 74 68 65 20 70 72 69 6e 74 65 64 20 62 6f 61 72 64 2e 20 49 74 20 63 61 6e 20 62 65 20 64 69 73 ┆the printed board. It can be dis┆
0x14860…14880 63 6f 6e 6e 65 63 74 65 64 20 77 69 74 68 20 61 20 0a 19 89 80 80 6b 6e 69 66 65 2e 0d 0a 0d 0a ┆connected with a knife. ┆
0x14880…148a0 20 09 54 68 65 20 73 74 61 6e 64 61 72 64 20 6a 75 6d 70 65 72 73 20 6f 6e 20 74 68 65 20 43 50 ┆ The standard jumpers on the CP┆
0x148a0…148bc 55 36 31 30 58 20 61 72 65 20 6c 69 73 74 65 64 20 62 65 6c 6f 77 20 3a 0d 0a 0d 0a ┆U610X are listed below : ┆
0x148bc…148f5 Params {
0x148bc…148f5 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x148bc…148f5 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x148bc…148f5 }
0x148f5…1492e Params {
0x148f5…1492e 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x148f5…1492e 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x148f5…1492e }
0x1492e…14940 0a 20 20 20 20 20 20 20 20 20 20 20 20 b0 a1 4a 75 6d ┆ Jum┆
0x14940…14960 70 65 72 20 20 20 63 6f 6e 6e 65 63 74 69 6f 6e 73 20 20 20 20 20 20 20 20 20 20 20 46 75 6e 63 ┆per connections Func┆
0x14960…14980 74 69 6f 6e 2e 20 20 20 20 20 20 20 20 20 20 20 20 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 ┆tion. ┆
0x14980…149a0 20 20 20 57 31 20 20 20 20 20 20 20 20 20 4e 43 20 20 20 20 20 20 20 20 20 54 65 73 74 20 4a 75 ┆ W1 NC Test Ju┆
0x149a0…149c0 6d 70 65 72 20 28 4e 6f 74 20 69 6e 20 55 73 65 29 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 ┆mper (Not in Use). ┆
0x149c0…149e0 20 20 57 32 20 20 20 20 20 20 20 20 20 4e 43 20 20 20 20 20 20 20 20 20 20 20 20 2d 22 2d 20 20 ┆ W2 NC -"- ┆
0x149e0…14a00 20 20 20 20 84 28 44 69 73 63 6f 6e 6e 65 63 74 73 20 74 68 65 20 0a 19 b0 80 80 69 4c 42 58 62 ┆ (Disconnects the iLBXb┆
0x14a00…14a20 (165,) 75 73 29 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 57 33 20 20 20 20 20 20 20 20 20 4e ┆us). W3 N┆
0x14a20…14a40 43 20 20 20 20 20 20 20 20 20 20 20 20 2d 22 2d 20 20 20 20 20 20 84 28 54 65 73 74 20 6d 61 73 ┆C -"- (Test mas┆
0x14a40…14a60 74 65 72 20 65 6c 73 65 20 0a 19 b0 80 80 74 65 73 74 20 73 6c 61 76 65 29 2e 0d 0a 09 20 20 20 ┆ter else test slave). ┆
0x14a60…14a80 20 20 57 34 20 20 20 20 20 20 20 20 20 4e 43 09 20 20 84 42 75 73 20 50 72 69 6f 72 69 74 79 20 ┆ W4 NC Bus Priority ┆
0x14a80…14aa0 4f 75 74 2e 20 28 4f 6e 6c 79 20 75 73 65 64 20 0a 19 a4 80 80 69 6e 20 73 79 73 74 65 6d 73 20 ┆Out. (Only used in systems ┆
0x14aa0…14ac0 77 69 74 68 20 73 65 72 69 65 6c 20 0a 19 a4 80 80 61 72 62 69 74 72 61 74 69 6f 6e 73 20 6c 6f ┆with seriel arbitrations lo┆
0x14ac0…14ae0 67 69 63 29 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 57 35 20 20 20 20 20 20 20 20 20 ┆gic). W5 ┆
0x14ae0…14b00 31 20 2d 20 34 34 20 20 20 20 20 84 54 69 6d 65 72 20 69 6e 74 65 72 72 75 70 74 20 74 6f 20 4d ┆1 - 44 Timer interrupt to M┆
0x14b00…14b20 61 73 74 65 72 20 50 49 43 20 0a 19 a4 80 80 6c 65 76 65 6c 20 30 2e 0d 0a 09 20 20 20 20 20 57 ┆aster PIC level 0. W┆
0x14b20…14b40 35 20 20 20 20 20 20 20 20 20 32 20 2d 20 34 33 20 20 20 20 20 84 4d 75 6c 74 69 62 75 73 20 69 ┆5 2 - 43 Multibus i┆
0x14b40…14b60 6e 74 65 72 72 75 70 74 20 32 20 74 6f 20 0a 19 a4 80 80 4d 61 73 74 65 72 20 50 49 43 20 6c 65 ┆nterrupt 2 to Master PIC le┆
0x14b60…14b80 76 65 6c 20 32 2e 0d 0a 09 20 20 20 20 20 57 35 20 20 20 20 20 20 20 20 20 33 20 2d 20 34 32 20 ┆vel 2. W5 3 - 42 ┆
0x14b80…14ba0 20 20 20 20 84 4d 75 6c 74 69 62 75 73 20 69 6e 74 65 72 72 75 70 74 20 33 20 74 6f 20 0a 19 a4 ┆ Multibus interrupt 3 to ┆
0x14ba0…14bc0 80 80 4d 61 73 74 65 72 20 50 49 43 20 6c 65 76 65 6c 20 33 2e 0d 0a 09 20 20 20 20 20 57 35 20 ┆ Master PIC level 3. W5 ┆
0x14bc0…14be0 20 20 20 20 20 20 20 20 34 20 2d 20 34 31 20 20 20 20 20 84 4d 75 6c 74 69 62 75 73 20 69 6e 74 ┆ 4 - 41 Multibus int┆
0x14be0…14c00 65 72 72 75 70 74 20 34 20 74 6f 20 0a 19 a4 80 80 4d 61 73 74 65 72 20 50 49 43 20 6c 65 76 65 ┆errupt 4 to Master PIC leve┆
0x14c00…14c20 (166,) 6c 20 34 2e 0d 0a 09 20 20 20 20 20 57 35 20 20 20 20 20 20 20 20 20 35 20 2d 20 34 30 20 20 20 ┆l 4. W5 5 - 40 ┆
0x14c20…14c40 20 20 84 4d 75 6c 74 69 62 75 73 20 69 6e 74 65 72 72 75 70 74 20 35 20 74 6f 20 0a 19 a4 80 80 ┆ Multibus interrupt 5 to ┆
0x14c40…14c60 4d 61 73 74 65 72 20 50 49 43 20 6c 65 76 65 6c 20 35 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 ┆Master PIC level 5. ┆
0x14c60…14c80 20 20 20 57 35 20 20 20 20 20 20 20 20 20 36 20 2d 20 33 39 20 20 20 20 20 84 38 32 37 34 20 69 ┆ W5 6 - 39 8274 i┆
0x14c80…14ca0 6e 74 65 72 72 75 70 74 20 74 6f 20 4d 61 73 74 65 72 20 50 49 43 20 0a 19 a4 80 80 6c 65 76 65 ┆nterrupt to Master PIC leve┆
0x14ca0…14cc0 6c 20 36 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 57 35 20 20 20 20 20 20 20 20 20 37 ┆l 6. W5 7┆
0x14cc0…14ce0 20 2d 20 33 38 20 20 20 20 20 84 4d 75 6c 74 69 62 75 73 20 69 6e 74 65 72 72 75 70 74 20 36 20 ┆ - 38 Multibus interrupt 6 ┆
0x14ce0…14d00 74 6f 20 53 6c 61 76 65 20 0a 19 a4 80 80 50 49 43 31 20 6c 65 76 65 6c 20 30 2e 0d 0a 09 20 20 ┆to Slave PIC1 level 0. ┆
0x14d00…14d20 20 20 20 57 35 20 20 20 20 20 20 20 20 20 38 20 2d 20 33 37 20 20 20 20 20 84 4d 75 6c 74 69 62 ┆ W5 8 - 37 Multib┆
0x14d20…14d40 75 73 20 69 6e 74 65 72 72 75 70 74 20 37 20 74 6f 20 53 6c 61 76 65 20 0a 19 a4 80 80 50 49 43 ┆us interrupt 7 to Slave PIC┆
0x14d40…14d60 20 6c 65 76 65 6c 20 31 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 57 35 20 20 20 20 20 ┆ level 1. W5 ┆
0x14d60…14d80 20 20 20 20 39 20 2d 20 33 36 20 20 20 20 20 84 54 69 6d 65 20 6f 75 74 20 69 6e 74 65 72 72 75 ┆ 9 - 36 Time out interru┆
0x14d80…14da0 70 74 20 74 6f 20 53 6c 61 76 65 20 0a 19 a4 80 80 50 49 43 31 20 6c 65 76 65 6c 20 32 2e 0d 0a ┆pt to Slave PIC1 level 2. ┆
0x14da0…14dc0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 57 35 20 20 20 20 20 20 20 20 31 30 20 2d 20 33 35 20 ┆ W5 10 - 35 ┆
0x14dc0…14de0 20 20 20 20 84 69 53 42 58 62 75 73 20 69 6e 74 65 72 72 75 70 74 20 30 20 74 6f 20 53 6c 61 76 ┆ iSBXbus interrupt 0 to Slav┆
0x14de0…14e00 65 20 0a 19 a4 80 80 50 49 43 31 20 6c 65 76 65 6c 20 33 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 ┆e PIC1 level 3. ┆
0x14e00…14e20 (167,) 20 20 20 20 57 35 20 20 20 20 20 20 20 20 31 31 20 2d 20 33 34 20 20 20 20 20 84 69 53 42 58 62 ┆ W5 11 - 34 iSBXb┆
0x14e20…14e40 75 73 20 69 6e 74 65 72 72 75 70 74 20 31 20 74 6f 20 53 6c 61 76 65 20 0a 19 a4 80 80 50 49 43 ┆us interrupt 1 to Slave PIC┆
0x14e40…14e60 31 20 6c 65 76 65 6c 20 34 2e 0d 0a 09 20 20 20 20 20 57 35 20 20 20 20 20 20 20 20 31 32 20 2d ┆1 level 4. W5 12 -┆
0x14e60…14e80 20 33 33 20 20 20 20 20 84 4d 75 6c 74 69 62 75 73 20 69 6e 74 65 72 72 75 70 74 20 30 20 74 6f ┆ 33 Multibus interrupt 0 to┆
0x14e80…14ea0 20 53 6c 61 76 65 20 0a 19 a4 80 80 50 49 43 31 20 6c 65 76 65 6c 20 35 2e 0d 0a 09 20 20 20 20 ┆ Slave PIC1 level 5. ┆
0x14ea0…14ec0 20 57 35 20 20 20 20 20 20 20 20 31 33 20 2d 20 33 32 20 20 20 20 20 84 4d 75 6c 74 69 62 75 73 ┆ W5 13 - 32 Multibus┆
0x14ec0…14ee0 20 69 6e 74 65 72 72 75 70 74 20 31 20 74 6f 20 53 6c 61 76 65 20 0a 19 a4 80 80 50 49 43 31 20 ┆ interrupt 1 to Slave PIC1 ┆
0x14ee0…14f00 6c 65 76 65 6c 20 36 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 57 35 20 20 20 20 20 20 ┆level 6. W5 ┆
0x14f00…14f20 20 20 31 34 20 2d 20 33 31 20 20 20 20 20 84 4c 69 6e 65 20 50 72 69 6e 74 65 72 20 69 6e 74 65 ┆ 14 - 31 Line Printer inte┆
0x14f20…14f40 72 72 75 70 74 20 74 6f 20 0a 19 a4 80 80 53 6c 61 76 65 20 50 49 43 31 20 6c 65 76 65 6c 20 37 ┆rrupt to Slave PIC1 level 7┆
0x14f40…14f60 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 57 35 20 20 20 20 20 20 20 20 31 35 20 2d 20 ┆. W5 15 - ┆
0x14f60…14f80 33 30 20 20 20 20 20 84 45 78 74 65 6e 64 65 64 20 6d 75 6c 74 69 62 75 73 20 69 6e 74 65 72 72 ┆30 Extended multibus interr┆
0x14f80…14fa0 75 70 74 20 38 20 0a 19 a4 80 80 74 6f 20 53 6c 61 76 65 20 50 49 43 32 20 6c 65 76 65 6c 20 30 ┆upt 8 to Slave PIC2 level 0┆
0x14fa0…14fc0 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 57 35 20 20 20 20 20 20 20 20 31 36 20 2d 20 ┆. W5 16 - ┆
0x14fc0…14fe0 32 39 20 20 20 20 20 84 45 78 74 65 6e 64 65 64 20 6d 75 6c 74 69 62 75 73 20 69 6e 74 65 72 72 ┆29 Extended multibus interr┆
0x14fe0…15000 75 70 74 20 39 20 0a 19 a4 80 80 74 6f 20 53 6c 61 76 65 20 50 49 43 32 20 6c 65 76 65 6c 20 31 ┆upt 9 to Slave PIC2 level 1┆
0x15000…15020 (168,) 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 57 35 20 20 20 20 20 20 20 20 31 37 20 2d 20 ┆. W5 17 - ┆
0x15020…15040 32 38 20 20 20 20 20 84 45 78 74 65 6e 64 65 64 20 6d 75 6c 74 69 62 75 73 20 69 6e 74 65 72 72 ┆28 Extended multibus interr┆
0x15040…15060 75 70 74 20 0a 19 a4 80 80 31 30 20 74 6f 20 53 6c 61 76 65 20 50 49 43 32 20 6c 65 76 65 6c 20 ┆upt 10 to Slave PIC2 level ┆
0x15060…15064 32 2e 0d 0a ┆2. ┆
0x15064…15067 FormFeed {
0x15064…15067 0c 83 cc ┆ ┆
0x15064…15067 }
0x15067…15080 0a 20 20 20 20 20 20 20 20 20 20 20 20 b0 a1 4a 75 6d 70 65 72 20 20 20 63 ┆ Jumper c┆
0x15080…150a0 6f 6e 6e 65 63 74 69 6f 6e 73 20 20 20 20 20 20 20 20 20 20 20 46 75 6e 63 74 69 6f 6e 2e 20 20 ┆onnections Function. ┆
0x150a0…150c0 20 20 20 20 20 20 20 20 20 20 20 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 57 35 20 ┆ W5 ┆
0x150c0…150e0 20 20 20 20 20 20 20 31 38 20 2d 20 32 37 20 20 20 20 20 84 45 78 74 65 6e 64 65 64 20 6d 75 6c ┆ 18 - 27 Extended mul┆
0x150e0…15100 74 69 62 75 73 20 69 6e 74 65 72 72 75 70 74 20 0a 19 a4 80 80 31 31 20 74 6f 20 53 6c 61 76 65 ┆tibus interrupt 11 to Slave┆
0x15100…15120 20 50 49 43 32 20 6c 65 76 65 6c 20 33 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 57 35 ┆ PIC2 level 3. W5┆
0x15120…15140 20 20 20 20 20 20 20 20 31 39 20 2d 20 32 36 20 20 20 20 20 84 45 78 74 65 6e 64 65 64 20 6d 75 ┆ 19 - 26 Extended mu┆
0x15140…15160 6c 74 69 62 75 73 20 69 6e 74 65 72 72 75 70 74 20 0a 19 a4 80 80 31 32 20 74 6f 20 53 6c 61 76 ┆ltibus interrupt 12 to Slav┆
0x15160…15180 65 20 50 49 43 32 20 6c 65 76 65 6c 20 34 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 57 ┆e PIC2 level 4. W┆
0x15180…151a0 35 20 20 20 20 20 20 20 20 32 30 20 2d 20 32 35 20 20 20 20 20 84 45 78 74 65 6e 64 65 64 20 6d ┆5 20 - 25 Extended m┆
0x151a0…151c0 75 6c 74 69 62 75 73 20 69 6e 74 65 72 72 75 70 74 20 0a 19 a4 80 80 31 33 20 74 6f 20 53 6c 61 ┆ultibus interrupt 13 to Sla┆
0x151c0…151e0 76 65 20 50 49 43 32 20 6c 65 76 65 6c 20 35 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ve PIC2 level 5. ┆
0x151e0…15200 57 35 20 20 20 20 20 20 20 20 32 31 20 2d 20 32 34 20 20 20 20 20 84 45 78 74 65 6e 64 65 64 20 ┆W5 21 - 24 Extended ┆
0x15200…15220 (169,) 6d 75 6c 74 69 62 75 73 20 69 6e 74 65 72 72 75 70 74 20 0a 19 a4 80 80 31 34 20 74 6f 20 53 6c ┆multibus interrupt 14 to Sl┆
0x15220…15240 61 76 65 20 50 49 43 32 20 6c 65 76 65 6c 20 36 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ave PIC2 level 6. ┆
0x15240…15260 20 57 35 20 20 20 20 20 20 20 20 32 32 20 2d 20 32 33 20 20 20 20 20 84 45 78 74 65 6e 64 65 64 ┆ W5 22 - 23 Extended┆
0x15260…15280 20 6d 75 6c 74 69 62 75 73 20 69 6e 74 65 72 72 75 70 74 20 0a 19 a4 80 80 31 35 20 74 6f 20 53 ┆ multibus interrupt 15 to S┆
0x15280…152a0 6c 61 76 65 20 50 49 43 32 20 6c 65 76 65 6c 20 37 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 ┆lave PIC2 level 7. ┆
0x152a0…152c0 20 20 57 36 20 20 20 20 20 20 20 20 4e 43 20 20 20 20 20 20 20 20 20 20 84 55 73 65 64 20 74 6f ┆ W6 NC Used to┆
0x152c0…152e0 20 67 65 6e 65 72 61 74 65 20 69 6e 74 65 72 72 75 70 74 73 20 0a 19 a4 80 80 6f 75 74 20 74 6f ┆ generate interrupts out to┆
0x152e0…15300 20 74 68 65 20 6d 75 6c 74 69 62 75 73 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 57 37 ┆ the multibus. W7┆
0x15300…15320 20 20 20 20 20 20 20 20 32 20 2d 20 33 20 20 20 20 20 20 20 84 53 65 6c 65 63 74 20 74 68 65 20 ┆ 2 - 3 Select the ┆
0x15320…15340 62 61 75 64 20 72 61 74 65 20 73 69 67 6e 61 6c 20 41 20 0a 19 a4 80 80 61 73 20 61 20 72 65 63 ┆baud rate signal A as a rec┆
0x15340…15360 65 69 76 65 72 20 63 6c 6f 63 6b 20 69 6e 20 74 68 65 20 0a 19 a4 80 80 52 53 34 32 32 41 20 69 ┆eiver clock in the RS422A i┆
0x15360…15380 6e 74 65 72 66 61 63 65 2c 20 65 6c 73 65 20 74 68 65 20 54 54 20 0a 19 a4 80 80 73 69 67 6e 61 ┆nterface, else the TT signa┆
0x15380…153a0 6c 20 28 54 65 72 6d 69 6e 61 6c 20 54 69 6d 69 6e 67 29 20 69 73 20 0a 19 a4 80 80 69 6e 20 75 ┆l (Terminal Timing) is in u┆
0x153a0…153c0 73 65 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 57 38 20 20 20 20 20 20 20 20 4e 43 20 ┆se. W8 NC ┆
0x153c0…153e0 20 20 20 20 20 20 20 20 20 54 65 73 74 20 4a 75 6d 70 65 72 2e 20 28 4e 6f 74 20 69 6e 20 75 73 ┆ Test Jumper. (Not in us┆
0x153e0…15400 65 29 2e 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 57 39 20 20 20 20 20 20 20 20 4e 43 20 ┆e). W9 NC ┆
0x15400…15420 (170,) 20 20 20 20 20 20 20 20 20 84 55 73 65 64 20 74 6f 20 74 68 65 20 28 38 30 32 38 37 29 2e 20 4e ┆ Used to the (80287). N┆
0x15420…15440 43 20 69 74 20 0a 19 a4 80 80 69 6e 64 69 63 61 74 65 73 20 74 68 61 74 20 74 68 65 20 38 30 32 ┆C it indicates that the 802┆
0x15440…15460 38 37 20 75 73 65 20 0a 19 a4 80 80 74 68 65 20 43 50 55 20 63 6c 6f 63 6b 20 65 6c 73 65 20 69 ┆87 use the CPU clock else i┆
0x15460…15480 74 20 69 73 20 0a 19 a4 80 80 64 69 76 69 64 65 64 20 62 79 20 74 68 72 65 65 2e 0d 0a 20 20 20 ┆t is divided by three. ┆
0x15480…154a0 20 20 20 20 20 20 20 20 20 20 20 57 31 30 20 20 20 20 20 20 20 31 20 2d 20 33 20 20 20 20 20 20 ┆ W10 1 - 3 ┆
0x154a0…154c0 20 84 53 65 6c 65 63 74 20 74 68 65 20 38 30 32 38 37 20 63 6c 6f 63 6b 2e 20 49 74 20 0a 19 a4 ┆ Select the 80287 clock. It ┆
0x154c0…154e0 80 80 75 73 65 20 74 68 65 20 63 70 75 20 63 6c 6f 63 6b 20 64 69 76 69 64 65 64 20 62 79 20 0a ┆ use the cpu clock divided by ┆
0x154e0…15500 19 a4 80 80 74 77 6f 20 69 6e 20 74 68 65 20 73 74 61 6e 64 61 72 64 20 0a 19 a4 80 80 63 6f 6e ┆ two in the standard con┆
0x15500…15520 66 69 67 75 72 61 74 69 6f 6e 20 65 6c 73 65 20 63 75 74 20 57 31 30 20 20 0a 19 a4 80 80 31 2d ┆figuration else cut W10 1-┆
0x15520…15540 33 20 35 4d 48 7a 20 63 6c 6f 63 6b 20 6f 72 20 57 31 30 20 33 2d 34 20 28 57 39 20 0a 19 a4 80 ┆3 5MHz clock or W10 3-4 (W9 ┆
0x15540…15560 80 31 2d 32 29 20 74 68 65 20 65 78 61 63 74 20 43 50 55 20 63 6c 6f 63 6b 2e 20 0a 19 a4 80 80 ┆ 1-2) the exact CPU clock. ┆
0x15560…15580 28 42 75 74 20 69 6e 74 65 72 6e 20 69 6e 20 74 68 65 20 38 30 32 38 37 20 69 74 20 0a 19 a4 80 ┆(But intern in the 80287 it ┆
0x15580…155a0 80 69 73 20 64 69 76 69 64 65 64 20 62 79 20 74 68 72 65 65 2e 0d 0a b0 20 20 20 20 20 20 20 20 ┆ is divided by three. ┆
0x155a0…155c0 20 20 20 20 20 20 f0 57 31 31 20 20 20 20 20 20 20 31 20 2d 20 32 20 20 20 20 20 20 20 84 4f 6e ┆ W11 1 - 2 On┆
0x155c0…155e0 20 50 43 42 37 31 35 20 69 74 20 69 73 20 74 68 65 20 6f 6e 6c 79 20 73 74 61 6e 64 61 72 64 20 ┆ PCB715 it is the only standard ┆
0x155e0…15600 0a 19 a4 81 80 64 65 74 61 63 68 61 62 6c 65 20 6a 75 6d 70 65 72 2e 20 49 74 20 75 73 65 64 20 ┆ detachable jumper. It used ┆
0x15600…15620 (171,) 74 6f 20 0a 19 a4 81 80 32 37 32 35 36 20 45 50 52 4f 4d 27 73 2e 20 49 66 20 32 37 31 32 38 20 ┆to 27256 EPROM's. If 27128 ┆
0x15620…15640 6f 72 20 0a 19 a4 81 80 32 37 36 34 20 45 50 52 4f 4d 27 73 20 69 73 20 75 73 65 20 69 74 20 69 ┆or 2764 EPROM's is use it i┆
0x15640…15660 73 20 0a 19 a4 81 80 64 69 73 63 6f 6e 6e 65 63 74 65 64 2e 20 4f 6e 20 50 43 42 37 37 31 20 69 ┆s disconnected. On PCB771 i┆
0x15660…15680 74 20 69 73 20 0a 19 a4 81 80 6f 70 70 6f 73 69 74 65 2c 20 68 65 72 65 20 74 68 65 72 65 20 69 ┆t is opposite, here there i┆
0x15680…156a0 73 20 6e 6f 20 0a 19 a4 81 80 73 74 61 6e 64 61 72 64 20 6a 75 6d 70 65 72 73 2e 0d 0a 20 20 20 ┆s no standard jumpers. ┆
0x156a0…156c0 20 20 20 20 20 20 20 20 20 b0 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d ┆ ----------------------┆
0x156c0…156e0 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 2d 0d 0a ┆------------------------------ ┆
0x156e0…15719 Params {
0x156e0…15719 04 00 2d 4e 0a 00 06 00 00 00 00 03 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x156e0…15719 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x156e0…15719 }
0x15719…15752 Params {
0x15719…15752 04 00 2d 4e 0a 00 06 00 00 00 00 02 01 41 31 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 00 ┆ -N A1 ┆
0x15719…15752 00 00 00 00 00 00 00 00 0a 12 23 2a 37 41 4b 55 5f 69 73 7d 87 91 ff ff 04 ┆ #*7AKU_iså ┆
0x15719…15752 }
0x15752…15760 0a 0d 0a a1 b0 35 2e 36 20 20 20 20 20 20 ┆ 5.6 ┆
0x15760…15780 45 6e 76 69 72 6f 6d 65 6e 74 61 6c 20 53 70 65 63 69 66 69 63 61 74 69 6f 6e 2e 0d 0a 0d 0a 20 ┆Enviromental Specification. ┆
0x15780…157a0 20 20 20 20 20 20 20 20 4f 70 65 72 61 74 69 6e 67 20 54 65 6d 70 65 72 61 74 75 72 65 3a 20 20 ┆ Operating Temperature: ┆
0x157a0…157c0 30 81 30 82 20 2d 20 35 35 81 30 82 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 52 65 6c 61 74 69 76 ┆0 0 - 55 0 Relativ┆
0x157c0…157e0 65 20 48 75 6d 69 64 69 74 79 3a 20 20 20 20 20 32 30 25 20 2d 20 38 30 25 20 28 4e 6f 6e 20 63 ┆e Humidity: 20% - 80% (Non c┆
0x157e0…157f1 6f 6e 64 65 6e 73 69 6e 67 29 2e 0d 0a 0d 0a 0d 0a ┆ondensing). ┆
0x157f1…157f4 FormFeed {
0x157f1…157f4 0c 83 a0 ┆ ┆
0x157f1…157f4 }
0x157f4…15800 0a a1 b0 35 2e 37 20 20 20 20 20 20 ┆ 5.7 ┆
0x15800…15820 (172,) 50 68 79 73 69 63 61 6c 20 53 70 65 63 69 66 69 63 61 74 69 6f 6e 73 2e 0d 0a 0d 0a 20 20 20 20 ┆Physical Specifications. ┆
0x15820…15840 20 20 20 20 20 57 69 64 74 68 3a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 33 30 34 2e 38 ┆ Width: 304.8┆
0x15840…15860 6d 6d 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 4c 65 6e 67 68 74 3a 20 20 20 20 20 20 20 20 20 20 ┆mm Lenght: ┆
0x15860…15880 20 20 20 20 20 31 37 39 2e 31 6d 6d 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 48 65 69 67 68 74 3a ┆ 179.1mm Height:┆
0x15880…158a0 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 31 32 6d 6d 0d 0a 0d 0a 0d 0a a1 b0 35 2e 38 20 20 ┆ 12mm 5.8 ┆
0x158a0…158c0 20 20 20 20 50 6f 77 65 72 20 53 70 65 63 69 66 69 63 61 74 69 6f 6e 73 2e 0d 0a 0d 0a 20 20 20 ┆ Power Specifications. ┆
0x158c0…158e0 20 20 20 20 20 20 50 6f 77 65 72 20 44 69 73 73 69 70 61 74 69 6f 6e 20 33 36 2e 38 20 57 20 28 ┆ Power Dissipation 36.8 W (┆
0x158e0…15900 6d 61 78 29 2e 0d 0a 09 56 43 43 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2b 35 56 20 2b ┆max). VCC +5V +┆
0x15900…15920 2f 2d 20 35 25 20 20 28 37 2e 31 41 20 6d 61 78 29 0d 0a 20 20 20 20 20 20 20 20 20 56 44 44 2b ┆/- 5% (7.1A max) VDD+┆
0x15920…15940 20 20 20 20 20 20 20 20 20 20 20 20 20 20 2b 31 32 56 20 2b 2f 2d 31 30 25 20 20 28 35 30 6d 41 ┆ +12V +/-10% (50mA┆
0x15940…15960 20 6d 61 78 29 0d 0a 20 20 20 20 20 20 20 20 20 56 44 44 2d 20 20 20 20 20 20 20 20 20 20 20 20 ┆ max) VDD- ┆
0x15960…1597b 20 20 2d 31 32 56 20 2b 2f 2d 31 30 25 20 20 28 35 30 6d 41 20 6d 61 78 29 0d 0a ┆ -12V +/-10% (50mA max) ┆
0x1597b…1597e FormFeed {
0x1597b…1597e 0c 81 b4 ┆ ┆
0x1597b…1597e }
0x1597e…15980 0a 0d ┆ ┆
0x15980…15981 0a ┆ ┆
0x15981…15984 FormFeed {
0x15981…15984 0c 80 8c ┆ ┆
0x15981…15984 }
0x15984…159a0 0a a1 b0 41 20 20 20 20 20 20 20 20 52 65 66 65 72 65 6e 63 65 73 2e 0d 0a 0d 0a 20 ┆ A References. ┆
0x159a0…159c0 20 20 20 20 20 20 20 20 31 2e 20 20 20 84 49 4e 54 45 4c 20 4d 69 63 72 6f 73 79 73 74 65 6d 20 ┆ 1. INTEL Microsystem ┆
0x159c0…159e0 43 6f 6d 70 6f 6e 65 6e 74 73 20 48 61 6e 64 62 6f 6f 6b 2e 20 31 39 38 34 2e 20 0a 19 8e 80 80 ┆Components Handbook. 1984. ┆
0x159e0…15a00 32 33 30 38 34 33 2d 30 30 31 2e 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 32 2e 20 20 20 49 4e 54 ┆230843-001. 2. INT┆
0x15a00…15a20 (173,) 45 4c 20 4d 55 4c 54 49 42 55 53 20 53 70 65 63 69 66 69 63 61 74 69 6f 6e 20 39 38 30 30 36 38 ┆EL MULTIBUS Specification 980068┆
0x15a20…15a40 33 2d 30 34 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 33 2e 20 20 20 49 4e 54 45 4c 20 69 4c 42 58 ┆3-04 3. INTEL iLBX┆
0x15a40…15a60 20 42 75 73 20 53 70 65 63 69 66 69 63 61 74 69 6f 6e 20 31 34 35 36 39 35 2d 52 45 56 20 41 0d ┆ Bus Specification 145695-REV A ┆
0x15a60…15a80 0a 0d 0a 20 20 20 20 20 20 20 20 20 34 2e 20 20 20 49 4e 54 45 4c 20 69 53 42 58 20 42 75 73 20 ┆ 4. INTEL iSBX Bus ┆
0x15a80…15aa0 53 70 65 63 69 66 69 63 61 74 69 6f 6e 20 31 34 32 36 38 36 2d 30 30 31 0d 0a 0d 0a 20 20 20 20 ┆Specification 142686-001 ┆
0x15aa0…15ac0 20 20 20 20 20 35 2e 20 20 20 84 43 65 6e 74 72 61 6c 20 50 72 6f 63 65 73 73 6f 72 20 55 6e 69 ┆ 5. Central Processor Uni┆
0x15ac0…15ae0 74 20 43 50 55 36 31 30 2e 20 52 65 76 20 31 2e 32 20 2e 20 48 61 72 64 77 61 72 65 20 0a 19 8e ┆t CPU610. Rev 1.2 . Hardware ┆
0x15ae0…15b00 80 80 52 65 66 65 72 65 6e 63 65 20 4d 61 6e 75 61 6c 20 6d 61 6e 75 61 6c 2e 20 52 43 53 4c 20 ┆ Reference Manual manual. RCSL ┆
0x15b00…15b20 39 39 2d 31 20 30 39 38 36 33 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 36 2e 20 20 20 84 52 43 20 ┆99-1 09863 6. RC ┆
0x15b20…15b40 33 39 30 32 20 28 43 50 55 20 36 31 30 29 20 48 61 72 64 77 61 72 65 20 53 65 6c 66 74 65 73 74 ┆3902 (CPU 610) Hardware Selftest┆
0x15b40…15b60 2e 20 55 73 65 72 27 73 20 4d 61 6e 75 61 6c 2e 20 0a 19 8e 80 80 52 43 53 4c 20 39 39 2d 31 20 ┆. User's Manual. RCSL 99-1 ┆
0x15b60…15b80 31 30 31 37 36 0d 0a 0d 0a 20 20 20 20 20 20 20 20 20 37 2e 20 20 20 84 52 43 20 33 39 20 53 65 ┆10176 7. RC 39 Se┆
0x15b80…15ba0 6c 66 74 65 73 74 20 43 6f 6e 63 65 70 74 2e 20 55 73 65 72 27 73 20 4d 61 6e 75 61 6c 2e 52 43 ┆lftest Concept. User's Manual.RC┆
0x15ba0…15bb4 53 4c 20 39 39 2d 31 20 0a 19 8e 80 80 31 30 30 39 32 0d 0a ┆SL 99-1 10092 ┆
0x15bb4…15bb7 FormFeed {
0x15bb4…15bb7 0c 81 e4 ┆ ┆
0x15bb4…15bb7 }
0x15bb7…15bc0 0a 0d 0a 1a 1a 20 20 20 20 ┆ ┆
0x15bc0…15be0 31 35 20 2d 20 33 30 20 20 20 20 20 84 45 78 74 65 6e 64 65 64 20 6d 75 6e 74 65 72 72 75 70 74 ┆15 - 30 Extended munterrupt┆
0x15be0…15c00 20 38 20 0a 19 a4 80 80 74 55 52 4e e1 a1 e1 0d 0a 20 20 20 20 20 20 20 20 20 20 20 20 20 20 20 ┆ 8 tURN ┆